JPH0269959A - 半導体装置 - Google Patents

半導体装置

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Publication number
JPH0269959A
JPH0269959A JP63221929A JP22192988A JPH0269959A JP H0269959 A JPH0269959 A JP H0269959A JP 63221929 A JP63221929 A JP 63221929A JP 22192988 A JP22192988 A JP 22192988A JP H0269959 A JPH0269959 A JP H0269959A
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JP
Japan
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regions
conductivity type
region
type
potential
Prior art date
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Pending
Application number
JP63221929A
Other languages
English (en)
Inventor
Takaaki Hayashi
孝明 林
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Seiko Epson Corp
Original Assignee
Seiko Epson Corp
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Filing date
Publication date
Application filed by Seiko Epson Corp filed Critical Seiko Epson Corp
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Publication of JPH0269959A publication Critical patent/JPH0269959A/ja
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  • Element Separation (AREA)
  • Metal-Oxide And Bipolar Metal-Oxide Semiconductor Integrated Circuits (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [産業上の利用分野1 本発明は、半導体集積回路装置において、特に寄生MO
5効果を防止する構造に関する。
[発明の概要] 本発明は、MOSFETから成るところの半導体集積回
路装置において、半導体基板に形成された少なくとも2
つの導電型の領域の1方の領域を、チャンネルストッパ
ー用の高不純物濃度領域とアルミ配線層で囲み、高不純
物濃度領域と配線層の電位を基板電位と同電位にする事
を特徴とするものである。
〔従来の技術〕
半導体集積回路において、N形基板中の逆バイアスされ
た2つ以上の隣接するP影領域間の上を配化膜を介して
アルミ配線が置かれている場合、アルミ配線に加わる電
位によってその下にチャンネルが生じてP影領域相互間
に電流が流れることがある。この作用を積極的に利用し
たのがMO3形電界効果トランジスタであるが、この作
用が単なる配線層の下で生じて絶縁されているべき領域
同志が導通する現象を寄生MO3効果という。
従来の半導体集積回路装置の寄生MO3防止の構造は、
特開昭56−167347の様に、第2図、第3図、第
4図の様な構造である。
[発明が解決しようとする課題] 第2図は、従来のチャンネルストッパーの構造を示すが
、最高電位に印加されたN型基板(27)の中にP空領
域(21)、(23)があり、それらの上に低電位アル
ミ配線(24)が通っており、各P空領域(21)、(
23)はそれぞれ端子(25)、(26)と、(28)
、(29)のアルミ配線と接続されている。ここで、例
えば端子(28)、(29)とアルミ配線(24)の間
に、この部分のもつ閾値電位を越える電圧が印加される
と、アルミ配り、5(24)の直下のN基板が反転し、
P空領域(21)、(23)の間にチャンネルが形成さ
れ、寄生MO3効果が生じ、このチャンネルを通して電
流が流れる。前記寄生MO8効果を防止する場合には、
N型基板(27)に形成された所定のP空領域(21)
、(23)の間にチャンネルストッパーと呼ぶ高濃度の
N型領域(22)(22’ )を設けることがなされて
いる。しかしながら酸化膜表面の汚れや水分等が付着し
た場合は汚れや水分に電荷がたまり、これらが新たなゲ
ート電極として働くためアルミ配線のない所にも寄生M
O3効果が生じ、このため、単にアルミ配線の下にのみ
高濃度N型領域を設けてもこの寄生MO3効果を防ぐこ
とができない。
また第3図の様に高濃度N型領域(32)で−方のP空
領域(31)を囲んでしまうと、寄生MO8効果は防止
できるが、この高濃度N型領域の占有面積が増すばかり
でなく他のP空領域との間にも十分な間隔を設けねばな
らないので高密度な集積回路が得られないという欠点が
ある。また第4図の様なN型基板(47)の中に逆バイ
アスされた2つのP空領域(41)と(43)があり、
それらの間に通常は低電位が与えられるアルミ配#J9
(44)が絶縁膜を介して置かれ、一方のP空領域の両
側を高濃度N型領域(42)(42′)で囲み、この高
濃度N型領域(42)(42’ )の各両端を(410
)Jよび(411)のアルミ配線が位置し、このアルミ
配線は、P空領域(41)と接続している。しかしこの
様な場合でも、P空領域(43)に、高電位が与えられ
て、P空領域(41)に低電位が与えられた場合、アル
ミ配線(410)および(411)の下には、チャンネ
ルが形成され、さらに、酸化膜表面の汚れや水分等が付
着した場合は、汚れや水分に電荷がたまり寄生MO5効
果が生し、P空領域(41)と(43)の間に寄生MO
3が発生してリーク電流が発生する。本発明は、この様
な従来のチャンネルストッパーを改善し、小さい占有面
積で効果のあるチャンネルストッパーを提供することに
ある。
[課題を解決するための手段] 本発明の半導体装置は、一導電型の半導体基板に形成さ
れた少なくとも2つの他の導電型の領域と、該受なくと
も2つの他の導電型の領域と交叉して該受なくとも2つ
の他の導電型の領域間の前記半導体基板上に絶縁膜を介
して形成された第一の配線層と、前記少なくとも2つの
他の導電型の領域間の前記半導体基板表面領域で前記第
1の配線層下に形成された前記一導電型の第1の高不純
物濃度領域と、前記少なくとも2つの他の導電型の領域
の一方の周辺に形成された第2配線層および前記一導電
型の第2の高不純物濃度領域とを有し、前記第2の配線
層および前記第1と第2の高不純物濃度領域は、平面的
に前記一方の他の導電型の領域をとり囲むように配置さ
れており、さらに前記第2の配線層は、前記半導体基板
電位と同電位が印加されており、かつ前記第1および第
2の高不純物濃度領域と部分的に重なり合って接続する
ことを特徴とする。
[実 施 例] 以下に本発明の実施例を図面にもとづいて説明する。第
1図は本発明におけるチャンネルストッパーのパターン
図である。N型基板(7)の中に逆バイアスされた2つ
のP壁領域(1)および(3)があり、それらの間に通
常は低電位が与えられるアルミ配線(4)が絶縁膜を介
して置かれており、この内のP壁領域(1)は、アルミ
配線(5)、(6)が、P壁領域(3)は、アルミ配線
(8)、(9)が接続している。さらにこのアルミ配m
(4)の電位と、アルミ配線(5)、(6)、ならびに
アルミ配線(8)、(9)の電位差により、P壁領域(
1)と(3)に電位差がある場合アルミ配線(4)で形
成される寄生MOSトランジスタが閾値電圧を越える場
合にチャンネルストッパーとして作用するように、高濃
度N型領域(2)(2′)をP壁領域(1)の両側に形
成し、この高濃度N型領域(2)(2′)の各両端をア
ルミ配線(10)、(11)で接続する。又アルミ配線
(10)、(11)は、基板電位と同電位にする。この
様にすると、P壁領域(3)が高電位、P壁領域(1)
が低電位となる場合において、アルミ配線(4)が低電
位である場合、N型高濃度領域(2)はチャンネルスト
ッパーとして作用する。又、アルミ配線(4)以外の部
分で、酸化膜表面の汚れや水分等が付着した場合は汚れ
や水分に電荷がたまり、これらが新たなゲート電極とし
て働くためアルミ配線のない所にも寄生MO3効果が生
じるが、アルミ配線(10)、〔11)が、基板電位と
同電位であり、P壁領域(1)を囲んでいる為、P壁領
域(1)と(2)の間のチャンネルは完全に遮断されリ
ーク電流は流れない。又逆の場合について、P壁領域(
1)の電位が高電位で、P壁領域(3)の電位が低電位
でも同様である。上記実施例は、半導体基板(7)がN
型基板で、導電型の領域(1)、(3)をP壁領域、高
不純物濃度領域(2)、(2′)をN型領域としたが、
基板電位を反転させて半導体基板(7)がP型基板で、
導電型の領域(])、(3)をN型領域、高不純物濃度
領域(2)、(2′)をP壁領域としても同様の効果が
得られる。
[発明の効果] 本発明によれば、アルミ配線によるチャンネルストッパ
ーのための高濃度領域を広げる必要はなく、小さい占有
面積で絶大なチャンネルストップ効果が得られる為、よ
り高密度の集積回路が得られる。
【図面の簡単な説明】
第1図は、本発明の一実施例にかかわるチャンネルスト
ッパーの構造を示す平面図。 第2図は、従来のチャンネルストッパーの構造を示す平
面図。 第3図は、従来のチャンネルストッパーの方法であるP
壁領域をN型高不純物濃度領域で全周を囲む構造を示す
平面図。 第4図は、従来のチャンネルストッパーの方法であるP
壁領域と接続されるアルミ配線と、N型高不純物濃度領
域で周辺を囲む構造を示す平面図。 1.3 ・・・・・・・・導電型領域 (P壁領域) 2.2′ ・・・・・・・・高不純物濃度領域(高濃度
N型領域) 4.5.6.8.9.10.11 ・・・・・アルミ配線 7・・・・・・・・・・・半導体基板 (N型基板) 12.13.14.15.16.17.1819・・:
・・・・・・・・端子(コンタクト)21.23・・・
・・・・・導電型領域(P壁領域) 22.22′ ・・・・・・・高不純物濃度領域(高濃
度N型領域) 24・・・・・・・・・・・アルミ配線27・・・・・
・・・・・・半導体基板(N型基板) 25.26.28.29・・端子(コンタクト)31.
33・・・・・・・・導電型領域(P型領域) 32・・・・・ ・・・ ・高不純物濃度領域(高濃度
N型領域) 34・・・・・・・・・・・アルミ配線37・・・・・
・・・・・・半導体基板(N型基板) 35.36.38.39 ・端子(コンタクト)41.
43・・・・・・・・導電型領域(P型領域) 42.42′ ・・・・・・・高不純物濃度領域(高濃
度N型領域) 44.410.411.412.413・・・・・アル
ミ配線 45.46.48.49 ・端子(コンタクト)47・
・・・・・・・・ ・半導体基板(N型基板) 以上 出願人 セイコーエプソン株式会社 代理人 弁理士 上 柳 雅 誉(他1名)■

Claims (1)

    【特許請求の範囲】
  1. 一導電型の半導体基板に形成された少なくとも2つの他
    の導電型の領域と、該少なくとも2つの他の導電型の領
    域と交叉して該少なくとも2つの他の導電型の領域間の
    前記半導体基板上に絶縁膜を介して形成された第一の配
    線層と、前記少なくとも2つの他の導電型の領域間の前
    記半導体基板表面領域で前記第1の配線層下に形成され
    た前記一導電型の第1の高不純物濃度領域と、前記少な
    くとも2つの他の導電型の領域の一方の周辺に形成され
    た第2配線層および前記一導電型の第2の高不純物濃度
    領域とを有し、前記第2の配線層および前記第1と第2
    の高不純物濃度領域は、平面的に前記一方の他の導電型
    の領域をとり囲むように配置されており、さらに前記第
    2の配線層は、前記半導体基板電位と同電位が印加され
    ており、かつ前記第1および第2の高不純物濃度領域と
    部分的に重なり合って接続することを特徴とする半導体
    装置。
JP63221929A 1988-09-05 1988-09-05 半導体装置 Pending JPH0269959A (ja)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR20250023469A (ko) 2022-07-29 2025-02-18 닛폰세이테츠 가부시키가이샤 트랜스 버스 방식의 유도 가열 장치

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KR20250023469A (ko) 2022-07-29 2025-02-18 닛폰세이테츠 가부시키가이샤 트랜스 버스 방식의 유도 가열 장치

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