JPH0284200U - - Google Patents

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JPH0284200U
JPH0284200U JP16360988U JP16360988U JPH0284200U JP H0284200 U JPH0284200 U JP H0284200U JP 16360988 U JP16360988 U JP 16360988U JP 16360988 U JP16360988 U JP 16360988U JP H0284200 U JPH0284200 U JP H0284200U
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pulse
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eprom
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circuit
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Description

【図面の簡単な説明】
第1図は本考案のEPROM書き込み回路を示
す回路図、第2図は第1図の各部波形を示すタイ
ミングチヤートである。 1……PROMライタ、2……EPROM、3
……ORゲート、4……第1のパルス発生回路、
5……NORゲート、6……T―FF。

Claims (1)

  1. 【実用新案登録請求の範囲】 所定ビツトの記憶容量を有し、プログラムデー
    タの書き込み/読み出しが可能なEPROMと、
    該EPROMの所定アドレスをアクセスする為の
    アドレスデータを順次発生し、該EPROMにお
    ける全記憶容量よりも少ない記憶容量に対して、
    プログラムデータを書き込み可能なPROMライ
    タとを備えたEPROM書き込み回路において、 前記PROMライタから前記EPROMに印加
    される書き込み初期アドレスに基づいて、所定時
    間だけ第1のパルスを発生する第1のパルス発生
    回路と、 前記書き込み初期アドレスに基づき、該書き込
    み初期アドレスの発生期間だけ第2のパルスを発
    生する第2のパルス発生回路と、 前記第1のパルスの発生期間が前記第2のパル
    スの発出期間未満の時、リセツトパルスを発生す
    るリセツトパルス発生回路と、 前記リセツトパルス発生回路から発生するリセ
    ツトパルスでリセツトされた後、前記PROMラ
    イタから発生する最後のアドレスデータの最上位
    ピツトの変化によつてセツトされ、リセツト又は
    セツト出力を前記EPROMのアドレスの最上位
    ビツトとすることによつて、前記EPROMの書
    き込み領域を切換えさせるリセツト/セツト回路
    とを備え、 前記書き込み初期アドレスにおける前記第2の
    パルスの発生時期を前記第1のパルスの発生期間
    より長く設定することによつて、前記リセツト/
    セツト回路のリセツト出力で、前記EPROMの
    所定の書き込み領域における記憶容量にプログラ
    ムデータを書き込み可能とし、その後、前記書き
    込み初期アドレスにおける前記第2のパルスの発
    生期間を前記第1のパルスの発生期間以下に設定
    することによつて、前記リセツト/セツト回路の
    セツト出力で、前記EPROMの残りの書き込み
    領域における記憶容量にプログラムデータを書き
    込み可能としたことを特徴とするEPROM書き
    込み回路。
JP16360988U 1988-12-16 1988-12-16 Expired - Lifetime JPH0538480Y2 (ja)

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JP16360988U JPH0538480Y2 (ja) 1988-12-16 1988-12-16

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Publication Number Publication Date
JPH0284200U true JPH0284200U (ja) 1990-06-29
JPH0538480Y2 JPH0538480Y2 (ja) 1993-09-29

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ID=31448483

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JP16360988U Expired - Lifetime JPH0538480Y2 (ja) 1988-12-16 1988-12-16

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JPH0538480Y2 (ja) 1993-09-29

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