JPH03104390A - 再生ｆｍ信号処理用半導体集積回路 - Google Patents
再生ｆｍ信号処理用半導体集積回路Info
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- JPH03104390A JPH03104390A JP1240759A JP24075989A JPH03104390A JP H03104390 A JPH03104390 A JP H03104390A JP 1240759 A JP1240759 A JP 1240759A JP 24075989 A JP24075989 A JP 24075989A JP H03104390 A JPH03104390 A JP H03104390A
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- Multimedia (AREA)
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［発明の目的］
（産業上の利用分野）
この発明は集積回路化されたビデオ・テープ・レコーダ
の再生信号処理系に係り、特にドロ・ソブアウト補償、
輝度信号のくし型フィルタ、クロマ・ノイズ・リダクシ
ョン等の処理を行う再生ＦＭ信号処理回路に関する。
の再生信号処理系に係り、特にドロ・ソブアウト補償、
輝度信号のくし型フィルタ、クロマ・ノイズ・リダクシ
ョン等の処理を行う再生ＦＭ信号処理回路に関する。
（従来の技術）
ビデオ・テープ・レコーダ（以下、ＶＴＲと称する）で
は一般に、テープからの再生ＦＭ信号に信号の欠落が発
生し、再生画面上にノイズが生じることを防止するため
にドロップアウト補償系を設けるようにしている。さら
にＶＴＲではクロマ◆ノイズ・リダクション（ＣＮＲ）
処理を行うために、再生ＦＭ信号を復調して得られた輝
度信号を用いて非相関／相関処理系により非相関／相関
信号を発生するようにしている。
は一般に、テープからの再生ＦＭ信号に信号の欠落が発
生し、再生画面上にノイズが生じることを防止するため
にドロップアウト補償系を設けるようにしている。さら
にＶＴＲではクロマ◆ノイズ・リダクション（ＣＮＲ）
処理を行うために、再生ＦＭ信号を復調して得られた輝
度信号を用いて非相関／相関処理系により非相関／相関
信号を発生するようにしている。
従来、上記のドロップアウト補償系と非相関／相関処理
系の回路は同じ集積回路内に全く独立した状態で構成さ
れており、なおかつドロップアウト補償用のパルス信号
（ＤＯＣパルス）と非相関／相関パルスとはそれぞれ専
用の端子から集積回路の外部に出力されている。
系の回路は同じ集積回路内に全く独立した状態で構成さ
れており、なおかつドロップアウト補償用のパルス信号
（ＤＯＣパルス）と非相関／相関パルスとはそれぞれ専
用の端子から集積回路の外部に出力されている。
（発明が解決しようとする課題）
このように従来では、ドロップアウト補償系と非相関／
相関処理系の回路とを全く独立に構成しているため、そ
れぞれに専用の出力端子を必要としている。ところで、
最近のＶＴＲ用集積回路は多機能化が進み、外部端子の
数も増加する傾向にある。しかしながら、外部端子数の
増加はチップサイズの大型化を招き、ＶＴＲの製造コス
トを高くしてしまうので、端子の数はできるだけ減らす
必要がある。
相関処理系の回路とを全く独立に構成しているため、そ
れぞれに専用の出力端子を必要としている。ところで、
最近のＶＴＲ用集積回路は多機能化が進み、外部端子の
数も増加する傾向にある。しかしながら、外部端子数の
増加はチップサイズの大型化を招き、ＶＴＲの製造コス
トを高くしてしまうので、端子の数はできるだけ減らす
必要がある。
この発明は上記のような事情を考慮してなされたもので
あり、その目的は、同一集積回路内にドロップアウト補
償系と非相関／相関処理系の回路を含み、外部端子の数
を従来よりも減らすことができる再生ＦＭ信号処理回路
を提供することにある。
あり、その目的は、同一集積回路内にドロップアウト補
償系と非相関／相関処理系の回路を含み、外部端子の数
を従来よりも減らすことができる再生ＦＭ信号処理回路
を提供することにある。
［発明の構成］
（課題を解決するための手段）
この発明の再生ＦＭ信号処理回路は、再生ＦＭ信号の振
幅レベルが所定値以下になったことを検出してドロップ
アウト信号を発生するドロップアウト信号発生手段と、
上記再生ＦＭ信号から復調された輝度信号を１水平期間
遅延する遅延手段と、上記遅延手段で遅延された信号と
遅延する前の元の輝度信号との間の差成分を得る減算手
段と、上記減算手段で得られた差成分をスライスし、波
形整形して非相関／相関信号を発生する非相関／相関信
号発生手段と、上記ドロップアウト信号と上記非相関／
相関信号とを加算して出カする加算手段とを具備したこ
とを特徴とする。
幅レベルが所定値以下になったことを検出してドロップ
アウト信号を発生するドロップアウト信号発生手段と、
上記再生ＦＭ信号から復調された輝度信号を１水平期間
遅延する遅延手段と、上記遅延手段で遅延された信号と
遅延する前の元の輝度信号との間の差成分を得る減算手
段と、上記減算手段で得られた差成分をスライスし、波
形整形して非相関／相関信号を発生する非相関／相関信
号発生手段と、上記ドロップアウト信号と上記非相関／
相関信号とを加算して出カする加算手段とを具備したこ
とを特徴とする。
（作 用）
ドロップアウト信号発生手段で発生されたドロップアウ
ト信号と、非相関／相関信号発生手段で発生された非相
関／相関信号とが加算手段によって加算され、同一の端
子から集積回路の外部に出力される。
ト信号と、非相関／相関信号発生手段で発生された非相
関／相関信号とが加算手段によって加算され、同一の端
子から集積回路の外部に出力される。
（実施例）
以下、図面を参照してこの発明を実施例により説明する
。
。
第１図はこの発明に係る再生ＦＭ信号処理回路を内蔵し
た集積回路の構成を示すブロック図である。図において
、図示しない磁気ヘッドによって得られた再生ＦＭ信号
（ＰＢ−ＦＭ）はドロップアウト検出回路１１に供給さ
れる。このドロップアウト検出回路１１は、再生ＦＭ信
号の振幅レベルを検出し、このレベルが一峙的に極めて
小さくなった場合や０になった場合等にドロップアウト
捕償パルス（ＤＯＣパルス）を発生する周知のものであ
り、この回路ｌ１の出力は加算回路ｌ２に供給される。
た集積回路の構成を示すブロック図である。図において
、図示しない磁気ヘッドによって得られた再生ＦＭ信号
（ＰＢ−ＦＭ）はドロップアウト検出回路１１に供給さ
れる。このドロップアウト検出回路１１は、再生ＦＭ信
号の振幅レベルを検出し、このレベルが一峙的に極めて
小さくなった場合や０になった場合等にドロップアウト
捕償パルス（ＤＯＣパルス）を発生する周知のものであ
り、この回路ｌ１の出力は加算回路ｌ２に供給される。
この加算回路ｌ２の出力は端子１３から集積回路の外部
に出力される。
に出力される。
一方、図示しない復調回路で上記再生ＦＭ信号から復調
された再生輝度信号（ＰＢ−Ｙ）は遅延回路ｌ４、減算
回路ｌ５及び加算回路１６に並列に供給される。上記遅
延回路ｌ４は、上記再生輝度信号をその１水平期間に相
当する時間だけ遅延するものであり、その遅延出力は上
記減算回路１５に供給される。減算回路１５は、上記再
生輝度信号から上記遅延回路１４の遅延出力を減算する
ものであり、その出力は増幅回路ｌ７に供給される。こ
の増幅回路ｌ７は上記減算回路１５の減算出力のレベル
を適度に増幅するものであり、その増幅出力は第１の抵
抗素子ｔ８を介してリミツタ回路１９の一方入力端に、
第２の抵抗素子２０を介してこのリミツタ回路１９の他
方入力端にそれぞれ供給される。上記リミ・ソタ回路ｌ
９は差動増幅回路構成のものであり、その他方人力端と
接地電位との間には交流信号バイパス用及び直流信号蓄
積用のコンデンサ２ｌが接続されている。従って、上記
第２の抵抗素子２０と上記コンデンサ２ｌとの存在によ
り、リミツタ回路ｌ９の他方人力端には上記増幅回路ｌ
７の増幅出力の直流成分のみが供給される。
された再生輝度信号（ＰＢ−Ｙ）は遅延回路ｌ４、減算
回路ｌ５及び加算回路１６に並列に供給される。上記遅
延回路ｌ４は、上記再生輝度信号をその１水平期間に相
当する時間だけ遅延するものであり、その遅延出力は上
記減算回路１５に供給される。減算回路１５は、上記再
生輝度信号から上記遅延回路１４の遅延出力を減算する
ものであり、その出力は増幅回路ｌ７に供給される。こ
の増幅回路ｌ７は上記減算回路１５の減算出力のレベル
を適度に増幅するものであり、その増幅出力は第１の抵
抗素子ｔ８を介してリミツタ回路１９の一方入力端に、
第２の抵抗素子２０を介してこのリミツタ回路１９の他
方入力端にそれぞれ供給される。上記リミ・ソタ回路ｌ
９は差動増幅回路構成のものであり、その他方人力端と
接地電位との間には交流信号バイパス用及び直流信号蓄
積用のコンデンサ２ｌが接続されている。従って、上記
第２の抵抗素子２０と上記コンデンサ２ｌとの存在によ
り、リミツタ回路ｌ９の他方人力端には上記増幅回路ｌ
７の増幅出力の直流成分のみが供給される。
上記リミッタ回路１９はその他方入力端に得られる直流
或分と、上記増幅回路１７の増幅出力とを比較すること
により、上記増幅回路１７の増幅出力を所定のスライス
レベルで制限するものであり、その出力は前記加算回路
１６に供給されると共に、波形整形回路２２を経由して
前記加算回路１２に供給される。
或分と、上記増幅回路１７の増幅出力とを比較すること
により、上記増幅回路１７の増幅出力を所定のスライス
レベルで制限するものであり、その出力は前記加算回路
１６に供給されると共に、波形整形回路２２を経由して
前記加算回路１２に供給される。
そして、上記加算回路ｌ２の出力は端子１３を介して集
積回路の外部に出力され、また、上記加算回路１６の出
力は集積回路内の他の回路に供給される。
積回路の外部に出力され、また、上記加算回路１６の出
力は集積回路内の他の回路に供給される。
このような構成おいて、上記リミツタ回路ｌ９の出力は
、スライスレベル以下であれば相関となり、スライスレ
ベル以上であれば非相関であることにより、非相関／相
関信号となっている。従って、加算回路１６によりこの
非相関／相関信号と元の再生輝度信号の加算が行われる
ことにより、この加算回路ＩＢからは、輝度信号をくし
型フィルタを通過させた信号（＜シ型フィルタ出力）が
出力される。
、スライスレベル以下であれば相関となり、スライスレ
ベル以上であれば非相関であることにより、非相関／相
関信号となっている。従って、加算回路１６によりこの
非相関／相関信号と元の再生輝度信号の加算が行われる
ことにより、この加算回路ＩＢからは、輝度信号をくし
型フィルタを通過させた信号（＜シ型フィルタ出力）が
出力される。
一方、加算回路ｌ２によりＤＯＣパルスと上記非相関／
相関信号との加算が行われるため、端子ｌ３からはＤＯ
Ｃパルスと非相関／相関信号の加算信号が出力される。
相関信号との加算が行われるため、端子ｌ３からはＤＯ
Ｃパルスと非相関／相関信号の加算信号が出力される。
このように上記実施例回路によれば、従来ではそれぞれ
専用の出力端子から出力していた２種類の信号を一つの
端子から出力するようにしたので、従来に比べて端子の
数を減らすことができる。なお、一つの端子から２種類
の信号が出力されるため、この端子の信号を受けて処理
を行う外部回路ではこの２種類の信号を区別する必要が
あるが、これは後に説明するように３値の電圧レベルを
加算回路１２で発生するようにすれば容易に区別が可能
である。
専用の出力端子から出力していた２種類の信号を一つの
端子から出力するようにしたので、従来に比べて端子の
数を減らすことができる。なお、一つの端子から２種類
の信号が出力されるため、この端子の信号を受けて処理
を行う外部回路ではこの２種類の信号を区別する必要が
あるが、これは後に説明するように３値の電圧レベルを
加算回路１２で発生するようにすれば容易に区別が可能
である。
第２図は上記実施例回路におけるリミッタ回路の具体的
な構成を示す回路図である。 この回路は、前記第１、
第２の抵抗素子１８． ２０を介して伝達される前記増
幅回路１７の出力が各ベースに供給されるエミッタ結合
された差動対トランジスタ３ｌと、この差動対トランジ
スタ３ｌの負荷回路３２とから構成されている。そして
、上記差動対トランジスタ３ｌの一方のトランジスタ３
３のベースと接地電位との間に前記コンデンサ２ｌが接
続されることにより、そのベースには前記スライスレベ
ルを決定するための直流バ−イアス電位が得られる。他
方、差動対トランジスタ３１の他方のトランジスタ３４
のベースにはこの直流バイアス電位に交流信号成分が重
畳された信号が供給される。
な構成を示す回路図である。 この回路は、前記第１、
第２の抵抗素子１８． ２０を介して伝達される前記増
幅回路１７の出力が各ベースに供給されるエミッタ結合
された差動対トランジスタ３ｌと、この差動対トランジ
スタ３ｌの負荷回路３２とから構成されている。そして
、上記差動対トランジスタ３ｌの一方のトランジスタ３
３のベースと接地電位との間に前記コンデンサ２ｌが接
続されることにより、そのベースには前記スライスレベ
ルを決定するための直流バ−イアス電位が得られる。他
方、差動対トランジスタ３１の他方のトランジスタ３４
のベースにはこの直流バイアス電位に交流信号成分が重
畳された信号が供給される。
第３図は上記実施例回路における加算回路１２の出力信
号の一例を示す図である。前記ドロップアウト検出回路
１１でＤＯＣパルスが発生されたとき、加算回路１２の
出力レベルは最も高いレベル（ＤＯＣレベル）になる。
号の一例を示す図である。前記ドロップアウト検出回路
１１でＤＯＣパルスが発生されたとき、加算回路１２の
出力レベルは最も高いレベル（ＤＯＣレベル）になる。
また、非相関／相関信号が非相関状態のとき、加算回路
ｌ２の出力レベルはＤＯＣレベルの次に高いレベル（非
相関レベル）となる。さらに、非相関／相関信号が相関
状態のとき、加算回路１２の出力レベルは最も低いレベ
ル（ノーマルレベル）となる。従って、前記端子に接続
された外部回路に、ＤＯＣレベルと非相関レベルとの間
のレベルをスライスレベルとし、人力レベルがこのスラ
イスレベルに対して高いか低いかを検出する第１のレベ
ル検出回路と、非相関レベルとノーマルレベルとの間の
レベルをスライスレベルとし、人力レベルがこのスライ
スレベルに対して高いか低いかを検出する第２のレベル
検出回路とを設けることによって、前記２種類の信号を
認識することが可能である。
ｌ２の出力レベルはＤＯＣレベルの次に高いレベル（非
相関レベル）となる。さらに、非相関／相関信号が相関
状態のとき、加算回路１２の出力レベルは最も低いレベ
ル（ノーマルレベル）となる。従って、前記端子に接続
された外部回路に、ＤＯＣレベルと非相関レベルとの間
のレベルをスライスレベルとし、人力レベルがこのスラ
イスレベルに対して高いか低いかを検出する第１のレベ
ル検出回路と、非相関レベルとノーマルレベルとの間の
レベルをスライスレベルとし、人力レベルがこのスライ
スレベルに対して高いか低いかを検出する第２のレベル
検出回路とを設けることによって、前記２種類の信号を
認識することが可能である。
［発明の効果］
以上説明したようにこの発明によれば、同一集積回路内
にドロップアウト補償系と非相関／相関処理系の回路を
含み、外部端子の数を従来よりも減らすことができる再
生ＦＭ信号処理回路を提供することができる。
にドロップアウト補償系と非相関／相関処理系の回路を
含み、外部端子の数を従来よりも減らすことができる再
生ＦＭ信号処理回路を提供することができる。
第１図はこの発明に係る再生ＦＭ信号処理回路を内蔵し
た集積回路の構成を示すブロック図、第２図は上記実施
例回路の一部回路の具体的な構成を示す回路図、第３図
は上記実施例回路の一部回路の出力信号の一例を示す図
である。 １ｌ・・・ドロップアウト検出回路、ｌ２・・・加算回
路、ｌ３・・・端子、１４・・・遅延回路、１５・・・
減算回路、ＩＢ・・・加算回路、１７・・・増幅回路、
１８・・・第１の抵抗素子、ｌ９・・・リミッタ回路、
２０・・・第２の抵抗素子、２１・・・コンデンサ、２
２・・・波形整形回路。
た集積回路の構成を示すブロック図、第２図は上記実施
例回路の一部回路の具体的な構成を示す回路図、第３図
は上記実施例回路の一部回路の出力信号の一例を示す図
である。 １ｌ・・・ドロップアウト検出回路、ｌ２・・・加算回
路、ｌ３・・・端子、１４・・・遅延回路、１５・・・
減算回路、ＩＢ・・・加算回路、１７・・・増幅回路、
１８・・・第１の抵抗素子、ｌ９・・・リミッタ回路、
２０・・・第２の抵抗素子、２１・・・コンデンサ、２
２・・・波形整形回路。
Claims (1)
- 【特許請求の範囲】 再生ＦＭ信号の振幅レベルが所定値以下になったことを
検出してドロップアウト信号を発生するドロップアウト
信号発生手段と、 上記再生ＦＭ信号から復調された輝度信号を１水平期間
遅延する遅延手段と、 上記遅延手段で遅延された信号と遅延する前の元の輝度
信号との間の差成分を得る減算手段と、上記減算手段で
得られた差成分をスライスし、波形整形して非相関／相
関信号を発生する非相関／相関信号発生手段と、 上記ドロップアウト信号と上記非相関／相関信号とを加
算して出力する加算手段と を具備したことを特徴とする再生ＦＭ信号処理回路。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1240759A JPH0767181B2 (ja) | 1989-09-19 | 1989-09-19 | 再生ｆｍ信号処理用半導体集積回路 |
| US07/582,079 US5150220A (en) | 1989-09-19 | 1990-09-14 | Video signal-processing circuit for outputting a drop out signal superimposed on a correlation/noncorrelation signal |
| DE69026994T DE69026994T2 (de) | 1989-09-19 | 1990-09-19 | Integrierte Halbleiterschaltung für die Videosignalverarbeitung |
| KR1019900014802A KR940000972B1 (ko) | 1989-09-19 | 1990-09-19 | 재생 fm신호처리회로 |
| EP90118014A EP0418854B1 (en) | 1989-09-19 | 1990-09-19 | Semiconductor integrated circuit for video signal processing |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1240759A JPH0767181B2 (ja) | 1989-09-19 | 1989-09-19 | 再生ｆｍ信号処理用半導体集積回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH03104390A true JPH03104390A (ja) | 1991-05-01 |
| JPH0767181B2 JPH0767181B2 (ja) | 1995-07-19 |
Family
ID=17064295
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1240759A Expired - Fee Related JPH0767181B2 (ja) | 1989-09-19 | 1989-09-19 | 再生ｆｍ信号処理用半導体集積回路 |
Country Status (5)
| Country | Link |
|---|---|
| US (1) | US5150220A (ja) |
| EP (1) | EP0418854B1 (ja) |
| JP (1) | JPH0767181B2 (ja) |
| KR (1) | KR940000972B1 (ja) |
| DE (1) | DE69026994T2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
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| JP2010057964A (ja) * | 2009-12-14 | 2010-03-18 | Mars Engineering Corp | 景品払出機および景品払出システム |
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| Publication number | Priority date | Publication date | Assignee | Title |
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-
1989
- 1989-09-19 JP JP1240759A patent/JPH0767181B2/ja not_active Expired - Fee Related
-
1990
- 1990-09-14 US US07/582,079 patent/US5150220A/en not_active Expired - Lifetime
- 1990-09-19 EP EP90118014A patent/EP0418854B1/en not_active Expired - Lifetime
- 1990-09-19 KR KR1019900014802A patent/KR940000972B1/ko not_active Expired - Fee Related
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