JPH0322463A - 半導体装置 - Google Patents

半導体装置

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Publication number
JPH0322463A
JPH0322463A JP15770489A JP15770489A JPH0322463A JP H0322463 A JPH0322463 A JP H0322463A JP 15770489 A JP15770489 A JP 15770489A JP 15770489 A JP15770489 A JP 15770489A JP H0322463 A JPH0322463 A JP H0322463A
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JP
Japan
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wiring
layer
silicon film
polycrystalline silicon
resistance
Prior art date
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Pending
Application number
JP15770489A
Other languages
English (en)
Inventor
Megumi Ogawa
恵 小川
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC IC Microcomputer Systems Co Ltd
Original Assignee
NEC IC Microcomputer Systems Co Ltd
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、半導体装置に関し、特に交差配線を有する半
導体装置に関する。
〔従来の技術〕
従来の半導体装置は、第3図に示すように、シリコン基
板1の上に設けた酸化シリコン膜2の上に選択的に設け
た多結晶シリコン層からなる抵抗層3と抵抗層3の両端
に接続して設けた配線4a,4bと抵抗層3の上に設け
た酸化シリコン11!5を介して抵抗層3と交差する配
線8を有して構成される。ここで、第4図に示すように
、酸化シリコン膜5を介して抵抗層3と配線8でコンデ
ンサCが構成される。
〔発明が解決しようとする課題〕
上述した従来の半導体装置は、酸化膜を誘電体とし、多
結晶シリコン層によって形或された抵抗層と配線を両極
とするコンデンサを形戒するため、両者間において干渉
が生じる。すなわち、抵抗層と配線間の結合により誘起
された信号が抵抗層及び配線に接続された回路に作用し
て誤動作を引き起こすという欠点がある。
〔課題を解決するための手段〕
本発明の半導体装置は、多結晶シリコンによって形威さ
れた抵抗あるいはMOS}ランジスタのゲートあるいは
配線と金属配線が交差する領域にこれらの間に、両者に
対して酸化膜によって絶縁され、かつ集積回路上におけ
る電源又は接地線に接続された導体層を有する。
〔実施例〕
次に、本発明について図面を参照して説明する。
第1図は本発明の一実施例の断面図である。
第1図に示すように、シリコン基板1の上に設けた酸化
シリコン膜2の上に選択的に設けた多結晶シリコン層か
らなる抵抗層3と、抵抗層3の両端に接続して設けた配
線4a及び配線4bと、抵抗層3の表面に設けて抵抗層
3を被覆する酸化シリコン膜5と、酸化シリコン膜5の
上に設けた多結晶シリコン層6と、多結晶シリコン層6
の表面に設けて多結晶シリコン層6を被覆する酸化シリ
コン膜7と、酸化シリコン膜7の上に設けて抵抗層3と
交差され配線8と、酸化シリコン膜7に設けた開口部の
多結晶シリコン層6と接続して設けた配線9を有して半
導体装置を構成する。
第2図は、第1図の実施例の等価回路図である。酸化シ
リコン膜5を介して抵抗層3及び多結晶シリコン層6で
形成されるコンデンサC,、酸化シリコン膜7を介して
多結晶シリコン層6及び配線8で形成されるコンデンサ
C2が配線9により電源又は接地線に接続されて高周波
信号が接地され、抵抗層3と配線8との相互間漏洩信号
を防止する。
なお、ここで、抵抗層の場合だけでな<MOSトランジ
スタのゲート電極の場合でも同様の効果がある。
〔発明の効果〕
以上説明したように本発明は、多結晶シリコン層により
形成された抵抗あるいはMOSトランジスタのゲートと
金属配線が交差する場合、これらの間に酸化膜によって
絶縁され、かつ集積回路上における低インピーダンスで
ある電源の最高あるいは最低電位でバイアスされた別の
多結晶シリコン層を形成したことにより、多結晶シリコ
ン層により形成された抵抗と金属配線相互の干渉を前記
多結晶シリコン層でシールドした状態となり、多結晶シ
リコン層により形成された抵抗あるいはMOS}ランジ
スタあるいは配線と金属配線の交差によって不用な信号
が発生し、回路動作に影響を及ぼすことを防ぐ。
【図面の簡単な説明】
第1図は、本発明の一実施例の断面図、第2図は第1図
の実施例の等価回路図、第3図は従来の半導体装置の断
面図、第4図は第3図の半導体装置の等価回路図である
。 1・・・シリコン基板、2・・・酸化シリコン膜、3・
・・抵抗層、4a,4b・・・配線、5・・・酸化シリ
コン膜、6・・・多結晶シリコン層、7・・・酸化シリ
コン膜、8,9・・・配線、C,C,,C2・・・コン
デンサ。

Claims (1)

    【特許請求の範囲】
  1. 半導体基板上に設けた絶縁膜上に設けた抵抗層又はゲー
    ト電極と交差する配線を有する半導体装置において、前
    記抵抗層又はゲート電極と前記配線との交差領域の相互
    間に互に絶縁膜を介して設け且つ電源又は接地線に接続
    された導体層を備えたことを特徴とする半導体装置。
JP15770489A 1989-06-19 1989-06-19 半導体装置 Pending JPH0322463A (ja)

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