JPH0363099U - - Google Patents

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JPH0363099U
JPH0363099U JP12166489U JP12166489U JPH0363099U JP H0363099 U JPH0363099 U JP H0363099U JP 12166489 U JP12166489 U JP 12166489U JP 12166489 U JP12166489 U JP 12166489U JP H0363099 U JPH0363099 U JP H0363099U
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【図面の簡単な説明】
第１図は本考案の一実施例による過電流時間監
視回路の回路図、第２図は第１図の過電流時間監
視回路における各部の信号の波形図、第３図はプ
ログラマブル・インターバル・タイマ回路のモー
ド説明図、第４図はプログラマブル・インターバ
ル・タイマ回路における過電流監視状態の説明図
、第５図は従来の定電流チヨツパ駆動回路の回路
図、そして第６図は第５図の回路における負荷に
流れる電流の波形図である。 １……過電流時間監視回路、２……ピーク値ホ
ールド回路、２ａ……オペアンプ、３……コンパ
レータ回路、３ａ……コンパレータ、４……タイ
マ回路、４ａ……プログラマブル・インターバル
・タイマ回路（８２５３）、４ｂ……ＮＡＮＤ回
路（論理回路）、２１……ハイブリツドＩＣ、Ｌ
１，Ｌ３……負荷、ＲＳ……電流検出用抵抗器。

Claims (1)

  1. 【実用新案登録請求の範囲】 制御手段により誘導負荷に対し誘導負荷の定格
    を超過した過電流を一時的に流す制御が行われる
    定電流チヨツパ駆動回路における誘電負荷の過電
    流時間監視回路であつて、 誘導負荷に流れる電流の検出用である電流検出
    用抵抗器におけるチヨツパ電圧を平滑化するピー
    ク値ホールド回路、 ピーク値ホールド回路からの出力パルスを所定
    のスライスレベルにより処理するコンパレータ回
    路、 コンパレータ回路からの出力パルスと適宜の手
    段により与えられるクロツクパルスとの論理演算
    を行う論理回路、及び 論理回路からの出力パルスをトリガとして、予
    め設定されているカウント数について所定のクロ
    ツク周期に基づきカウントを行い、カウントオー
    バーになつた時に所定の信号を出力するプログラ
    マブル・インターバル・タイマ回路を備えてなる
    誘導負荷の過電流時間監視回路。
JP1989121664U 1989-10-19 1989-10-19 誘導負荷の過電流時間監視回路 Expired - Lifetime JP2581580Y2 (ja)

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Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5010426A (ja) * 1973-06-04 1975-02-03
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Patent Citations (6)

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JP2581580Y2 (ja) 1998-09-21

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