JPH0366210A - Matching circuit for high frequency transistor - Google Patents
Matching circuit for high frequency transistorInfo
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。(57) [Summary] This bulletin contains application data before electronic filing, so abstract data is not recorded.
Description
【発明の詳細な説明】
産業上の利用分野
本発明は高周波高出力増幅器に使用するトランジスタの
入出力のインピーダンスを容易にかつ安価に調整できる
高周波トランジスタの整合回路に関するものである。DETAILED DESCRIPTION OF THE INVENTION FIELD OF INDUSTRIAL APPLICATION The present invention relates to a matching circuit for high-frequency transistors that can easily and inexpensively adjust the input and output impedances of transistors used in high-frequency, high-output amplifiers.
従来の技術
高周波用トランジスタの人出力インピーダンスは、一般
に主線路マイクロストリップラインの特性インピーダン
ス(50オーム)に一致しない。電気信号を効率良く増
幅するためには、トランジスタの人出力インピーダンス
と、人出力それぞれの主線路マイクロストリップライン
のインピーダンスができるだけ一致して、その点におけ
る反射ができるだけ少なくなるほど好ましい。特に高周
波高出力用トランジスタの入出力インピーダンスは、5
0オームよりもはるかに低いので、通常、入出力主線路
マイクロストリップラインに並列にインピーダンスの低
い素子を挿入して、インピーダンスの整合をとるように
している。終端開放マイクロストリップライン(オープ
ンスタブ)のインピーダンス、Zosは、
Zos−−j−cot βL(1)
但し、β=2π/λ
λは整合をとろうとしている周波数におけるマイクロス
トリップライン上での波長(管内波長)
Lはマイクロストリップラインの長さ
で与えられる。The human output impedance of conventional high frequency transistors generally does not match the characteristic impedance (50 ohms) of the main line microstrip line. In order to efficiently amplify electric signals, it is preferable that the output impedance of the transistor and the impedance of the main line microstrip line of each output match as much as possible, so that reflection at that point is reduced as much as possible. In particular, the input/output impedance of high-frequency, high-output transistors is 5
Since it is much lower than 0 ohm, a low impedance element is usually inserted in parallel with the input/output main line microstrip line to match the impedance. The impedance, Zos, of an open-terminated microstrip line (open stub) is: Zos--j-cot βL (1) However, β = 2π/λ λ is the wavelength on the microstrip line at the frequency to be matched ( Inner wavelength) L is given by the length of the microstrip line.
したがって、ZosはβLがπ/2、ずなわち、Lがλ
/4に近づくにつれ小さくなり、適当な値を選ぶことに
より、トランジスタとの整合をとることができる。Therefore, Zos has βL of π/2, that is, L of λ
It becomes smaller as it approaches /4, and matching with the transistor can be achieved by selecting an appropriate value.
この方法による従来の高周波増幅器の代表的構成を第3
図に示す。The typical configuration of a conventional high frequency amplifier using this method is shown in the third section.
As shown in the figure.
第3図において、101は電界効果トランジスタ(FE
T)、102は入力整合回路基板、103は出力整合回
路基板、104は入力端子に接続されるマイクロストリ
ップラインで構成された主線路、105は出力端子に接
続されるマイクロストリップラインで構成された主線路
、106は前記トランジスタと前記入力整合回路基板を
接続するワイヤー、107は前記トランジスタと前記出
力整合回路基板を接続するワイヤー 301は入力整合
回路を形成するオープンスタブ、302は出力整合回路
を形成するオープンスタブ、303.304はオープン
スタブの長さを調整するための島状電極(パッド)、3
05.306はオープンスタブと調整用パッドを接続す
るためのワイヤーである。この構造において、人力整合
回路および出力整合回路の調整は、オープンスタブに調
整用パッドをワイヤーで接続することにより、実質的に
オープンスタブの長さを調整することによって行ってい
る。In FIG. 3, 101 is a field effect transistor (FE).
T), 102 is an input matching circuit board, 103 is an output matching circuit board, 104 is a main line composed of a microstrip line connected to the input terminal, and 105 is composed of a microstrip line connected to the output terminal. Main line, 106 is a wire connecting the transistor and the input matching circuit board, 107 is a wire connecting the transistor and the output matching circuit board, 301 is an open stub forming an input matching circuit, 302 is forming an output matching circuit 303.304 is an island-shaped electrode (pad) for adjusting the length of the open stub, 3
05.306 is a wire for connecting the open stub and the adjustment pad. In this structure, the manual matching circuit and the output matching circuit are adjusted by connecting an adjustment pad to the open stub with a wire, thereby substantially adjusting the length of the open stub.
この方式をさらに改良したものとして、整合用チップコ
ンデンサを用いたものが知られており、その代表的構造
を第4図に示す。第4図において、101は電界効果ト
ランジスタ(FET)、401は人力整合調整回路基板
、402は出力整合調整回路基板、104は入力端子に
接続されるマイクロストリップラインで構成された主線
路、105は出力端子に接続されるマイクロストリップ
ラインで構成された主線路、403は人力インピーダン
ス整合用チップコンデンサ、404は出力インピーダン
ス整合用チップコンデンサで、403.404のチップ
コンデンサはともに、下電極はアースされている台座の
上に接続され、上電極はワイヤーでトランジスタと入出
力整合調整回路基板の主線路マイクロストリップライン
に接続されている。 405.406は前記トランジス
タと前記チップコンデンサを接続するワイヤーミ407
.408は、前記チップコンデンサと前記入出力整合調
整回路基板の主線路マイクロストリップラインを接続す
るワイヤーである。409.410は入出力整合を調整
するためのパッド、411412は主線路マイクロスト
リップラインと調整用パッドを接続するためのワイヤー
である。この構造において、入出力整合はチップコンデ
ンサとそれを接続しているワイヤーのインダクタンスで
主に整合をとるようにし、補助的に入出力整合調整回路
基板において、調整用パッドをワイヤーで接続すること
により行っている。As a further improvement of this method, one using a matching chip capacitor is known, and a typical structure thereof is shown in FIG. In FIG. 4, 101 is a field effect transistor (FET), 401 is a manual matching adjustment circuit board, 402 is an output matching adjustment circuit board, 104 is a main line composed of a microstrip line connected to an input terminal, and 105 is a main line composed of a microstrip line connected to an input terminal. The main line consists of a microstrip line connected to the output terminal, 403 is a chip capacitor for human impedance matching, 404 is a chip capacitor for output impedance matching, and the lower electrodes of both chip capacitors 403 and 404 are grounded. The upper electrode is connected by a wire to the transistor and the main line microstrip line of the input/output matching adjustment circuit board. 405 and 406 are wire wires 407 connecting the transistor and the chip capacitor.
.. 408 is a wire connecting the chip capacitor and the main line microstrip line of the input/output matching adjustment circuit board. 409.410 is a pad for adjusting input/output matching, and 411412 is a wire for connecting the main line microstrip line and the adjustment pad. In this structure, input/output matching is performed primarily by the inductance of the chip capacitor and the wire connecting it, and is supplemented by connecting adjustment pads with wires on the input/output matching adjustment circuit board. Is going.
発明が解決しようとする課題
しかし、第1の従来例に示す調整方法では、インピーダ
ンスの低い高周波高出力FETの整合をとるのは困難で
ある。主線路のインピーダンスは一般に50オームであ
り、これに対して高周波高出力FETのインピーダンス
は一般に数オームもしくは1オーム以下となっている。Problems to be Solved by the Invention However, with the adjustment method shown in the first conventional example, it is difficult to match high frequency, high output FETs with low impedance. The impedance of the main line is generally 50 ohms, whereas the impedance of high frequency, high output FETs is generally several ohms or less than 1 ohm.
したがって、これを整合させるためには、主線路とアー
ス間にかなり静電容量の大きいコンデンサを挿入するこ
とが必要となる。実施例1に示したオープンスタブでこ
れを実現するためには、(1)式より容易にわかるよう
に、オープンスタブの長さを、整合をとろうとしている
周波数の1/4波長にかなり近い長さにする必要がある
。しかしオープンスタブのインピーダンスは、cotβ
Lで変化し、1/4波長付近では、スタブ長がわずかに
変化してもその値は大きく変化することになり、実際の
調整は極めて困難となる。したがって第1の実施例の方
法は、高周波高出力FET)ランジスタの整合をとるの
には適していない。Therefore, in order to match this, it is necessary to insert a capacitor with a considerably large capacitance between the main line and the ground. In order to achieve this with the open stub shown in Example 1, the length of the open stub must be very close to 1/4 wavelength of the frequency to be matched, as can be easily seen from equation (1). It needs to be long. However, the impedance of the open stub is cotβ
L, and in the vicinity of 1/4 wavelength, even if the stub length changes slightly, its value changes greatly, making actual adjustment extremely difficult. Therefore, the method of the first embodiment is not suitable for matching high frequency, high power FET (FET) transistors.
また第2の従来例に述べた構成の場合、大きいチップコ
ンデンサを接続するため、第1の従来例よりも、インピ
ーダンスの低い高周波高出力FETとの整合をとりやす
いが、チップコンデンサの静電容量の値を微調整するの
が困難であり、そこで入出力整合回路基板上にオープン
スタブを形威し、このオープンスタブの長さを微調整す
ることによって、整合微調整を行う必要がある。また整
合用コンデンサは、主線路とアース間に挿入されるため
、信号の伝送損失を少なくするためには、誘電体損失な
どコンデンサとしての損失のきわめて小さいことが要求
され、そのため必然的に高価なものとなる。さらに製造
する上でチップを実装するため工数が増し、またチップ
取り付は部が別にいるなどから小型高集積化が困難であ
り、その結果製造コストも高くなる。In addition, in the case of the configuration described in the second conventional example, since a large chip capacitor is connected, it is easier to match with a high frequency, high output FET with low impedance than in the first conventional example, but the capacitance of the chip capacitor Therefore, it is necessary to form an open stub on the input/output matching circuit board and finely adjust the matching by adjusting the length of the open stub. In addition, matching capacitors are inserted between the main line and the ground, so in order to reduce signal transmission loss, they must have extremely low dielectric loss and other losses as a capacitor, so they are inevitably expensive. Become something. Furthermore, mounting the chips during manufacturing increases the number of man-hours, and since a separate part is required for mounting the chips, it is difficult to achieve small size and high integration, resulting in high manufacturing costs.
課題を解決するための手段
本発明は上記課題を解決するため、トランジスタの入出
力インピーダンス整合回路において、主線路と並列に薄
膜コンデンサもしくはインターデジタルコンデンサと終
端開放マイクロストリップラインの直列回路を有し、こ
の終端開放マイクロストリップラインが開放端から当該
周波数の1/4波長のところで、つまりコンデンサの主
線路接続電極の反対側の電極端で電気的にショートとみ
なせることを利用して、前記トランジスタとの整合状態
を調整できるようにしたものである。Means for Solving the Problems In order to solve the above problems, the present invention has a transistor input/output impedance matching circuit that includes a series circuit of a thin film capacitor or an interdigital capacitor and an open-terminated microstrip line in parallel with the main line, By utilizing the fact that this open-terminated microstrip line can be considered to be electrically shorted at 1/4 wavelength of the frequency from the open end, that is, at the electrode end opposite to the main line connection electrode of the capacitor, the connection with the transistor is made. This allows the consistency state to be adjusted.
作用
本発明は上記した構成により、インピーダンスの低い高
周波高出力トランジスタの整合をとるのが容易であり、
また整合用コンデンサの損失に基づく信号の伝送損失を
小さくすることができ、さらに実装工数が少なく、小型
集積化が可能であり、製造コストの安い高周波トランジ
スタの整合回路を提供するものである。Effect The present invention has the above-described configuration, which makes it easy to match high-frequency, high-output transistors with low impedance.
Further, the present invention provides a high-frequency transistor matching circuit that can reduce signal transmission loss due to loss of a matching capacitor, requires fewer mounting steps, can be integrated in a small size, and is inexpensive to manufacture.
実施例
以下本発明の高周波増幅器の整合回路の実施例について
、図面を参照しながら説明する。Embodiments Hereinafter, embodiments of a matching circuit for a high frequency amplifier according to the present invention will be described with reference to the drawings.
第1図は本発明の高周波トランジスタの整合回路の構造
の■実施例を示したものである。第1図において、10
1は電界効果トランジスタ(FET)、102は入力整
合回路基板、103は出力整合回路基板、104は入力
端子に接続されるマイクロストリップラインで構成され
た主線路、105は出力端子に接続されるマイクロスト
リップラインで構成された主線路、106は前記トラン
ジスタと前記入力整合回路基板を接続するワイヤー、1
07は前記トランジスタと前記出力整合回路基板を接続
するワイヤー、(08は入力整合用薄膜コンデンサ、1
09は出力整合用薄膜コンデンサ、110.111は一
端を前記薄膜コンデンサの主線路に接続されていない側
の電極に接続された終端開放マイクロストリップライン
で、その長さは1/4波長となっている。 112は終
端開放マイクロストリップライン近傍に設けられた島状
電極である。入出力整合回路基板はアル5すなどのセラ
実ツク基板を用い、主線路およびマイクロストリップラ
インなどの導電部には通常用いられるCr−Auを用い
、薄膜コンデンサとしては酸化珪素を誘電体として用い
た金属−誘電体−金属構造の薄膜コンデンサを用いた。FIG. 1 shows an embodiment of the structure of a matching circuit for high frequency transistors according to the present invention. In Figure 1, 10
1 is a field effect transistor (FET), 102 is an input matching circuit board, 103 is an output matching circuit board, 104 is a main line composed of a microstrip line connected to the input terminal, and 105 is a microstrip line connected to the output terminal. A main line constituted by a strip line; 106 is a wire connecting the transistor and the input matching circuit board; 1;
07 is a wire connecting the transistor and the output matching circuit board, (08 is a thin film capacitor for input matching, 1
09 is a thin film capacitor for output matching, 110.111 is an open-ended microstrip line whose one end is connected to the electrode on the side of the thin film capacitor that is not connected to the main line, and its length is 1/4 wavelength. There is. 112 is an island-shaped electrode provided near the open-ended microstrip line. The input/output matching circuit board uses a ceramic substrate such as Al5, the conductive parts such as the main line and microstrip line use the commonly used Cr-Au, and the thin film capacitor uses silicon oxide as the dielectric. A thin film capacitor with a metal-dielectric-metal structure was used.
またトランジスタとしてGaAsFETを、また整合さ
せる周波数として14C;Hzを用いた。Further, a GaAsFET was used as the transistor, and 14C; Hz was used as the matching frequency.
アル≧す基板の誘電率を9.8とした場合、14GH2
における1/4波長相当のマイクロストリップラインの
長さは約2 mmである。If the dielectric constant of the substrate Al≧ is 9.8, then 14GH2
The length of the microstrip line corresponding to 1/4 wavelength is approximately 2 mm.
本方式における整合方法についてさらに詳しく説明する
。前述したように、高出力用FETの入出力インピーダ
ンスは数オームから1オーム以下と主線路のインピーダ
ンス50オームに比べてかなり低い。そこで本実施例で
はその整合をとるために主線路マイクロストリップライ
ンと並列に薄膜コンデンサと終端開放マイクロストリッ
プラインの直列回路を挿入している。この直列回路のイ
ンピーダンス、Zinは、
Z tn=1/jωc−jZo −c o tβL(2
)= j(1/ωc+Zo−cotβL ) (3)
但し、ω−2πf
β−2π/λ
fは整合をとろうとしている周波数、
0
Cは薄膜コンデンサの静電容量、
Zoはマイクロストリップラインの特性インピーダンス
、
λは整合をとろうとしている周波数の基板内での波長、
Lはマイクロストリップラインの長さ
で表わされる。The matching method in this system will be explained in more detail. As mentioned above, the input/output impedance of the high output FET is from several ohms to less than 1 ohm, which is considerably lower than the impedance of the main line, which is 50 ohms. Therefore, in this embodiment, a series circuit of a thin film capacitor and an open-ended microstrip line is inserted in parallel with the main line microstrip line in order to achieve the matching. The impedance of this series circuit, Zin, is Z tn=1/jωc-jZo-co tβL(2
)=j(1/ωc+Zo-cotβL) (3)
However, ω-2πf β-2π/λ f is the frequency to be matched, 0C is the capacitance of the thin film capacitor, Zo is the characteristic impedance of the microstrip line, and λ is the substrate at the frequency to be matched. The wavelength within, L, is expressed by the length of the microstrip line.
Lが整合をとろうとしている周波数における管内波長の
1/4波長であるから(3)式の第2項は0となるので
純粋に薄膜コンデンサの値のみがZinとして見えるこ
ととなる。したがって、静電容量Cを調整することによ
りZinの値を数オームあるいは1オーム以下にするこ
とは容易である。Since L is 1/4 wavelength of the tube wavelength at the frequency to be matched, the second term in equation (3) becomes 0, so that only the value of the thin film capacitor can be seen as Zin. Therefore, by adjusting the capacitance C, it is easy to reduce the value of Zin to several ohms or 1 ohm or less.
また終端開放マイクロストリップラインを近傍に設けら
れた島状電極と接続する事により(3)式の第2項を変
化させることができ、結果として終端開放マイクロスト
リップラインと薄膜コンデンサの直列回路のインピーダ
ンスを調整することが可能である。Furthermore, by connecting the open-ended microstrip line to an island-shaped electrode provided nearby, the second term in equation (3) can be changed, resulting in the impedance of the series circuit of the open-ended microstrip line and the thin film capacitor. It is possible to adjust.
本実施例では、はぼ整合すると思われる値に薄膜コンデ
ンサの値を最初から設定し、トランジスタの特性のバラ
ツキや、薄膜コンデンサの製造時のバラツキなどによる
整合のズレを、終端開放マイクロストリップラインと周
辺の島状電極を接続することにより主線路マイクロスト
リップラインからみた薄膜コンデンサと終端開放マイク
ロストリップラインの直列回路のインピーダンスを変化
させたり、主線路マイクロストリップラインにオープン
スタブを設定することにより調整することができる。In this example, the value of the thin film capacitor is set from the beginning to a value that is considered to be closely matched, and the mismatching due to variations in transistor characteristics and variations in the manufacturing process of the thin film capacitor is corrected by using an open-terminated microstrip line. The impedance of the series circuit of the thin film capacitor and the open-terminated microstrip line as seen from the main line microstrip line can be changed by connecting the surrounding island-shaped electrodes, or it can be adjusted by setting an open stub on the main line microstrip line. be able to.
また(3)式かられかるように、マイクロストリップラ
インの長さを適当に選ぶことにより、整合用コンデンサ
の静電容量の値をきわめて小さく選ぶことができる。こ
のことは整合用コンデンサの電極面積をきわめて小さく
できることを意味し、したがって、電極面積に比例する
コンデンサの損失をきわめて小さくできる。また逆に、
少々、コンデンサの損失特性が、従来のものよりも悪く
ても使用でき−ることになり、その場合にはコストの低
減になる。また薄膜コンデンサの主線路接続電極1
2
の反対側の電極端をアースする方法も考えられるが、マ
イクロストリップライン基板では基板表面にアース電極
が存在せず基板端面でストリップラインをアースに接続
するか、バイアホールをあける必要があり、薄膜コンデ
ンサを形成する場所に制約がある。しかし、本方式では
基板内の任意の場所に薄膜コンデンサを形成することが
できインピーダンス整合回路設計における自由度が増す
と考えられる。Furthermore, as can be seen from equation (3), by appropriately selecting the length of the microstrip line, the value of the capacitance of the matching capacitor can be selected to be extremely small. This means that the electrode area of the matching capacitor can be made extremely small, and therefore the loss of the capacitor that is proportional to the electrode area can be made extremely small. And vice versa,
This means that it can be used even if the loss characteristics of the capacitor are slightly worse than those of conventional capacitors, and in that case, the cost will be reduced. Another possibility is to ground the electrode end on the opposite side of the main line connection electrode 1 2 of the thin film capacitor, but in the case of a microstrip line board, there is no ground electrode on the board surface, so it is better to connect the strip line to ground at the end face of the board. , it is necessary to open a via hole, and there are restrictions on where to form the thin film capacitor. However, with this method, thin film capacitors can be formed anywhere within the substrate, which is thought to increase the degree of freedom in designing the impedance matching circuit.
本実施例では、入出力整合回路ともに同一の方式で整合
をとったが、一般に出力インピーダンスは人力インピー
ダンスよりも高いので、入力整合のみに本実施例の方法
を用いてもよい。In this embodiment, the input and output matching circuits are matched using the same method, but since the output impedance is generally higher than the human impedance, the method of this embodiment may be used only for input matching.
また別の実施例として薄膜コンデンサのかわりにインタ
ープ、ジタルコンデンサを用いた例を第2図に示す。こ
の場合は入力端しか示していないが、出力側も同様に構
成できることはあきらかである。FIG. 2 shows another embodiment in which an interp or digital capacitor is used instead of a thin film capacitor. In this case, only the input end is shown, but it is obvious that the output side can also be configured in the same way.
第2図において、・101は電界効果トランジスタ(F
ET)、102は人力整合回路基板、104は入力端子
に接続されるマイクロストリップラインで構成された主
線路、106は前記l・ランジスタと前記入力整合回路
基板を接続するワイヤー 201は人力整合用インター
デジタルコンデンサ、110は一端を前記インターデジ
タルコンデンサの主線路に接続されていない側の電極に
接続された終端開放マイクロストリップラインで、その
長さは1/4波長となっている。112は終端開放マイ
クロストリップライン近傍に設けられた島状電極である
。In Figure 2, ・101 is a field effect transistor (F
ET), 102 is a manual matching circuit board, 104 is a main line composed of a microstrip line connected to an input terminal, 106 is a wire connecting the L transistor and the input matching circuit board, 201 is a manual matching interface. The digital capacitor 110 is an open-ended microstrip line whose one end is connected to the electrode of the interdigital capacitor on the side not connected to the main line, and its length is 1/4 wavelength. 112 is an island-shaped electrode provided near the open-ended microstrip line.
入出力整合回路基板はアルごすなどのセラミック基板を
用い、主線路およびマイクロストリップラインなどの導
電部には通常用いられるCr−Auを用いた。またトラ
ンジスタとしてGaAs FETを、また整合させる周
波数として14GHzを用いた。アルミナ基板の誘電率
を9.8とした場合、14GHzにおける1/4波長相
当のマイクロストリップラインの長さは約2Mである。For the input/output matching circuit board, a ceramic board such as Algosu was used, and for the conductive parts such as the main line and the microstrip line, commonly used Cr-Au was used. Further, a GaAs FET was used as the transistor, and 14 GHz was used as the matching frequency. When the dielectric constant of the alumina substrate is 9.8, the length of a microstrip line corresponding to 1/4 wavelength at 14 GHz is about 2M.
第一の実施例と同様にインターデジタルコンデンサの静
電容量を調整することによりZinの値を数オームある
いは1オーム以下にすることは容易である。また終端開
放マイクロストリップラインを近傍に設置3
4
けられた島状電極と接続する事により(3)式の第2項
を変化させることができ、結果として終端開放マイクロ
ストリップラインとインターデジタルコンデンサの直列
回路のインピーダンスを調整することが可能である。薄
)模コンデンサの場合と同様にインターデジタルコンデ
ンサを用いても、集積化が容易であり、また対向電極部
の面積を減らずことによって、コンデンサとしての損失
を減少させることができ、やはり本発明の目的とする効
果の得られるものである。As in the first embodiment, it is easy to reduce the value of Zin to several ohms or 1 ohm or less by adjusting the capacitance of the interdigital capacitor. In addition, by installing an open-ended microstrip line nearby and connecting it to the cut-off island electrode, the second term in equation (3) can be changed, and as a result, the difference between the open-ended microstrip line and the interdigital capacitor can be changed. It is possible to adjust the impedance of the series circuit. Even if an interdigital capacitor is used as in the case of a thin (thin) imitation capacitor, integration is easy, and loss as a capacitor can be reduced by not reducing the area of the opposing electrode portion, and the present invention also The desired effect can be obtained.
発明の効果
以上述べた如く、本発明は、主線路と並列に薄膜コンデ
ンサもしくはインターデジタルコンデンサと終端開放マ
イクロストリップラインの直列回路を設け、前記終端開
放マイクロストリップラインの開放端から当該周波数の
1/4波長のところでつまり前記薄膜コンデンサもしく
はインターデジタルコンデンサの主線路マイクロストリ
ップラインの主線路接続電極の反対側の電極端で電気的
にショートと見なせることを利用し、この終端開5
族マイクロストリップラインを島状電極と接続すること
により長さを変化させ、前記トランジスタとの整合状態
を調整できるようにしたもので、これによりインピーダ
ンスの低い高周波高出力トランジスタの整合をとるのが
容易であり、整合用コンデンサの損失に基づく信号の伝
送損失を低減することができ、また実装工数が少なく、
小型集積化が可能であり、製造コストの安い高周波トラ
ンジスタの整合回路を提供するものである。Effects of the Invention As described above, the present invention provides a series circuit of a thin film capacitor or an interdigital capacitor and an open-terminated microstrip line in parallel with the main line, and connects the open end of the open-terminated microstrip line to 1/1 of the frequency. By utilizing the fact that an electrical short can be considered to occur at the fourth wavelength, that is, at the electrode end opposite to the main line connecting electrode of the main line microstrip line of the thin film capacitor or interdigital capacitor, this terminated open group 5 microstrip line can be By connecting it to an island-shaped electrode, the length can be changed and the matching state with the transistor can be adjusted.This makes it easy to match high frequency, high output transistors with low impedance, and is suitable for matching. Signal transmission loss due to capacitor loss can be reduced, and the number of mounting steps is reduced.
The present invention provides a high-frequency transistor matching circuit that can be integrated in a small size and is inexpensive to manufacture.
第1図は本発明の一実施例を示す基本構造図、第2図は
第1の基本構成を用いた他の実施例の構造図、第3図、
第4図は従来例の構造図を示したものである。
101・・・・・・トランジスタ、102・・・・・・
人力整合回路基板、103・・・・・・出力整合回路基
板、104・・・・・・入力側主線路、105・・・・
・・出力側主線路、106.107.114.115・
・・・・・ワイヤー、108・・・・・・入力整合用薄
膜コンデンサ、109・・・・・・出力整合用薄膜コン
デンサ、110・・・・・・人力整合用終端開放マイク
ロストリップ6
プライン、111・・・・・・出力整合用終端開放マイ
クロストリップライン、112・・・・・・島状電極。FIG. 1 is a basic structural diagram showing one embodiment of the present invention, FIG. 2 is a structural diagram of another embodiment using the first basic configuration, and FIG.
FIG. 4 shows a structural diagram of a conventional example. 101...Transistor, 102...
Manual matching circuit board, 103...Output matching circuit board, 104...Input side main line, 105...
・・Output side main line, 106.107.114.115・
... wire, 108 ... thin film capacitor for input matching, 109 ... thin film capacitor for output matching, 110 ... open-terminated microstrip 6 pline for manual matching, 111... Open-terminated microstrip line for output matching, 112... Island electrode.
Claims (2)
ンジスタのインピーダンス整合回路において、主線路と
並列に薄膜コンデンサもしくはインターデジタルコンデ
ンサと終端開放マイクロストリップラインの直列回路を
有し、このマイクロストリップラインがインピーダンス
を整合させようとする当該周波数において管内波長の1
/4波長となっていることを特徴とする高周波トランジ
スタの整合回路。(1) In a transistor impedance matching circuit that uses a microstrip line as the main line, a series circuit of a thin film capacitor or an interdigital capacitor and an open-terminated microstrip line is installed in parallel with the main line, and this microstrip line matches the impedance. 1 of the channel wavelength at the frequency to be
A high-frequency transistor matching circuit characterized by having a /4 wavelength.
極を設けこの島状電極と前記終端開放マイクロストリッ
プラインを接続する事により、薄膜コンデンサもしくは
インターデジタルコンデンサと終端開放マイクロストリ
ップラインの直列回路のインピーダンスを変化させるこ
とができることを特徴とする請求項(1)記載の高周波
トランジスタの整合回路。(2) By providing an island-shaped electrode near the open-terminated microstrip line and connecting this island-like electrode to the open-terminated microstrip line, the impedance of the series circuit of the thin-film capacitor or interdigital capacitor and the open-terminated microstrip line can be reduced. 2. The high frequency transistor matching circuit according to claim 1, wherein the matching circuit can be changed.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1203298A JPH0366210A (en) | 1989-08-04 | 1989-08-04 | Matching circuit for high frequency transistor |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1203298A JPH0366210A (en) | 1989-08-04 | 1989-08-04 | Matching circuit for high frequency transistor |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0366210A true JPH0366210A (en) | 1991-03-20 |
Family
ID=16471715
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1203298A Pending JPH0366210A (en) | 1989-08-04 | 1989-08-04 | Matching circuit for high frequency transistor |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0366210A (en) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0575361A (en) * | 1991-09-12 | 1993-03-26 | Mitsubishi Electric Corp | Microwave amplifier |
| US6130589A (en) * | 1997-06-04 | 2000-10-10 | Nec Corporation | Matching circuit and a method for matching a transistor circuit |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59105341A (en) * | 1982-12-09 | 1984-06-18 | Mitsubishi Electric Corp | Interdigital capacitor |
| JPS62271502A (en) * | 1987-04-24 | 1987-11-25 | Toshiba Corp | Matching circuit for microwave device |
| JPS6444101A (en) * | 1987-08-12 | 1989-02-16 | Toshiba Corp | Impedance matching circuit device |
-
1989
- 1989-08-04 JP JP1203298A patent/JPH0366210A/en active Pending
Patent Citations (3)
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