JPH0373020A - マイクロプログラム制御装置 - Google Patents

マイクロプログラム制御装置

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Publication number
JPH0373020A
JPH0373020A JP20786289A JP20786289A JPH0373020A JP H0373020 A JPH0373020 A JP H0373020A JP 20786289 A JP20786289 A JP 20786289A JP 20786289 A JP20786289 A JP 20786289A JP H0373020 A JPH0373020 A JP H0373020A
Authority
JP
Japan
Prior art keywords
control
micromemory
micromemories
signal
supplied
Prior art date
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Pending
Application number
JP20786289A
Other languages
English (en)
Inventor
Masaru Murakawa
村川 賢
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujifilm Business Innovation Corp
Original Assignee
Fuji Xerox Co Ltd
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Filing date
Publication date
Application filed by Fuji Xerox Co Ltd filed Critical Fuji Xerox Co Ltd
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Publication of JPH0373020A publication Critical patent/JPH0373020A/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (産業上の利用分野) 本発明はマイクロプログラム制御装置に関するものであ
り、特に、フィードバック制御によって、制御を多様化
するのに好適なマイクロプログラム制御装置に関する。
(従来の技術) 従来のマイクロプログラム制御(以下、マイクロ制御と
いう)装置の一例を図面を参照して説明する。第3図は
従来のマイクロ制御装置の構成を示すブロック図、第4
図は従来のマイクロ制御装置による制御状態遷移図であ
る。
第3図および第4図において、状態記憶素子(以下、ラ
ッチという)1に人力される信号は、外部演算手段での
演算結果の状態を示すフラグの内容(ステータス信号C
)、および状態/制御記述素子(以下、ROMという)
2からのフィードバック信号すである。
前記ステータス信号Cとフィードバック信号bとは、制
御用のクロック信号CKがノ\イ“H″の時に取込まれ
てラッチ1の出力aとなって現れる。
このステータス信号Cとフィードバック信号すとに基づ
く出力aは、例えばROM2のアドレスであり、このア
ドレスで指定されたROM2の内容が読出されて他の回
路を制御するためのコントロール信号dになる。
したがって、ROM2から出力されるコントロール信号
dは、自ら出力されるフィードパ1.り信号すによって
その内容が変更される。
(発明が解決しようとする課題) このように、従来のマイクロ制御装置では、ROM2か
ら出力されたフィードバック信号すによってコントロー
ル信号dの内容を変更できるが、その変更内容はROM
2からのフィードバック信号すによるたけであり、比較
的111純なものに限定されていた。
ところで、近年コンピュータの使用範囲が拡大されるに
伴って複雑多様な制御内容を要求されるようになってき
た。そして、このような要求を満足させるマイクロ制御
装置としては、上述の従来装置のように単純な構成によ
るものでは不十分であり、このためにより複雑な制御内
容の変更を行い得るマイクロ制御装置の出現が望まれて
いた。
本発明の目的は、前述の要求を満足でき、制御内容に多
様な変化を与えることによって、より複雑な制御を行う
ことができるマイクロ制御装置を提供することにある。
(課題を解決するための手段および作用)前記の問題点
を解決し、目的を達成するために本発明は、各々が別の
系を制御する段数のマイクロメモリを備え、これらのマ
イクロメモリの各々で実行された制御内容に基づく情報
を他のマイクロメモリに供給するようにこれら複数のマ
イクロメモリを多段に配した点に特徴がある。
上記特徴を有する本発明によれば、各マイクロメモリの
制御結果に基づく情報によって、他のマイクロメモリの
制御内容を変更させることができる。
(吏施例) 以下、図面を参照して本発明の詳細な説明する。
第1図は本発明の一実施例であるマイクロ制御装置の構
成を示すブロック図、第2図はこのマイクロ制御装置に
よる制御状態遷移図である。
同図に示したように、本実施例のマイクロ制御装置は、
ラッチおよびROMからなるマイクロメモリを2段付し
ている。つまり、このマイクロ制御装置は第1のラッチ
1aおよび第1のROM2aからなる前段マイクロメモ
リAと、第2のラッチ1bおよび第2のROFv12b
からなる後段マイクロメモリBとから構成されている。
このような2段のマイクメモリを有する本実施例におい
て、前段マイクロメモリAのROM2 aからは、ラッ
チ1aに対するフィードバック信号b1、および後段マ
イクロメモリBのラッチ1bに供給される信号fが出力
される。
一方、後段マイクロメモリBのROM2bからは、ラッ
チ1bに対するフィードバック信号b2、および前段の
マイクロメモリAのラッチ1aに供給される信号eが出
力される。
ラッチ1aには前記ROM2a、2bからのフィードバ
ック信号bl、eのほか、外部演算手段での演算結果の
状態を示すステータス信号C1が供給される。また、ラ
ッチ1bには前記ROM2a、2bからのフィードバッ
ク信号f、b2のほか、外部演算手段での演算結果の状
態を示すステータス信号C2が供給される。これらラッ
チla、lbに供給される信号はそれぞれ制御用のクロ
ック信号CKI、CK2に応答してラソチla、lbに
取込まれる。
そして、これらラッチla、lbに取込まれた信号に基
づいてアドレスal、a2がそれぞれ形成されてROM
2a、2bに供給される。アドレスal、a2が供給さ
れると、ROM2a、2bからはそれぞれ他の回路を制
御するコントロール信号di、d2が出力される。
前記第1および第2のROM2a、2bから第1および
第2のラッチla、lbに供給されるフィードバック信
号bl、b2は、例えば、それぞれ第1および第2のR
OM2 g、2bから出力される次のマイクロ命令のア
トルスの一部を構成するデータであり、第2のROM2
bから第1のラッチ1aに供給されるフィードバック信
号eは、ml(7)ROM2aから出力される次のマイ
クロ命令ノアドレスの一部を構成するデルりである。
コノように、本実施例では、各マイクロメモリA、Bか
ら前回どのようなコントロール信号h< 出力されたか
、つまりどのような制御を行ったかによって次に実行さ
れる命令のアドレスデータが各ラノチla、lbにフィ
ードバック信号として供給される。したがって、このフ
ィードバック信号によってROM2a、2bから出力さ
れるコントロール信号d1..d2、つまり次の制iM
容が決定される。
さらに、前段マイクロメモリAのROM2aからどのよ
うな内容のコントロール信号が出力されたかの情報(信
号f)が後段マイクロメモリBに供給され、後段マイク
ロメモリBのROM2bからはどのような内容のコント
ロール信号が出力されたかという情報に関連して決定さ
れるアドレスデータ(信号e)が、前段マイクロメモリ
Aに供給される。したがってこれらの信号e、fによっ
ても次に実行される制御の内容が決定される。
こうして、ROM2a、2bは互いに別の系にコントロ
ール信号d1.d2を送出しながら、その制御情報を他
のマイクロメモリに供給し、マイクロメモリから出力さ
れるコントロール(R号の内容を変更することができる
なお、本実施例では、マイクロメモリを2紹使用した構
成例を示したが、本発明によるマイクロ制御装置ではマ
イクロメモリの数は2組に限定されるものではなく、さ
らに多くのマイクロメモリを使用することによって、よ
り高度な制御を行い得ることはもちろんである。
(発明の効果) 以上の説明から明らかなように、本発明によれば、複数
のマイクロメモリから出力されるコントロール信号によ
って複数の系を制御しながら、各々のマイクロメモリの
制御結果に基づいて他の系の制御内容を変更できる。し
たがって、従来比較的Qi純なものに限定されていた制
御内容の変更を多様化させることができ、より復雑な処
理をさせることができるようになる。
【図面の簡単な説明】
第1図は、本発明の実施例の構成を示すブロック図、第
2図は実施例によるマイクロ制御の状態遷移図、第3図
は従来のマイクロ制御装置の構成を示すブロック図、第
4図は従来のマイクロ制御の状態遷移図である。 第 図

Claims (2)

    【特許請求の範囲】
  1. (1)別々の系を制御するための複数のマイクロメモリ
    と、 該複数のマイクロメモリの各々で実行された制御内容に
    基づく情報を他のマイクロメモリに供給する回路とを具
    備したことを特徴とするマイクロプログラム制御装置。
  2. (2)前記マイクロメモリが、 ROMと、 該ROMで前回実行された制御内容に基づくフィードバ
    ック信号および外部での演算結果に基づくステータス信
    号を保持するラッチと、 該ラッチに保持された信号によって形成されたアドレス
    を前記ROMに供給する回路とを具備し、前記複数のマ
    イクロメモリの各々で実行された制御内容に基づく情報
    が他のマイクロメモリのラッチに供給されることを特徴
    とする請求項1記載のマイクロプログラム制御装置。
JP20786289A 1989-08-14 1989-08-14 マイクロプログラム制御装置 Pending JPH0373020A (ja)

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JP20786289A JPH0373020A (ja) 1989-08-14 1989-08-14 マイクロプログラム制御装置

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JP20786289A Pending JPH0373020A (ja) 1989-08-14 1989-08-14 マイクロプログラム制御装置

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