JPH04100232A - 半導体装置 - Google Patents

半導体装置

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JPH04100232A
JPH04100232A JP21841390A JP21841390A JPH04100232A JP H04100232 A JPH04100232 A JP H04100232A JP 21841390 A JP21841390 A JP 21841390A JP 21841390 A JP21841390 A JP 21841390A JP H04100232 A JPH04100232 A JP H04100232A
Authority
JP
Japan
Prior art keywords
film
tin
wiring
oxide film
nitride
Prior art date
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Pending
Application number
JP21841390A
Other languages
English (en)
Inventor
Hiroko Ogino
荻野 ひろ子
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Seiko Epson Corp
Original Assignee
Seiko Epson Corp
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Filing date
Publication date
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Pending legal-status Critical Current

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  • Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
  • Formation Of Insulating Films (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [産業上の利用分野] 本発明は、半導体装置の保護膜の構造に関する。
[従来の技術] 従来の半導体装置及びその表面保護膜の構造は第3図の
ような窒化膜による一層構造をしており、この構造はA
l合金膜に与える応力が大きくエレクトロマイグレーシ
ョン及びストレスマイグレーション耐性が劣化した。
この事を従来の工程を追って説明すると、まずSi基板
301上に酸化膜(SiO2)302を全面に形成しフ
ォトエッチによってコンタクト部を設ける。
さらに、高融点金属化合物とAl合金膜を含む多層配[
303〜305を形成しフォトエッチする。
最後に表面保護膜を窒化膜306 (0,8μmの一層
構造で形成する。
以上が従来の工程である。
[発明が解決しようとする課題及び目的]しかし、前述
の従来技術では、表面保護膜が窒化膜による一層構造で
あるため、Al合金膜に与える応力が大きくエレクトロ
マイグレーション、ストレスマイグレーション耐性が劣
化するという課題点があった。
そこで、本発明はこのような課題点を解決するもので、
その目的とするところは、表面保護膜を形成する際、従
来の一層構造から酸化膜と窒化膜の二層構造にすること
によって、Al合金に与える応力を緩和させより信頼性
の高い多層配線を提供するところにある。
[課題を解決するための手段] 本発明の半導体装置は、高融点金属化合物とA」5合金
膜を含む多層配線の表面を酸化膜と窒化膜で保護し、二
層構造とすることを特徴とする。
[作用] 本発明の上記の構成によれば、保護膜を形成する際、表
面を酸化膜と窒化膜で保護し二層構造にする事によって
、Al合金膜に与える応力を緩和させより信頼性の高い
多層配線を備えた半導体装置を構成できる。
[実施例] 本発明の半導体装置は、第1図に示される構造をしてい
る。
101はSi基板、102は酸化膜の二酸化珪素、10
3は窒化チタン、104はアルミ合金膜、105は窒化
チタン、106は保護膜の5i02.107は保護膜の
5i3Naである。
以下、詳細は工程を追いながら説明していく。
(第2図(a)〜(e)) まず、Si基板201の表面全体に紛縁膜としテ酸化膜
(Si02)202を4000人形成する。
さらに、フォトエッチによってコンタクト開孔部を設け
る。(第2図(a)) 次いで、配線層を形成する工程として、まず、スパッタ
リング装置内に窒素ガスを導入し、アルゴンと窒素の混
合ガスにより、基板温度200℃の条件下で、反応性ス
パッタを行い、膜厚1000人の窒化チタン膜(TiN
)203を形成する。
さらにその上層にアルミ合金(A 1−0. 5  %
Cu)204をスパッタし、膜厚0.5μmのアルミ合
金膜を得る。さらに、もう−度反応性スバッタにより、
膜厚400人の窒化チタン205を形成し、TiN/A
l−0,5%Cu / T i Nの三層構造配線を得
る。(第2図(b)) こうして得られた三層配線をフォトエッチによて同時に
パターニングする。(第2図(C))次に、該多層配線
の上層に保護膜として、5i02膜206を形成する。
(第3図(d))この際、該酸化膜の形成方法としては
、TE01(Si(○C2H3)4)によって3000
人のSiO2を形成する。さらに保護膜のSi3N、膜
207を形成する。(第2図(e)) この際、該窒化膜の形成方法としては5xHaガス60
0secm、NH3ガス6400secmの混合ガスに
より、圧力2500mtorr、温度350℃の条件下
で、S L 3 N m膜厚00人を得る。
上述の工程を経て、できあがった本発明、半導体装置は
、従来の半導体装置に比べると、表面を酸化膜と窒化膜
で保護し、二層構造にする事によって、Al合金膜に与
える応力を緩和させエレクトロマイグレーション及びス
トレスマイグレーションに強い配線が得られる。
さらに、本発明半導体装置を用いてエレクトロマイグレ
ーション試験を行ったところ、保護膜を二層にすると、
従来の一層構造に比べてTTF (Time  To 
 Fai、1ure)にして2倍以上の向上がみちれた
[発明の効果] 以上に述べた本発明によれば、従来の構造に比べて、保
護膜を形成する際、表面を酸化膜と窒化膜で保護し二層
構造にする事によって、Al合金に与える応力を緩和さ
せより信頼性の優れた半導体装置を提供できる。
【図面の簡単な説明】
第1図は、本発明の半導体装置を示す、主要断面図。 第2図(a)〜(e)は、本発明の半導体装置の製造工
程の断面図。 第3図は、従来の半導体装置を示す断面図。 101.201,301・・・Si基板102.202
,302・・・酸化膜(SiO2)103.203,3
03・・・窒化チタン(TiN)104.204,30
4・・・Al合金膜105.205,305・・・窒化
チタン(TiN)106.206    −− ・保護
膜(Si02)107.207,306・・・保護膜(
Si3N4)以  上 出願人 セイコーエプソン株式会社 代理人 弁理士 絵本喜三部 他1名 第 霞 (e 第 巳 (1)+ ((L) 第 1男 とす 力 図

Claims (1)

    【特許請求の範囲】
  1.  少なくとも高融点金属化合物とAl合金膜を含む配線
    層を有する半導体装置に於て、該多層配線の表面を酸化
    膜と窒化膜の二層構造とすることを特徴とする半導体装
    置。
JP21841390A 1990-08-20 1990-08-20 半導体装置 Pending JPH04100232A (ja)

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5427980A (en) * 1992-12-02 1995-06-27 Hyundai Electronics Industries Co., Ltd. Method of making a contact of a semiconductor memory device
US6448612B1 (en) 1992-12-09 2002-09-10 Semiconductor Energy Laboratory Co., Ltd. Pixel thin film transistor and a driver circuit for driving the pixel thin film transistor

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