JPH0410659B2 - - Google Patents
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- Publication number
- JPH0410659B2 JPH0410659B2 JP59272877A JP27287784A JPH0410659B2 JP H0410659 B2 JPH0410659 B2 JP H0410659B2 JP 59272877 A JP59272877 A JP 59272877A JP 27287784 A JP27287784 A JP 27287784A JP H0410659 B2 JPH0410659 B2 JP H0410659B2
- Authority
- JP
- Japan
- Prior art keywords
- channel
- device control
- control
- interface
- section
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
Links
Classifications
-
- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
- G06F13/10—Program control for peripheral devices
- G06F13/12—Program control for peripheral devices using hardware independent of the central processor, e.g. channel or peripheral processor
- G06F13/122—Program control for peripheral devices using hardware independent of the central processor, e.g. channel or peripheral processor where hardware performs an I/O function other than control of data transfer
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は、Ｉ／Ｏデバイスを制御する制御装置
に係り、特に、制御装置がBUSY状態の時の交
代アクセス経路を自動的に選択し、上位チヤネル
装置が交代経路を選択する為に必要な時間を削減
するのに好適なＩ／Ｏデバイス制御装置に関す
る。
に係り、特に、制御装置がBUSY状態の時の交
代アクセス経路を自動的に選択し、上位チヤネル
装置が交代経路を選択する為に必要な時間を削減
するのに好適なＩ／Ｏデバイス制御装置に関す
る。
従来の装置は、一箇体内に２台の制御部を設け
二重化しているが、その目的は、Ｉ／Ｏデバイス
に対する交代制御経路の確保にあり、その切り替
えは、上位装置であるチヤネル、またはオペレー
テイングシステムからでなければ実行できなかつ
た。したがつて装置BUSYによる交代経路選択
の為の上位装置のオーバヘツドに対する配慮がな
されていなかつた。なおこの種の装置として関連
するものには特開昭59−79330号公報がある。
二重化しているが、その目的は、Ｉ／Ｏデバイス
に対する交代制御経路の確保にあり、その切り替
えは、上位装置であるチヤネル、またはオペレー
テイングシステムからでなければ実行できなかつ
た。したがつて装置BUSYによる交代経路選択
の為の上位装置のオーバヘツドに対する配慮がな
されていなかつた。なおこの種の装置として関連
するものには特開昭59−79330号公報がある。
本発明の目的は、チヤネル装置が、Ｉ／Ｏデバ
イスをアクセスするとき、Ｉ／Ｏデバイス制御装
置が使用中でアクセス経路が使用できない場合
に、チヤネル装置または、オペレーテイング・シ
ステムが交代アクセス経路を選択する時間を削減
する為の、Ｉ／Ｏデバイス制御装置による交代ア
クセス経路自動選択機能を提供することにある。
イスをアクセスするとき、Ｉ／Ｏデバイス制御装
置が使用中でアクセス経路が使用できない場合
に、チヤネル装置または、オペレーテイング・シ
ステムが交代アクセス経路を選択する時間を削減
する為の、Ｉ／Ｏデバイス制御装置による交代ア
クセス経路自動選択機能を提供することにある。
従来、チヤネル装置が、Ｉ／Ｏデバイスを選択
し、Ｉ／Ｏ動作を行なう場合に、Ｉ／Ｏデバイス
制御装置が使用中のときは、Ｉ／Ｏデバイス制御
装置は、チヤネルに対してBUSY状態であるこ
とを報告し、その結果、オペレーテイングシステ
ム、または、チヤネル装置が交代パスを選択して
いたため、交代パス選択の為のオーバヘツドがあ
つた。一方、デイスク制御装置においては、従来
から一箇体内に２台の制御部が格納されていて、
一方が使用中の場合でも、他方が、動作可能な場
合が考えられる。したがつて、BUSY状態の場
合に、使用中の制御部に対するアクセスを動作可
能な他方の制御部へ切替えれば、Ｉ／Ｏ動作が可
能である。すなわち、上位チヤネル装置とチヤン
ネルタフエース部の間にインターフエース信号を
他Ｉ／Ｏデバイス制御部へ切替えるインタフエー
ス信号切替部を設け、任意のデバイス制御部の動
作状態によつて、当該Ｉ／Ｏ制御部がチヤンネル
インタフエース信号を他の任意のＩ／Ｏデバイス
制御部へ切替え、Ｉ／Ｏ制御を他の任意のＩ／Ｏ
デバイス制御部に代行させる機能を設けたことを
特徴とするものである。
し、Ｉ／Ｏ動作を行なう場合に、Ｉ／Ｏデバイス
制御装置が使用中のときは、Ｉ／Ｏデバイス制御
装置は、チヤネルに対してBUSY状態であるこ
とを報告し、その結果、オペレーテイングシステ
ム、または、チヤネル装置が交代パスを選択して
いたため、交代パス選択の為のオーバヘツドがあ
つた。一方、デイスク制御装置においては、従来
から一箇体内に２台の制御部が格納されていて、
一方が使用中の場合でも、他方が、動作可能な場
合が考えられる。したがつて、BUSY状態の場
合に、使用中の制御部に対するアクセスを動作可
能な他方の制御部へ切替えれば、Ｉ／Ｏ動作が可
能である。すなわち、上位チヤネル装置とチヤン
ネルタフエース部の間にインターフエース信号を
他Ｉ／Ｏデバイス制御部へ切替えるインタフエー
ス信号切替部を設け、任意のデバイス制御部の動
作状態によつて、当該Ｉ／Ｏ制御部がチヤンネル
インタフエース信号を他の任意のＩ／Ｏデバイス
制御部へ切替え、Ｉ／Ｏ制御を他の任意のＩ／Ｏ
デバイス制御部に代行させる機能を設けたことを
特徴とするものである。
以下、本発明の一実施例を第１図により説明す
る。チヤネルインタフエース信号を切替えるセレ
クタ部３とチヤネルインタフエースの接続切離し
を制御するチヤネルスイツチ部４とＩ／Ｏデバイ
スインタフエース部８とＩ／Ｏデバイスを制御す
る転送制御部１３と、Ｉ／Ｏ制御部のBUSY状
態およびマシンチエツクによる動作不能状態を表
示するBUSY表示部７と、それを監視し、Ｉ／
Ｏ動作のルート制御を行なうルート制御部５より
成るＩ／Ｏ制御部が、一つの箇体内に２台（Ｉ／
Ｏ制御部２，６）格納され、それぞれ独立に動作
可能であるＩ／Ｏ制御装置１において、チヤネル
インタフエースルートＡ１０からの起動に対し
て、Ｉ／Ｏ制御部２がBUSY状態で、起動の受
領が不能な場合、Ｉ／Ｏ制御部２のルート制御部
がＩ／Ｏ制御部６のBUSY状態をモニタし、
Ｉ／Ｏ制御部６がBUSYまたは、マシンチエツ
クによる動作不能状態でなければ、ルート制御信
号１４によつてルート切替えをチヤネルスイツチ
部に指示し、チヤネルスイツチ部は、切替信号９
によつて、チヤネルインタフエース、ルートＡ
と、Ｉ／Ｏ制御部６のインタフエース線１１が接
続され、それと同時にチヤネルインタフエース、
ルートＡ１０とＩ／Ｏ制御部２のインタフエース
線１５は切離されてチヤネルインタフエース、ル
ートＣ１６に接続される。以降、チヤネルインタ
フエースルートＡからのアクセスはＩ／Ｏ制御部
６側で処理される。Ｉ／Ｏ制御部２および６の両
側ともBUSY状態のときは、ルートの切替えは
行なわず、そのまま上位チヤネル装置に対し、
BUSY状態を報告する。本実施例によれば、
Ｉ／Ｏ制御装置が、BUSY状態のとき、BUSY
を上位チヤネル装置へ報告し、チヤネル装置、あ
るいは、オペレーレーテイングシステムが、交代
アクセス経路を選択して、再起動をかけるという
一連の動作が不要となるため、再選択および起動
の為のオーバヘツドの削減の効果があり、システ
ムの動作効率を向上させる効果がある。
る。チヤネルインタフエース信号を切替えるセレ
クタ部３とチヤネルインタフエースの接続切離し
を制御するチヤネルスイツチ部４とＩ／Ｏデバイ
スインタフエース部８とＩ／Ｏデバイスを制御す
る転送制御部１３と、Ｉ／Ｏ制御部のBUSY状
態およびマシンチエツクによる動作不能状態を表
示するBUSY表示部７と、それを監視し、Ｉ／
Ｏ動作のルート制御を行なうルート制御部５より
成るＩ／Ｏ制御部が、一つの箇体内に２台（Ｉ／
Ｏ制御部２，６）格納され、それぞれ独立に動作
可能であるＩ／Ｏ制御装置１において、チヤネル
インタフエースルートＡ１０からの起動に対し
て、Ｉ／Ｏ制御部２がBUSY状態で、起動の受
領が不能な場合、Ｉ／Ｏ制御部２のルート制御部
がＩ／Ｏ制御部６のBUSY状態をモニタし、
Ｉ／Ｏ制御部６がBUSYまたは、マシンチエツ
クによる動作不能状態でなければ、ルート制御信
号１４によつてルート切替えをチヤネルスイツチ
部に指示し、チヤネルスイツチ部は、切替信号９
によつて、チヤネルインタフエース、ルートＡ
と、Ｉ／Ｏ制御部６のインタフエース線１１が接
続され、それと同時にチヤネルインタフエース、
ルートＡ１０とＩ／Ｏ制御部２のインタフエース
線１５は切離されてチヤネルインタフエース、ル
ートＣ１６に接続される。以降、チヤネルインタ
フエースルートＡからのアクセスはＩ／Ｏ制御部
６側で処理される。Ｉ／Ｏ制御部２および６の両
側ともBUSY状態のときは、ルートの切替えは
行なわず、そのまま上位チヤネル装置に対し、
BUSY状態を報告する。本実施例によれば、
Ｉ／Ｏ制御装置が、BUSY状態のとき、BUSY
を上位チヤネル装置へ報告し、チヤネル装置、あ
るいは、オペレーレーテイングシステムが、交代
アクセス経路を選択して、再起動をかけるという
一連の動作が不要となるため、再選択および起動
の為のオーバヘツドの削減の効果があり、システ
ムの動作効率を向上させる効果がある。
本発明によれば、Ｉ／Ｏデバイスアクセスの際
に、Ｉ／Ｏデバイス制御装置が使用中である場合
のチヤネル装置、またはオペレーテイングシステ
ムによる交代アクセス経路の選択時間と、再起動
に要するインタフエース動作を削減できるので、
システムスループツト向上の効果がある。
に、Ｉ／Ｏデバイス制御装置が使用中である場合
のチヤネル装置、またはオペレーテイングシステ
ムによる交代アクセス経路の選択時間と、再起動
に要するインタフエース動作を削減できるので、
システムスループツト向上の効果がある。
第１図は本発明の一実施例のＩ／Ｏデバイス制
御装置のブロツク図である。 １…Ｉ／Ｏデバイス制御装置、３…インタフエ
ース信号切替部、４…チヤネルスイツチ、５…ル
ート制御部、９…ルート切替信号、１１，１５…
インタフエース線、１３…Ｉ／Ｏ制御部、１４…
ルート制御信号。
御装置のブロツク図である。 １…Ｉ／Ｏデバイス制御装置、３…インタフエ
ース信号切替部、４…チヤネルスイツチ、５…ル
ート制御部、９…ルート切替信号、１１，１５…
インタフエース線、１３…Ｉ／Ｏ制御部、１４…
ルート制御信号。
Claims (1)
- 【特許請求の範囲】 １ 上位チヤネル装置からのインタフエース信号
の入出力を制御するチヤネルインタフエース部
と、Ｉ／Ｏ動作制御部とＩ／Ｏデバイスインタフ
エース部を含み上記チヤネルインタフエース部と
対応して設けられたＩ／Ｏデバイス制御部を、筐
体内に複数台格納し、それぞれのＩ／Ｏデバイス
制御部が独立に動作可能としたＩ／Ｏデバイス制
御装置において、 上記Ｉ／Ｏデバイス制御装置内に、それぞれの
Ｉ／Ｏデバイス制御部の動作状況を監視する監視
手段と、 上記チヤネルインタフエース部と上記Ｉ／Ｏデ
バイス制御部との間に、上記監視手段の出力によ
つて上位チヤネル装置から割り当てられたＩ／Ｏ
デバイス制御部へのインタフエース信号を、他の
Ｉ／Ｏデバイス制御部へ切換えて出力するインタ
フエース信号切換部と、を設けたことを特徴とす
るＩ／Ｏデバイス制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27287784A JPS61151764A (ja) | 1984-12-26 | 1984-12-26 | Ｉ／ｏデバイス制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27287784A JPS61151764A (ja) | 1984-12-26 | 1984-12-26 | Ｉ／ｏデバイス制御装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61151764A JPS61151764A (ja) | 1986-07-10 |
| JPH0410659B2 true JPH0410659B2 (ja) | 1992-02-26 |
Family
ID=17520005
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP27287784A Granted JPS61151764A (ja) | 1984-12-26 | 1984-12-26 | Ｉ／ｏデバイス制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61151764A (ja) |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59111516A (ja) * | 1982-12-17 | 1984-06-27 | Fujitsu Ltd | インタ−フエイス切り換え方式 |
-
1984
- 1984-12-26 JP JP27287784A patent/JPS61151764A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS61151764A (ja) | 1986-07-10 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |