JPH04127214A - 電源制御方式 - Google Patents
電源制御方式Info
- Publication number
- JPH04127214A JPH04127214A JP2247103A JP24710390A JPH04127214A JP H04127214 A JPH04127214 A JP H04127214A JP 2247103 A JP2247103 A JP 2247103A JP 24710390 A JP24710390 A JP 24710390A JP H04127214 A JPH04127214 A JP H04127214A
- Authority
- JP
- Japan
- Prior art keywords
- power
- contact
- switch
- program
- operator
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Power Sources (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は計算機システムの電源制御に関し、特に電源切
断制御方法に関するものである。
断制御方法に関するものである。
ジョブの実行途中で、システムの電源切断を防止する方
法としては、特開昭５８−１６８１１８号公報に記載の
ように、あらかじめ計画されたスケジュールにより電源
切断を行なうシステムにおいて、電源切断時該にまだジ
ョブが実行中であった場合、ジョブの終了を待って電源
切断を行なう方式が知られている。
法としては、特開昭５８−１６８１１８号公報に記載の
ように、あらかじめ計画されたスケジュールにより電源
切断を行なうシステムにおいて、電源切断時該にまだジ
ョブが実行中であった場合、ジョブの終了を待って電源
切断を行なう方式が知られている。
上記従来技術は、オペレータの電源スイッチの操作によ
る電源切断に対する配慮がされておらずオペレータの誤
操作によってジョブの実行中にシステムの電源が切断さ
れてしまう問題があった。
る電源切断に対する配慮がされておらずオペレータの誤
操作によってジョブの実行中にシステムの電源が切断さ
れてしまう問題があった。
本発明の目的は、オペレータの電源スイッチの操作によ
り、ジョブの実行中にシステムの電源切断が発生するこ
とを防ぐことにある。
り、ジョブの実行中にシステムの電源切断が発生するこ
とを防ぐことにある。
上記目的を達成するために、電源制御回路内に電源スイ
ッチからの信号に並列に接点回路を設けこの接点の制御
をプログラマブルとし、システムの電源投入後プログラ
ムにより該接点を接続状態とし、オペレータの電源スイ
ッチのオフ操作によっては電源が切断できない様にした
ものである。
ッチからの信号に並列に接点回路を設けこの接点の制御
をプログラマブルとし、システムの電源投入後プログラ
ムにより該接点を接続状態とし、オペレータの電源スイ
ッチのオフ操作によっては電源が切断できない様にした
ものである。
また、電源スイッチの状態をプログラムから読出し可能
とすることにより、オペレータが電源スイッチをオフし
たことをプログラムに知らせ、以降新たなジョブの受付
けを抑止させ、現在実行中のジョブが終了した時点で該
接点を未接続状態とすることにより、システムの電源を
切断する様にしたものである。
とすることにより、オペレータが電源スイッチをオフし
たことをプログラムに知らせ、以降新たなジョブの受付
けを抑止させ、現在実行中のジョブが終了した時点で該
接点を未接続状態とすることにより、システムの電源を
切断する様にしたものである。
オペレータは、電源スイッチをオンすることにより、シ
ステムの電源投入を行なう。システム制御プログラムは
、システム立上げ処理の一環として、接点回路の接続命
令を発行する。接点回路は電源スイッチと並列に接続さ
れた接点を接続状態にすることにより、電源スイッチの
状態が電源制御に直接反映されない様にする。この一連
の動作の終了後、ジョブの開始を行なう。
ステムの電源投入を行なう。システム制御プログラムは
、システム立上げ処理の一環として、接点回路の接続命
令を発行する。接点回路は電源スイッチと並列に接続さ
れた接点を接続状態にすることにより、電源スイッチの
状態が電源制御に直接反映されない様にする。この一連
の動作の終了後、ジョブの開始を行なう。
次に電源を切断する場合、オペレータは電源スミ源オフ
要求を行なう、システム制御プログラムは、オペレータ
からの電源オフ要求を受取ると、以降新たなジョブの受
付けを抑止し、現在実行中のジ１ブの終了を待つ、ジョ
ブの終了を検出すると、接点回路の切離し命令を発行す
る。接点回路は電源スイッチと並列に接続された接点を
未接続状態とすることにより、システムの電源を切断す
る。このことによって、オペレータの誤操作によっても
ジョブの実行中にシステムの電源が切断されることがな
くなる。
要求を行なう、システム制御プログラムは、オペレータ
からの電源オフ要求を受取ると、以降新たなジョブの受
付けを抑止し、現在実行中のジ１ブの終了を待つ、ジョ
ブの終了を検出すると、接点回路の切離し命令を発行す
る。接点回路は電源スイッチと並列に接続された接点を
未接続状態とすることにより、システムの電源を切断す
る。このことによって、オペレータの誤操作によっても
ジョブの実行中にシステムの電源が切断されることがな
くなる。
以下、本発明の一実施例を第１図により説明する。
第１図は、本発明を用いた計算機システムの概略構成図
である。電源スイッチ６は、第１接点６−ａと第２接点
６−ｂを持つ２連のスイッチであり、オペレータにより
操作される。オペレータが電源スイッチ６を投入すると
、第１接点６−ａ。
である。電源スイッチ６は、第１接点６−ａと第２接点
６−ｂを持つ２連のスイッチであり、オペレータにより
操作される。オペレータが電源スイッチ６を投入すると
、第１接点６−ａ。
第２接点６−ｂが接続状態となる。第１接点６−ａから
の接点信号ａは電源制御部１を経由して電源オン信号Ｃ
として電源ユニット７に伝えられ、電源が投入され電源
ユニット７よりＤＣ電圧が出力される。その後、ファイ
ル装置１２よりプログラムが主メモリ１１にロードされ
実行される。
の接点信号ａは電源制御部１を経由して電源オン信号Ｃ
として電源ユニット７に伝えられ、電源が投入され電源
ユニット７よりＤＣ電圧が出力される。その後、ファイ
ル装置１２よりプログラムが主メモリ１１にロードされ
実行される。
プログラムは、電源スイッチ６による電源切断を抑止す
るための電源保持命令をシステムバスｈを介して電源制
御部１に発行する。
るための電源保持命令をシステムバスｈを介して電源制
御部１に発行する。
電源保持命令は命令デコーダ３により解読され電源保持
信号ｅとして電源保持回路２に伝えられ接点駈動用信号
ｇにより保持接点４を駆動する。
信号ｅとして電源保持回路２に伝えられ接点駈動用信号
ｇにより保持接点４を駆動する。
このことにより電源スイッチ６の状態にかかわらず電源
オン信号Ｃが出力される。
オン信号Ｃが出力される。
この状態でオペレータが電源スイッチ６を切断すると、
第２接点６−ｂからのスイッチモニタ信号６が切断され
、スイッチモニタ回路５を介してパワーオフ割込み信号
ｄがＣＰ ＵＩＯへ伝えられる。
第２接点６−ｂからのスイッチモニタ信号６が切断され
、スイッチモニタ回路５を介してパワーオフ割込み信号
ｄがＣＰ ＵＩＯへ伝えられる。
プログラムはパワーオフ割込み信号ｄを検出すると以降
のジョブの起動を抑止し、現在実行中のジョブの終了を
待つ。
のジョブの起動を抑止し、現在実行中のジョブの終了を
待つ。
４゜
プログラムはジョブの終了を検出すると電源オフ命令を
システムバスｈを介して電源制御部１に発行する。電源
オフ命令は命令デコーダ３により解読され電源オフ信号
ｆとして電源保持回路２に出力される。電源オフ信号ｆ
により接点駈動用信号ｇがオフされ保持接点４を開放す
る。
システムバスｈを介して電源制御部１に発行する。電源
オフ命令は命令デコーダ３により解読され電源オフ信号
ｆとして電源保持回路２に出力される。電源オフ信号ｆ
により接点駈動用信号ｇがオフされ保持接点４を開放す
る。
これにより電源オン信号Ｃがオフされ電源が切断される
。
。
なお第１図においてノイズフィルタ９はＡＣ入力のノイ
ズ除去、エマ−ジエンジ−スイッチ８は電源異常等の緊
急時の電源切断を行なうためのスイッチである。
ズ除去、エマ−ジエンジ−スイッチ８は電源異常等の緊
急時の電源切断を行なうためのスイッチである。
本発明によれば、電源オフのタイミングはプログラムに
より管理することができるので、オペレータの誤操作に
よるジョブ途中での電源断を防ぐことができる。
より管理することができるので、オペレータの誤操作に
よるジョブ途中での電源断を防ぐことができる。
第１図は本発明を用いた計算機システムの概略構成図で
ある。 １・・・電源制御部、 ２・・・電源保持回路。 ３・・・命令デコーダ、 ４・・・保持接点、 ５・・・スイッチモニタ回路、 ６・・・電源スイッチ、 ６−ａ・・第１接点、 ６−ｂ・・・第２接点、 ７・・・電源ユニット、 ８・・・エマ−ジエンジ−スイッチ、 ９・・・ノイズフィルタ、 １０・・・ＣＰＵ、 １１・・・主メモリ、 １２・・・ファイル装置。
ある。 １・・・電源制御部、 ２・・・電源保持回路。 ３・・・命令デコーダ、 ４・・・保持接点、 ５・・・スイッチモニタ回路、 ６・・・電源スイッチ、 ６−ａ・・第１接点、 ６−ｂ・・・第２接点、 ７・・・電源ユニット、 ８・・・エマ−ジエンジ−スイッチ、 ９・・・ノイズフィルタ、 １０・・・ＣＰＵ、 １１・・・主メモリ、 １２・・・ファイル装置。
Claims (1)
- １、オペレータが操作する電源スイッチと該電源スイッ
チの状態により、処理装置の電源制御を行なう計算機シ
ステムにおいて、電源制御部に、電源スイッチの状態に
かかわらず、電源を投入状態にする電源保持用回路と、
プログラムにより該電源保持用回路の動作を有効、無効
にする手段と、該電源スイッチのオン／オフ状態をプロ
グラムに知らせる手段を有しジョブの実行中は、プログ
ラムによりオペレータが行なった電源オフ操作を無効と
し、ジョブの終了後システムの電源オフを行なうことを
特徴とした電源制御方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2247103A JPH04127214A (ja) | 1990-09-19 | 1990-09-19 | 電源制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2247103A JPH04127214A (ja) | 1990-09-19 | 1990-09-19 | 電源制御方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04127214A true JPH04127214A (ja) | 1992-04-28 |
Family
ID=17158474
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2247103A Pending JPH04127214A (ja) | 1990-09-19 | 1990-09-19 | 電源制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04127214A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0784684A (ja) * | 1993-09-13 | 1995-03-31 | Nec Corp | コンピュータシステム |
| JPH1027072A (ja) * | 1996-07-09 | 1998-01-27 | Nec Field Service Ltd | データディスクアレイ装置 |
-
1990
- 1990-09-19 JP JP2247103A patent/JPH04127214A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0784684A (ja) * | 1993-09-13 | 1995-03-31 | Nec Corp | コンピュータシステム |
| JPH1027072A (ja) * | 1996-07-09 | 1998-01-27 | Nec Field Service Ltd | データディスクアレイ装置 |
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