JPH04147660A - 電子部品 - Google Patents
電子部品Info
- Publication number
- JPH04147660A JPH04147660A JP27194490A JP27194490A JPH04147660A JP H04147660 A JPH04147660 A JP H04147660A JP 27194490 A JP27194490 A JP 27194490A JP 27194490 A JP27194490 A JP 27194490A JP H04147660 A JPH04147660 A JP H04147660A
- Authority
- JP
- Japan
- Prior art keywords
- leads
- lead
- printed wiring
- wiring board
- package
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
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Classifications
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K1/00—Printed circuits
- H05K1/18—Printed circuits structurally associated with non-printed electric components
- H05K1/182—Printed circuits structurally associated with non-printed electric components associated with components mounted in printed circuit boards [PCB], e.g. insert-mounted components [IMC]
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K3/00—Apparatus or processes for manufacturing printed circuits
- H05K3/30—Assembling printed circuits with electric components, e.g. with resistors
- H05K3/32—Assembling printed circuits with electric components, e.g. with resistors electrically connecting electric components or wires to printed circuits
- H05K3/34—Assembling printed circuits with electric components, e.g. with resistors electrically connecting electric components or wires to printed circuits by soldering
- H05K3/341—Surface mounted components
- H05K3/3421—Leaded components
Landscapes
- Structures For Mounting Electric Components On Printed Circuit Boards (AREA)
- Lead Frames For Integrated Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、電子部品のパッケージ及びその実装構造に
関するものである。
関するものである。
第3図a、bは従来の表面実装型ICの外形を示す正面
図と平面図である0図において、1は表面実装型ICで
あり、2はそのリード部、3は樹脂部である。また第4
図a、bは上記表面実装型IC1をプリント配線基板4
にはんだ付けした状態を示す正面図と平面図である。
図と平面図である0図において、1は表面実装型ICで
あり、2はそのリード部、3は樹脂部である。また第4
図a、bは上記表面実装型IC1をプリント配線基板4
にはんだ付けした状態を示す正面図と平面図である。
従来の表面実装型ICは以上の様に構成されているが、
近年のパッケージの軽薄短小化に伴うリードピッチの狭
小化により、はんだ付けの際、ショートが非常に発生し
易く、かつパッケージの薄型化の限界による基板への部
品実装後の厚み制限が生じるなどの問題点があった。
近年のパッケージの軽薄短小化に伴うリードピッチの狭
小化により、はんだ付けの際、ショートが非常に発生し
易く、かつパッケージの薄型化の限界による基板への部
品実装後の厚み制限が生じるなどの問題点があった。
この発明は上記のような問題点を解消するためになされ
たもので、はんだ付は時のリード間ショートが防止でき
、かつ基板への部品実装後の厚みが薄くできるようにす
ることを目的とする。
たもので、はんだ付は時のリード間ショートが防止でき
、かつ基板への部品実装後の厚みが薄くできるようにす
ることを目的とする。
この発明に係る電子部品のパッケージは、2種類以上の
リード形状を有し、かつはんだ付は時のリード間ショー
トの発生しにくいリード形状にすると共に、プリント配
線基板にザグリを設けて実装した際に厚み方向に対して
薄型化できる構造としたものである。
リード形状を有し、かつはんだ付は時のリード間ショー
トの発生しにくいリード形状にすると共に、プリント配
線基板にザグリを設けて実装した際に厚み方向に対して
薄型化できる構造としたものである。
この発明における電子部品のパッケージは、2種類のリ
ード形状を交互に配しリード間距離を大きくとるように
してリード間ショートを防止し、かつリード接地高さを
リード形状ごとに変化させ、かつ基板側にザグリを設け
ることにより厚みを薄型化する。
ード形状を交互に配しリード間距離を大きくとるように
してリード間ショートを防止し、かつリード接地高さを
リード形状ごとに変化させ、かつ基板側にザグリを設け
ることにより厚みを薄型化する。
以下、この発明の一実施例を図について説明する。第1
図a、bにおいて、1は表面実装型ICであり、5はそ
のリード部で、5aはガルウィング型ICリード、5b
はリード加工を行わずストレートのままのICリードで
あって、これらのり−ド5a、5bは交互に配設されて
いる。
図a、bにおいて、1は表面実装型ICであり、5はそ
のリード部で、5aはガルウィング型ICリード、5b
はリード加工を行わずストレートのままのICリードで
あって、これらのり−ド5a、5bは交互に配設されて
いる。
跋た第2図a、bは上記表面実装型ICをプリント配線
板4にはんだ付けされた状態を示すもので、6はプリン
ト配線基板4に設けたザグリ部を示す。
板4にはんだ付けされた状態を示すもので、6はプリン
ト配線基板4に設けたザグリ部を示す。
以上のように第1の発明によれば、2種類のリード形状
のものを交互に配したので、リード間距離が大きくとれ
、はんだ付は時のリード間ショートが防止できる。
のものを交互に配したので、リード間距離が大きくとれ
、はんだ付は時のリード間ショートが防止できる。
また第2の発明では、基板側にザグリを設けることによ
り、基板に部品を実装した際に厚み方向の薄型化が可能
となる。
り、基板に部品を実装した際に厚み方向の薄型化が可能
となる。
第1図a、bはこの発明の一実施例による電子部品のパ
ッケージを示す正面図と平面図、第2図a、bはこの発
明の電子部品パッケージをプリント配線基板に実装した
状態を示す正面図と平面図、第3図a、bは従来の電子
部品パッケージ構造を示す正面図と平面図、第4図a、
bは従来の電子部品パッケージをプリント配線基板に実
装した状態を示す正面図と平面図である。 図中、1は表面実装型ICl3は樹脂部、4はプリント
配線基板、5aはガルウィング型ICリード、5bはス
トレートのICリード、6はザグリ部である。 なお、図中同一符号は同−又は相当部分を示す。
ッケージを示す正面図と平面図、第2図a、bはこの発
明の電子部品パッケージをプリント配線基板に実装した
状態を示す正面図と平面図、第3図a、bは従来の電子
部品パッケージ構造を示す正面図と平面図、第4図a、
bは従来の電子部品パッケージをプリント配線基板に実
装した状態を示す正面図と平面図である。 図中、1は表面実装型ICl3は樹脂部、4はプリント
配線基板、5aはガルウィング型ICリード、5bはス
トレートのICリード、6はザグリ部である。 なお、図中同一符号は同−又は相当部分を示す。
Claims (2)
- (1)パッケージの外部リード部を、ガルウィング型リ
ードと、ほぼストレートのリードとを交互に配してなる
電子部品のパッケージ。 - (2)プリント基板にザグリ部を設け、このザグリ部に
、請求項1記載のパッケージのガルウィング型リードを
埋入してはんだ付けし、部品高さを低くしたことを特徴
とする電子部品のパッケージの実装構造。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2271944A JP2866465B2 (ja) | 1990-10-09 | 1990-10-09 | 電子部品 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2271944A JP2866465B2 (ja) | 1990-10-09 | 1990-10-09 | 電子部品 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04147660A true JPH04147660A (ja) | 1992-05-21 |
| JP2866465B2 JP2866465B2 (ja) | 1999-03-08 |
Family
ID=17507006
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2271944A Expired - Fee Related JP2866465B2 (ja) | 1990-10-09 | 1990-10-09 | 電子部品 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2866465B2 (ja) |
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO1996041507A1 (en) * | 1995-06-07 | 1996-12-19 | The Panda Project | Low profile semiconductor die carrier |
| US5821457A (en) * | 1994-03-11 | 1998-10-13 | The Panda Project | Semiconductor die carrier having a dielectric epoxy between adjacent leads |
| US5969416A (en) * | 1997-09-19 | 1999-10-19 | Samsung Aerospace Industries, Ltd. | Ball grid array semiconductor package |
| US6141869A (en) * | 1998-10-26 | 2000-11-07 | Silicon Bandwidth, Inc. | Apparatus for and method of manufacturing a semiconductor die carrier |
| US6339191B1 (en) | 1994-03-11 | 2002-01-15 | Silicon Bandwidth Inc. | Prefabricated semiconductor chip carrier |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5425463A (en) * | 1977-07-29 | 1979-02-26 | Hitachi Ltd | Print substrate assembly |
| JPH01258453A (ja) * | 1988-04-08 | 1989-10-16 | Toshiba Corp | 半導体装置 |
-
1990
- 1990-10-09 JP JP2271944A patent/JP2866465B2/ja not_active Expired - Fee Related
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5425463A (en) * | 1977-07-29 | 1979-02-26 | Hitachi Ltd | Print substrate assembly |
| JPH01258453A (ja) * | 1988-04-08 | 1989-10-16 | Toshiba Corp | 半導体装置 |
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| US5824950A (en) * | 1994-03-11 | 1998-10-20 | The Panda Project | Low profile semiconductor die carrier |
| US6339191B1 (en) | 1994-03-11 | 2002-01-15 | Silicon Bandwidth Inc. | Prefabricated semiconductor chip carrier |
| US6828511B2 (en) | 1994-03-11 | 2004-12-07 | Silicon Bandwidth Inc. | Prefabricated semiconductor chip carrier |
| US6977432B2 (en) | 1994-03-11 | 2005-12-20 | Quantum Leap Packaging, Inc. | Prefabricated semiconductor chip carrier |
| WO1996041507A1 (en) * | 1995-06-07 | 1996-12-19 | The Panda Project | Low profile semiconductor die carrier |
| US5969416A (en) * | 1997-09-19 | 1999-10-19 | Samsung Aerospace Industries, Ltd. | Ball grid array semiconductor package |
| US6141869A (en) * | 1998-10-26 | 2000-11-07 | Silicon Bandwidth, Inc. | Apparatus for and method of manufacturing a semiconductor die carrier |
| US6857173B1 (en) | 1998-10-26 | 2005-02-22 | Silicon Bandwidth, Inc. | Apparatus for and method of manufacturing a semiconductor die carrier |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2866465B2 (ja) | 1999-03-08 |
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