JPH04168821A - シリアルバス伝送方式 - Google Patents
シリアルバス伝送方式Info
- Publication number
- JPH04168821A JPH04168821A JP2295908A JP29590890A JPH04168821A JP H04168821 A JPH04168821 A JP H04168821A JP 2295908 A JP2295908 A JP 2295908A JP 29590890 A JP29590890 A JP 29590890A JP H04168821 A JPH04168821 A JP H04168821A
- Authority
- JP
- Japan
- Prior art keywords
- serial bus
- bits
- bit
- circuit
- channel
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 230000005540 biological transmission Effects 0.000 title claims abstract description 14
- 238000001514 detection method Methods 0.000 claims abstract description 14
- 238000000034 method Methods 0.000 claims description 4
- 239000000284 extract Substances 0.000 abstract description 4
- 230000001360 synchronised effect Effects 0.000 abstract description 4
- 238000012544 monitoring process Methods 0.000 abstract description 2
- 238000000605 extraction Methods 0.000 description 6
- 238000010586 diagram Methods 0.000 description 5
- 230000000694 effects Effects 0.000 description 1
Landscapes
- Time-Division Multiplex Systems (AREA)
- Maintenance And Management Of Digital Transmission (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はシリアルバス伝送方式、特に複数のビットから
なるチャネルごとのデータを時分割多重して伝送するシ
リアルバス伝送方式に関する。
なるチャネルごとのデータを時分割多重して伝送するシ
リアルバス伝送方式に関する。
従来、この種のシリアルバス伝送方式は、チャネル当り
の複数のデータビットの他に障害検出用の１ビツトを付
加して、このビットを正常なデータ送出時に常にロール
レベルとし、受信側でこのビットがハイレベルであった
ときには、送出口路または伝送路に開放障害があったと
判断する方法が多用されている。またこの１ビツトはチ
ャネル回路の実装・未実装の判定に使用されることもあ
る。
の複数のデータビットの他に障害検出用の１ビツトを付
加して、このビットを正常なデータ送出時に常にロール
レベルとし、受信側でこのビットがハイレベルであった
ときには、送出口路または伝送路に開放障害があったと
判断する方法が多用されている。またこの１ビツトはチ
ャネル回路の実装・未実装の判定に使用されることもあ
る。
上述した従来のシリアルバス伝送方式は、１ビツトのみ
により開放障害を判定しているため、送出回路または伝
送路に地絡障害が発生した場合には、直ちに検出するこ
とができないという欠点がある。
により開放障害を判定しているため、送出回路または伝
送路に地絡障害が発生した場合には、直ちに検出するこ
とができないという欠点がある。
本発明のシリアルバス伝送方式は、複数のビットからな
るチャネルごとのデータを時分割多重して伝送するシリ
アルバス伝送方式において、チャネルごとに付加した第
１の付加ビットをロールレベルにして送信し受信側でこ
の付加ビットのハイレベルの検出を行なう第１の検出手
段と、チャネルごとに付加した第２の付加ビットをハイ
レベルにして送信し受信側でこの付加ビットのローレベ
ルの検出を行なう第２の検出手段とを有することにより
構成される。
るチャネルごとのデータを時分割多重して伝送するシリ
アルバス伝送方式において、チャネルごとに付加した第
１の付加ビットをロールレベルにして送信し受信側でこ
の付加ビットのハイレベルの検出を行なう第１の検出手
段と、チャネルごとに付加した第２の付加ビットをハイ
レベルにして送信し受信側でこの付加ビットのローレベ
ルの検出を行なう第２の検出手段とを有することにより
構成される。
次に、本発明について図面を参照して説明する。
第１図は本発明の一実施例のブロック図で、３２チヤネ
ルのアナログ信号のそれぞれを６ビツトの符号化を行な
ってシリアルバスを介して伝送する場合を示している。
ルのアナログ信号のそれぞれを６ビツトの符号化を行な
ってシリアルバスを介して伝送する場合を示している。
符号化回路１０１゜１０２〜１３２はそれぞれ第１．第
２〜第３２チヤネルのアナログ信号を１２５μＳ周期で
６ビツトの符号化を行ない、出力線ＤＩ、Ｄ２〜Ｄ６に
並列出力を送出すると共に、出力線Ｄ７およびＤ８には
それぞれ常時“０”および“１”を出力する。多重化回
路２は符号化回路１０１，１０２〜１３２からの出力を
、ビット同期信号およびフレーム周期信号に同期して、
時分割多重してシリアルバス３に出力する。第２図はシ
リアルバス３に出力される多重化信号のフレーム構成図
で、チャネル当り８ビツトのデータが３２多重されて１
フレームを構成していることを示している。同期信号抽
出回路４はシリアルバス３の受信部において、シリアル
バス３上のフレームからビット同期信号およびフレーム
同期信号を抽出する回路である。付加ビット抽出回路５
は同期信号抽出回路４からの同期信号を受けて、シリア
ルバス３上のフレームから各チャネルの第１〜第６ビツ
トを次回路へ、第７および第８ビツトを抽出する回路で
ある。“１”検出回路６および“Ｏ”検出回路７は、そ
れぞれ付加ビット抽出回路らから出力される第７および
第８ビツトが“１”および“０”になった場合に検出信
号を出力する回路である。
２〜第３２チヤネルのアナログ信号を１２５μＳ周期で
６ビツトの符号化を行ない、出力線ＤＩ、Ｄ２〜Ｄ６に
並列出力を送出すると共に、出力線Ｄ７およびＤ８には
それぞれ常時“０”および“１”を出力する。多重化回
路２は符号化回路１０１，１０２〜１３２からの出力を
、ビット同期信号およびフレーム周期信号に同期して、
時分割多重してシリアルバス３に出力する。第２図はシ
リアルバス３に出力される多重化信号のフレーム構成図
で、チャネル当り８ビツトのデータが３２多重されて１
フレームを構成していることを示している。同期信号抽
出回路４はシリアルバス３の受信部において、シリアル
バス３上のフレームからビット同期信号およびフレーム
同期信号を抽出する回路である。付加ビット抽出回路５
は同期信号抽出回路４からの同期信号を受けて、シリア
ルバス３上のフレームから各チャネルの第１〜第６ビツ
トを次回路へ、第７および第８ビツトを抽出する回路で
ある。“１”検出回路６および“Ｏ”検出回路７は、そ
れぞれ付加ビット抽出回路らから出力される第７および
第８ビツトが“１”および“０”になった場合に検出信
号を出力する回路である。
以上の構成により、伝送回路上に開放障害があれば“１
”検出回路６から直ち出力が得られ、また地絡障害があ
れば“０”検出回路７か直ちに出力が得られる。
”検出回路６から直ち出力が得られ、また地絡障害があ
れば“０”検出回路７か直ちに出力が得られる。
以上説明したように本発明は、送信側にシリアルバス上
のチャネルごとのデータビットに、常時“０”および常
時“１”のビットを付加して送出して送出し、受信側で
この２ビツトを監視することにより、開放障害および地
絡障害を直ちに検出できる効果がある。
のチャネルごとのデータビットに、常時“０”および常
時“１”のビットを付加して送出して送出し、受信側で
この２ビツトを監視することにより、開放障害および地
絡障害を直ちに検出できる効果がある。
第１図は本発明の一実施例のブロック図、第２図は第１
図のシリアルバス上でのフレーム構成図である。 ２・・・・・・多重化回路、３・・・・・・シリアルバ
ス、４・・・・・・同期信号抽出回路、５・・・・・・
付加ビット抽出回路、６・・・・・・“１”検出回路、
７・・・・・・“Ｏ”検出回路、１０１．〜１３２・・
・・・・符号化回路。
図のシリアルバス上でのフレーム構成図である。 ２・・・・・・多重化回路、３・・・・・・シリアルバ
ス、４・・・・・・同期信号抽出回路、５・・・・・・
付加ビット抽出回路、６・・・・・・“１”検出回路、
７・・・・・・“Ｏ”検出回路、１０１．〜１３２・・
・・・・符号化回路。
Claims (1)
- 複数のビットからなるチャネルごとのデータを時分割多
重して伝送するシリアルバス伝送方式において、チャネ
ルごとに付加した第１の付加ビットをロールレベルにし
て送信し受信側でこの付加ビットのハイレベルの検出を
行なう第１の検出手段と、チャネルごとに付加した第２
の付加ビットをハイレベルにして送信し受信側でこの付
加ビットのローレベルの検出を行なう第２の検出手段と
を有することを特徴とするシリアルバス伝送方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2295908A JPH04168821A (ja) | 1990-11-01 | 1990-11-01 | シリアルバス伝送方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2295908A JPH04168821A (ja) | 1990-11-01 | 1990-11-01 | シリアルバス伝送方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04168821A true JPH04168821A (ja) | 1992-06-17 |
Family
ID=17826703
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2295908A Pending JPH04168821A (ja) | 1990-11-01 | 1990-11-01 | シリアルバス伝送方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04168821A (ja) |
-
1990
- 1990-11-01 JP JP2295908A patent/JPH04168821A/ja active Pending
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