JPH04168976A - 直流電源 - Google Patents
直流電源Info
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- JPH04168976A JPH04168976A JP29352290A JP29352290A JPH04168976A JP H04168976 A JPH04168976 A JP H04168976A JP 29352290 A JP29352290 A JP 29352290A JP 29352290 A JP29352290 A JP 29352290A JP H04168976 A JPH04168976 A JP H04168976A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野］
本発明はプリンタ装置等に用いられるドロッパタイプの
直流電源に関するものである。
直流電源に関するものである。
［従来の技術］
第２図は従来のドロッパタイプの直流電源のブロック図
、第３図（ａ） 、（ｂ） 、 （ｃ）は同直流電源の
各部位における電圧波形を示す波形図であり、１は交流
電圧を降圧する電源トランス、２は４つのダイオードＤ
−Ｄ４と平滑コンデンサ３によって全波整流を行う
整流回路、４は整流回路２に接続された電圧レギュレー
タである。
、第３図（ａ） 、（ｂ） 、 （ｃ）は同直流電源の
各部位における電圧波形を示す波形図であり、１は交流
電圧を降圧する電源トランス、２は４つのダイオードＤ
−Ｄ４と平滑コンデンサ３によって全波整流を行う
整流回路、４は整流回路２に接続された電圧レギュレー
タである。
従来のドロッパタイプの直流電源は上記のように構成さ
れ、例えば電源トランス１の一次側に交流電圧窒１が入
力されると、電源トランス１の二次側に降圧された第３
図（ａ）に示す交流電圧窒。
れ、例えば電源トランス１の一次側に交流電圧窒１が入
力されると、電源トランス１の二次側に降圧された第３
図（ａ）に示す交流電圧窒。
が出力される。その交流電圧窒２は整流回路２によって
全波整流され、平滑コンデンサ３によって第３図（ｂ）
に示す脈流ｖ１が得られる。更に、脈流Ｖｉは電圧レギ
ュレータ４に入力され、電圧レギュレータ４からは必要
とされる第３図（ｅ）に示す一定の電圧ｖ２が出力され
る。
全波整流され、平滑コンデンサ３によって第３図（ｂ）
に示す脈流ｖ１が得られる。更に、脈流Ｖｉは電圧レギ
ュレータ４に入力され、電圧レギュレータ４からは必要
とされる第３図（ｅ）に示す一定の電圧ｖ２が出力され
る。
［発明が解決しようとする課題］
しかしながら、上記構成の直流電源では、電源トランス
１に入力される交流電圧窒が上昇すると、電源トランス
１から出力される交流電圧で。も窒１の上昇分と同じ割
合で上昇し、整流回路２の出力ｖ１も上昇するが、電圧
レギュレータ４の出力は一定である。従って、上昇前の
電圧レギュレータ４の入力電圧の平均値を１、そのとき
の出力電圧をｖ １出力電流を１１上昇後の電圧レギュ
レータ４の入力電圧の平均値を１＋Δ■とすると、電圧
レギュレータ４での電力損失が（１十Δｖ） −ｖ
）ｘＩ −（ｖ −ｖ２） Ｘ Ｉ −ΔｖＸＩ
だけ増え、電圧レギュレータ４での発熱が増えてしまう
という欠点があった。
１に入力される交流電圧窒が上昇すると、電源トランス
１から出力される交流電圧で。も窒１の上昇分と同じ割
合で上昇し、整流回路２の出力ｖ１も上昇するが、電圧
レギュレータ４の出力は一定である。従って、上昇前の
電圧レギュレータ４の入力電圧の平均値を１、そのとき
の出力電圧をｖ １出力電流を１１上昇後の電圧レギュ
レータ４の入力電圧の平均値を１＋Δ■とすると、電圧
レギュレータ４での電力損失が（１十Δｖ） −ｖ
）ｘＩ −（ｖ −ｖ２） Ｘ Ｉ −ΔｖＸＩ
だけ増え、電圧レギュレータ４での発熱が増えてしまう
という欠点があった。
本発明は以上述べた電源トランスに入力される交流電圧
が上昇したときに電圧レギュレータにおける電力損失が
増加して発熱が増えるという問題点を除去するため、電
圧レギュレータの入力電圧の平均値を常に一定とし、電
圧レギュレータでの電力損失を防ぐことのできる優れた
直流電源を提供することを目的とする。
が上昇したときに電圧レギュレータにおける電力損失が
増加して発熱が増えるという問題点を除去するため、電
圧レギュレータの入力電圧の平均値を常に一定とし、電
圧レギュレータでの電力損失を防ぐことのできる優れた
直流電源を提供することを目的とする。
［課題を解決するための手段］
本発明は前記問題点を解決するために、直流電源におい
て、整流回路をサイリスタを含む回路で構成し、電源ト
ランスと電圧レギュレータの他に、電源トランスの入力
電圧を検出して出力するとともに、入力電圧からサイリ
スタ点弧用信号を形成して出力する交流電圧検出回路と
、交流電圧検出回路から出力された検出電圧と基準電圧
とを比較して差を求め、その差に応じたサイリスタ点弧
信号の遅れ位相角を演算し、前記サイリスタのゲートに
演算された遅れ位相角のサイリスタ点弧信号を交流電圧
検出回路から出力された点弧用信号に同期させて出力す
るサイリスタ制御部とを備えるようにしたものである。
て、整流回路をサイリスタを含む回路で構成し、電源ト
ランスと電圧レギュレータの他に、電源トランスの入力
電圧を検出して出力するとともに、入力電圧からサイリ
スタ点弧用信号を形成して出力する交流電圧検出回路と
、交流電圧検出回路から出力された検出電圧と基準電圧
とを比較して差を求め、その差に応じたサイリスタ点弧
信号の遅れ位相角を演算し、前記サイリスタのゲートに
演算された遅れ位相角のサイリスタ点弧信号を交流電圧
検出回路から出力された点弧用信号に同期させて出力す
るサイリスタ制御部とを備えるようにしたものである。
［作 用］
本発明によれば、以上のように直流電源を構成したので
、整流回路はサイリスタの点弧制御によって入力された
交流電圧をその波形の一部が削られた状態に整流する。
、整流回路はサイリスタの点弧制御によって入力された
交流電圧をその波形の一部が削られた状態に整流する。
また、交流電圧検出回路は電源トランスの入力電圧を検
出して出力するとともに、入力電圧からサイリスタ点弧
用信号を形成して出力する。従って、例えば電源トラン
スの入力電圧が上昇した場合、交流電圧検出回路の出力
する検出電圧も上昇し、サイリスタ制御部ではその上昇
した検出電圧と基準電圧とを比較して差を求め、その差
に応じたサイリスタ点弧信号の遅れ位相角を演算し、整
流回路のサイリスタのゲートに演算された遅れ位相角の
サイリスタ点弧信号を交流電圧検出回路から出力された
点弧用信号に同期させて出力する。それ故、サイリスタ
は入力電圧の上昇に応じた一定時間遅らされてオンする
こととなり、整流回路に入力された交流電圧はその波形
の一部が入力電圧の上昇した割合に応じて削られた状態
に整流されるため電圧レギュレータの入力電圧の平均値
は入力される交流電圧が上昇しても一定となる。
出して出力するとともに、入力電圧からサイリスタ点弧
用信号を形成して出力する。従って、例えば電源トラン
スの入力電圧が上昇した場合、交流電圧検出回路の出力
する検出電圧も上昇し、サイリスタ制御部ではその上昇
した検出電圧と基準電圧とを比較して差を求め、その差
に応じたサイリスタ点弧信号の遅れ位相角を演算し、整
流回路のサイリスタのゲートに演算された遅れ位相角の
サイリスタ点弧信号を交流電圧検出回路から出力された
点弧用信号に同期させて出力する。それ故、サイリスタ
は入力電圧の上昇に応じた一定時間遅らされてオンする
こととなり、整流回路に入力された交流電圧はその波形
の一部が入力電圧の上昇した割合に応じて削られた状態
に整流されるため電圧レギュレータの入力電圧の平均値
は入力される交流電圧が上昇しても一定となる。
［実施例］
第１図は本発明の一実施例の直流電源のブロック図、第
４図（ａ） 、 （ｂ） 、（ｃ）は同直流電源の各部
位における電圧波形を示す波形図、第５図は交流電圧検
出回路のブロック図、第６図（ａ） 、（ｂ） 、（ｃ
）は交流電圧検出回路の各部位における電圧波形を示す
波形図、第７図はサイリスタ制御部のブロック図である
。
４図（ａ） 、 （ｂ） 、（ｃ）は同直流電源の各部
位における電圧波形を示す波形図、第５図は交流電圧検
出回路のブロック図、第６図（ａ） 、（ｂ） 、（ｃ
）は交流電圧検出回路の各部位における電圧波形を示す
波形図、第７図はサイリスタ制御部のブロック図である
。
第１図において、従来例と同一の構成は同一符号を付し
て重複した構成の説明を省略する。１２は二つのダイオ
ードＤ 、Ｄ と二つのサイリスタＳＣＲ，５ＣＲ
２と平滑コンデンサ３とからなす る整流回路、１３は電源トランス１に入力される交流電
圧を検出する交流電圧検出回路、１４は交流電圧検出回
路１３の出力電圧に基づいて余波整流回路１２の二つの
サイリスタＳＣＲ，５ＣＲ２の点弧■ を制御するサイリスタ制御部である。
て重複した構成の説明を省略する。１２は二つのダイオ
ードＤ 、Ｄ と二つのサイリスタＳＣＲ，５ＣＲ
２と平滑コンデンサ３とからなす る整流回路、１３は電源トランス１に入力される交流電
圧を検出する交流電圧検出回路、１４は交流電圧検出回
路１３の出力電圧に基づいて余波整流回路１２の二つの
サイリスタＳＣＲ，５ＣＲ２の点弧■ を制御するサイリスタ制御部である。
第５図において、２０は交流電圧検出回路１３の電圧検
出用電源トランスで、１次側は電源トランス１の１次側
に並列接続されている。２１は電圧検出用電源トランス
２０の２次側に接続されたダイオード、２２はダイオー
ド２１の出力側に設けられた半波整流回路で、ダイオー
ド２３と平滑コンデンサ２４と抵抗２５とで構成されて
いる。２６は半波整流回路２２から出力される脈流を直
流に変換するＡ／Ｄコンバータ、２７はダイオード２１
によって半波整流された脈流からサイリスタの点弧用信
号を生成するトランジスタである。
出用電源トランスで、１次側は電源トランス１の１次側
に並列接続されている。２１は電圧検出用電源トランス
２０の２次側に接続されたダイオード、２２はダイオー
ド２１の出力側に設けられた半波整流回路で、ダイオー
ド２３と平滑コンデンサ２４と抵抗２５とで構成されて
いる。２６は半波整流回路２２から出力される脈流を直
流に変換するＡ／Ｄコンバータ、２７はダイオード２１
によって半波整流された脈流からサイリスタの点弧用信
号を生成するトランジスタである。
第７図において、３０はＡ／Ｄコンバータ２６の検出電
圧と基準電圧とを比較して電圧変動の差を求めるサイリ
スタ制御部１４の比較部、３工は比較部３０の出力値に
基いてサイリスタ点弧信号の遅れ位相角を演算する位相
角演算部、３２は位相角演算部３１の演算した遅れ位相
角に基づき遅延した点弧作成信号を出力するデイレイタ
イマ、３３はデイレイタイマ３２の点弧作成信号に基づ
いて点弧信号を作成するトランジスタである。
圧と基準電圧とを比較して電圧変動の差を求めるサイリ
スタ制御部１４の比較部、３工は比較部３０の出力値に
基いてサイリスタ点弧信号の遅れ位相角を演算する位相
角演算部、３２は位相角演算部３１の演算した遅れ位相
角に基づき遅延した点弧作成信号を出力するデイレイタ
イマ、３３はデイレイタイマ３２の点弧作成信号に基づ
いて点弧信号を作成するトランジスタである。
次に、上記実施例の動作を説明する。
交流電圧窒 が電源トランス１に入力されるが、この交
流電圧は一般には一定でなくある範囲をもっている。こ
の交流電圧マ１は電源トランス１により降圧されて窒
の電圧となる。そのマ２のピ−ク値は第４図（ａ）に示
すように交流電圧ン１の上昇、下降によって変化する。
流電圧は一般には一定でなくある範囲をもっている。こ
の交流電圧マ１は電源トランス１により降圧されて窒
の電圧となる。そのマ２のピ−ク値は第４図（ａ）に示
すように交流電圧ン１の上昇、下降によって変化する。
その交流電圧ｖ２は整流回路１２によって整流されるが
、交流電圧Ｖ の電圧変動に応じたサイリスタＳＣＲ，
。
、交流電圧Ｖ の電圧変動に応じたサイリスタＳＣＲ，
。
５ＣＲ２の点弧制御が交流電圧検出回路１３とサイリス
タ制御部１４によって行われる。
タ制御部１４によって行われる。
まず、交流電圧検出回路１３の動作について説明する。
交流電圧検出回路１３では電源トランス１に入力された
交流電圧璧、を検出する。その交流電圧で は電圧検出
用トランス２０で降圧された後、■ 半波整流回路２２によって整流されて第６図（ｃ）に示
す脈流ＣとなってＡ／Ｄコンバータ２６に入力される。
交流電圧璧、を検出する。その交流電圧で は電圧検出
用トランス２０で降圧された後、■ 半波整流回路２２によって整流されて第６図（ｃ）に示
す脈流ＣとなってＡ／Ｄコンバータ２６に入力される。
Ａ／Ｄコンバータ２６ではその脈流Ｃを直流に変換して
サイリスタ制御部１４に入力する。それと同時に電圧検
出用トランス２０で降圧された交流電圧マ１はダイオー
ド２１によって第６図（ａ）に示すように半波整流され
た脈流Ａとなり、トランジスタ２７は半波整流された脈
流Ａから第６図（ｂ）に示すように点弧用信号Ｂを生成
し、サイリスタ制御部１４に入力する。
サイリスタ制御部１４に入力する。それと同時に電圧検
出用トランス２０で降圧された交流電圧マ１はダイオー
ド２１によって第６図（ａ）に示すように半波整流され
た脈流Ａとなり、トランジスタ２７は半波整流された脈
流Ａから第６図（ｂ）に示すように点弧用信号Ｂを生成
し、サイリスタ制御部１４に入力する。
次に、サイリスタ制御部の動作を第７図及び第８図のフ
ローチャートに基づいて説明する。
ローチャートに基づいて説明する。
サイリスタ制御部１４ではその比較部３０が交流電圧検
出回路１３のＡ／Ｄコンバータ２６から出力された検出
電圧Ｖ１ｎと基準電圧である制御目標電圧ＶＲとを比較
しくステップＳ１）、ｖｉｎ−ｖＲ≦０であれば、サイ
リスタＳＣＲ，５ＣＲ２のオ■ ンデイレイを０として遅延しない点弧信号をトランジス
タ３３によって作成して常にサイリスタＳＣＲ，５ＣＲ
２をフルオンさせる（ステップＳ２）。また、ｖ、ｎ−
ｖＲ＞Ｏであれば、次にｖ ／ Ｖ Ｒの値が２より
大きいか否かを判断し、（ステップＳ３）、ｖＩｎ／ｖ
Ｒ〉２であれば、アラームを出力しくステップＳ４）
、ｖ、ｎ／ｖＲ＞２であれば位相角演算部３１でサイリ
スタ点弧信号の遅れ位相角θを演算しくステップｓ５）
、デイレイタイマ３２をスタートさせる。このデイレイ
タイマ３２のスタートは、交流電圧検出回路１３のトラ
ンジスタ２７によって生成された点弧用信号Ｂの立ち上
がりエツジに同期させられている。デイレイタイマ３２
のデイレイ時間は遅れ位相角θに基づくもので、デイレ
イ時間に達したところで、デイレイタイマ３２から出力
された点弧作成信号により、トランジスタ３３が動作さ
せられてサイリスタ点弧信号が作成され、その点弧信号
によってサイリスタＳＣＲ又はサイリスタ５ＣＲ２が点
弧即ちオン動作させられる（ステップＳ７）。サイリス
タＳＣＲ又はサイリスタ５ＣＲ２がオン動作させられる
ことにより、交流電圧マ２の整流が行われる。
出回路１３のＡ／Ｄコンバータ２６から出力された検出
電圧Ｖ１ｎと基準電圧である制御目標電圧ＶＲとを比較
しくステップＳ１）、ｖｉｎ−ｖＲ≦０であれば、サイ
リスタＳＣＲ，５ＣＲ２のオ■ ンデイレイを０として遅延しない点弧信号をトランジス
タ３３によって作成して常にサイリスタＳＣＲ，５ＣＲ
２をフルオンさせる（ステップＳ２）。また、ｖ、ｎ−
ｖＲ＞Ｏであれば、次にｖ ／ Ｖ Ｒの値が２より
大きいか否かを判断し、（ステップＳ３）、ｖＩｎ／ｖ
Ｒ〉２であれば、アラームを出力しくステップＳ４）
、ｖ、ｎ／ｖＲ＞２であれば位相角演算部３１でサイリ
スタ点弧信号の遅れ位相角θを演算しくステップｓ５）
、デイレイタイマ３２をスタートさせる。このデイレイ
タイマ３２のスタートは、交流電圧検出回路１３のトラ
ンジスタ２７によって生成された点弧用信号Ｂの立ち上
がりエツジに同期させられている。デイレイタイマ３２
のデイレイ時間は遅れ位相角θに基づくもので、デイレ
イ時間に達したところで、デイレイタイマ３２から出力
された点弧作成信号により、トランジスタ３３が動作さ
せられてサイリスタ点弧信号が作成され、その点弧信号
によってサイリスタＳＣＲ又はサイリスタ５ＣＲ２が点
弧即ちオン動作させられる（ステップＳ７）。サイリス
タＳＣＲ又はサイリスタ５ＣＲ２がオン動作させられる
ことにより、交流電圧マ２の整流が行われる。
例えば交流電圧マ。が高くなると、サイリスタＳＣＲ又
はサイリスタ５ＣＲ２をオン動作させる時間が遅らされ
、交流電圧マ。を第４図（ａ）に示すようにその波形の
一部が入力電圧の上昇した割合に応じて削られた状態に
整流する。従って、電圧レギュレータ４に入力される脈
流の入力電圧ｖ１は第４図（ｂ）に示すように入力され
る交流電圧が上昇しない場合に比べて減少するように変
化し、電圧レギュレータ４の入力電圧平均値７１は交流
電圧の上昇にかかわらず一定となる。また、電圧レギュ
レータ４の出力電圧は常にｖ２であるから、電圧レギュ
レータ４での電圧損失は入力される交流電圧窒１にかか
わらず（Ｖ ｌ −Ｖ ２ ） Ｘｌとなり、一定とな
る。
はサイリスタ５ＣＲ２をオン動作させる時間が遅らされ
、交流電圧マ。を第４図（ａ）に示すようにその波形の
一部が入力電圧の上昇した割合に応じて削られた状態に
整流する。従って、電圧レギュレータ４に入力される脈
流の入力電圧ｖ１は第４図（ｂ）に示すように入力され
る交流電圧が上昇しない場合に比べて減少するように変
化し、電圧レギュレータ４の入力電圧平均値７１は交流
電圧の上昇にかかわらず一定となる。また、電圧レギュ
レータ４の出力電圧は常にｖ２であるから、電圧レギュ
レータ４での電圧損失は入力される交流電圧窒１にかか
わらず（Ｖ ｌ −Ｖ ２ ） Ｘｌとなり、一定とな
る。
なお、マ２が零電圧になるときはサイリスタＳＣＲ，５
ＣＲ２はオフとなる。
ＣＲ２はオフとなる。
■
［発明の効果］
以上詳細に説明したように本発明によれば整流回路をサ
イリスタを含む回路で構成し、電源トランスの入力電圧
を検出して出力するとともに、入力電圧からサイリスタ
点弧用信号を形成して出力する交流電圧検出回路と、交
流電圧検出回路から出力された検出電圧と基準電圧とを
比較して差を求め、その差に応じたサイリスタ点弧信号
の遅れ位相角を演算し、サイリスタのゲートに演算され
た遅れ位相角のサイリスタ点弧信号を交流電圧検出部か
ら出力された点弧用信号に同期させて出力するサイリス
タ制御部とを鍮え、電源トランスの入力電圧が上昇した
場合に整流回路のサイリスタがサイリスタ制御部からの
遅れ位相角のサイリスタ点弧信号により入力電圧の上昇
に応じた一定時間遅らされてオンされるようにしたので
、整流回路に入力された交流電圧はその波形の一部が入
力電圧の上昇した割合に応じて削られた状態に整流され
るために電圧レギュレータの入力電圧の平均値は入力さ
れる交流電圧が上昇しても一定となり、電圧レギュレー
タにおける電力損失を防ぐことができるという効果が期
待できる。
イリスタを含む回路で構成し、電源トランスの入力電圧
を検出して出力するとともに、入力電圧からサイリスタ
点弧用信号を形成して出力する交流電圧検出回路と、交
流電圧検出回路から出力された検出電圧と基準電圧とを
比較して差を求め、その差に応じたサイリスタ点弧信号
の遅れ位相角を演算し、サイリスタのゲートに演算され
た遅れ位相角のサイリスタ点弧信号を交流電圧検出部か
ら出力された点弧用信号に同期させて出力するサイリス
タ制御部とを鍮え、電源トランスの入力電圧が上昇した
場合に整流回路のサイリスタがサイリスタ制御部からの
遅れ位相角のサイリスタ点弧信号により入力電圧の上昇
に応じた一定時間遅らされてオンされるようにしたので
、整流回路に入力された交流電圧はその波形の一部が入
力電圧の上昇した割合に応じて削られた状態に整流され
るために電圧レギュレータの入力電圧の平均値は入力さ
れる交流電圧が上昇しても一定となり、電圧レギュレー
タにおける電力損失を防ぐことができるという効果が期
待できる。
第１図は本発明の一実施例の直流電源のブロック図、第
２図は従来の直流電源のブロック図、第３図（ａ） 、
（ｂ） 、 （ｃ）は同電源の各部位における電圧波
形を示す波形図、第４図（ａ） 、（Ｊりは本発明の直
流電源の各部位における電圧波形を示す波形図、第５図
は交流電圧検出回路のブロック図、第６図（ａ） 、
（ｂ） 、 （ｃ）は交流電圧検出回路の各部位におけ
る電圧波形を示す波形図、第７図はサイリスタ制御部の
ブロック図、第８図はサイリスタ制御部の動作を示すフ
ローチャートである。 １・・・電源トランス、３・・・平滑コンデンサ、４・
・・電圧レギュレータ、１３・・・交流電圧検出回路、
１４・・・サイリスタ制御部、Ｄ Ｄ ・・・ダイオ
ード、１′２ ＳＣＲ，５ＣＲ２・・・サイリスタ。 特許出願人 沖電気工業株式会社 代 理 人 弁理士 佐々木宗治 本発明の直流電源のブ０−．り図 第１図 従来例の直ｉ棗を源のブロックＸ 第２ｒｊＡ 従来の直流電源の各部位の電圧波形図 第３図 交流電圧検出回路の７０ツク図 第６図 サイリスタ制御部のブロック図 第７図
２図は従来の直流電源のブロック図、第３図（ａ） 、
（ｂ） 、 （ｃ）は同電源の各部位における電圧波
形を示す波形図、第４図（ａ） 、（Ｊりは本発明の直
流電源の各部位における電圧波形を示す波形図、第５図
は交流電圧検出回路のブロック図、第６図（ａ） 、
（ｂ） 、 （ｃ）は交流電圧検出回路の各部位におけ
る電圧波形を示す波形図、第７図はサイリスタ制御部の
ブロック図、第８図はサイリスタ制御部の動作を示すフ
ローチャートである。 １・・・電源トランス、３・・・平滑コンデンサ、４・
・・電圧レギュレータ、１３・・・交流電圧検出回路、
１４・・・サイリスタ制御部、Ｄ Ｄ ・・・ダイオ
ード、１′２ ＳＣＲ，５ＣＲ２・・・サイリスタ。 特許出願人 沖電気工業株式会社 代 理 人 弁理士 佐々木宗治 本発明の直流電源のブ０−．り図 第１図 従来例の直ｉ棗を源のブロックＸ 第２ｒｊＡ 従来の直流電源の各部位の電圧波形図 第３図 交流電圧検出回路の７０ツク図 第６図 サイリスタ制御部のブロック図 第７図
Claims (1)
- 交流電圧が入力される電源トランスと、電源トランス
から出力された交流電圧を整流するサイリスタを含む整
流回路と、整流回路の出力側に接続された電圧レギュレ
ータと、電源トランスの入力電圧を検出して出力すると
ともに、入力電圧からサイリスタ点弧用信号を形成して
出力する交流電圧検出回路と、交流電圧検出回路から出
力された検出電圧と基準電圧とを比較して差を求め、そ
の差に応じたサイリスタ点弧信号の遅れ位相角を演算し
、前記サイリスタのゲートに演算された遅れ位相角のサ
イリスタ点弧信号を交流電圧検出回路から出力された点
弧用信号に同期させて出力するサイリスタ制御部とを備
えてなることを特徴とする直流電源。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29352290A JPH04168976A (ja) | 1990-11-01 | 1990-11-01 | 直流電源 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29352290A JPH04168976A (ja) | 1990-11-01 | 1990-11-01 | 直流電源 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04168976A true JPH04168976A (ja) | 1992-06-17 |
Family
ID=17795834
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP29352290A Pending JPH04168976A (ja) | 1990-11-01 | 1990-11-01 | 直流電源 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04168976A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN105529940A (zh) * | 2014-10-17 | 2016-04-27 | 意法半导体(图尔)公司 | 受控的整流电路 |
| FR3097386A1 (fr) * | 2019-06-17 | 2020-12-18 | Stmicroelectronics Ltd | Commande d'un thyristor |
-
1990
- 1990-11-01 JP JP29352290A patent/JPH04168976A/ja active Pending
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN105529940A (zh) * | 2014-10-17 | 2016-04-27 | 意法半导体(图尔)公司 | 受控的整流电路 |
| FR3097386A1 (fr) * | 2019-06-17 | 2020-12-18 | Stmicroelectronics Ltd | Commande d'un thyristor |
| EP3754849A1 (fr) | 2019-06-17 | 2020-12-23 | STMicroelectronics Ltd | Commande d'un thyristor |
| US11271493B2 (en) | 2019-06-17 | 2022-03-08 | Stmicroelectronics Ltd | Thyristor control |
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