JPH04177764A - ショットキ―電極の形成方法 - Google Patents
ショットキ―電極の形成方法Info
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- JPH04177764A JPH04177764A JP30379890A JP30379890A JPH04177764A JP H04177764 A JPH04177764 A JP H04177764A JP 30379890 A JP30379890 A JP 30379890A JP 30379890 A JP30379890 A JP 30379890A JP H04177764 A JPH04177764 A JP H04177764A
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- film
- nitride film
- nitrogen
- metal nitride
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
[産業上の利用分野]
本発明は窒化チタン(TiN)からなるショットキー電
極の形成方法に関するものである。
極の形成方法に関するものである。
[従来の技術]
金属・半導体接合障壁であるショットキー接合障壁を用
いたショットキー型半導体装置は、高速性に優れ、高周
波回路弯に広く利用されている。
いたショットキー型半導体装置は、高速性に優れ、高周
波回路弯に広く利用されている。
特にGaAs半専体半月体、ショットキー電極をゲート
電極として用いた電界効果トランジスタ(以下、MES
FETという)は、マイグロ波帯での能動素子として優
れた特性を示すものである。
電極として用いた電界効果トランジスタ(以下、MES
FETという)は、マイグロ波帯での能動素子として優
れた特性を示すものである。
このようなMESFETのゲート電極として、G a
A、 s半導体と接する最下層にA]、T1などの金属
層を用いることが多い。この場合、A1、T1などの金
属層が半導体中へ拡散しやすいため、M E S FE
Tの動作、特に高温での動作が安定しない。
A、 s半導体と接する最下層にA]、T1などの金属
層を用いることが多い。この場合、A1、T1などの金
属層が半導体中へ拡散しやすいため、M E S FE
Tの動作、特に高温での動作が安定しない。
この拡散防止のためにTiN、TaN、ZrN、WNな
どの導電性の金属窒化物をショットキー電極の最下層に
用いることが検討されている。この場合に、これらの金
属窒化物は電気伝導率が低いため、高い電導率を有する
A1、A IJなどの金属との多層構造にすることが多
い。
どの導電性の金属窒化物をショットキー電極の最下層に
用いることが検討されている。この場合に、これらの金
属窒化物は電気伝導率が低いため、高い電導率を有する
A1、A IJなどの金属との多層構造にすることが多
い。
しかしながら、反応性スパッタリング法などによりTj
Hなどの導電性の金属窒化物を作成する場合、揮発成分
を含む化合物半導体の表面がプラズマガスにさらされる
ため、その表面に多大なダメージが与えられ半導体装置
の特性の劣化を招くこととなる。
Hなどの導電性の金属窒化物を作成する場合、揮発成分
を含む化合物半導体の表面がプラズマガスにさらされる
ため、その表面に多大なダメージが与えられ半導体装置
の特性の劣化を招くこととなる。
また、反応性スパッタリング法などにより導電性の金属
窒化物を作成した後に、その表面にA1、T iなとの
酸化されやすい金属を形成する場合、金属窒化物の表面
に大気中での酸化などにともなう酸化物層が形成される
。この酸化物層のため、ショットキー電極の内部抵抗が
増大するという問題があった。
窒化物を作成した後に、その表面にA1、T iなとの
酸化されやすい金属を形成する場合、金属窒化物の表面
に大気中での酸化などにともなう酸化物層が形成される
。この酸化物層のため、ショットキー電極の内部抵抗が
増大するという問題があった。
本発明の目的は、化合物半導体の表面にダメージを与え
ず、かつ、内部抵抗の充分に低いショットキー電極の形
成方法を提供することにある。
ず、かつ、内部抵抗の充分に低いショットキー電極の形
成方法を提供することにある。
[課題を解決するための手段]
本発明によるショットキー電極の形成方法は、III−
V族化合物半導体からなる半導体上に、窒素または窒素
化合物ガスの雰囲気下で第1の金属を蒸着して導電性の
金属窒化物膜を形成し、次に、該金属窒化物膜上に真空
下で第2の金属を蒸着することで金属膜を形成するもの
である。
V族化合物半導体からなる半導体上に、窒素または窒素
化合物ガスの雰囲気下で第1の金属を蒸着して導電性の
金属窒化物膜を形成し、次に、該金属窒化物膜上に真空
下で第2の金属を蒸着することで金属膜を形成するもの
である。
なお、前記第1の金属がチタンであり、前記第2の金属
がアルミニウムであることが望ましい。
がアルミニウムであることが望ましい。
また、前記窒化金属膜の形成と前記第2の金属の蒸着は
同一の真空容器内で連続して行うことが望ましい。
同一の真空容器内で連続して行うことが望ましい。
[作用]
本発明の構成によれば、反応性蒸着により金属窒化物膜
を形成するため、化合物半導体にダメージを与えること
はない。同時に、第2の金属を真空下で蒸着するため、
ゲート電極の内部抵抗が増大することはない。
を形成するため、化合物半導体にダメージを与えること
はない。同時に、第2の金属を真空下で蒸着するため、
ゲート電極の内部抵抗が増大することはない。
〔実施例1
以下、実施例により本発明をより詳細に説明する。本発
明による実施例であるMESFETの断面構造を第1図
に示す。
明による実施例であるMESFETの断面構造を第1図
に示す。
半絶縁性GaAs基板1の一主面」−にN型のGaAs
からなるバッファ層2(ノンドープ、キャリア濃度1,
0E14/−以下、厚さ2μm)およびN型のGaAs
からなるチャンネル層3 (Slドープ、キャリア濃度
3.0E17/CI献厚さ0.15μm)を順次、気相
成長法により形成する。 (イオン注入法によりチャン
ネル層3を形成することもできる。) このチャンネル層3上に所定間隔(8μm)を離間して
オーミックコンタクトを形成する金属からなるソース電
極4およびドレイン電極5を形成する。
からなるバッファ層2(ノンドープ、キャリア濃度1,
0E14/−以下、厚さ2μm)およびN型のGaAs
からなるチャンネル層3 (Slドープ、キャリア濃度
3.0E17/CI献厚さ0.15μm)を順次、気相
成長法により形成する。 (イオン注入法によりチャン
ネル層3を形成することもできる。) このチャンネル層3上に所定間隔(8μm)を離間して
オーミックコンタクトを形成する金属からなるソース電
極4およびドレイン電極5を形成する。
このソース電極4およびドレイン電極5の間のチャンネ
ル層3」−にゲート?’ii極長に相当する1μm幅の
開口を有するレジスト腺(図示せず)を全面に形成する
。
ル層3」−にゲート?’ii極長に相当する1μm幅の
開口を有するレジスト腺(図示せず)を全面に形成する
。
この基板を蒸着装置の蒸着室内に装着し、蒸着室を1
、 OE −7t、、orr以下の高真空状態にする
。
、 OE −7t、、orr以下の高真空状態にする
。
=4−
その後、窒素ガスを導入して1. 0E−4torr程
度の圧力とした状態で、電子ビームによりチタン金属を
溶解気化させて蒸着を行う。これにより、金属窒化物膜
である窒化チタン(T ]N)膜6Aを50nmの厚さ
に形成する。次に、蒸着室を再び1 、 OE −7
torr以下の高真空状態し、電子ビームによりアルミ
ニウム金属を溶解気化させて蒸着を行う。これにより、
窒化チタン(T i N)膜6A上に金属膜(アルミニ
ウム(ハ1)膜6B)を400nmの厚さに形成する。
度の圧力とした状態で、電子ビームによりチタン金属を
溶解気化させて蒸着を行う。これにより、金属窒化物膜
である窒化チタン(T ]N)膜6Aを50nmの厚さ
に形成する。次に、蒸着室を再び1 、 OE −7
torr以下の高真空状態し、電子ビームによりアルミ
ニウム金属を溶解気化させて蒸着を行う。これにより、
窒化チタン(T i N)膜6A上に金属膜(アルミニ
ウム(ハ1)膜6B)を400nmの厚さに形成する。
その後、蒸着室から基板を取りだしてレジスト膜を除去
することでゲート電極6を形成する。
することでゲート電極6を形成する。
以上の]1程で、MESFETが作成されるが、FET
以外にもショットキー電極を用いるダイオードなどにも
本発明は利用できる。
以外にもショットキー電極を用いるダイオードなどにも
本発明は利用できる。
また、基板としてGaAsを用いたがIn、GaAs、
I n Pなどを用いることもできる。窒化チタンを金
属窒化物とし用いているが、タンタル(Ta:)、ジル
コニウム(Zr)、タングステン(W)などの窒化物を
用いることもできる。
I n Pなどを用いることもできる。窒化チタンを金
属窒化物とし用いているが、タンタル(Ta:)、ジル
コニウム(Zr)、タングステン(W)などの窒化物を
用いることもできる。
A−
〔発明の効果〕
以上、説明したように本発明によるショットキー電極の
形成方法は、Ill −V族化合物半導体からなる半導
体上に、窒素または窒素化合物ガスの雰囲気下で第1の
金属を蒸着して導電性の金属窒化物膜を形成し、次に、
該金属窒化物膜上に真空下で第2の金属を蒸着すること
で金属膜を形成するものである。
形成方法は、Ill −V族化合物半導体からなる半導
体上に、窒素または窒素化合物ガスの雰囲気下で第1の
金属を蒸着して導電性の金属窒化物膜を形成し、次に、
該金属窒化物膜上に真空下で第2の金属を蒸着すること
で金属膜を形成するものである。
したがって、反応性蒸着により金属窒化物膜を形成する
ため、化合物半導体にダメージを与えることはない。同
時に、第2の金属を真空下で蒸着するため、ショットキ
ー電極の内部抵抗か増大することはない。このため、優
れた特性のショットキー電極を作成することができる。
ため、化合物半導体にダメージを与えることはない。同
時に、第2の金属を真空下で蒸着するため、ショットキ
ー電極の内部抵抗か増大することはない。このため、優
れた特性のショットキー電極を作成することができる。
第1図は、本発明による実施例であるM E S FE
Tの断面構造を示す図である。 図中において、 ] 半絶縁性GaAs基板、 2・バッファ層、 3・・チャンネル層、4・・ソー
ス電極、 5・・・ドレイン電極、6 ・ゲート電極
、 6A・・窒化チタン(T i N)膜、6B・アルミニ
ウム(A1)膜。
Tの断面構造を示す図である。 図中において、 ] 半絶縁性GaAs基板、 2・バッファ層、 3・・チャンネル層、4・・ソー
ス電極、 5・・・ドレイン電極、6 ・ゲート電極
、 6A・・窒化チタン(T i N)膜、6B・アルミニ
ウム(A1)膜。
Claims (2)
- (1)III−V族化合物半導体からなる半導体上に、窒
素または窒素化合物ガスの雰囲気下で第1の金属を蒸着
して導電性の金属窒化物膜を形成し、次に、該金属窒化
物膜上に真空下で第2の金属を蒸着することで金属膜を
形成することを特徴とするショットキー電極の形成方法
。 - (2)前記第1の金属がチタンであり、前記第2の金属
がアルミニウムであることを特徴とする第1項記載のシ
ョットキー電極の形成方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP30379890A JPH04177764A (ja) | 1990-11-13 | 1990-11-13 | ショットキ―電極の形成方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP30379890A JPH04177764A (ja) | 1990-11-13 | 1990-11-13 | ショットキ―電極の形成方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04177764A true JPH04177764A (ja) | 1992-06-24 |
Family
ID=17925429
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP30379890A Pending JPH04177764A (ja) | 1990-11-13 | 1990-11-13 | ショットキ―電極の形成方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04177764A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2013021822A1 (ja) * | 2011-08-05 | 2013-02-14 | シャープ株式会社 | GaN系化合物半導体装置 |
| JP2014500620A (ja) * | 2010-11-10 | 2014-01-09 | クリー インコーポレイテッド | コンタクトパッドおよびその製造方法 |
-
1990
- 1990-11-13 JP JP30379890A patent/JPH04177764A/ja active Pending
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2014500620A (ja) * | 2010-11-10 | 2014-01-09 | クリー インコーポレイテッド | コンタクトパッドおよびその製造方法 |
| US9607955B2 (en) | 2010-11-10 | 2017-03-28 | Cree, Inc. | Contact pad |
| WO2013021822A1 (ja) * | 2011-08-05 | 2013-02-14 | シャープ株式会社 | GaN系化合物半導体装置 |
| JP2013038180A (ja) * | 2011-08-05 | 2013-02-21 | Sharp Corp | GaN系化合物半導体装置 |
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