JPH04314226A - 通信データ保護回路 - Google Patents
通信データ保護回路Info
- Publication number
- JPH04314226A JPH04314226A JP7968891A JP7968891A JPH04314226A JP H04314226 A JPH04314226 A JP H04314226A JP 7968891 A JP7968891 A JP 7968891A JP 7968891 A JP7968891 A JP 7968891A JP H04314226 A JPH04314226 A JP H04314226A
- Authority
- JP
- Japan
- Prior art keywords
- clock
- data
- power supply
- interface section
- transmission
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Time-Division Multiplex Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】本発明は、電源断時の通信データ
の保護回路に関する。
の保護回路に関する。
【０００２】
【従来の技術】以下、図３と図４をもちいて従来の通信
回路を説明する。図３は通信回路である。図３中、１は
例えば送信系の第一装置であり、並列−直列変換部１１
と第一インタフェース部１２を具える。尚、２は例えば
受信系の第二装置であり、第二インタフェース部２１と
直列−並列変換部２２を具える。また、３は平衡伝送路
、更に４は第一装置１の供給電源である。
回路を説明する。図３は通信回路である。図３中、１は
例えば送信系の第一装置であり、並列−直列変換部１１
と第一インタフェース部１２を具える。尚、２は例えば
受信系の第二装置であり、第二インタフェース部２１と
直列−並列変換部２２を具える。また、３は平衡伝送路
、更に４は第一装置１の供給電源である。
【０００３】図４は通信回路のタイムチャートである。
図４において、（Ａ）は供給電源のタイムチャート、（
Ｂ）は第一インタフェース部のタイムチャートである。 例えば、交換機のように二重化されたシステムにおいて
、常用系の或る第一装置１から非常系の或る第二装置２
へデータの通信を行ったりする場合、図３の回路のよう
に平衡伝送路３を用いてクロックやデータの通信をおこ
なっている。
Ｂ）は第一インタフェース部のタイムチャートである。 例えば、交換機のように二重化されたシステムにおいて
、常用系の或る第一装置１から非常系の或る第二装置２
へデータの通信を行ったりする場合、図３の回路のよう
に平衡伝送路３を用いてクロックやデータの通信をおこ
なっている。
【０００４】即ち、図３において、第一装置１の並列−
直列変換部１１に送られてきたパラレルデータは、第一
クロックのタイミングでシリアルデータに変換されて第
一インタフェース部１２に送られる。第一インタフェー
ス部１２では、並列−直列変換部１１からのデータと第
一クロックとを平衡伝送路３を介して第二インタフェー
ス部２１に送出する。
直列変換部１１に送られてきたパラレルデータは、第一
クロックのタイミングでシリアルデータに変換されて第
一インタフェース部１２に送られる。第一インタフェー
ス部１２では、並列−直列変換部１１からのデータと第
一クロックとを平衡伝送路３を介して第二インタフェー
ス部２１に送出する。
【０００５】第二装置２では、第二インタフェース部２
１に送られてきた第二クロックによって直列−並列変換
部２２においてデータをラッチしてパラレルデータに変
換し受信する。
１に送られてきた第二クロックによって直列−並列変換
部２２においてデータをラッチしてパラレルデータに変
換し受信する。
【０００６】この通信回路の場合、データ送信中に第一
装置１の供給電源４に電源断が生じた場合、並列−直列
変換部１１と第一インタフェース部１２の機能は供給電
源４に支配されて動いており、このため並列−直列変換
部１１と第一インタフェース部１２の機能が停止する前
に若干の時間があり、この区間にクロックが第一インタ
フェース部１２から送出される。このために、正常なデ
ータが揃って後のクロックで動作する第二装置２が、こ
の供給電源４が壊れた後のクロックで動いてしまい、壊
れたデータ又は不確定なデータが直列−並列変換部２２
にラッチしてしまうことが生じる。
装置１の供給電源４に電源断が生じた場合、並列−直列
変換部１１と第一インタフェース部１２の機能は供給電
源４に支配されて動いており、このため並列−直列変換
部１１と第一インタフェース部１２の機能が停止する前
に若干の時間があり、この区間にクロックが第一インタ
フェース部１２から送出される。このために、正常なデ
ータが揃って後のクロックで動作する第二装置２が、こ
の供給電源４が壊れた後のクロックで動いてしまい、壊
れたデータ又は不確定なデータが直列−並列変換部２２
にラッチしてしまうことが生じる。
【０００７】これを図４で説明すると、供給電源４が断
となって電圧降下を開始してから第一インタフェース部
１２の５ｖ電圧が下降を開始するまでに数ｍｓ〜数１０
ｍｓの時間があり、この間において第二インタフェース
部２１に入ってくるクロックにて直列−並列変換回路２
２が動いてしまい、壊れたデータまたは不確定なデータ
が受信されてしまうようになる。
となって電圧降下を開始してから第一インタフェース部
１２の５ｖ電圧が下降を開始するまでに数ｍｓ〜数１０
ｍｓの時間があり、この間において第二インタフェース
部２１に入ってくるクロックにて直列−並列変換回路２
２が動いてしまい、壊れたデータまたは不確定なデータ
が受信されてしまうようになる。
【０００８】
【発明が解決しようとする課題】従って、従来例の通信
回路において、電源断によって壊れたデータ又は不確定
なデータが送出されてしまうという課題がある。
回路において、電源断によって壊れたデータ又は不確定
なデータが送出されてしまうという課題がある。
【０００９】本発明は、電源断が起こると同時にクロッ
クの送出機能を停止し、電源断前の最終的なデータを受
信側でラッチすることを目的とする。
クの送出機能を停止し、電源断前の最終的なデータを受
信側でラッチすることを目的とする。
【００１０】
【課題を解決するための手段】上記の目的を達成するた
め本発明では、第一インタフェース部１２を具えてクロ
ックとデータの送信を行う第一装置１と、該クロックを
基に前記データを受信する第二装置２とからなる通信回
路において、前記第一装置１の内部に、電源断時に第一
インタフェース部１２からのクロックの送出を停止させ
る電源監視回路１３を設け、電源断時における不確定な
クロックの伝送を防止するよう構成する。
め本発明では、第一インタフェース部１２を具えてクロ
ックとデータの送信を行う第一装置１と、該クロックを
基に前記データを受信する第二装置２とからなる通信回
路において、前記第一装置１の内部に、電源断時に第一
インタフェース部１２からのクロックの送出を停止させ
る電源監視回路１３を設け、電源断時における不確定な
クロックの伝送を防止するよう構成する。
【００１１】
【作用】本発明は図１に示すごとく、電源断時に瞬時に
電源監視回路１３から第一インタフェース部１２に対し
て出力制御を送出し、第一インタフェース部１２からの
クロックの送出を停止するようにしている。
電源監視回路１３から第一インタフェース部１２に対し
て出力制御を送出し、第一インタフェース部１２からの
クロックの送出を停止するようにしている。
【００１２】従って、第一装置１の供給電源４の電圧が
落ちかけている時のクロックの送出を停止する為、壊れ
たデータや不確定なデータの受信を無くすることができ
る。
落ちかけている時のクロックの送出を停止する為、壊れ
たデータや不確定なデータの受信を無くすることができ
る。
【００１３】
【実施例】以下、図１と図２をもちいて本発明の通信回
路を説明する。図１は通信回路である。１は例えば送信
系の第一装置であり、並列−直列変換部１１と第一イン
タフェース部１２と電源監視回路１３を具える。尚、２
は例えば受信系の第二装置であり、第二インタフェース
部２１と直列−並列変換部２２を具える。又、３は平衡
伝送路、更に４は第一装置１の供給電源である。
路を説明する。図１は通信回路である。１は例えば送信
系の第一装置であり、並列−直列変換部１１と第一イン
タフェース部１２と電源監視回路１３を具える。尚、２
は例えば受信系の第二装置であり、第二インタフェース
部２１と直列−並列変換部２２を具える。又、３は平衡
伝送路、更に４は第一装置１の供給電源である。
【００１４】図２は通信回路の送信系のタイムチャート
である。図２において、（Ａ）は供給電源のタイムチャ
ート、（Ｂ）は電源監視回路の出力制御のタイムチャー
ト、（Ｃ）は第一インタフェース部の出力のタイムチャ
ートである。以下、図１と図２により本発明の実施例を
説明する。
である。図２において、（Ａ）は供給電源のタイムチャ
ート、（Ｂ）は電源監視回路の出力制御のタイムチャー
ト、（Ｃ）は第一インタフェース部の出力のタイムチャ
ートである。以下、図１と図２により本発明の実施例を
説明する。
【００１５】従来例と同様に、例えば交換機のように二
重化されたシステムにおいては、常用系の或る第一装置
１から非常系の或る第二装置２へデータの通信は、平衡
伝送路３を用いてクロックやデータの通信をおこなって
いる。
重化されたシステムにおいては、常用系の或る第一装置
１から非常系の或る第二装置２へデータの通信は、平衡
伝送路３を用いてクロックやデータの通信をおこなって
いる。
【００１６】通常の動作時は、第一装置１の並列−直列
変換部１１からきたデータと第一クロックを第一インタ
フェース部１２をもちいて第二装置２の第二インタフェ
ース部２１に送り、直列−並列変換部２２では第二イン
タフェース部２１から来たデータを第二インタフェース
部２１からから来た第二クロックでラッチして受信して
いる。
変換部１１からきたデータと第一クロックを第一インタ
フェース部１２をもちいて第二装置２の第二インタフェ
ース部２１に送り、直列−並列変換部２２では第二イン
タフェース部２１から来たデータを第二インタフェース
部２１からから来た第二クロックでラッチして受信して
いる。
【００１７】図２（Ａ）に示すように供給電源４の５ｖ
が低下して約４．２ ｖに降下すると、図２（Ｂ）に示
すように電源監視回路１３から第一インタフェース部１
２に対する出力制御が瞬時に‘０’レベルに落ちる為、
図２（Ｃ）のごとく第一インタフェース部１２の出力は
停止する。従って、供給電源４の電圧が４．２ ｖ以下
の落ちかけの状態で未だクロックが動いていても第一イ
ンタフェース部１２からデータが出力されることはない
。
が低下して約４．２ ｖに降下すると、図２（Ｂ）に示
すように電源監視回路１３から第一インタフェース部１
２に対する出力制御が瞬時に‘０’レベルに落ちる為、
図２（Ｃ）のごとく第一インタフェース部１２の出力は
停止する。従って、供給電源４の電圧が４．２ ｖ以下
の落ちかけの状態で未だクロックが動いていても第一イ
ンタフェース部１２からデータが出力されることはない
。
【００１８】即ち、クロックの送出機能の支配権が電源
監視回路１３に委ねるようにし、供給電源４の電圧が低
下したとき第一インタフェース部１２の動作を確実に停
止させるようにしている。
監視回路１３に委ねるようにし、供給電源４の電圧が低
下したとき第一インタフェース部１２の動作を確実に停
止させるようにしている。
【００１９】
【発明の効果】以上の説明から明らかなように本発明に
よれば、電源断時の不確定なデータをラッチしてしまう
ことがなくなり、データが壊れる前のデータを確実にラ
ッチする効果を奏する。
よれば、電源断時の不確定なデータをラッチしてしまう
ことがなくなり、データが壊れる前のデータを確実にラ
ッチする効果を奏する。
【図１】 本発明の回路構成を示す図である。
【図２】 本発明回路のタイムチャートを示す図であ
る。
る。
【図３】 従来の通信回路の一実施例を示す図である
。
。
【図４】 従来の通信回路のタイムチャートを示す図
である。
である。
１は第一装置
２は第二装置
１１は並列−直列変換部
１２は第一インタフェース部
１３は電源監視回路
２１は第二インタフェース部
２２は直列−並列変換部
Claims (1)
- 【請求項１】 第一インタフェース部（１２）を具え
てクロックとデータの送信を行う第一装置（１） と、
該クロックを基に前記データを受信する第二装置（２）
とからなる通信回路において、前記第一装置１の内部
に、電源断時に第一インタフェース部（１２）からのク
ロックの送出を停止させる電源監視回路（１３）を設け
、電源断時における不確定なクロックの伝送を防止した
ことを特徴とする通信データ保護回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7968891A JPH04314226A (ja) | 1991-04-12 | 1991-04-12 | 通信データ保護回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7968891A JPH04314226A (ja) | 1991-04-12 | 1991-04-12 | 通信データ保護回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04314226A true JPH04314226A (ja) | 1992-11-05 |
Family
ID=13697146
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7968891A Pending JPH04314226A (ja) | 1991-04-12 | 1991-04-12 | 通信データ保護回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04314226A (ja) |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5887941A (ja) * | 1981-11-19 | 1983-05-25 | Matsushita Electric Ind Co Ltd | デ−タ伝送装置 |
| JPS63272236A (ja) * | 1987-04-30 | 1988-11-09 | Fujitsu Ltd | バースト信号送出用スイッチング制御回路 |
-
1991
- 1991-04-12 JP JP7968891A patent/JPH04314226A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5887941A (ja) * | 1981-11-19 | 1983-05-25 | Matsushita Electric Ind Co Ltd | デ−タ伝送装置 |
| JPS63272236A (ja) * | 1987-04-30 | 1988-11-09 | Fujitsu Ltd | バースト信号送出用スイッチング制御回路 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 19961105 |