JPH04323968A - ビデオ信号増幅回路 - Google Patents
ビデオ信号増幅回路Info
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- JPH04323968A JPH04323968A JP3092510A JP9251091A JPH04323968A JP H04323968 A JPH04323968 A JP H04323968A JP 3092510 A JP3092510 A JP 3092510A JP 9251091 A JP9251091 A JP 9251091A JP H04323968 A JPH04323968 A JP H04323968A
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- 239000003990 capacitor Substances 0.000 claims abstract description 33
- 239000002131 composite material Substances 0.000 claims abstract description 27
- 239000000872 buffer Substances 0.000 claims description 21
- 230000003321 amplification Effects 0.000 claims description 19
- 238000003199 nucleic acid amplification method Methods 0.000 claims description 19
- 238000010586 diagram Methods 0.000 description 5
- 230000001360 synchronised effect Effects 0.000 description 3
- 230000000694 effects Effects 0.000 description 1
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- Picture Signal Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】本発明はビデオ信号増幅回路に関
し、特にテレビジョン方式における複合映像信号を増幅
するビデオ信号増幅回路に関する。
し、特にテレビジョン方式における複合映像信号を増幅
するビデオ信号増幅回路に関する。
【０００２】
【従来の技術】従来のこの種のビデオ信号増幅回路２は
、図４に示すように、複合映像信号Ｉを増幅し複合ビデ
オ出力信号Ｏを出力する増幅器Ａ１１と、複合ビデオ出
力信号Ｏの直流レベルを設定する直流レベル設定回路２
１とを備えて構成され、端子Ｔ５を介して、直流レベル
保持用の容量Ｃ１が接続されているというものであった
。
、図４に示すように、複合映像信号Ｉを増幅し複合ビデ
オ出力信号Ｏを出力する増幅器Ａ１１と、複合ビデオ出
力信号Ｏの直流レベルを設定する直流レベル設定回路２
１とを備えて構成され、端子Ｔ５を介して、直流レベル
保持用の容量Ｃ１が接続されているというものであった
。
【０００３】直流レベル設定回路２１は、入力の一方が
増幅器Ａ１１の出力側に接続された増幅器Ａ１２と、増
幅器Ａ１２の他方の入力に接続された基準電圧ＶＲ１と
、バッフアＢ１１，Ｂ１２と、スイッチ回路Ｓ１１とを
備えて構成されていた。バッファＢ１１はスイッチ回路
Ｓ１１と容量Ｃ１とが入力側に接続され、出力側は増幅
器Ａ１１の他の一方の端子に負帰還回路を構成するよう
接続されている。バッファＢ１２は端子Ｔ１から入力さ
れる水平同期クランプパルスＨＣに対するバッファであ
る。
増幅器Ａ１１の出力側に接続された増幅器Ａ１２と、増
幅器Ａ１２の他方の入力に接続された基準電圧ＶＲ１と
、バッフアＢ１１，Ｂ１２と、スイッチ回路Ｓ１１とを
備えて構成されていた。バッファＢ１１はスイッチ回路
Ｓ１１と容量Ｃ１とが入力側に接続され、出力側は増幅
器Ａ１１の他の一方の端子に負帰還回路を構成するよう
接続されている。バッファＢ１２は端子Ｔ１から入力さ
れる水平同期クランプパルスＨＣに対するバッファであ
る。
【０００４】次に、本回路の動作について説明する。
【０００５】図５および図６は、図４で示す従来の回路
の定常時および電源投入時の動作をそれぞれ説明するタ
イムチャートである。
の定常時および電源投入時の動作をそれぞれ説明するタ
イムチャートである。
【０００６】まず図５により、定常時の動作について説
明する。端子Ｔ１から入力される水平同期クランプパル
スＨＣがハイレベルの期間にあるときは、スイッチ回路
Ｓ１１はｂ側に、すなわち、増幅器Ａ１２の出力がバッ
ファＢ１１に入力されるように制御される。この結果、
複合ビデオ出力信号Ｏと基準電圧ＶＲ１との比較結果で
ある差電圧がバッファＢ１２を介して増幅器Ａ１１の入
力側に負帰還される。この負帰還動作により端子Ｔ３に
おける複合ビデオ出力信号Ｏの直流レベルは基準電圧Ｖ
Ｒ１に設定される。
明する。端子Ｔ１から入力される水平同期クランプパル
スＨＣがハイレベルの期間にあるときは、スイッチ回路
Ｓ１１はｂ側に、すなわち、増幅器Ａ１２の出力がバッ
ファＢ１１に入力されるように制御される。この結果、
複合ビデオ出力信号Ｏと基準電圧ＶＲ１との比較結果で
ある差電圧がバッファＢ１２を介して増幅器Ａ１１の入
力側に負帰還される。この負帰還動作により端子Ｔ３に
おける複合ビデオ出力信号Ｏの直流レベルは基準電圧Ｖ
Ｒ１に設定される。
【０００７】次に、水平同期クランプパルスＨＣがハイ
レベルの期間になると、スイッチ回路Ｓ１１はｂ側に、
すなわち、増幅器Ａ１２の負帰還ループが切断されるよ
うに制御される。しかし、容量Ｃ１には、スイッチ回路
Ｓ１１がｂ側に接続されていたときに増幅器Ａ１２の出
力である差電圧により充電された電圧ＶＣＲ、すなわち
、基準電圧ＶＲ１とほぼ等しい電圧が保持されているの
で、端子Ｔ３における複合ビデオ出力信号Ｏの直流レベ
ルは引続き電圧ＶＣＲに設定される。このとき、端子Ｔ
２にビデオ信号Ｉが入力されていれば、端子Ｔ３からは
この電圧ＶＣＲを動作点とする複合ビデオ出力信号Ｏが
出力される。
レベルの期間になると、スイッチ回路Ｓ１１はｂ側に、
すなわち、増幅器Ａ１２の負帰還ループが切断されるよ
うに制御される。しかし、容量Ｃ１には、スイッチ回路
Ｓ１１がｂ側に接続されていたときに増幅器Ａ１２の出
力である差電圧により充電された電圧ＶＣＲ、すなわち
、基準電圧ＶＲ１とほぼ等しい電圧が保持されているの
で、端子Ｔ３における複合ビデオ出力信号Ｏの直流レベ
ルは引続き電圧ＶＣＲに設定される。このとき、端子Ｔ
２にビデオ信号Ｉが入力されていれば、端子Ｔ３からは
この電圧ＶＣＲを動作点とする複合ビデオ出力信号Ｏが
出力される。
【０００８】次に図６により、電源投入時の動作につい
て説明する。スイッチ回路Ｓ１が開いていることにより
端子Ｔ４を介して供給される電源ＶＤが断である場合は
、容量Ｃ１には充電電荷はなく、したがって、電位は０
Ｖである。スイッチ回路Ｓ１を閉じて電源ＶＤを投入す
ると、水平同期クランプパルスＨＣのクランプ期間Ｌに
同期して容量Ｃ１に対する充電が開始される。このとき
、増幅器Ａ１２の出力電流をＩＤとすると、１回のクラ
ンプ期間ｔＬごとに容量Ｃ１に充電される電圧ΔＶＣは
次式で示される。
て説明する。スイッチ回路Ｓ１が開いていることにより
端子Ｔ４を介して供給される電源ＶＤが断である場合は
、容量Ｃ１には充電電荷はなく、したがって、電位は０
Ｖである。スイッチ回路Ｓ１を閉じて電源ＶＤを投入す
ると、水平同期クランプパルスＨＣのクランプ期間Ｌに
同期して容量Ｃ１に対する充電が開始される。このとき
、増幅器Ａ１２の出力電流をＩＤとすると、１回のクラ
ンプ期間ｔＬごとに容量Ｃ１に充電される電圧ΔＶＣは
次式で示される。
【０００９】
【００１０】したがって、定常時に容量Ｃ１に保持され
る電圧値をＶＣとすると、所要のクランプ期間Ｌの回数
Ｆは次式で示される。
る電圧値をＶＣとすると、所要のクランプ期間Ｌの回数
Ｆは次式で示される。
【００１１】
【００１２】複合映像信号の水平同期クランプパルスＨ
Ｃの周期をｔＳとすると、電源投入後複合ビデオ出力信
号Ｏが所要の直流レベルに到達し定常状態となるまでの
時間ｔＲは次式で示される。
Ｃの周期をｔＳとすると、電源投入後複合ビデオ出力信
号Ｏが所要の直流レベルに到達し定常状態となるまでの
時間ｔＲは次式で示される。
【００１３】
【００１４】ここで、連続的に充電される場合における
容量Ｃ１の電圧がＶＣＲに到達するまでの時間ｔＲＳは
次式で示される。
容量Ｃ１の電圧がＶＣＲに到達するまでの時間ｔＲＳは
次式で示される。
【００１５】
【００１６】一方、水平同期クランプパルスＨＣの周期
ｔＳはクランプ期間Ｌの１０倍以上であるので、定常状
態となるまでの時間ｔＲは容量Ｃ１を連続的に充電する
場合の時間ｔＲＳと比較して次式で示される。
ｔＳはクランプ期間Ｌの１０倍以上であるので、定常状
態となるまでの時間ｔＲは容量Ｃ１を連続的に充電する
場合の時間ｔＲＳと比較して次式で示される。
【００１７】
【００１８】以上により、この従来のビデオ信号増幅回
路は、電源投入から定常状態の動作に到達するまでの時
間が長いことが示されるというものであった。
路は、電源投入から定常状態の動作に到達するまでの時
間が長いことが示されるというものであった。
【００１９】
【発明が解決しようとする課題】上述した従来のビデオ
信号増幅回路は、直流電圧レベル設定回路の設定レベル
保持用容量の充電が水平同期信号のクランプパルスのク
ランプ期間に断続的に行なわれるため電源投入後所定の
設定値に達するのに時間がかかり、その間定常状態の複
合ビデオ出力信号出力が得られないという問題点があっ
た。
信号増幅回路は、直流電圧レベル設定回路の設定レベル
保持用容量の充電が水平同期信号のクランプパルスのク
ランプ期間に断続的に行なわれるため電源投入後所定の
設定値に達するのに時間がかかり、その間定常状態の複
合ビデオ出力信号出力が得られないという問題点があっ
た。
【００２０】
【課題を解決するための手段】本発明のビデオ信号増幅
回路は、テレビジョン方式の複合映像信号を増幅し複合
ビデオ出力信号を出力する第一の増幅器と、前記複合ビ
デオ出力信号と予め定めた第一の基準電圧とを比較し差
電圧を出力する第二の増幅器と、前記差電圧を水平同期
信号に同期して接断するとともに前記差電圧を前記第一
の増幅器に負帰還するよう接続する第一のスイッチ回路
と、前記スイッチ回路を介して前記差電圧を充電しこの
差電圧を保持する第一の容量とを備えたビデオ信号増幅
回路において、予め定めた第二の基準電圧とこの第二の
基準電圧を接断する第二のスイッチ回路とを有する初期
設定回路と、電源投入時に前記第二のスイッチ回路を接
にし予め定めた時間の経過後に前記第二のスイッチ回路
を断にするスイッチ制御信号を発生する時定数設定回路
とを備えて構成されている。
回路は、テレビジョン方式の複合映像信号を増幅し複合
ビデオ出力信号を出力する第一の増幅器と、前記複合ビ
デオ出力信号と予め定めた第一の基準電圧とを比較し差
電圧を出力する第二の増幅器と、前記差電圧を水平同期
信号に同期して接断するとともに前記差電圧を前記第一
の増幅器に負帰還するよう接続する第一のスイッチ回路
と、前記スイッチ回路を介して前記差電圧を充電しこの
差電圧を保持する第一の容量とを備えたビデオ信号増幅
回路において、予め定めた第二の基準電圧とこの第二の
基準電圧を接断する第二のスイッチ回路とを有する初期
設定回路と、電源投入時に前記第二のスイッチ回路を接
にし予め定めた時間の経過後に前記第二のスイッチ回路
を断にするスイッチ制御信号を発生する時定数設定回路
とを備えて構成されている。
【００２１】
【実施例】次に、本発明の実施例について図面を参照し
て説明する。
て説明する。
【００２２】図１は本発明のビデオ信号増幅回路の一実
施例を示すブロック図である。
施例を示すブロック図である。
【００２３】本実施例のビデオ信号増幅回路１は、図１
に示すように、複合映像信号Ｉを増幅し複合ビデオ出力
信号Ｏを出力する増幅器Ａ１１と、複合ビデオ出力信号
Ｏの直流レベルを設定する直流レベル設定回路１１と、
時定数設定回路１２と、初期設定回路１３とを備えて構
成され、端子Ｔ５を介して、直流レベル保持用の容量Ｃ
１が接続されている。
に示すように、複合映像信号Ｉを増幅し複合ビデオ出力
信号Ｏを出力する増幅器Ａ１１と、複合ビデオ出力信号
Ｏの直流レベルを設定する直流レベル設定回路１１と、
時定数設定回路１２と、初期設定回路１３とを備えて構
成され、端子Ｔ５を介して、直流レベル保持用の容量Ｃ
１が接続されている。
【００２４】直流レベル設定回路１１は、入力の一方が
増幅器Ａ１１の出力側に接続された増幅器Ａ１２と、増
幅器Ａ１２の他方の入力に接続された基準電圧ＶＲ１と
、バッフアＢ１１，Ｂ１２と、スイッチ回路Ｓ１１と、
論理積回路Ｅ１１とを備えて構成されている。バッファ
Ｂ１１はスイッチ回路Ｓ１１と容量Ｃ１とが入力側に接
続され、出力側は増幅器Ａ１１の他の一方の端子に負帰
還回路を構成するよう接続されている。バッファＢ１２
は端子Ｔ１から入力される水平同期クランプパルスＨＣ
に対するバッファである。論理積回路Ｅ１１は、バッフ
ァＢ１２の出力と時定数設定回路１２の出力との論理積
をとる回路であり、この出力により、スイッチ回路Ｓ１
１を制御する。
増幅器Ａ１１の出力側に接続された増幅器Ａ１２と、増
幅器Ａ１２の他方の入力に接続された基準電圧ＶＲ１と
、バッフアＢ１１，Ｂ１２と、スイッチ回路Ｓ１１と、
論理積回路Ｅ１１とを備えて構成されている。バッファ
Ｂ１１はスイッチ回路Ｓ１１と容量Ｃ１とが入力側に接
続され、出力側は増幅器Ａ１１の他の一方の端子に負帰
還回路を構成するよう接続されている。バッファＢ１２
は端子Ｔ１から入力される水平同期クランプパルスＨＣ
に対するバッファである。論理積回路Ｅ１１は、バッフ
ァＢ１２の出力と時定数設定回路１２の出力との論理積
をとる回路であり、この出力により、スイッチ回路Ｓ１
１を制御する。
【００２５】時定数設定回路１２は、電源ＶＤが接続さ
れている抵抗Ｒ１と容量Ｃ２とからなる時定数回路と、
一方の端子に時定数回路の出力が入力される増幅器Ａ１
３と、増幅器Ａ１３の他方の入力に接続された基準電圧
ＶＲ３とを備えて構成されている。
れている抵抗Ｒ１と容量Ｃ２とからなる時定数回路と、
一方の端子に時定数回路の出力が入力される増幅器Ａ１
３と、増幅器Ａ１３の他方の入力に接続された基準電圧
ＶＲ３とを備えて構成されている。
【００２６】初期設定回路１３は、基準電圧ＶＲ２と、
時定数設定回路１２の出力により基準電圧ＶＲ２と接地
電位とを切替えるスイッチ回路Ｓ１２と、バッファＢ１
３とを備えて構成される。基準電圧ＶＲ２は、複合ビデ
オ出力信号Ｏが定常状態のときの容量Ｃ１に充電されて
いる電圧ＶＣＲの予測値の電圧に設定される。
時定数設定回路１２の出力により基準電圧ＶＲ２と接地
電位とを切替えるスイッチ回路Ｓ１２と、バッファＢ１
３とを備えて構成される。基準電圧ＶＲ２は、複合ビデ
オ出力信号Ｏが定常状態のときの容量Ｃ１に充電されて
いる電圧ＶＣＲの予測値の電圧に設定される。
【００２７】図２は時定数設定回路１２と、初期設定回
路１３との具体的な回路の一例を示す回路図である。
路１３との具体的な回路の一例を示す回路図である。
【００２８】増幅器Ａ１３は、ＰＮＰトランジスタＱ１
，Ｑ２からなる差動増幅器であり、トランジスタＱ１の
ベースに時定数回路の抵抗Ｒ１とＣ２とが接続されてい
る。電源電圧ＶＤを分圧して基準電圧ＶＲ３を発生する
分圧回路Ｒ３，Ｒ４の出力は、トランジスタＱ２のベー
スに印加される。トランジスタＱ２のコレクタは負荷抵
抗Ｒ５に接続され、出力は端子Ｔ１４，Ｔ１５を介して
スイッチ回路Ｓ１２に入力される。
，Ｑ２からなる差動増幅器であり、トランジスタＱ１の
ベースに時定数回路の抵抗Ｒ１とＣ２とが接続されてい
る。電源電圧ＶＤを分圧して基準電圧ＶＲ３を発生する
分圧回路Ｒ３，Ｒ４の出力は、トランジスタＱ２のベー
スに印加される。トランジスタＱ２のコレクタは負荷抵
抗Ｒ５に接続され、出力は端子Ｔ１４，Ｔ１５を介して
スイッチ回路Ｓ１２に入力される。
【００２９】スイッチ回路Ｓ１２は、ＮＰＮトランジス
タＱ３のエミッタ接地回路と、基準電圧ＶＲ２を発生す
る抵抗Ｒ６，Ｒ７からなる分圧回路とで構成される。
タＱ３のエミッタ接地回路と、基準電圧ＶＲ２を発生す
る抵抗Ｒ６，Ｒ７からなる分圧回路とで構成される。
【００３０】バッファＢ１３は、ＰＮＰトランジスタＱ
４とＮＰＮトランジスタＱ５とからなるエミッタフォロ
ワ形のバッファであり端子Ｔ５を介して容量Ｃ１に接続
されている。
４とＮＰＮトランジスタＱ５とからなるエミッタフォロ
ワ形のバッファであり端子Ｔ５を介して容量Ｃ１に接続
されている。
【００３１】次に、本実施例の動作について説明する。
【００３２】図３は、図１で示す本実施例の回路のタイ
ムチャートである。
ムチャートである。
【００３３】まず、スイッチ回路Ｓ１を閉じて電源ＶＤ
を投入する。電源投入直後の時刻ｔ１においては、容量
Ｃ２の電位Ｖｔ１は次式で示される。
を投入する。電源投入直後の時刻ｔ１においては、容量
Ｃ２の電位Ｖｔ１は次式で示される。
【００３４】
【００３５】このとき、増幅器Ａ１３の出力はローレベ
ルであり、スイッチ回路Ｓ１２の出力端子Ｔ１２には基
準電圧ＶＲ２が出力されており、バッファＢ１３を介し
て容量Ｃ１に充電動作を行なっている。また、増幅器１
３の出力と水平同期クランプパルスＨＣとの論理積はロ
ーレベルであり、したがって、スイッチ回路Ｓ１１が開
となり増幅器Ａ１２による負帰還ループが切断されてい
るので、増幅器Ａ１２による容量Ｃ１に対する充電は行
なわれない。
ルであり、スイッチ回路Ｓ１２の出力端子Ｔ１２には基
準電圧ＶＲ２が出力されており、バッファＢ１３を介し
て容量Ｃ１に充電動作を行なっている。また、増幅器１
３の出力と水平同期クランプパルスＨＣとの論理積はロ
ーレベルであり、したがって、スイッチ回路Ｓ１１が開
となり増幅器Ａ１２による負帰還ループが切断されてい
るので、増幅器Ａ１２による容量Ｃ１に対する充電は行
なわれない。
【００３６】次に、時刻ｔ２になると、容量Ｃ１の電位
ＶＣは基準電圧ＶＲ２の値に達し、複合ビデオ出力信号
Ｏの直流レベルは所定の直流レベルＶＣＲに近い値とな
る。
ＶＣは基準電圧ＶＲ２の値に達し、複合ビデオ出力信号
Ｏの直流レベルは所定の直流レベルＶＣＲに近い値とな
る。
【００３７】次に、時刻ｔ３になると、時定数設定回路
１２の容量Ｃ２の電位Ｖｔ３は、次式により示される。
１２の容量Ｃ２の電位Ｖｔ３は、次式により示される。
【００３８】
【００３９】このとき、増幅器１３の出力はハイレベル
に転じ、スイッチ回路Ｓ１２の出力端子Ｔ１２には接地
電位０Ｖが出力される。また、容量Ｃ１は、依然として
基準電圧ＶＲ２の電位を保持しているため、バッファＢ
１３のトランジスタＱ５のエミッタベース間は逆バイア
ス状態となりバッファ回路Ｂ１３の出力が遮断される。 したがって、容量Ｃ１に対する充電動作は停止する。さ
らに、ハイレベルの増幅器Ａ１３の出力により論理積回
路Ｅ１１が開となり水平同期クランプパルスＨＣを通過
させる。その結果、直流レベル設定回路１１は、従来例
と同様の水平同期クランプパルスＨＣに同期する動作状
態となり、容量Ｃ１の電位ＶＣは、基準電圧ＶＲ２から
定常状態のときの電位ＶＣＲになる。したがって、複合
ビデオ出力信号Ｏの直流レベルはＶＲ１とほぼ等しい電
圧ＶＣＲに設定される。
に転じ、スイッチ回路Ｓ１２の出力端子Ｔ１２には接地
電位０Ｖが出力される。また、容量Ｃ１は、依然として
基準電圧ＶＲ２の電位を保持しているため、バッファＢ
１３のトランジスタＱ５のエミッタベース間は逆バイア
ス状態となりバッファ回路Ｂ１３の出力が遮断される。 したがって、容量Ｃ１に対する充電動作は停止する。さ
らに、ハイレベルの増幅器Ａ１３の出力により論理積回
路Ｅ１１が開となり水平同期クランプパルスＨＣを通過
させる。その結果、直流レベル設定回路１１は、従来例
と同様の水平同期クランプパルスＨＣに同期する動作状
態となり、容量Ｃ１の電位ＶＣは、基準電圧ＶＲ２から
定常状態のときの電位ＶＣＲになる。したがって、複合
ビデオ出力信号Ｏの直流レベルはＶＲ１とほぼ等しい電
圧ＶＣＲに設定される。
【００４０】ここで、バッファＢ１３から容量Ｃ１に対
する充電時間ｔ３は、次式により示される。
する充電時間ｔ３は、次式により示される。
【００４１】
【００４２】さらに、容量Ｃ１の電位ＶＣがＶＲ２から
定常状態のときの値ＶＣＲに達するまでの時間Δｔ３は
、次式により示される。
定常状態のときの値ＶＣＲに達するまでの時間Δｔ３は
、次式により示される。
【００４３】
【００４４】ここで、ＶＲ２は定常状態の充電電圧ＶＣ
Ｒの設計上の予測値に設定されているので次式が成立す
る。
Ｒの設計上の予測値に設定されているので次式が成立す
る。
【００４５】
【００４６】したがって、Δｔ３は非常に小さい値とな
る。
る。
【００４７】また、容量Ｃ１に対する充電開始から電位
ＶＲ２に達するまでの時間ｔ１は、低インピーダンスで
あるエミッタフォロワ形のバッファにより充電を行なっ
ているので水平同期クランプパルスＨＣの周期ｔＳに比
し十分短かい時間となる。
ＶＲ２に達するまでの時間ｔ１は、低インピーダンスで
あるエミッタフォロワ形のバッファにより充電を行なっ
ているので水平同期クランプパルスＨＣの周期ｔＳに比
し十分短かい時間となる。
【００４８】したがって、抵抗Ｒ１、容量Ｃ２、基準電
圧ＶＲ１，ＶＲ２の各値を次式（１１），（１２）を満
足するように適切に設定することにより、複合ビデオ出
力信号Ｏが定常状態になる時間ｔ３＋Δｔ３を従来の定
常状態となるまでの時間ｔＲに比し極めて短縮すること
ができる。
圧ＶＲ１，ＶＲ２の各値を次式（１１），（１２）を満
足するように適切に設定することにより、複合ビデオ出
力信号Ｏが定常状態になる時間ｔ３＋Δｔ３を従来の定
常状態となるまでの時間ｔＲに比し極めて短縮すること
ができる。
【００４９】
【００５０】
【発明の効果】以上説明したように、本発明のビデオ信
号増幅回路は、第二の基準電圧とこの第二の基準電圧を
接断する第二のスイッチ回路とを有する初期設定回路と
、電源投入時に第二のスイッチ回路を接にし設定時間の
経過後にこれを断にするスイッチ制御信号を発生する時
定数設定回路とを備えることにより、電源投入後直ちに
直流電圧レベル設定回路の設定レベル保持用容量を所要
の設定値付近まで充電できるので、速かに複合ビデオ出
力信号出力が定常状態となるという効果がある。
号増幅回路は、第二の基準電圧とこの第二の基準電圧を
接断する第二のスイッチ回路とを有する初期設定回路と
、電源投入時に第二のスイッチ回路を接にし設定時間の
経過後にこれを断にするスイッチ制御信号を発生する時
定数設定回路とを備えることにより、電源投入後直ちに
直流電圧レベル設定回路の設定レベル保持用容量を所要
の設定値付近まで充電できるので、速かに複合ビデオ出
力信号出力が定常状態となるという効果がある。
【００５１】
【図１】本発明のビデオ信号増幅回路の一実施例を示す
ブロック図である。
ブロック図である。
【図２】本実施例のビデオ信号増幅回路の時定数設定回
路と初期設定回路との具体的な回路の一例を示す回路図
である。
路と初期設定回路との具体的な回路の一例を示す回路図
である。
【図３】本実施例のビデオ信号増幅回路の動作を示すタ
イムチャートである。
イムチャートである。
【図４】従来のビデオ信号増幅回路の一例を示すブロッ
ク図である。
ク図である。
【図５】従来のビデオ信号増幅回路の定常状態の動作を
示すタイムチャートである。
示すタイムチャートである。
【図６】従来のビデオ信号増幅回路の電源投入時の動作
を示すタイムチャートである。
を示すタイムチャートである。
１，２ ビデオ信号増幅回路
１１，２１ 直流レベル設定回路１２ 時
定数設定回路 １３ 初期設定回路 Ａ１１〜Ａ１３ 増幅器 Ｂ１１〜Ｂ１３ バッファ Ｃ１，Ｃ２ 容量 Ｅ１ 論理積回路 Ｑ１〜Ｑ５ トランジスタ Ｒ１〜Ｒ８ 抵抗 Ｓ１，Ｓ１１，Ｓ１２ スイッチ回路ＶＲ１〜Ｖ
Ｒ３ 基準電圧
定数設定回路 １３ 初期設定回路 Ａ１１〜Ａ１３ 増幅器 Ｂ１１〜Ｂ１３ バッファ Ｃ１，Ｃ２ 容量 Ｅ１ 論理積回路 Ｑ１〜Ｑ５ トランジスタ Ｒ１〜Ｒ８ 抵抗 Ｓ１，Ｓ１１，Ｓ１２ スイッチ回路ＶＲ１〜Ｖ
Ｒ３ 基準電圧
Claims (3)
- 【請求項１】 テレビジョン方式の複合映像信号を増
幅し複合ビデオ出力信号を出力する第一の増幅器と、前
記複合ビデオ出力信号と予め定めた第一の基準電圧とを
比較し差電圧を出力する第二の増幅器と、前記差電圧を
水平同期信号に同期して接断するとともに前記差電圧を
前記第一の増幅器に負帰還するよう接続する第一のスイ
ッチ回路と、前記スイッチ回路を介して前記差電圧を充
電しこの差電圧を保持する第一の容量とを備えたビデオ
信号増幅回路において、予め定めた第二の基準電圧とこ
の第二の基準電圧を接断する第二のスイッチ回路とを有
する初期設定回路と、電源投入時に前記第二のスイッチ
回路を接にし予め定めた時間の経過後に前記第二のスイ
ッチ回路を断にするスイッチ制御信号を発生する時定数
設定回路とを備えることを特徴とするビデオ信号増幅回
路。 - 【請求項２】 前記初期設定回路は前記第二の基準電
圧と前記第二のスイッチ回路とこの第二のスイッチ回路
の出力を出力するエミッタフォロワ型のバッファ回路と
を有し、前記第二のスイッチ回路は前記第二の基準電圧
と接地電位とを切替え、前記バッファ回路は前記第二の
スイッチ回路が前記基準電圧を選択したとき前記基準電
圧を出力し前記接地電位を選択したとき前記基準電圧の
出力を停止することを特徴とする請求項１記載のビデオ
信号増幅回路。 - 【請求項３】 前記時定数設定回路は電源電圧が印加
され第一の抵抗と第二の容量からなる時定数回路と予め
定めた第三の基準電圧と前記時定数回路の出力と前記第
三の基準電圧とを比較する第三の増幅器とを有すること
を特徴とする請求項１記載のビデオ信号増幅回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3092510A JPH04323968A (ja) | 1991-04-24 | 1991-04-24 | ビデオ信号増幅回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3092510A JPH04323968A (ja) | 1991-04-24 | 1991-04-24 | ビデオ信号増幅回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04323968A true JPH04323968A (ja) | 1992-11-13 |
Family
ID=14056312
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3092510A Pending JPH04323968A (ja) | 1991-04-24 | 1991-04-24 | ビデオ信号増幅回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04323968A (ja) |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63232606A (ja) * | 1987-03-20 | 1988-09-28 | Canon Inc | クランプ回路 |
| JPS6417570A (en) * | 1987-07-13 | 1989-01-20 | Hitachi Ltd | Multi-scanning horizontal oscillation circuit |
| JPH0269010A (ja) * | 1988-09-05 | 1990-03-08 | Matsushita Electric Ind Co Ltd | 時定数切換回路 |
-
1991
- 1991-04-24 JP JP3092510A patent/JPH04323968A/ja active Pending
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63232606A (ja) * | 1987-03-20 | 1988-09-28 | Canon Inc | クランプ回路 |
| JPS6417570A (en) * | 1987-07-13 | 1989-01-20 | Hitachi Ltd | Multi-scanning horizontal oscillation circuit |
| JPH0269010A (ja) * | 1988-09-05 | 1990-03-08 | Matsushita Electric Ind Co Ltd | 時定数切換回路 |
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| JPH0228948B2 (ja) |
Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 19990601 |