JPH0441262A - 印字ヘッド制御装置 - Google Patents
印字ヘッド制御装置Info
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- JPH0441262A JPH0441262A JP2149433A JP14943390A JPH0441262A JP H0441262 A JPH0441262 A JP H0441262A JP 2149433 A JP2149433 A JP 2149433A JP 14943390 A JP14943390 A JP 14943390A JP H0441262 A JPH0441262 A JP H0441262A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、ドツトマトリクスプリンタの印字ヘッド制御
装置に関するものである。
装置に関するものである。
従来の技術
近年、ドツトマトリクスプリンタにおいて各ピンが同時
に打点することによる騒音、電源の大容量化や電磁力を
利用する場合のｒＪＰｉ気干渉などの回避および高密度
実装化等のためにキャリッジにｔｉ載され、キャリッジ
の移動方向に直交する方向に対してピンを傾斜して配列
した印字ヘッドのピン列の各々のピンに対応した駆動信
号を供給し印字をおこなわせる分散印字ヘッドが用いら
れ、分取印字ヘッドの印字ヘッド制御装置が使用されて
いる。
に打点することによる騒音、電源の大容量化や電磁力を
利用する場合のｒＪＰｉ気干渉などの回避および高密度
実装化等のためにキャリッジにｔｉ載され、キャリッジ
の移動方向に直交する方向に対してピンを傾斜して配列
した印字ヘッドのピン列の各々のピンに対応した駆動信
号を供給し印字をおこなわせる分散印字ヘッドが用いら
れ、分取印字ヘッドの印字ヘッド制御装置が使用されて
いる。
以下従来の印字ヘッド制御装置について説明する。
第４図（ａ）は従来の２４ピンワイヤドツトヘツドのピ
ン列のパターンである。第４図（ｂ）はピンを傾斜して
配列した分散印字ヘッドのピン列のパターン、第４図（
Ｃ）は分散印字ヘッドのピン列のパターンのもう一つの
例である。
ン列のパターンである。第４図（ｂ）はピンを傾斜して
配列した分散印字ヘッドのピン列のパターン、第４図（
Ｃ）は分散印字ヘッドのピン列のパターンのもう一つの
例である。
第５図は２４ピンワイヤドツトヘツドの駆動タイミング
チャートであり、第５図（ａ）、第５図（ｂ）、第５図
（ｃ）はそれぞれ第４図（ａ、 ）、第４図（ｂ）、第
４図（Ｃ）のピン列のパターンのヘッドに対応している
。第４図（ａ）のピン列のパターンにおいては第５図（
ａ）に示すように文字を構成するドツトとドツトの間隔
を決定するタイミングＴ７、ヘッドのピンを駆動するヘ
ッドコイルの通電時間を決定するタイミングＴ８を生成
するタイマのみてよいが、第４図（ｂ）のピン列のパタ
ーンにおいては第５図（ｂ）に示ずように各々のピンで
駆動タイミングが異なるため、タイミングＴ７、タイミ
ングＴ８を生成するタイマだけでなく、ピン配列の傾斜
に従ってピン毎の遅延時間を決定するタイミングＴ９を
生成するタイマが必要で、２４ピンの駆動タイミング全
てをタイミングＴ９づつ遅延する必要がある。
チャートであり、第５図（ａ）、第５図（ｂ）、第５図
（ｃ）はそれぞれ第４図（ａ、 ）、第４図（ｂ）、第
４図（Ｃ）のピン列のパターンのヘッドに対応している
。第４図（ａ）のピン列のパターンにおいては第５図（
ａ）に示すように文字を構成するドツトとドツトの間隔
を決定するタイミングＴ７、ヘッドのピンを駆動するヘ
ッドコイルの通電時間を決定するタイミングＴ８を生成
するタイマのみてよいが、第４図（ｂ）のピン列のパタ
ーンにおいては第５図（ｂ）に示ずように各々のピンで
駆動タイミングが異なるため、タイミングＴ７、タイミ
ングＴ８を生成するタイマだけでなく、ピン配列の傾斜
に従ってピン毎の遅延時間を決定するタイミングＴ９を
生成するタイマが必要で、２４ピンの駆動タイミング全
てをタイミングＴ９づつ遅延する必要がある。
第４図（Ｃ）のピン配列では第５図（Ｃ）に示すように
駆動タイミングの遅延を６ピンのグループ毎に行い制御
回路を簡略化している。
駆動タイミングの遅延を６ピンのグループ毎に行い制御
回路を簡略化している。
第６図は第４図（ｂ）のピン配列を持つ従来の印字ヘッ
ド制御装置のフロック図である。第６図において、２２
は文字フォントのデータが書き込まれている文字フォン
ト読み出し専用メモリ（以下、文字フォントＲＯＭと略
称する。）、２３は印字データ分散用のタイミングを生
成するタイミング生成部で、第５図（ｂ）に示すような
Ｔ７、Ｔ８のタイミングを有するクロックを生成するタ
イマ２４、Ｔ９のタイミングを有するクロックを生成す
るタイマ２５および、これらのタイマ２４．２５を動作
させる発振器２６よりなっている。２７は文字フォント
ＲＯＭ２２より読み出された印字データを遅延させるシ
フトレジスタ部である。２８は中央処理装置（以下、Ｃ
ＰＵと略称する。）で文字フォントＲＯＭ２２、タイミ
ング生成部２３、シフトレジスタ部２７のそれぞれを入
出力部（以下、１７０部と略称する。）２９を介して制
御している。３０は２４個のＡＮＤ回路でそれぞれＣＰ
Ｕ２８からの２４ピン分の印字データとタイマ２４の出
力のＡＮＤを取る。３１はヘッドコイル３２にパルス信
号を印加するヘッドドライバである。
ド制御装置のフロック図である。第６図において、２２
は文字フォントのデータが書き込まれている文字フォン
ト読み出し専用メモリ（以下、文字フォントＲＯＭと略
称する。）、２３は印字データ分散用のタイミングを生
成するタイミング生成部で、第５図（ｂ）に示すような
Ｔ７、Ｔ８のタイミングを有するクロックを生成するタ
イマ２４、Ｔ９のタイミングを有するクロックを生成す
るタイマ２５および、これらのタイマ２４．２５を動作
させる発振器２６よりなっている。２７は文字フォント
ＲＯＭ２２より読み出された印字データを遅延させるシ
フトレジスタ部である。２８は中央処理装置（以下、Ｃ
ＰＵと略称する。）で文字フォントＲＯＭ２２、タイミ
ング生成部２３、シフトレジスタ部２７のそれぞれを入
出力部（以下、１７０部と略称する。）２９を介して制
御している。３０は２４個のＡＮＤ回路でそれぞれＣＰ
Ｕ２８からの２４ピン分の印字データとタイマ２４の出
力のＡＮＤを取る。３１はヘッドコイル３２にパルス信
号を印加するヘッドドライバである。
以上のように構成された印字ヘッド制御装置についてそ
の動作を以下に説明する。
の動作を以下に説明する。
ＣＰＵ２８はタイマ２４により第５図（ｂ）の１ピン目
のタイミング信号（以下、シフトデータと略称する。）
の立ち下がりタイミングＷが常に知らされ、ＣＰＵ２８
は文字フォントＲＯＭ２２より２４ピン分の印字データ
を読み込みシフトデータの立ち下がりのタイミングに従
ってＡＮＤ回路３０へ送り、ＡＮＤ回路３０て２４ピン
分の印字データのそれぞれとタイマ２４の出力のＡＮＤ
をとりシフトレジスタ部２７へ送る。またタイマ２５て
は文字モードデータＸをＣＰＵ２８より受は取りそれら
の印字モードに応じた第５図（ｂ）のＴ９を周期とする
タイミングを有するクロックｔ（以下、シフトクロック
と略称する。）をシフトレジスタ部２７に送る。シフト
レジスタ部２７はＡＮＤ回路３０からの出力（３号、シ
フトクロックｔに基き第５図（ｂ）の１ピンから２４ピ
ンまでの駆動信号を生成し、ヘットドライバ３１へ送る
。ヘッドドライバ３１は、シフトレジスタ部２７からの
駆動信号によりヘッドコイル３２にパルス電圧をあたえ
ることによりヘッドを駆動する。
のタイミング信号（以下、シフトデータと略称する。）
の立ち下がりタイミングＷが常に知らされ、ＣＰＵ２８
は文字フォントＲＯＭ２２より２４ピン分の印字データ
を読み込みシフトデータの立ち下がりのタイミングに従
ってＡＮＤ回路３０へ送り、ＡＮＤ回路３０て２４ピン
分の印字データのそれぞれとタイマ２４の出力のＡＮＤ
をとりシフトレジスタ部２７へ送る。またタイマ２５て
は文字モードデータＸをＣＰＵ２８より受は取りそれら
の印字モードに応じた第５図（ｂ）のＴ９を周期とする
タイミングを有するクロックｔ（以下、シフトクロック
と略称する。）をシフトレジスタ部２７に送る。シフト
レジスタ部２７はＡＮＤ回路３０からの出力（３号、シ
フトクロックｔに基き第５図（ｂ）の１ピンから２４ピ
ンまでの駆動信号を生成し、ヘットドライバ３１へ送る
。ヘッドドライバ３１は、シフトレジスタ部２７からの
駆動信号によりヘッドコイル３２にパルス電圧をあたえ
ることによりヘッドを駆動する。
シフトクロックｔの周波数は種々の文字に関する印字モ
ードに対応して変化するが、Ｔ８のタイミングを維持す
る為にはＴ８がシフトクロックｔの整数倍てなければな
らないので、必然的にシフトクロックｔの周波数を上げ
る、即ちＴ９期間を細分化したシフトクロックｔをシフ
トレジスタ部２７に与える必要が生しる。このためシフ
トレジスタ部２７のシフ］・レジスタは複数段設けてい
た。
ードに対応して変化するが、Ｔ８のタイミングを維持す
る為にはＴ８がシフトクロックｔの整数倍てなければな
らないので、必然的にシフトクロックｔの周波数を上げ
る、即ちＴ９期間を細分化したシフトクロックｔをシフ
トレジスタ部２７に与える必要が生しる。このためシフ
トレジスタ部２７のシフ］・レジスタは複数段設けてい
た。
発明が解決しようとする課題
しかしながら前記従来の構成では、文字フォントＲＯＭ
２２より読み出された印字データにヘッドコイル３２の
通電時間のデータをｆ寸前し、この印字データに通電時
間のデータを付加したデータによりシフトレジスタ部２
７て分散印字ヘッドのピン列の各々のピンに対応した分
散データを生成しているのでヘッドコイル３２の通電時
間をあらゆる印字モードに対しても維持するためヘット
′コイル３２の通電時間が常にシフトレジスタ部２７を
駆動するシフトクロックの周期の整数倍となるようシフ
トクロックの周波数を高くする必要があり、シフトレジ
スタ部３２においてシフトレジスタの数が多くゲート数
が多くなる。ゲート数を少なくするために第５図（Ｃ）
のようなピン列のパターン構成にすると、印字騒音低減
、電源容量縮小等の効果が激減する。
２２より読み出された印字データにヘッドコイル３２の
通電時間のデータをｆ寸前し、この印字データに通電時
間のデータを付加したデータによりシフトレジスタ部２
７て分散印字ヘッドのピン列の各々のピンに対応した分
散データを生成しているのでヘッドコイル３２の通電時
間をあらゆる印字モードに対しても維持するためヘット
′コイル３２の通電時間が常にシフトレジスタ部２７を
駆動するシフトクロックの周期の整数倍となるようシフ
トクロックの周波数を高くする必要があり、シフトレジ
スタ部３２においてシフトレジスタの数が多くゲート数
が多くなる。ゲート数を少なくするために第５図（Ｃ）
のようなピン列のパターン構成にすると、印字騒音低減
、電源容量縮小等の効果が激減する。
課題を解決する為の手段
本発明は前記問題点を解決するため、印字のインターバ
ルを周期とするタイミング信号を発生する第１のタイマ
と、タイミング信号をシフトするシフトレジスタと、シ
フトレジスタの出力を印字ヘッドの通電時間保持する通
電タイマと、印字データを出力する印字データ出力手段
と、印字データと通電タイマの出力との論理積をとる論
理積手段とを備えた。
ルを周期とするタイミング信号を発生する第１のタイマ
と、タイミング信号をシフトするシフトレジスタと、シ
フトレジスタの出力を印字ヘッドの通電時間保持する通
電タイマと、印字データを出力する印字データ出力手段
と、印字データと通電タイマの出力との論理積をとる論
理積手段とを備えた。
作用
本発明は前記した構成により、シフトクロックの周波数
を上げずに印字ヘッドの通電時間を維持し、キャリッジ
の移動方向に対して傾斜をつけた印字ヘッドのピン列の
傾斜を補正することができる。
を上げずに印字ヘッドの通電時間を維持し、キャリッジ
の移動方向に対して傾斜をつけた印字ヘッドのピン列の
傾斜を補正することができる。
実施例
第１図は本発明の一実施例における印字ヘッド制御装置
のフロック図である。第１図において１は中央処理装置
（以下、ＣＰＵと略称する。ン、２は各装置間のインタ
ーフェースを受は持つ入出力部（以下、Ｉ１０部と略称
する。３は文字フォント読み出し専用メモリ（以下、文
字フォントＲＯＭと略称する。）である。
のフロック図である。第１図において１は中央処理装置
（以下、ＣＰＵと略称する。ン、２は各装置間のインタ
ーフェースを受は持つ入出力部（以下、Ｉ１０部と略称
する。３は文字フォント読み出し専用メモリ（以下、文
字フォントＲＯＭと略称する。）である。
４は発振器、５は第１のタイマで発振器４が発生する基
本クロックＣによって駆動され印字データ要求割り込み
信号ｄおよび印字インターバル時間ｔ１の周期をもつ信
号ｐを出力する。６は第２のタイマでＣＰＵ１からの文
字の品位を切り換える印字モードデータｅと発振器４が
発生する基本クロックＣを入力とし各印字モードに従い
ピン列の傾斜を補正する、となり合うピン毎の駆動信号
の時間差を周期とするクロック信号ｆを出力する。７は
クロック信号ｆをシフトクロックとし第１のタイマより
送られてくる印字インターバル時間ｔ１の周期をもつ信
号ｐをシフトし各ピン毎のタイミング信号を生成するシ
フトレジスタ部である。８−１〜８−２４はシフトレジ
スタ部７て生成された１ピンから２４ピンまてのタイミ
ング信号ｒを入力としヘッドの通電時間を各ピン毎に与
える個別タイマである。１１はＣＰＵ１からハスライン
を通して送られる印字データ信号ｇを入力データとし個
別タイマ８−１〜８−２４の出力信号Ｓをラッチクロッ
クとするラッチ部である。１２は個別タイマ８−１〜８
−２４の出力信号Ｓとラッチ部１１の出力信号■とのＡ
ＮＤをとり駆動信号Ｗを出力するＡＮＤ回路である。９
はヘッドドライバでの出力信号ｉ−１〜ｊ−２４により
ヘッドコイル１０にパルス電圧を与えヘッドを駆動する
。
本クロックＣによって駆動され印字データ要求割り込み
信号ｄおよび印字インターバル時間ｔ１の周期をもつ信
号ｐを出力する。６は第２のタイマでＣＰＵ１からの文
字の品位を切り換える印字モードデータｅと発振器４が
発生する基本クロックＣを入力とし各印字モードに従い
ピン列の傾斜を補正する、となり合うピン毎の駆動信号
の時間差を周期とするクロック信号ｆを出力する。７は
クロック信号ｆをシフトクロックとし第１のタイマより
送られてくる印字インターバル時間ｔ１の周期をもつ信
号ｐをシフトし各ピン毎のタイミング信号を生成するシ
フトレジスタ部である。８−１〜８−２４はシフトレジ
スタ部７て生成された１ピンから２４ピンまてのタイミ
ング信号ｒを入力としヘッドの通電時間を各ピン毎に与
える個別タイマである。１１はＣＰＵ１からハスライン
を通して送られる印字データ信号ｇを入力データとし個
別タイマ８−１〜８−２４の出力信号Ｓをラッチクロッ
クとするラッチ部である。１２は個別タイマ８−１〜８
−２４の出力信号Ｓとラッチ部１１の出力信号■とのＡ
ＮＤをとり駆動信号Ｗを出力するＡＮＤ回路である。９
はヘッドドライバでの出力信号ｉ−１〜ｊ−２４により
ヘッドコイル１０にパルス電圧を与えヘッドを駆動する
。
第２図は本発明の一実施例における印字ヘッド制御装置
が制御するヘッドのピン列のパターンである。第２図に
おいてヘッドのピン列のパターンは２４ピンのうち奇数
ピンを第１列、偶数ピンを第２列とし、同一列のピンが
同時に駆動されることがないようそれぞれの列の１２ピ
ンのうちピンＮとピン（Ｎ＋２）とが１／１２０＊１／
１２インチ印字行方向にずれている。ここで１ ／ １
２０インチは文字のドツト間隔である。さらに第１列と
第２列のピンにおいても同時に駆動されることがないよ
うピンＮとピン（Ｎ＋ １ ）は１／１２０＊ １／１
２インチの整数倍とは異なった長さの間隔となっている
。即ち、それぞれのピンは同時にオンになることがない
よう、印字ヘッドが１／１２０インチ移動する距離の間
に印字ヘッドの２４ピンが２４のタイミングに分散され
て印字を行う。
が制御するヘッドのピン列のパターンである。第２図に
おいてヘッドのピン列のパターンは２４ピンのうち奇数
ピンを第１列、偶数ピンを第２列とし、同一列のピンが
同時に駆動されることがないようそれぞれの列の１２ピ
ンのうちピンＮとピン（Ｎ＋２）とが１／１２０＊１／
１２インチ印字行方向にずれている。ここで１ ／ １
２０インチは文字のドツト間隔である。さらに第１列と
第２列のピンにおいても同時に駆動されることがないよ
うピンＮとピン（Ｎ＋ １ ）は１／１２０＊ １／１
２インチの整数倍とは異なった長さの間隔となっている
。即ち、それぞれのピンは同時にオンになることがない
よう、印字ヘッドが１／１２０インチ移動する距離の間
に印字ヘッドの２４ピンが２４のタイミングに分散され
て印字を行う。
以上のように構成された印字ヘッド制御装置について以
下その動作を説明する。
下その動作を説明する。
第３図は第１図の印字ヘッド制御装置のタイミングチャ
ートである。第１のタイマ５は印字インターバル時間ｔ
１の周期をインターバル信号ｐとしてレジスタ部７へ出
力する。シフトレジスタ部７では、プリンタが持ってい
る印字モード（文字数／インチ、フォント種類のバリエ
ーション）に対応したＣＰＵ１からの信号ｅにより第２
のタイマ６から出力される、ピン列の傾斜を補正する、
となり合うピン毎の駆動信号の時間差ｔ３を周期とする
信号ｆをシフトクロックとしインターバル信号ｐをピン
毎にｔ３ずつ遅延しｒ１〜ｒ２４を出力する。例えば、
ＣＰＵ１が信号ｅにより第２のタイマにｔ３を３６と設
定した場合、第２のタイマはシフトレジスタ部７に３６
を周期とする信号ｆを送る。個別タイマ８−１〜８−２
４ではｒ１〜ｒ２４の立ち上がりで予め設定したヘッド
の通電時間ｔ２の間ハイレベルとじＳ１〜ｓ２４のタイ
ミング信号を生成する。
ートである。第１のタイマ５は印字インターバル時間ｔ
１の周期をインターバル信号ｐとしてレジスタ部７へ出
力する。シフトレジスタ部７では、プリンタが持ってい
る印字モード（文字数／インチ、フォント種類のバリエ
ーション）に対応したＣＰＵ１からの信号ｅにより第２
のタイマ６から出力される、ピン列の傾斜を補正する、
となり合うピン毎の駆動信号の時間差ｔ３を周期とする
信号ｆをシフトクロックとしインターバル信号ｐをピン
毎にｔ３ずつ遅延しｒ１〜ｒ２４を出力する。例えば、
ＣＰＵ１が信号ｅにより第２のタイマにｔ３を３６と設
定した場合、第２のタイマはシフトレジスタ部７に３６
を周期とする信号ｆを送る。個別タイマ８−１〜８−２
４ではｒ１〜ｒ２４の立ち上がりで予め設定したヘッド
の通電時間ｔ２の間ハイレベルとじＳ１〜ｓ２４のタイ
ミング信号を生成する。
ＣＰＵＩは第１のタイマ５より送られてくるインターバ
ル信号ｐと同じ周期の印字データ割り込み要求信号ｍの
立ち上がりタイミングに従って印字すべき文字のフォン
トを文字フォントＲＯλ（３より呼び出し、２４ピンの
各ピンそれぞれの印字データ信号ｇをラッチ部１１へ出
力する。ラッチ部１１は個別タイマ８−１〜８−２４の
出力Ｓをラッチクロックとし印字データ信号ｇを各ピン
毎にラッチする。更にこの２４ビツトのラッチされた各
ピンの印、字データ信号Ｖとタイミング信号とＳのＡＮ
ＤをＡＮＤ回路１２てとることによりヘッドの各ピンの
駆動信号Ｗを得る。ヘッドドライバ９はこの駆動信号Ｗ
に従いヘッドコイル１０にパルス電圧をあたえることに
よりヘッドを駆動する。
ル信号ｐと同じ周期の印字データ割り込み要求信号ｍの
立ち上がりタイミングに従って印字すべき文字のフォン
トを文字フォントＲＯλ（３より呼び出し、２４ピンの
各ピンそれぞれの印字データ信号ｇをラッチ部１１へ出
力する。ラッチ部１１は個別タイマ８−１〜８−２４の
出力Ｓをラッチクロックとし印字データ信号ｇを各ピン
毎にラッチする。更にこの２４ビツトのラッチされた各
ピンの印、字データ信号Ｖとタイミング信号とＳのＡＮ
ＤをＡＮＤ回路１２てとることによりヘッドの各ピンの
駆動信号Ｗを得る。ヘッドドライバ９はこの駆動信号Ｗ
に従いヘッドコイル１０にパルス電圧をあたえることに
よりヘッドを駆動する。
本実施例では個別タイマを用いることにより、従来の回
路に比べ約１／３のゲート数に削減できる。
路に比べ約１／３のゲート数に削減できる。
なお、本実施例は単一モードの印字の場合においても使
用てきる。
用てきる。
発明の効果
以上のように本発明は、印字のインターバルを周期とす
るタイミング信号を発生する第１のタイマと、タイミン
グ信号をシフトするシフトレジスタと、シフトレジスタ
の出力を印字ヘッドの通電時間保持する通電タイマと、
印字データを出力する印字データ出力手段と、印字デー
タと通電タイマの出力との論理積をとる論理積手段とを
備えたことにより、シフトクロックの周波数を上げずに
印字ヘッドの通電時間を維持し、キャリッジの移動方向
に対して傾斜をつけた印字ヘッドのピン列の傾斜を補正
することがてき、ケート数の低減が可能となる。
るタイミング信号を発生する第１のタイマと、タイミン
グ信号をシフトするシフトレジスタと、シフトレジスタ
の出力を印字ヘッドの通電時間保持する通電タイマと、
印字データを出力する印字データ出力手段と、印字デー
タと通電タイマの出力との論理積をとる論理積手段とを
備えたことにより、シフトクロックの周波数を上げずに
印字ヘッドの通電時間を維持し、キャリッジの移動方向
に対して傾斜をつけた印字ヘッドのピン列の傾斜を補正
することがてき、ケート数の低減が可能となる。
第１図は本発明の一実施例に置ける印字ヘッド制御装置
のブロック図、第２図は本発明の一実施例に置ける印字
ヘッド制御装置が制御するヘッドのピン列のパターンを
示した図、第３図は本発明の一実施例に置ける印字ヘッ
ド制御装置のタイミロ図は従来の印字ヘッド制御装置の
フロック図である。 １ ・ ２ ・ ３ ・ ４ ・ ５ ・ ６ ・ ７ ・ ８ ・ ９ ・ １０ ・ １１ ・ １２ ・ ＣＰＵ １７０部 文字フォントＲＯＭ 発振器 第１のタイマ 第２のタイマ シフトレジスタ部 個別タイマ ヘッドドライバ ヘッドコイル ラッチ部 ＡＮＤ回路
のブロック図、第２図は本発明の一実施例に置ける印字
ヘッド制御装置が制御するヘッドのピン列のパターンを
示した図、第３図は本発明の一実施例に置ける印字ヘッ
ド制御装置のタイミロ図は従来の印字ヘッド制御装置の
フロック図である。 １ ・ ２ ・ ３ ・ ４ ・ ５ ・ ６ ・ ７ ・ ８ ・ ９ ・ １０ ・ １１ ・ １２ ・ ＣＰＵ １７０部 文字フォントＲＯＭ 発振器 第１のタイマ 第２のタイマ シフトレジスタ部 個別タイマ ヘッドドライバ ヘッドコイル ラッチ部 ＡＮＤ回路
Claims (1)
- キャリッジに搭載され、前記キャリッジの移動方向に直
交する方向に対して傾斜をつけた印字ヘッドのピン列の
各々のピンに対応した駆動信号を供給し印字をおこなわ
せる印字ヘッド制御装置であつて、印字のインターバル
を周期とする第１のタイミング信号を発生する第１のタ
イマと、前記ピン列の傾斜を補正するとなり合うピン毎
の駆動信号の時間差を周期とする第２のタイミング信号
を発生する第２のタイマと、該第２のタイミング信号を
シフトクロックとし前記タイミング信号をシフトするシ
フトレジスタと、前記シフトレジスタの出力を前記印字
ヘッドの通電時間保持する通電タイマと、印字データを
出力する印字データ出力手段と、前記印字データと前記
通電タイマの出力との論理積をとる論理積手段と、前記
論理積手段の出力によりヘッドを駆動する駆動手段とを
備えたことを特徴とする印字ヘッド制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2149433A JPH0441262A (ja) | 1990-06-07 | 1990-06-07 | 印字ヘッド制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2149433A JPH0441262A (ja) | 1990-06-07 | 1990-06-07 | 印字ヘッド制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0441262A true JPH0441262A (ja) | 1992-02-12 |
Family
ID=15475008
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2149433A Pending JPH0441262A (ja) | 1990-06-07 | 1990-06-07 | 印字ヘッド制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0441262A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5724077A (en) * | 1992-10-08 | 1998-03-03 | Fuji Xerox Co., Ltd. | Driving method for an ink jet recording device having a plurality of recording heads |
-
1990
- 1990-06-07 JP JP2149433A patent/JPH0441262A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5724077A (en) * | 1992-10-08 | 1998-03-03 | Fuji Xerox Co., Ltd. | Driving method for an ink jet recording device having a plurality of recording heads |
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