JPH0444768B2 - - Google Patents
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- Publication number
- JPH0444768B2 JPH0444768B2 JP59037332A JP3733284A JPH0444768B2 JP H0444768 B2 JPH0444768 B2 JP H0444768B2 JP 59037332 A JP59037332 A JP 59037332A JP 3733284 A JP3733284 A JP 3733284A JP H0444768 B2 JPH0444768 B2 JP H0444768B2
- Authority
- JP
- Japan
- Prior art keywords
- data
- input
- memory
- program controller
- condition
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
Links
Classifications
-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
- G05B19/00—Program-control systems
- G05B19/02—Program-control systems electric
- G05B19/04—Program control other than numerical control, i.e. in sequence controllers or logic controllers
- G05B19/05—Programmable logic controllers, e.g. simulating logic interconnections of signals according to ladder diagrams or function charts
- G05B19/058—Safety, monitoring
Landscapes
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Engineering & Computer Science (AREA)
- Automation & Control Theory (AREA)
- Tests Of Electronic Circuits (AREA)
- Testing And Monitoring For Control Systems (AREA)
- Programmable Controllers (AREA)
Description
【発明の詳細な説明】
〔発明の属する技術分野〕
この発明は、デイジタル入出力装置（Di／Dp）
を所定の態様で制御するプログラムコントローラ
（以下、単にPCともいう。）のデイジタル入出力
データを収集し、その時間的推移をタイムチヤー
ト形式で表示することにより、プログラムコント
ローラの動作を試験する試験装置に関する。
を所定の態様で制御するプログラムコントローラ
（以下、単にPCともいう。）のデイジタル入出力
データを収集し、その時間的推移をタイムチヤー
ト形式で表示することにより、プログラムコント
ローラの動作を試験する試験装置に関する。
一般に、PCによつて制御されるDi／Dpには、
動作速度の早いものと遅いものとがあるため、そ
のデータをサンプリングする周期はそれぞれの動
作速度に合わせることが望ましく、したがつて、
PCではその制御対象によつて任意の周期を選択
してサンプリングができるようにされている。し
かしながら、このサンプリング周期をPCの動作
周期よりも大きく設定すると、条件成立に至るデ
ータの推移を見逃してしまい、その試験ができな
くなるという欠点を有している。
動作速度の早いものと遅いものとがあるため、そ
のデータをサンプリングする周期はそれぞれの動
作速度に合わせることが望ましく、したがつて、
PCではその制御対象によつて任意の周期を選択
してサンプリングができるようにされている。し
かしながら、このサンプリング周期をPCの動作
周期よりも大きく設定すると、条件成立に至るデ
ータの推移を見逃してしまい、その試験ができな
くなるという欠点を有している。
この発明はこのような欠点を除去すべくなされ
たもので、プログラムコントローラの動作を、通
常は制御対象である入出力装置に合う時間的推移
で知ることができるようにするとともに、データ
が変化する直前においては、プログラムコントロ
ーラの動作周期に合つた時間的推移で知ることが
できるようにして、条件成立に至るデータの見逃
しを防止することが可能なプログラムコントロー
ラ試験装置を提供することを目的とするものであ
る。
たもので、プログラムコントローラの動作を、通
常は制御対象である入出力装置に合う時間的推移
で知ることができるようにするとともに、データ
が変化する直前においては、プログラムコントロ
ーラの動作周期に合つた時間的推移で知ることが
できるようにして、条件成立に至るデータの見逃
しを防止することが可能なプログラムコントロー
ラ試験装置を提供することを目的とするものであ
る。
この発明は、プログラマブルコントローラのデ
イジタル入出力データをその動作周期で取り込ん
で記憶するとともに、制御対象に合つた所定周期
でもデータを記憶することにより、入出力データ
の推移を通常は制御対象に合つた周期で、また、
所定の条件が成立する直前についてはプログラム
コントローラの動作周期でそれぞれ表示し得るよ
うにしたものである。
イジタル入出力データをその動作周期で取り込ん
で記憶するとともに、制御対象に合つた所定周期
でもデータを記憶することにより、入出力データ
の推移を通常は制御対象に合つた周期で、また、
所定の条件が成立する直前についてはプログラム
コントローラの動作周期でそれぞれ表示し得るよ
うにしたものである。
第１図はこの発明の実施例を示す構成図、第１
Ａ図は第１図の入出力番号（NO）記憶部の構成
を示す構成図、第１Ｂ図は同じく表示条件記憶部
の構成を示す構成図、第１Ｃ図は同じくデータ収
集部の構成を示す構成図、第１Ｄ図は同じく詳細
データ記憶部の構成を示す構成図、第２図は表示
例を示すタイムチヤートである。第１図におい
て、１はキーボード、２は入出力NO記憶部、３
はサンプリング周期記憶部、４は条件記憶部、５
はタイマ部、６はデータ収集部、７はデイジタル
入出力部（Di／Dp）、８は詳細データ記憶部、９
はデータ記憶部、１０は条件比較部、１１は表示
部である。
Ａ図は第１図の入出力番号（NO）記憶部の構成
を示す構成図、第１Ｂ図は同じく表示条件記憶部
の構成を示す構成図、第１Ｃ図は同じくデータ収
集部の構成を示す構成図、第１Ｄ図は同じく詳細
データ記憶部の構成を示す構成図、第２図は表示
例を示すタイムチヤートである。第１図におい
て、１はキーボード、２は入出力NO記憶部、３
はサンプリング周期記憶部、４は条件記憶部、５
はタイマ部、６はデータ収集部、７はデイジタル
入出力部（Di／Dp）、８は詳細データ記憶部、９
はデータ記憶部、１０は条件比較部、１１は表示
部である。
キーボード１は、データを収集すべき入出力装
置の番号（NO）、サンプリング周期、表示条件
の設定等を行ない、入出力NO記憶部２は第１Ａ
図の如く構成され、キーボード１にて指定された
入出力装置NOを記憶する。サンプリング周期記
憶部３は、キーボード１により指定された入出力
装置NO毎に、その入出力データをプログラムコ
ントローラの動作周期の何倍の周期でデータを収
集するのかを記憶し、表示条件記憶部４は第１Ｂ
図の如く構成され、入出力NO記憶部２に記憶さ
れた各入出力装置がどんな状態（ON、OFF）に
なつたときにデータ収集を停止するかを、各入出
力装置毎に“１”，“０”のON、OFFデータとし
て記憶する。タイマ部５は、プログラムコントロ
ーラの動作周期信号S1と、これをサンプリング周
期記憶部３に記憶された記憶値倍にしたサンプリ
ング周期信号S2とを出力し、データ収集部６はこ
の動作周期信号S1またはサンプリング周期信号S2
が与えられたとき、入出力NO記憶部２に記憶さ
れた番号の入出力データをDi／Dp７から読み込
んで、第１Ｃ図の如く記憶する。このとき、動作
周期信号S1とともに読み込まれる入出力データ
は、第１Ｄ図の如く詳細データ記憶部８に記憶さ
れる一方、サンプリング周期信号S2とともに読み
込まれる入力データは、詳細データ記憶部８と同
様に構成されるデータ記憶部９に記憶される。な
お、第１Ｄ図に示されるポイタＰは現時点の入出
力データ格納位置を示すもので、これは入出力デ
ータが格納される毎に＋１されるが、格納位置の
最後に来たら再び最初に戻る如く構成されてい
る。条件比較部１０は、動作周期信号S1とともに
読み込まれる入出力部７からのデータと、表示条
件記憶部４に記憶された停止条件データとを比較
し、一致したとき条件成立信号S3を出力してデー
タ収集部６によるデータの収集を停止させるとと
もに、表示部１１をしてデータ記憶部８または９
の内容を表示させる。なお、このとき表示される
データは、データ記憶部８または９のポインタに
て示される位置迄の内容であり、具体的には第２
図の如きタイムチヤート形式で表示される。ま
た、記憶部８または、９のいずれの内容を表示す
るかは、オペレータの指示によつて選択し得るよ
うにされている。
置の番号（NO）、サンプリング周期、表示条件
の設定等を行ない、入出力NO記憶部２は第１Ａ
図の如く構成され、キーボード１にて指定された
入出力装置NOを記憶する。サンプリング周期記
憶部３は、キーボード１により指定された入出力
装置NO毎に、その入出力データをプログラムコ
ントローラの動作周期の何倍の周期でデータを収
集するのかを記憶し、表示条件記憶部４は第１Ｂ
図の如く構成され、入出力NO記憶部２に記憶さ
れた各入出力装置がどんな状態（ON、OFF）に
なつたときにデータ収集を停止するかを、各入出
力装置毎に“１”，“０”のON、OFFデータとし
て記憶する。タイマ部５は、プログラムコントロ
ーラの動作周期信号S1と、これをサンプリング周
期記憶部３に記憶された記憶値倍にしたサンプリ
ング周期信号S2とを出力し、データ収集部６はこ
の動作周期信号S1またはサンプリング周期信号S2
が与えられたとき、入出力NO記憶部２に記憶さ
れた番号の入出力データをDi／Dp７から読み込
んで、第１Ｃ図の如く記憶する。このとき、動作
周期信号S1とともに読み込まれる入出力データ
は、第１Ｄ図の如く詳細データ記憶部８に記憶さ
れる一方、サンプリング周期信号S2とともに読み
込まれる入力データは、詳細データ記憶部８と同
様に構成されるデータ記憶部９に記憶される。な
お、第１Ｄ図に示されるポイタＰは現時点の入出
力データ格納位置を示すもので、これは入出力デ
ータが格納される毎に＋１されるが、格納位置の
最後に来たら再び最初に戻る如く構成されてい
る。条件比較部１０は、動作周期信号S1とともに
読み込まれる入出力部７からのデータと、表示条
件記憶部４に記憶された停止条件データとを比較
し、一致したとき条件成立信号S3を出力してデー
タ収集部６によるデータの収集を停止させるとと
もに、表示部１１をしてデータ記憶部８または９
の内容を表示させる。なお、このとき表示される
データは、データ記憶部８または９のポインタに
て示される位置迄の内容であり、具体的には第２
図の如きタイムチヤート形式で表示される。ま
た、記憶部８または、９のいずれの内容を表示す
るかは、オペレータの指示によつて選択し得るよ
うにされている。
ここで、例えば第２図に示される時刻ｔの如
く、第１の入出力装置の入出力データが“０”か
ら“１”に変化する点のデータ推移を表示しよう
とするときは、第１Ａ図に示される入出力番号記
憶部２には入出力番号“１”が登録されるととも
に、第１Ｂ図に示される表示条件記憶部４の第１
入出力装置に対応する部分に“１”が記憶され
る。なお、このとき、サンプリング周期記憶部３
には、第１入出力装置の動作速度に適したサンプ
リング周期ｎが設定されることは云う迄もない。
このような設定が行なわれた後、データ収集部６
による入出力データの収集が第１Ｃ図の如く行な
われると、動作周期信号S1をもつて第１入出力装
置の詳細データが記憶部８に第１Ｄ図の如く格納
される一方、動作周期信号S1のｎ倍の周期（信号
S2）をもつて第１入出力装置のデータが記憶部９
に格納される。そして、時刻ｔにおいて、第１入
出力装置の表示条件記憶部４に設定された条件デ
ータと、データ収集部６を介して得られた条件デ
ータと、データ収集部６を介して得られた第１入
出力装置のデータとが一致したことが条件比較部
１０にて検出されると、条件成立信号S3を出力し
てデータ収集部６によるデータ収集を停止させる
とともに、表示部１１を駆動し、記憶部９または
８の内容を表示させる。この場合、データ記憶部
９だけであると、そのサンプリング周期の設定如
何によつては、第１入出力装置の時刻ｔにおける
“０”から“１”へのデータ推移を見逃すおそれ
があることから、詳細データ記憶部８によつてこ
れを防止しているものである。もつとも、詳細デ
ータ記憶部８の容量が無限にあれば如何なる場合
にも対処することができるが、それでは余りにも
容量がぼう大になり過ぎて実用的では無いので、
この実施例の如く構成することによつて、メモリ
容量の節約を図つているということができる。
く、第１の入出力装置の入出力データが“０”か
ら“１”に変化する点のデータ推移を表示しよう
とするときは、第１Ａ図に示される入出力番号記
憶部２には入出力番号“１”が登録されるととも
に、第１Ｂ図に示される表示条件記憶部４の第１
入出力装置に対応する部分に“１”が記憶され
る。なお、このとき、サンプリング周期記憶部３
には、第１入出力装置の動作速度に適したサンプ
リング周期ｎが設定されることは云う迄もない。
このような設定が行なわれた後、データ収集部６
による入出力データの収集が第１Ｃ図の如く行な
われると、動作周期信号S1をもつて第１入出力装
置の詳細データが記憶部８に第１Ｄ図の如く格納
される一方、動作周期信号S1のｎ倍の周期（信号
S2）をもつて第１入出力装置のデータが記憶部９
に格納される。そして、時刻ｔにおいて、第１入
出力装置の表示条件記憶部４に設定された条件デ
ータと、データ収集部６を介して得られた条件デ
ータと、データ収集部６を介して得られた第１入
出力装置のデータとが一致したことが条件比較部
１０にて検出されると、条件成立信号S3を出力し
てデータ収集部６によるデータ収集を停止させる
とともに、表示部１１を駆動し、記憶部９または
８の内容を表示させる。この場合、データ記憶部
９だけであると、そのサンプリング周期の設定如
何によつては、第１入出力装置の時刻ｔにおける
“０”から“１”へのデータ推移を見逃すおそれ
があることから、詳細データ記憶部８によつてこ
れを防止しているものである。もつとも、詳細デ
ータ記憶部８の容量が無限にあれば如何なる場合
にも対処することができるが、それでは余りにも
容量がぼう大になり過ぎて実用的では無いので、
この実施例の如く構成することによつて、メモリ
容量の節約を図つているということができる。
以下、第３を参照して動作を具体的に説明す
る。なお第３図は、本発明の実施例の動作例説明
図である。
る。なお第３図は、本発明の実施例の動作例説明
図である。
実施例における第１メモリ（詳細データ記憶部
８）には、コントローラの動作周期にてサンプリ
ングされたデータがサイクリツクに記憶され、第
２メモリ（詳細データ記憶部９）には、前記動作
周期の所定値倍（制御対象に応じて決定される）
にてサンプリングされたデータがサイクリツクに
記憶される。
８）には、コントローラの動作周期にてサンプリ
ングされたデータがサイクリツクに記憶され、第
２メモリ（詳細データ記憶部９）には、前記動作
周期の所定値倍（制御対象に応じて決定される）
にてサンプリングされたデータがサイクリツクに
記憶される。
第２のメモリのサンプリング周期を第１メモリ
のサンプリング周期の例えば３倍とした場合に、
第ｎ入力No.のサンプリング状態は、第３図ａのよ
うになり、これを記憶する第１、２メモリの記憶
内容は、それぞれ第３図ｂのようになる。
のサンプリング周期の例えば３倍とした場合に、
第ｎ入力No.のサンプリング状態は、第３図ａのよ
うになり、これを記憶する第１、２メモリの記憶
内容は、それぞれ第３図ｂのようになる。
なお、第１メモリの記憶容量を10データ分とし
た場合、A10からのデータはA1からのデータとサ
イクリツクに置き換えられる。第２メモリも同様
にサイクリツクに置き換えられる。従つて部分的
には同じデータが記憶されることになる。この第
12メモリの記憶内容に基づくタイムチヤートは第
３図ｃのようになる。
た場合、A10からのデータはA1からのデータとサ
イクリツクに置き換えられる。第２メモリも同様
にサイクリツクに置き換えられる。従つて部分的
には同じデータが記憶されることになる。この第
12メモリの記憶内容に基づくタイムチヤートは第
３図ｃのようになる。
第３図から明らかなように、制御対象に応じて
決定される動作周期にサンプリングされたデータ
を記憶する第２メモリ（データ記憶部９）を設け
ることにより、限られたメモリ容量にて制御対象
である入出力装置に合う長時間にわたるタイムチ
ヤートを表示することができる。
決定される動作周期にサンプリングされたデータ
を記憶する第２メモリ（データ記憶部９）を設け
ることにより、限られたメモリ容量にて制御対象
である入出力装置に合う長時間にわたるタイムチ
ヤートを表示することができる。
但し、このタイムチヤートでは詳しいこと（詳
細）がわからないので、コントローラの動作周期
にてサンプリングされたデータを記憶する第１メ
モリ（詳細データ記憶部８）を設け、この第１メ
モリの記憶内容もタイムチヤートで表示できるよ
うにして条件成立に至る詳細データがわかるよう
にしているわけである。
細）がわからないので、コントローラの動作周期
にてサンプリングされたデータを記憶する第１メ
モリ（詳細データ記憶部８）を設け、この第１メ
モリの記憶内容もタイムチヤートで表示できるよ
うにして条件成立に至る詳細データがわかるよう
にしているわけである。
本発明は、限られた記憶容量のメモリを用いて
制御対象である入出力装置に合う長時間のタイム
チヤートおよび条件成立に至る詳細データのタイ
ムチヤートの両方を表示可能としたコントローラ
の試験装置の提供を目的としたものであること
は、先にも述べた通りである。
制御対象である入出力装置に合う長時間のタイム
チヤートおよび条件成立に至る詳細データのタイ
ムチヤートの両方を表示可能としたコントローラ
の試験装置の提供を目的としたものであること
は、先にも述べた通りである。
この発明によれば、プログラムコントローラの
入出力データを、プログラムコントローラの動作
周期およびそのｎ倍の周期でそれぞれ記憶する２
種類の記憶部を設けることにより、制御対象に合
つた時間推移でデータを表示することが可能にな
るとともに、条件成立に至る直前のデータを詳細
に表示することができるのでデータの推移を見逃
すおそれがなくなるという利点がもたらされるも
のである。
入出力データを、プログラムコントローラの動作
周期およびそのｎ倍の周期でそれぞれ記憶する２
種類の記憶部を設けることにより、制御対象に合
つた時間推移でデータを表示することが可能にな
るとともに、条件成立に至る直前のデータを詳細
に表示することができるのでデータの推移を見逃
すおそれがなくなるという利点がもたらされるも
のである。
第１図はこの発明の実施例を示す構成図、第１
Ａ図は第１図の入出力番号記憶部の構成を示す構
成図、第１Ｂ図は同じく表示条件記憶部の構成を
示す構成図、第１Ｃ図は同じくデータ収集部の構
成を示す構成図、第１Ｄ図は同じく詳細データ記
憶部の構成を示す構成図、第２図は表示例を示す
タイムチヤート、第３図は本発明の一実施例の動
作例説明図、である。 符号説明、１……キーボード、２……入出力番
号記憶部、３……サンプリング周期記憶部、４…
…表示条件記憶部、５……タイマ部、６……デー
タ収集部、７……デイジタル入出力装置（Di／
Dp）、８……詳細データ記憶部、９……データ記
憶部、１０……条件比較部、１１……表示部。
Ａ図は第１図の入出力番号記憶部の構成を示す構
成図、第１Ｂ図は同じく表示条件記憶部の構成を
示す構成図、第１Ｃ図は同じくデータ収集部の構
成を示す構成図、第１Ｄ図は同じく詳細データ記
憶部の構成を示す構成図、第２図は表示例を示す
タイムチヤート、第３図は本発明の一実施例の動
作例説明図、である。 符号説明、１……キーボード、２……入出力番
号記憶部、３……サンプリング周期記憶部、４…
…表示条件記憶部、５……タイマ部、６……デー
タ収集部、７……デイジタル入出力装置（Di／
Dp）、８……詳細データ記憶部、９……データ記
憶部、１０……条件比較部、１１……表示部。
Claims (1)
- 【特許請求の範囲】 １ 所定の動作周期で各制御対象に関するデータ
を入出力するプログラムコントローラの、該入出
力データを収集しその時間的推移をタイムチヤー
ト形式で表示することにより、前記プログラムコ
ントローラの動作を試験する試験装置であつて、 プログラムコントローラの前記動作周期で収集
される入出力データを各制御対象対応に記憶する
第１のメモリと、該第１のメモリによつて収集さ
れるデータのうち各制御対象に適する前記動作周
期の所定値倍の周期で収集されるデータだけを各
制御対象対応に記憶する第２のメモリと、前記第
１のメモリに記憶されるデータが予め設定された
条件を満たすか否かを個々に判断し該条件を満た
したときデータの収集を停止させる条件判別手段
と、前記第１のメモリに記憶されたデータと第２
のメモリに記憶されたデータとを選択的に切り換
え表示する表示手段と、を有して成ることを特徴
とするプログラムコントローラ試験装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59037332A JPS60183610A (ja) | 1984-03-01 | 1984-03-01 | プログラムコントロ−ラ試験装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59037332A JPS60183610A (ja) | 1984-03-01 | 1984-03-01 | プログラムコントロ−ラ試験装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60183610A JPS60183610A (ja) | 1985-09-19 |
| JPH0444768B2 true JPH0444768B2 (ja) | 1992-07-22 |
Family
ID=12494671
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59037332A Granted JPS60183610A (ja) | 1984-03-01 | 1984-03-01 | プログラムコントロ−ラ試験装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60183610A (ja) |
-
1984
- 1984-03-01 JP JP59037332A patent/JPS60183610A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS60183610A (ja) | 1985-09-19 |
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