JPH0447971Y2 - - Google Patents

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JPH0447971Y2
JPH0447971Y2 JP1985130647U JP13064785U JPH0447971Y2 JP H0447971 Y2 JPH0447971 Y2 JP H0447971Y2 JP 1985130647 U JP1985130647 U JP 1985130647U JP 13064785 U JP13064785 U JP 13064785U JP H0447971 Y2 JPH0447971 Y2 JP H0447971Y2
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board
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external terminals
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Description

【考案の詳細な説明】 〔技術分野〕 本考案は、集積回路の外に任意の回路の構成さ
れている基板を接続してなる混成回路における外
部端子の固定方法に関する。
〔従来技術とその問題点〕
ほとんどの電子回路が集積回路化される現状に
おいて、インダクタンスを含む回路、例えばコイ
ルとコンデンサを組合せて構成される遅延線の回
路のように集積回路化が困難なものもあり、全体
の回路にこのような回路を含む場合には集積回路
の外部に接続する必要がある。TTL素子を用い
た飽和型論理回路に遅延線を組合せてバツフアー
ドデイレーラインを構成する場合もこのような例
に相当する。
そして基板にコイルやコンデンサを配置して遅
延線の回路を構成し、集積回路のフラツトパツケ
ージと重ね合せ、フラツトパツケージの端子を介
して両方の回路を接続し、外部端子をデユアルイ
ンラインパツケージ(以下DIPという)の外部に
露呈させた混成回路は実開昭58−89953号公報等
により公知である。
しかし従来の混成回路は第5図の説明図に示す
ように、フラツトパツケージ4、基板3、遅延線
を構成するコイル1やコンデンサ2が同じ方向に
順次重ね合さるので、1点鎖線で示してあるDIP
の厚みTを薄くすることが難しい。そこで基板3
の側辺近傍で行われる外部端子5やフラツトパツ
ケージ4の端子6の接続を、側辺より離して基板
3の内側の位置で回路素子を囲まないようにして
行い、基板3の平面積を広げることにより回路素
子をフラツトパツケージ4と同じ側に配置するこ
とが考えられる。その場合、基板3と各種の端子
の接続が広い基板3の面に対して平面的に対称で
なく、しかも片寄つた位置で行われると、樹脂封
止する時に金型内に流入する樹脂の力によつて基
板3が傾いたり接続部分が離れる事故が生じやす
い。
〔目的〕
本考案の目的は、基板の四隅に外部端子の先端
を固定することにより、樹脂封入時に基板を平面
的に対称な側辺で支持できるようにして、薄形化
する場合に生じる混成回路の前記技術問題を解決
することにある。
〔問題点を解決するための技術手段〕
本考案はコイルを含む回路が構成されている基
板と、該基板より平面積の狭い集積回路のフラツ
トパツケージを重ね合せてあり、両方の回路の接
続をフラツトパツケージの端子を介して行い、い
ずれかの回路に接続する外部端子をを露呈させた
状態で全体を樹脂封止してある混成回路であり、
端子に位置する外部端子の先端が少くとも基板の
四隅に固定されていることを特徴とするものであ
る。
〔実施例〕
以下第4図のバツフアードデイレーラインの回
路図を例にとり、本考案の混成回路の実施例を示
す第1図、第3図を参照しながら説明する。
第4図において、10はTTL素子、11は入
力端子、12はアース端子、13から17までは
出力端子、18は電源端子、19はコイル、20
はコンデンサ、21は抵抗である。そして6個の
TTL素子10が第1図、第2図の集積回路のフ
ラツトパツケージ30内に構成され、点線で囲ま
れた部分の遅延線は基板31に構成されている。
基板31にはその面を貫通する孔32、孔34
を設けてあり、1つの側辺には溝33を設けてあ
る。又四隅には凹部43を設けてある。孔34と
溝33に、下側から基板31より平面積の狭いフ
ラツトパツケージ30の上側に曲げてある端子3
5を嵌め込むことにより、基板31とフラツトパ
ツケージ30が重ね合わされる。孔32はコイル
19を嵌め込むためのものであり、ドラムコアに
巻線を行つてあるコイル19を立設する場合を考
慮して、ドラムコアの鍔とほぼ同じ大きさの円形
にしてある。そして孔32は基板31とフラツト
パツケージ30の重ならない位置にあり、下側か
ら孔32に嵌め込まれたコイル19は第1図のよ
うにフラツトパツケージ30の横の位置にある。
コイル19は基板31の上側から孔32の底を塞
ぐ接着テープ41の接着面に固定される。なお第
2図の基板31には、第4図の点線内に対応する
回路素子を取付ける様子を図示してあるが、それ
らの回路素子間の接続や、集積回路と基板31の
回路を接続するために孔34や溝33の周辺に形
成してある導体パターンは図示を省略してある。
フラツトパツケージ30は、対向する両側辺に
夫々7個ずつの端子を露呈している14ピンタイ
プのものであるが、基板31の回路と接続するた
めに上側に曲げてある端子35以外の端子36
は、その外面に沿つて折り曲げられ基板31と反
対側の外面42まで延在する。そして外面42で
端子36は夫々37A乃至37Hまでの外部端子
に接続される。端子36に接続する部分の外部端
子の先端の形状は2種類あり、2つに割れたもの
と細長くしてあるものとがある。2つに割れた先
端38は第3図aのように端子36を外面42で
挟み、又細長い先端39は第3図bのように端子
36に添わせて夫々半田付けし、その面を広くし
て半田付の信頼性を得る。先端39の細長い形状
は、外部端子37Aと外部端子37Bのように隣
接する端子36に接続する場合に先端における短
絡事故を防ぐ役割をする。
そして8個の外部端子の中で、端に位置する外
部端子37A,37D,37E,37Hには垂直
に上側に曲る屈曲部44を設けてあり、その屈曲
部44を基板31の凹部43に嵌め込み固定され
ている。凹部43の周辺には図示されていない
が、回路の導体パターンとは接続していない独立
した導体パターンを設けてあり、屈曲部44はそ
の導体パターンに半田付けされる。つまり端に位
置する外部端子の先端は、フラツトパツケージ3
0の端子36との接続部分の他に、別の先端であ
る屈曲部44が基板31の四隅に固定される。な
お外部端子37Bと外部端子37Cは水平部分を
クランク状に曲げてあるが、全部の外部端子の互
いの間隔を等しくするためである。
フラツトパツケージ30の上側に曲げてある端
子35は、孔34と溝33の周辺の導体パターン
に半田付けされる。6個の端子35は、第4図に
おける13から17までの5個の出力端子に接続
するTTL素子10の出力側の端子と、入力端子
11に接続するTTL素子10の出力側の端子に
夫々対応する。又下側に折り曲げられている8個
の端子36は、13から17までの出力端子、入
力端子11、電源端子18、アース端子12に
夫々対応する。そして全体が第1図で1点鎖線で
示すように樹脂封止され、端子36と接続する外
部端子によつてDIPの外側に内部の回路が引き出
される。
37Aから37Hまでの外部端子はDIPの外面
に沿つて折り曲げられて底面40まで延在してお
り、他の回路部品と共に別の回路基板に取付ける
時にその導体パターンに直接面接続できるように
してある。なお実施例において、基板31の四隅
の凹部43は端に位置する外部端子の先端の位置
決めを容易にするが、存在しなくてもよい。又固
定する位置は四隅の近傍でもよい。さらに外部端
子の先端は、いずれもフラツトパツケージ30の
端子36に接続しているが、端の外部端子を含め
て基板31の側辺に1部の外部端子を接続させ
て、内部の回路を引き出せるように設計変更する
ことも可能である。さらに又、四隅に先端を固定
される外部端子の1部は、その四隅だけに固定さ
せてあつてもよい。
〔効果〕
以上述べたように本考案の混成回路はフラツト
パツケージと基板を重ね合せて構成されるが、端
子に位置する外部端子の先端は少くとも基板の四
隅の部分に固定されている。混成回路を薄形化す
るために、各種の端子の接続が基板の面に対して
非対称でしかも片寄つた位置で行われても、樹脂
封止を行う時基板は四隅を外部端子により強固に
支持される。従つて樹脂の力で基板が傾いたり、
接続部分が離れて不良品が発生することはない。
【図面の簡単な説明】
第1図は本考案の混成回路の実施例を示す組立
説明図、第2図は分解斜視図、第3図aと第3図
bは外部端子とフラツトパツケージの端子の接続
部分を示す平面図、第4図はバツフアードデイレ
ーラインの回路図、第5図は従来の混成回路の説
明図である。 30……フラツトパツケージ、31……基板、
32,34……孔、33……溝、35,36……
端子、37A〜37H……外部端子、38,39
……先端、40……底面、43……凹部、44…
…屈曲部。

Claims (1)

    【実用新案登録請求の範囲】
  1. コイルを含む回路が構成されている基板と、該
    基板より平面積の狭い集積回路のフラツトパツケ
    ージを重ね合せてあり、両方の回路の接続をフラ
    ツトパツケージの端子を介して行い、いずれかの
    回路に接続する外部端子を露呈させた状態で全体
    を樹脂封止してある混成回路であり、端に位置す
    る外部端子の先端が少くとも基板の四隅の部分に
    固定されていることを特徴とする混成回路。
JP1985130647U 1985-08-09 1985-08-27 Expired JPH0447971Y2 (ja)

Priority Applications (2)

Application Number Priority Date Filing Date Title
JP1985130647U JPH0447971Y2 (ja) 1985-08-27 1985-08-27
US06/893,141 US4722027A (en) 1985-08-09 1986-08-05 Hybrid circuit device

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP1985130647U JPH0447971Y2 (ja) 1985-08-27 1985-08-27

Publications (2)

Publication Number Publication Date
JPS6237940U JPS6237940U (ja) 1987-03-06
JPH0447971Y2 true JPH0447971Y2 (ja) 1992-11-12

Family

ID=31028345

Family Applications (1)

Application Number Title Priority Date Filing Date
JP1985130647U Expired JPH0447971Y2 (ja) 1985-08-09 1985-08-27

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JP (1) JPH0447971Y2 (ja)

Family Cites Families (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5780836U (ja) * 1980-10-31 1982-05-19

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Publication number Publication date
JPS6237940U (ja) 1987-03-06

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