JPH0491456A - マイクロ波半導体装置 - Google Patents

マイクロ波半導体装置

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Publication number
JPH0491456A
JPH0491456A JP2205480A JP20548090A JPH0491456A JP H0491456 A JPH0491456 A JP H0491456A JP 2205480 A JP2205480 A JP 2205480A JP 20548090 A JP20548090 A JP 20548090A JP H0491456 A JPH0491456 A JP H0491456A
Authority
JP
Japan
Prior art keywords
permittivity
film
semiconductor substrate
epsilonr
substrate
Prior art date
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Pending
Application number
JP2205480A
Other languages
English (en)
Inventor
Takeshi Sekiguchi
剛 関口
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sumitomo Electric Industries Ltd
Original Assignee
Sumitomo Electric Industries Ltd
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Filing date
Publication date
Application filed by Sumitomo Electric Industries Ltd filed Critical Sumitomo Electric Industries Ltd
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Publication of JPH0491456A publication Critical patent/JPH0491456A/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明はマイクロストリップラインを備えたMMIC(
モノリシック・マイクロウニイブ・集積回路)などのマ
イクロ波半導体装置に関するものである。
〔従来の技術〕
従来、この種のマイクロ波半導体装置としては、例えば
、第3図の斜視図に示される構造のMMICがある。G
aAs (ガリウム砒素)半導体基板1上には、MES
FET (ショットキー形電界効果トランジスタ)2や
ダイオード3等の能動素子や、MIM (メタル・イン
シュレータ・メタル)キャパシタ4、インクディジタル
形キャパシタ5、インダクタ6および抵抗7等の受動素
子が集積化されている。また、裏面電極8とのコンタク
トをとるためにピアホール9が形成されおり、また、外
部装置との電気的接続をとるためにボンディングワイヤ
10が設けられている。また、基板1上に形成された各
素子間を電気的に接続するため、マイクロストリップラ
イン11か形成されている。
このマイクロストリップライン11にはその途中にエア
ブリッヂ12か形成され、不要な他の素子と電気的に接
触しないようになっている。
マイクロストリップライン11部分の断面図は第4図に
示される。半導体基板1の下部には裏面電極8、上部に
は窒化膜13が形成されており、この窒化膜13上には
配線金属、つまり、上記、のマイクロストリップライン
11が形成されている。
UHFHF上の周波数においては配線の長さは進行波の
波長λに比べて無視出来なくなり、逆にこれを利用して
フィルタ等を形成することが出来る。
この種のマイクロストリップライン11は伝搬される信
号波長λの1/4の長さで特徴的な線路特性を示すため
、λ/4の長さを持った配線利用が多い。
〔発明が解決しようとする課題〕
しかしながら、上記従来の第4図に示される断面構造を
有するマイクロストリップライン11を使用して、配線
長をλ/4の長さに設定すると、マイクロストリップラ
イン11の長さは長くなってしまう。例えば、信号周波
数が12GHzではλ/4長は2292μmと長くなる
。通常、MMICにおけるFETサイズは400μm角
の面積内に入るため、このFETサイズに比較すると2
292μmというλ/4長は非常に大きいことが理解さ
れる。このため、マイクロストリップライン11がGa
As基板1上に占める面積は大きくなり、MMICチッ
プは大形化していた。
〔課題を解決するための手段〕
本発明はこのような課題を解消するためになされたもの
で、半導体基板と配線金属とを備えたマイクロ波半導体
装置において、配線金属は半導体基板より高い誘電率を
有する誘電膜を介して半導体基板上に形成されたもので
ある。
また、配線金属上に半導体基板より高い誘電率を有する
第2の誘電膜が形成されたものである。
〔作用〕
配線金属に接する高誘電率の誘電膜の影響により、線路
の特性インピーダンスは低下する。
〔実施例〕
次に、本発明の第1の実施例によるMMICについて第
1図を参照して説明する。同図はMMICの一部断面図
を示している。このMMICは第3図と同様な構造をし
ているが、マイクロストリップライン24に接して高誘
電体膜23が形成されている点が異なっている。GaA
s半導体基板21は厚さが100μm1比誘電率εrが
12.9である。このGaAs半導体基板21上には比
誘電率εrが7の窒化膜(SiN)22が1μmの厚さ
に形成されている。この窒化膜22はMIMキャパシタ
を構成する絶縁膜の形成と同時に形成されるものであり
、窒化膜22上には比誘電率εrが100の高誘電体膜
23が1μmの厚さに形成されている。
高誘電体膜23の材質としては、例えば、比誘電率εr
が100程度のものとしてTaOxがあり、また、比誘
電率εrが100〜200程度のものとしてT iOs
さらに、比誘電率εrが200〜300程度の高誘電率
のものとしてBaT103などがある。現在実用化され
つつあるのは、”l”aox系のものであり、この誘電
体膜はスパッタリングや気相成長(CVD)技術により
形成されている。しかし、本実施例においては高誘電体
膜23の材質にこれらのいずれの材質を用いても良い。
マイクロストリップライン24は、半導体基板21より
高い誘電率を有する誘電膜、すなわち、高誘電体膜23
を介する半導体基板21上に形成されている。このマイ
クロストリップライン24は、下層部が厚さ400Aの
Ti金属、上層部が厚さ3μmのAu金属から形成され
ており(Au/Ti)、線路幅は70μmになっている
。下層部のTi金属は、マイクロストリップライン24
と高誘電体膜23との密着性を向上させるための下地金
属である。
また、半導体基板21の下側には裏面電極25が形成さ
れている。この裏面電極25は、上記のマイクロストリ
ップライン24の場合と同様に厚さ400AのTi金属
を下地金属とし、このTi金属上にAu金属が3μmの
厚さに形成されて構成されている(Au/Ti)。Au
金属は最初に2000A程度の厚さになるまで蒸着され
、その後、メツキ技術により、3μmの厚さに形成され
る。
第2図は本発明の第2の実施例によるMMICであり、
同図はこのMMICの一部断面図を示している。なお、
第1図と同一または相当する部分については同符号を用
いてその説明は省略する。
本実施例によるMMICの構造は、マイクロストリップ
ライン24上にさらに第2の高誘電体膜26が形成され
ている点が上述した第1の実施例と相違している。この
第2の高誘電体膜26の厚さは1μmであり、その材質
は上記の誘電体膜23と同じであり、比誘電率εrは1
00である。
次に、上記各実施例におけるマイクロストリップライン
24の各特性について、従来構造のマイクロストリップ
ライン11の特性と比較しつつ説明する。以下の第1表
は、2次元(断面)の有限要素法による電界計算から求
めた波長短縮率Rを基にし、信号周波数12GHzにお
けるλ/4長および特性インピーダンスZOを各種マイ
クロストリップラインについて計算した結果を示してい
る。
ただし、構造Aは第4図に示された従来構造、構造Bは
第1図に示された第1の実施例の構造、および構造Cは
第2図に示された第2の実施例の構造である。なお、従
来構造Aにおける基板厚さ、マイクロストリップライン
11の幅などの各寸法、および各物質の比誘電率εrは
上記各実施例と同一の値として計算しである。
従来構造Aにおける特性インピーダンスZOが50.6
(Ω)であるのに対し、第1の実施例の構造Bにおける
特性インピーダンスZOは47.2(Ω)、第2の実施
例の構造Cにおける特性インピーダンスZOは44.8
 (Ω)になっている。つまり、従来に比較して特性イ
ンピーダンスZOは低下している。これは、第1の実施
例ではマイクロストリップライン24下に高誘電体膜2
3、第2の実施例ではマイクロストリップライン24下
に高誘電体膜23およびマイクロストリップライン24
上に高誘電体膜26が形成されているためである。
このため、λ/4長は従来構造Aにおける長さ2292
μmに対し、第1の実施例の構造Bにおける長さは21
67μm1第2の実施例の構造Cにおける長さは206
1μmになっている。つまり、従来のλ/4長に比較し
、第1の実施例では125μm(−5,5%)、第2の
実施例では231μm(−10,1%)だけλ/4長が
短くなっている。この結果、上記各実施例によれば、M
M I C上にマイクロストリップライン24が占める
面積は縮小し、従来のようにMMICチップは大形化し
ない。
なお、上記の特性計算においては高誘電体膜23.26
の各比誘電率εrを100として計算したが、さらに、
大きい比誘電率εrを有する誘電体膜を使用することに
より、λ/4長もこれに伴ってさらに短くなる。また、
GaAs半導体基板21の厚さを100μmとしている
が、これより薄い半導体基板21を使用することによっ
ても、λ/4長は短くなる。また、パッシベーションや
MIMキャパシタ用の絶縁膜として用いた窒化膜22(
または酸化膜(S L O2) )を除去し、半導体基
板21上に直接高誘電体膜23を形成することによって
もλ/4長は短くなる。
〔発明の効果〕
以上説明したように本発明によれば、配線金属に接する
高誘電率の誘電膜の影響により、線路の特性インピーダ
ンスは低下する。このため、配線金属が半導体基板上に
占める面積の増加は抑制され、マイクロ波半導体装置は
大形化しない。
【図面の簡単な説明】
第1図は本発明の第1の実施例によるMMICにおける
マイクロストリップ線路部の一部拡大断面図、第2図は
本発明の第2の実施例によるMMICにおけるマイクロ
ストリップ線路部の一部拡大断面図、第3図はMMIC
の構造を示す斜視図、第4図は従来のMMICにおける
マイクロストリップ線路部の一部拡大断面図である。 21・・・GaAs半導体基板、22・・・窒化膜、2
3.26・・・高誘電体膜、24・・・マイクロストリ
ップライン、25・・・裏面電極。

Claims (1)

  1. 【特許請求の範囲】 1、半導体基板と配線金属とを備えたマイクロ波半導体
    装置において、前記配線金属は前記半導体基板より高い
    誘電率を有する誘電膜を介して前記半導体基板上に形成
    されたことを特徴とするマイクロ波半導体装置。 2、配線金属上に半導体基板より高い誘電率を有する第
    2の誘電膜が形成されたことを特徴とする請求項1記載
    のマイクロ波半導体装置。
JP2205480A 1990-08-02 1990-08-02 マイクロ波半導体装置 Pending JPH0491456A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP2205480A JPH0491456A (ja) 1990-08-02 1990-08-02 マイクロ波半導体装置

Applications Claiming Priority (1)

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JP2205480A JPH0491456A (ja) 1990-08-02 1990-08-02 マイクロ波半導体装置

Publications (1)

Publication Number Publication Date
JPH0491456A true JPH0491456A (ja) 1992-03-24

Family

ID=16507553

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Application Number Title Priority Date Filing Date
JP2205480A Pending JPH0491456A (ja) 1990-08-02 1990-08-02 マイクロ波半導体装置

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JP (1) JPH0491456A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002057535A (ja) * 2000-06-28 2002-02-22 Trw Inc 高ダイナミック・レンジ低雑音増幅器

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* Cited by examiner, † Cited by third party
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JP2002057535A (ja) * 2000-06-28 2002-02-22 Trw Inc 高ダイナミック・レンジ低雑音増幅器

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