JPH0512722A - スタンパー製造方法 - Google Patents

スタンパー製造方法

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JPH0512722A
JPH0512722A JP3192429A JP19242991A JPH0512722A JP H0512722 A JPH0512722 A JP H0512722A JP 3192429 A JP3192429 A JP 3192429A JP 19242991 A JP19242991 A JP 19242991A JP H0512722 A JPH0512722 A JP H0512722A
Authority
JP
Japan
Prior art keywords
master
stamper
film
silicon
manufactured
Prior art date
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Pending
Application number
JP3192429A
Other languages
English (en)
Inventor
Shinya Tezuka
信哉 手塚
Hisayuki Miyagawa
久行 宮川
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
TOHOKU NAKATANI KK
Original Assignee
TOHOKU NAKATANI KK
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Publication date
Application filed by TOHOKU NAKATANI KK filed Critical TOHOKU NAKATANI KK
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Publication of JPH0512722A publication Critical patent/JPH0512722A/ja
Pending legal-status Critical Current

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  • Moulds For Moulding Plastics Or The Like (AREA)
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Abstract

(57)【要約】 【目的】光ディスク製造等に必要であるスタンパーの製
造工程において、丈夫で耐久性が良く、取扱いが容易な
スタンパーの原盤を作製する。 【構成】ビットが形成されている原盤部の基板に、堅さ
が堅く、環境の変化に対して安定なシリコンウエハーを
用いる。前記シリコンウエハー1上にSiO2膜2の形
成、フォトレジスト3のスピンコート、情報信号に同期
したレーザー光の露光、現像、SiO2膜2のエッチン
グ、シリコン1の異方性エッチングの工程を順に施すこ
とによりシリコン基板上に直接ビット4が形成された原
盤部を作製する。前記原盤部を基に導通膜5の形成、電
鋳部材6の形成、原盤部と電鋳部材6の剥離を行うこと
によりスタンパーを作製する。 【効果】この方法を使うことにより同じ原盤部から数多
くのスタンパーを作製することができ、その原盤部は丈
夫で耐久性が良く、取扱いが容易である。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は光ディスク用基盤製造に
おいて必要となるスタンパーの製造に関する。
【0002】
【従来の技術】従来の一般的なスタンパー作製工程を以
下に示す。ガラス原盤上に感光体であるフォトレジスト
を塗布し、このレジストに情報信号に同期したレーザー
光等で所定形状のトラッキング用案内溝、ビット等を潜
像として感光記録し、これを現像することで所定形状の
案内溝やランドを有するスタンパー電鋳用原盤部を形成
する。その後、この原盤部上にNi薄膜等を形成し、通
電処理を行って、電鋳部材にて電鋳を行ない、その結
果、電鋳部材を原盤部より剥離してスタンパーを作製す
る。
【0003】
【発明が解決しようとする課題】作製されたスタンパー
は、その後射出成形により製品となる光デスクを大量生
産されるが、通常、1枚のスタンパーから成形されるデ
ィスクの数は1万枚程度であるため同じスタンパーを数
枚用意するのが普通である。従来の技術では、同じ原盤
部から電鋳,剥離を繰り返し行い複数枚のスタンパーを
作製しようとすると、フォトレジストの堅さが弱いため
に、原盤部に形成されているフォトレジストの情報信号
の凹凸が潰れてしまう。また、フォトレジストは温度や
湿度の変化に対して寸法が不安定になりやすいことや、
溶剤に弱い等の耐久性の問題がある。
【0004】通電処理は、スパッタリングによりNi薄
膜を着けるのが普通となっているが、フォトレジストは
スパッタリング中の熱によって変形しやすい等の問題が
ある。
【0005】
【課題を解決するための手段】本発明は、原盤部の基盤
に酸化膜を施したシリコンウエハーを用いる。そのシリ
コンウエハー上に従来の技術同様にフォトレジストをス
ピンコートし、情報信号に同期したレーザー光を照射し
て現像後ビットを形成する。それをフッ酸等で酸化膜を
エッチングして酸化膜のビットを形成する。次に、適当
なアルカリ性の水溶液で異方性エッチングを行うことに
よりシリコン基盤上に直接ビットを形成する。このシリ
コンの湿式の異方性エッチングはマイクロマシーニング
の分野等で一般的に使われている方法で、シリコンの単
結晶を適当なアルカリ性の水溶液を用いて湿式のエッチ
ングを行うと(100)面や(110)面に対して(1
11)面のエッチング速度が非常に遅いために異方性が
現れる。
【0006】シリコンはレジストと比較して堅く、温度
や湿度の変化に対して安定で、溶剤や酸などの薬品に対
しても安定であるため、形成されたビットは電鋳,剥離
を繰り返してもビットが潰れるということはなく、何枚
もスタンパーを転写できる。更に、基盤であるシリコン
ウエハー上に直接情報信号であるビットを形成するので
非常に扱い安い。また、スパッタリングにより熱変形し
にくい、等の利点がある。
【0007】シリコン基盤の原盤部作製後のスタンパー
作製法は、従来通り通電処理後、電鋳部材により電鋳を
行い、電鋳部材を原盤部から剥離することによりスタン
パーを作製する。
【0008】
【実施例】片面が鏡面になっている面方位が(100)
面の4インチのシリコンウエハー1に熱酸化を施しSi
2膜2を0.1μm形成する(図1a)。その上にフ
ォトレジスト3をスピンコートし、プリベーキング後
(図1b)、情報信号に同期したレーザー光で露光す
る。それを現像しポストベーキングすることによりフォ
トレジストのビットを形成する(図1c)。次に緩衝フ
ッ酸を用いてSiO2膜をエッチングすることによりS
iO2膜のビットを形成する(図1d)。次にSiO2
をマスクとして水酸化カリウム水溶液を用いて異方性エ
ッチングを行うことにより、シリコン基盤上に深さ0.
3μmの台形のビット4を形成し、レジストとSiO2
膜を除去して原盤部を作製する(図1e)。ビットの深
さはエッチング液の温度や濃度,時間などの条件を変え
ることにより制御される。その上に導電膜5としてNi
をスパッタリングにより0.1μm付ける(図1f)。
次に電鋳を行うことによりNi6を280μm堆積させ
(図1g)、原盤部から剥離させることによりNiのス
タンパーを作製する(図1h)。
【図面の簡単な説明】
【図1】本発明の方法でスタンパーを作製した工程図
で、aはシリコンウエハー上にSiO2膜の形成、bは
フォトレジストのスピンコート、cはレーザー光による
情報信号の露光、dは緩衝フッ酸によるSiO2膜のエ
ッチング、eはシリコンの異方性エッチング、fは導通
膜としてNiをスパッタ、gはNiの電鋳、hは電鋳部
と原盤部の剥離を示している。
【符号の説明】
1 シリコンウエハー 2 SiO2膜 3 フォトレジスト 4 異方性エッチングで開けられた台形のビット 5 Niスパッタ膜 6 Ni電鋳部

Claims (2)

    【特許請求の範囲】
  1. 【請求項1】 情報信号に対応する微少凹凸を有する原
    盤からメッキ技術により作製されるスタンパー製造工程
    において、前記原盤部にシリコンウエハーを使用するこ
    とを特徴とする。
  2. 【請求項2】 原盤部の情報信号に対応する微少凹凸を
    シリコンや水晶などの単結晶の異方性エッチングを用い
    て形成することを特徴とする。
JP3192429A 1991-07-05 1991-07-05 スタンパー製造方法 Pending JPH0512722A (ja)

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Cited By (7)

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