JPH0514915B2 - - Google Patents
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- JPH0514915B2 JPH0514915B2 JP59248171A JP24817184A JPH0514915B2 JP H0514915 B2 JPH0514915 B2 JP H0514915B2 JP 59248171 A JP59248171 A JP 59248171A JP 24817184 A JP24817184 A JP 24817184A JP H0514915 B2 JPH0514915 B2 JP H0514915B2
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- Japan
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- wiring
- active matrix
- block
- matrix circuit
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- G09G3/3674—Details of drivers for scan electrodes
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Description
【発明の詳細な説明】
［産業上の利用分野］
本発明は、アクテイブマトリクス回路基板の走
査線の構成に関するものであり、更にこの基板を
用いた液晶表示装置とその駆動法に関するもので
ある。
査線の構成に関するものであり、更にこの基板を
用いた液晶表示装置とその駆動法に関するもので
ある。
［従来の技術］
アクテイブマトリクス回路基板の代表的なもの
としてTFT（Thin−Film−Transistor）をスイ
ツチング素子として用いた液晶表示装置がある。
この液晶表示装置は、CRTに変わる表示装置と
して注目されているが、近年の高解像度化、高品
位化に対応するため、その走査線の本数は数百本
にものぼり、また高密度化している。
としてTFT（Thin−Film−Transistor）をスイ
ツチング素子として用いた液晶表示装置がある。
この液晶表示装置は、CRTに変わる表示装置と
して注目されているが、近年の高解像度化、高品
位化に対応するため、その走査線の本数は数百本
にものぼり、また高密度化している。
第２図は、従来のアクテイブマトリツクス型液
晶表示装置の回路構成をしたものである。図中１
は表示部、ANMは画素駆動用のTFTスイツチン
グ素子、２は信号線駆動回路、３は走査線駆動回
路、４は１と３の接続部、Ｇ１〜GNは走査線、
Ｓ１〜SMは信号線を示すものである。かかる装
置において、走査線数×信号線数を、Ｎ×Ｍのマ
トリクス構成とした場合、（Ｎ，Ｍは正の整数）、
接続部４はＮケ所となる。また密度に関しては、
例えば走査線数480本、アスペクト比３：４、画
面サイズ対角３インチの小型液晶テレビを考えた
場合、画面の縦の長さｌは、 ｌ＝３×25.4（mm）×３／５≒46（mm）． であるから走査線密度ｄは ｄ＝Ｎ／ｌ＝480／46≒10.4（本／mm） となり１mm当り、約10本の密度となる。
晶表示装置の回路構成をしたものである。図中１
は表示部、ANMは画素駆動用のTFTスイツチン
グ素子、２は信号線駆動回路、３は走査線駆動回
路、４は１と３の接続部、Ｇ１〜GNは走査線、
Ｓ１〜SMは信号線を示すものである。かかる装
置において、走査線数×信号線数を、Ｎ×Ｍのマ
トリクス構成とした場合、（Ｎ，Ｍは正の整数）、
接続部４はＮケ所となる。また密度に関しては、
例えば走査線数480本、アスペクト比３：４、画
面サイズ対角３インチの小型液晶テレビを考えた
場合、画面の縦の長さｌは、 ｌ＝３×25.4（mm）×３／５≒46（mm）． であるから走査線密度ｄは ｄ＝Ｎ／ｌ＝480／46≒10.4（本／mm） となり１mm当り、約10本の密度となる。
［発明が解決しようとする問題点］
従来、この高密度、且つ多数の走査線を外部の
走査線駆動回路と接続するために、実装の信頼
性、歩留りの低下及びコスト高が問題となつてい
た。また、走査線駆動回路の出力線数もＮ本必要
であるため、走査線駆動回路そのものが大規模と
なり、大きさ、コストの面で問題があつた。
走査線駆動回路と接続するために、実装の信頼
性、歩留りの低下及びコスト高が問題となつてい
た。また、走査線駆動回路の出力線数もＮ本必要
であるため、走査線駆動回路そのものが大規模と
なり、大きさ、コストの面で問題があつた。
本発明は、この様な従来の問題点に鑑みなされ
たもので、アクテイブマトリクス回路基板の走査
線と外部駆動回路との接続数を減らし、実装の簡
素化、歩留りの向上、実装コストの低下、さら
に、外部走査線駆動回路の小規模化、コンパクト
化、低コスト化を計ることを目的とするものであ
る。
たもので、アクテイブマトリクス回路基板の走査
線と外部駆動回路との接続数を減らし、実装の簡
素化、歩留りの向上、実装コストの低下、さら
に、外部走査線駆動回路の小規模化、コンパクト
化、低コスト化を計ることを目的とするものであ
る。
［問題点を解決するための手段］及び［作用］
本発明は、先ず第１に、
ａ 複数の行及び列に沿つて複数配置した３端子
のトランジスタ、 行上に配置された複数のトランジスタの第１
端子を共通に接続した走査線、 列上に配置された複数のトランジスタの第２
端子を共通に接続した信号線、 複数のトランジスタ毎の第３端子に接続した
画素電極、 からなるアクテイブマトリクス回路、及び ｂ 各走査線のアクテイブマトリクス回路と走査
線駆動回路との間に設けられた３端子のトラン
ジスタ、 ｃ 走査線をｍ本ずつｎ個のブロツクに分割し上
記ｂのトランジスタの第１端子をブロツク毎に
共通に接続したｎ個の配線からなる第１の配
線、 ｄ 各ブロツクのｒ番目の走査線を共通に接続し
たｍ個の配線からなる第２の配線、 ｅ 各走査線のアクテイブマトリクス回路と上記
ｂのトランジスタとの間に接続された、３端子
のトランジスタを介して該走査線に一定電圧を
印加する第３の配線 を有するアクテイブマトリクス回路基板を提供す
るものであり、第２に、上記第１の発明のアクテ
イブマトリクス回路基板と、対向電極を有する基
板間に液晶を挟持してなる表示パネルを有する液
晶表示装置を提供するものであり、第３に、上記
第２の発明の液晶表示装置の駆動法であつて、 第１の配線を順次選択し、且つ選択された第１
の配線に接続されたブロツク内の第２の配線を該
ブロツク選択時に順次選択してブロツク内の走査
線を全て選択し、ブロツク毎に順次走査線を選択
すると同時に、 任意の走査線において非選択時に上記ｅのトラ
ンジスタをオンして一定電圧を印加し該走査線の
放電を行なう液晶表示装置の駆動法を提供するも
のである。
のトランジスタ、 行上に配置された複数のトランジスタの第１
端子を共通に接続した走査線、 列上に配置された複数のトランジスタの第２
端子を共通に接続した信号線、 複数のトランジスタ毎の第３端子に接続した
画素電極、 からなるアクテイブマトリクス回路、及び ｂ 各走査線のアクテイブマトリクス回路と走査
線駆動回路との間に設けられた３端子のトラン
ジスタ、 ｃ 走査線をｍ本ずつｎ個のブロツクに分割し上
記ｂのトランジスタの第１端子をブロツク毎に
共通に接続したｎ個の配線からなる第１の配
線、 ｄ 各ブロツクのｒ番目の走査線を共通に接続し
たｍ個の配線からなる第２の配線、 ｅ 各走査線のアクテイブマトリクス回路と上記
ｂのトランジスタとの間に接続された、３端子
のトランジスタを介して該走査線に一定電圧を
印加する第３の配線 を有するアクテイブマトリクス回路基板を提供す
るものであり、第２に、上記第１の発明のアクテ
イブマトリクス回路基板と、対向電極を有する基
板間に液晶を挟持してなる表示パネルを有する液
晶表示装置を提供するものであり、第３に、上記
第２の発明の液晶表示装置の駆動法であつて、 第１の配線を順次選択し、且つ選択された第１
の配線に接続されたブロツク内の第２の配線を該
ブロツク選択時に順次選択してブロツク内の走査
線を全て選択し、ブロツク毎に順次走査線を選択
すると同時に、 任意の走査線において非選択時に上記ｅのトラ
ンジスタをオンして一定電圧を印加し該走査線の
放電を行なう液晶表示装置の駆動法を提供するも
のである。
本発明は、第１の配線と第２の配線を組合せる
ことにより、先ずアクテイブマトリクス回路基板
において接続線の数を大幅に減少させ、更に、第
３の配線を設けて比選択時に走査線の放電を行な
うことにより、全ての走査線について非選択時の
電位を一定に保つことができる。
ことにより、先ずアクテイブマトリクス回路基板
において接続線の数を大幅に減少させ、更に、第
３の配線を設けて比選択時に走査線の放電を行な
うことにより、全ての走査線について非選択時の
電位を一定に保つことができる。
［実施例］
第１図は本発明の実施例を示す回路構成図で、
第２図に示したＮ×Ｍアクテイブマトリクス型液
晶表示装置の走査線を４本の共通線Ａ，Ｂ，Ｃ，
Ｄに共通化した場合の例である。
第２図に示したＮ×Ｍアクテイブマトリクス型液
晶表示装置の走査線を４本の共通線Ａ，Ｂ，Ｃ，
Ｄに共通化した場合の例である。
図中SW11〜SWn4は分割化スイツチング素子
で、Ｅ１〜Enは前記分割化スイツチング素子を
制御するための分割ブロツク選択線である。な
お、本実施例における共通線は４本であるから、
この場合ｎはＮ／４に等しい。P1〜PNは放電用
スイツチング素子で、Ｉは放電制御線、Ｊは放電
電位線、５は共通化された走査線を駆動するため
の共通走査線駆動回路で、６は回路基板と５との
接続部を示すものである。また、第３図は表示部
１の走査線Ｇ１〜GNに与えるべき駆動信号のタ
イミングを示す波形図であり、第４図は本実施例
における各駆動信号のタイミングを示す波形図で
ある。
で、Ｅ１〜Enは前記分割化スイツチング素子を
制御するための分割ブロツク選択線である。な
お、本実施例における共通線は４本であるから、
この場合ｎはＮ／４に等しい。P1〜PNは放電用
スイツチング素子で、Ｉは放電制御線、Ｊは放電
電位線、５は共通化された走査線を駆動するため
の共通走査線駆動回路で、６は回路基板と５との
接続部を示すものである。また、第３図は表示部
１の走査線Ｇ１〜GNに与えるべき駆動信号のタ
イミングを示す波形図であり、第４図は本実施例
における各駆動信号のタイミングを示す波形図で
ある。
実際にデイスプレイ装置として駆動する場合に
は、第１図に示した共通走査線駆動回路５から、
共通線Ａ，Ｂ，Ｃ，Ｄに繰り返しパルスを与える
と共に、分割ブロツク選択線Ｅ１〜Enを順次
ON／OFFさせる。また、P1〜Pnには非選択時
にＧ１〜GNを−Ｖ(V)の電位に制御するために放
電制御線Ｉにパルスを与える。（第４図参照） この様に、共通走査線駆動回路５を、第４図に
示すごとく駆動することによつて、走査線Ｇ１〜
GNに第２図に示す様な電気信号を与えることが
できる。
は、第１図に示した共通走査線駆動回路５から、
共通線Ａ，Ｂ，Ｃ，Ｄに繰り返しパルスを与える
と共に、分割ブロツク選択線Ｅ１〜Enを順次
ON／OFFさせる。また、P1〜Pnには非選択時
にＧ１〜GNを−Ｖ(V)の電位に制御するために放
電制御線Ｉにパルスを与える。（第４図参照） この様に、共通走査線駆動回路５を、第４図に
示すごとく駆動することによつて、走査線Ｇ１〜
GNに第２図に示す様な電気信号を与えることが
できる。
上記実施例においては、走査線をＮ本、共通線
を４本として説明したが、例えば走査線を480本、
共通線を24本とすると、分割ブロツク選択線は20
本となり、外部駆動回路との接続数は、放電制御
線、放電電位線の２本を含めて合計46ケ所とな
り、約90％の接続数削減の効果がある。
を４本として説明したが、例えば走査線を480本、
共通線を24本とすると、分割ブロツク選択線は20
本となり、外部駆動回路との接続数は、放電制御
線、放電電位線の２本を含めて合計46ケ所とな
り、約90％の接続数削減の効果がある。
また、分割化スイツチング素子と放電用スイツ
チング素子は画素駆動用スイツチング素子と同一
機能であるので、同一基板上に一体化形成するこ
とが可能である。
チング素子は画素駆動用スイツチング素子と同一
機能であるので、同一基板上に一体化形成するこ
とが可能である。
［発明の効果］
本発明においては、アクテイブマトリクス回路
基板の走査線を、スイツチング素子を用いて共通
化すると共に、前記スイツチング素子をアクテイ
ブマトリクス回路と同一基板上に一体形成したこ
とにより、回路基板の走査線と、外部回路との接
続数を減らすことができるため、実装の簡素化、
歩留りの向上、低コスト化を図ることができる。
また走査線駆動回路の小規模化、コンパクト化、
低コスト化にも効果がある。
基板の走査線を、スイツチング素子を用いて共通
化すると共に、前記スイツチング素子をアクテイ
ブマトリクス回路と同一基板上に一体形成したこ
とにより、回路基板の走査線と、外部回路との接
続数を減らすことができるため、実装の簡素化、
歩留りの向上、低コスト化を図ることができる。
また走査線駆動回路の小規模化、コンパクト化、
低コスト化にも効果がある。
更に本発明では、各走査線に放電用の第３の配
線を接続することにより、非選択時の電位を一定
に保ち、アクテイブマトリクス回路のトランジス
タのスイツチング特性を良好に且つ一定に保つこ
とができる。従つて、本発明の液晶表示装置にお
いては、高品質の画像表示を行なうことができ
る。
線を接続することにより、非選択時の電位を一定
に保ち、アクテイブマトリクス回路のトランジス
タのスイツチング特性を良好に且つ一定に保つこ
とができる。従つて、本発明の液晶表示装置にお
いては、高品質の画像表示を行なうことができ
る。
第１図は本発明の実施例を示す回路構成図、第
２図は従来のアクテイブマトリクス型液晶表示装
置の回路構成図、第３図は走査線駆動信号の波形
図、第４図は第１図の共通走査線駆動回路におけ
る各駆動信号の波形図である。１……表示部、２
……信号線駆動回路、３……走査線駆動回路、
４，６……接続部、５……共通走査線駆動回路、
Ｓ，１〜Ｓ，Ｍ……信号線、Ｇ，１〜Ｇ，Ｎ……
走査線、Ａ，Ｂ，Ｃ，Ｄ……共通線、Ｅ，１〜
Ｅ，ｎ……分割ブロツク選択線、SW11〜SWn4…
…分割化スイツチング素子、P1〜Pn……放電用
スイツチング素子、Ｉ……放電制御線、Ｊ……放
電電位線。
２図は従来のアクテイブマトリクス型液晶表示装
置の回路構成図、第３図は走査線駆動信号の波形
図、第４図は第１図の共通走査線駆動回路におけ
る各駆動信号の波形図である。１……表示部、２
……信号線駆動回路、３……走査線駆動回路、
４，６……接続部、５……共通走査線駆動回路、
Ｓ，１〜Ｓ，Ｍ……信号線、Ｇ，１〜Ｇ，Ｎ……
走査線、Ａ，Ｂ，Ｃ，Ｄ……共通線、Ｅ，１〜
Ｅ，ｎ……分割ブロツク選択線、SW11〜SWn4…
…分割化スイツチング素子、P1〜Pn……放電用
スイツチング素子、Ｉ……放電制御線、Ｊ……放
電電位線。
Claims (1)
- 【特許請求の範囲】 １ ａ 複数の行及び列に沿つて複数配置した３
端子のトランジスタ、 行上に配置された複数のトランジスタの第１
端子を共通に接続した走査線、 列上に配置された複数のトランジスタの第２
端子を共通に接続した信号線、 複数のトランジスタ毎の第３端子に接続した
画素電極、 からなるアクテイブマトリクス回路、及び ｂ 各走査線のアクテイブマトリクス回路と走査
線駆動回路との間に設けられた３端子のトラン
ジスタ、 ｃ 走査線をｍ本ずつｎ個のブロツクに分割し上
記ｂのトランジスタの第１端子をブロツク毎に
共通に接続したｎ個の配線からなる第１の配
線、 ｄ 各ブロツクのｒ番目の走査線を共通に接続し
たｍ個の配線からなる第２の配線、 ｅ 各走査線のアクテイブマトリクス回路と上記
ｂのトランジスタとの間に接続された、３端子
のトランジスタを介して該走査線に一定電圧を
印加する第３の配線 を有することを特徴とするアクテイブマトリクス
回路基板。 ２ ａ 複数の行及び列に沿つて複数配置した３
端子のトランジスタ、 行上に配置された複数のトランジスタの第１
端子を共通に接続した走査線、 列上に配置された複数のトランジスタの第２
端子を共通に接続した信号線、 複数のトランジスタ毎の第３端子に接続した
画素電極、 からなるアクテイブマトリクス回路、及び ｂ 走査線のアクテイブマトリクス回路と走査線
駆動回路との間に設けられた３端子のトランジ
スタ、 ｃ 走査線をｍ本ずつｎ個のブロツクに分割し上
記ｂのトランジスタの第１端子をブロツク毎に
共通に接続したｎ個の配線からなる第１の配
線、 ｄ 各ブロツクのｒ番目の走査線を共通に接続し
たｍ個の配線からなる第２の配線、及び ｅ 各走査線のアクテイブマトリクス回路と上記
ｂのトランジスタとの間に接続された、３端子
のトランジスタを介して該走査線に一定電圧を
印加する第３の配線 を有するアクテイブマトリクス回路基板と、対向
電極を有する基板間に液晶を挟持してなる表示パ
ネルを有することを特徴とする液晶表示装置。 ３ ａ 複数の行及び列に沿つて複数配置した３
端子のトランジスタ、 行上に配置された複数のトランジスタの第１
端子を共通に接続した走査線、 列上に配置された複数のトランジスタの第２
端子を共通に接続した信号線、 複数のトランジスタ毎の第３端子に接続した
画素電極、 からなるアクテイブマトリクス回路、及び ｂ 各走査線のアクテイブマトリクス回路と走査
線駆動回路との間に設けられた３端子のトラン
ジスタ、 ｃ 走査線をｍ本ずつｎ個のブロツクに分割し上
記ｂのトランジスタの第１端子をブロツク毎に
共通に接続したｎ個の配線からなる第１の配
線、 ｄ 各ブロツクのｒ番目の走査線を共通に接続し
たｍ個の配線からなる第２の配線、及び ｅ 各走査線のアクテイブマトリクス回路と上記
ｂのトランジスタとの間に接続された、３端子
のトランジスタを介して該走査線に一定電圧を
印加する第３の配線 を有するアクテイブマトリクス回路基板と、対向
電極を有する基板間に液晶を挟持してなる表示パ
ネルを有する液晶表示装置の駆動法であつて、 第１の配線を順次選択し、且つ選択された第１
の配線に接続されたブロツク内の第２の配線を該
ブロツク選択時に順次選択してブロツク内の走査
線を全て選択し、ブロツク毎に順次走査線を選択
すると同時に、 任意の走査線において非選択時に上記ｅのトラ
ンジスタをオンして一定電圧を印加し該走査線の
放電を行なうことを特徴とする液晶表示装置の駆
動法。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59248171A JPS61126595A (ja) | 1984-11-26 | 1984-11-26 | アクティブマトリクス回路基板及びこれを用いた液晶表示装置とその駆動法 |
| US06/799,498 US4816819A (en) | 1984-11-26 | 1985-11-19 | Display panel |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59248171A JPS61126595A (ja) | 1984-11-26 | 1984-11-26 | アクティブマトリクス回路基板及びこれを用いた液晶表示装置とその駆動法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61126595A JPS61126595A (ja) | 1986-06-14 |
| JPH0514915B2 true JPH0514915B2 (ja) | 1993-02-26 |
Family
ID=17174266
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59248171A Granted JPS61126595A (ja) | 1984-11-26 | 1984-11-26 | アクティブマトリクス回路基板及びこれを用いた液晶表示装置とその駆動法 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US4816819A (ja) |
| JP (1) | JPS61126595A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0601869A3 (en) * | 1992-12-10 | 1995-05-10 | Sharp Kk | Flat display device, its control method and method for its production. |
Families Citing this family (18)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| ES2044845T3 (es) * | 1986-02-17 | 1994-01-16 | Canon Kk | Aparato excitador. |
| US5298913A (en) * | 1987-05-29 | 1994-03-29 | Sharp Kabushiki Kaisha | Ferroelectric liquid crystal display device and driving system thereof for driving the display by an integrated scanning method |
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