JPH0516667B2 - - Google Patents

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Publication number
JPH0516667B2
JPH0516667B2 JP60273369A JP27336985A JPH0516667B2 JP H0516667 B2 JPH0516667 B2 JP H0516667B2 JP 60273369 A JP60273369 A JP 60273369A JP 27336985 A JP27336985 A JP 27336985A JP H0516667 B2 JPH0516667 B2 JP H0516667B2
Authority
JP
Japan
Prior art keywords
electronic component
wiring board
silicone resin
leads
filled
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Lifetime
Application number
JP60273369A
Other languages
English (en)
Other versions
JPS62133742A (ja
Inventor
Yukio Yamaguchi
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
Nippon Electric Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Nippon Electric Co Ltd filed Critical Nippon Electric Co Ltd
Priority to JP60273369A priority Critical patent/JPS62133742A/ja
Priority to US06/900,532 priority patent/US4709301A/en
Priority to EP86112244A priority patent/EP0214621B1/en
Priority to DE86112244T priority patent/DE3688164T2/de
Publication of JPS62133742A publication Critical patent/JPS62133742A/ja
Publication of JPH0516667B2 publication Critical patent/JPH0516667B2/ja
Granted legal-status Critical Current

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    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W76/00Containers; Fillings or auxiliary members therefor; Seals
    • H10W76/40Fillings or auxiliary members in containers, e.g. centering rings
    • H10W76/42Fillings
    • H10W76/47Solid or gel fillings
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W72/00Interconnections or connectors in packages
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W70/00Package substrates; Interposers; Redistribution layers [RDL]
    • H10W70/60Insulating or insulated package substrates; Interposers; Redistribution layers
    • H10W70/62Insulating or insulated package substrates; Interposers; Redistribution layers characterised by their interconnections
    • H10W70/65Shapes or dispositions of interconnections
    • H10W70/654Top-view layouts
    • H10W70/656Fan-in layouts

Landscapes

  • Encapsulation Of And Coatings For Semiconductor Or Solid State Devices (AREA)
  • Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は電子装置等に使用されるパツケージに
係わり、特に信号等を授受する入出力ピンを配線
基板に設け電子部品を実装してシリコンコーテイ
ングされたパツケージに関するものである。
〔従来の技術〕
従来、この種のパツケージは、第2図に示すよ
うに内部に複数層の導体配線層1を有し裏面に入
出力ピン2が設けられた配線基板3上に電子部品
4が実装され、リード5を介して前記導体配線層
1に接続されて電子部品4の周辺部はシリコン樹
脂6により被覆されている(例えば、Brad
Older and Richard A.、“Non−hermetic
packaging techniques for hybrids”、
Electronic Packaging and Production、June、
1979、P137〜139)。
〔発明が解決しようとする問題点〕
上述した従来のパツケージでは、電子部品4の
交換時に、リード5と電子部品4と配線基板3と
で囲まれた領域に充填されたシリコン樹脂6の除
去が困難であり、特にリード5が微細化したり、
電子部品4がフエイスダウン実装となると、リー
ド5と電子部品4の配線基板3とで囲まれた領域
が狭くなり、シリコン樹脂6が除去できず、また
シリコン樹脂を溶解させる有機溶剤への浸漬時に
シリコン樹脂6の膨張でリード5が切断された
り、配線基板1からリード5が剥れたりするなど
の問題があつた。
〔問題点を解決するための手段〕
本発明によるパツケージは、配線基板上に実装
された電子部品とこの電子部品のリードとで囲ま
れた領域に紫外線照射により未硬化ないし半硬化
する第1の紫外線硬化形シリコン樹脂を充填し、
この第1の紫外線硬化形シリコン樹脂上に弾性力
のあるゲル状に硬化する第2の紫外線硬化形シリ
コン樹脂を充填するものである。
〔作用〕
第1のシリコン樹脂が硬化されていないので、
有機溶剤に溶解される。
〔実施例〕 次に、本発明について図面を参照して説明す
る。
第1図は本発明の一実施例を示す縦断面図であ
り、前述の図と同一部分には同一符号を付してあ
る。同図において、配線基板1の表面にはリード
用パツド8が、その裏面には入出力ピン2がそれ
ぞれ設けられており、このリード用パツド8と入
出力ピン2とは配線基板3内で導体配線層1によ
り電気的に接続されている。また、この配線基板
1上には図示しないが例えばエポキシ樹脂などの
接着剤によりスペーサ9が固定配置され、さらに
このスペーサ9上には電子部品4がフエースダウ
ンで接着配置され、電子部品4のリード5が配線
基板3上のリード用パツド8に電気的に接続され
ている。また、この配線基板3上にはその周辺部
に枠体10が図示しないが接着剤により取付固定
されている。そして、この枠体10内には紫外線
硬化形のシリコン樹脂が充填され、上方側から紫
外線を照射することにより、電子部品4および電
子部品4のリード5の影になる部分が未硬化ない
しは半硬化状態となる第1のシリコン樹脂11が
形成され、その周辺部および上部には弾力性のあ
るゲル状に硬化する第2のシリコン樹脂12が形
成されている。また、枠体10の開口部には電子
部品4と図示しない熱伝導性コンパウンドで接触
してキヤツプ13が図示しないが接着剤により取
付固定されている。このキヤツプ13は、ヒート
シンク等の放熱部品を接着、半田付けまたは熱伝
導性コンパウンドによる接続等により、電子部品
4で発生する熱を外部に導く機能を有しており、
空冷するためのヒートシンクまたは水冷するため
の冷却板と一体化しても良い。また、スペーサ9
は、絶縁性であれば配線基板3と電子部品4との
接着剤も絶縁性であることが望ましいが、電子部
品4のスペーサ9との接する面が絶縁されていた
り、配線基板3のスペーサ9との接する面が絶縁
されていれば、スペーサ9および接着剤は導電性
でも良い。また、配線基板3の枠体10との接す
る部分が絶縁されていれば、枠体10および接着
剤は導電性でも良い。さらに配線基板3の枠体1
0と接する部分が絶縁され、かつその上に専用の
金属層を設ければ、金属の場合の枠体10と配線
基板3とを半田付けできる。
このような構成によれば、電子部品4等を交換
する場合、まず第2のシリコン樹脂12を剥が
し、次に第1のシリコン樹脂11を有機溶剤に浸
漬することにより、溶解され、容易に除去するこ
とができる。
〔発明の効果〕
以上説明したように本発明によれば、配線基板
上に実装された電子部品とこの電子部品のリード
とで囲まれた領域に硬化しない第1の紫外線硬化
形シリコン樹脂を充填したことにより、電子部品
の交換時に電子部品のリードの外側の第2の紫外
線硬化形シリコン樹脂のみを剥離し、第1のシリ
コン樹脂を有機溶剤に浸漬することにより、溶解
され、容易に除去されるので、電子部品のリード
の切断および配線基板からの剥れ等を確実に防止
することができるという極めて優れた硬化が得ら
れる。
【図面の簡単な説明】
第1図は本発明によるパツケージの一実施例を
示す縦断面図、第2図は従来のパツケージを示す
縦断面図である。 1……導体配線層、2……入出力ピン、3……
配線基板、4……電子部品、5……リード、8…
…リード用パツド、9……スペーサ、10……枠
体、11……第1のシリコン樹脂、12……第2
のシリコン樹脂、13……キヤツプ。

Claims (1)

    【特許請求の範囲】
  1. 1 リードを有する電子部品を実装した配線基板
    と、前記配線基板上に取付固定された枠体と、前
    記電子部品と電子部品のリードと配線基板とで囲
    まれる領域に充填された硬化しない第1の紫外線
    硬化形シリコン樹脂と、前記電子部品の周辺部お
    よび上部に充填された弾力性のあるゲル状に硬化
    する第2の紫外線硬化形シリコン樹脂とを具備す
    ることを特徴としたパツケージ。
JP60273369A 1985-09-05 1985-12-06 パツケ−ジ Granted JPS62133742A (ja)

Priority Applications (4)

Application Number Priority Date Filing Date Title
JP60273369A JPS62133742A (ja) 1985-12-06 1985-12-06 パツケ−ジ
US06/900,532 US4709301A (en) 1985-09-05 1986-08-26 Package
EP86112244A EP0214621B1 (en) 1985-09-05 1986-09-04 A package comprising a substrate and at least one electronic component
DE86112244T DE3688164T2 (de) 1985-09-05 1986-09-04 Packung mit einem Substrat und mindestens einem elektronischen Bauelement.

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP60273369A JPS62133742A (ja) 1985-12-06 1985-12-06 パツケ−ジ

Publications (2)

Publication Number Publication Date
JPS62133742A JPS62133742A (ja) 1987-06-16
JPH0516667B2 true JPH0516667B2 (ja) 1993-03-05

Family

ID=17526940

Family Applications (1)

Application Number Title Priority Date Filing Date
JP60273369A Granted JPS62133742A (ja) 1985-09-05 1985-12-06 パツケ−ジ

Country Status (1)

Country Link
JP (1) JPS62133742A (ja)

Family Cites Families (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS59171343U (ja) * 1983-04-28 1984-11-16 株式会社デンソー 混成集積回路装置
JPS60116151A (ja) * 1983-11-28 1985-06-22 Matsushita Electric Works Ltd 電子部品の封止法
JPS6120771U (ja) * 1984-07-09 1986-02-06 日本フエラス工業株式会社 サツシ枠の建付装置

Also Published As

Publication number Publication date
JPS62133742A (ja) 1987-06-16

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