JPH05308083A - 半導体装置 - Google Patents

半導体装置

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JPH05308083A
JPH05308083A JP4137654A JP13765492A JPH05308083A JP H05308083 A JPH05308083 A JP H05308083A JP 4137654 A JP4137654 A JP 4137654A JP 13765492 A JP13765492 A JP 13765492A JP H05308083 A JPH05308083 A JP H05308083A
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JP
Japan
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chip
resin
semiconductor device
mounting
improve
Prior art date
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Withdrawn
Application number
JP4137654A
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English (en)
Inventor
Hiroshi Hizaki
浩 檜崎
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Nippon Steel Corp
Original Assignee
Nippon Steel Corp
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Filing date
Publication date
Application filed by Nippon Steel Corp filed Critical Nippon Steel Corp
Priority to JP4137654A priority Critical patent/JPH05308083A/ja
Publication of JPH05308083A publication Critical patent/JPH05308083A/ja
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    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W72/00Interconnections or connectors in packages
    • H10W72/30Die-attach connectors
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10DINORGANIC ELECTRIC SEMICONDUCTOR DEVICES
    • H10D62/00Semiconductor bodies, or regions thereof, of devices having potential barriers
    • H10D62/10Shapes, relative sizes or dispositions of the regions of the semiconductor bodies; Shapes of the semiconductor bodies
    • H10D62/117Shapes of semiconductor bodies
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W72/00Interconnections or connectors in packages
    • H10W72/851Dispositions of multiple connectors or interconnections
    • H10W72/874On different surfaces
    • H10W72/884Die-attach connectors and bond wires
    • HELECTRICITY
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  • Die Bonding (AREA)
  • Lead Frames For Integrated Circuits (AREA)

Abstract

(57)【要約】 【目的】 半田実装時のストレスによるチップの剥離を
防止することにより、耐湿性強度の向上を図ることを目
的とする。 【構成】 チップ1の裏面に凹凸部3を設け、リードフ
レームのアイランド5上にAgペースト等のマウント材
4を介してチップ1をマウントし、チップ1とマウント
4との密着性を向上させる構成とする。 【効果】 チップ1とマウント材4との密着性を向上さ
せることで、半田実装時の熱ストレスによるチップ1の
剥離を生じ難くする。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、半導体装置に関し、特
に樹脂封止型半導体装置の構造に関するものである。
【0002】
【従来の技術】従来の半導体装置では、図3に示すよう
に、リードフレームのアイランド5上にAgペースト等
のマウント材4を介してチップ1をマウントし、チップ
1上のパッドとリードフレームのステッチとをAu等の
ボンディングワイヤー2で接続した後、樹脂6で封止す
る方法が主である。
【0003】
【発明が解決しようとする課題】従来は、チップ1の下
方部分がAgペースト等のマウント材4及びリードフレ
ームのアイランド5であり、その周囲を樹脂6で封止し
ているため、半導体装置を基板等に実装する際の熱スト
レスで剥離等を生じて、その後の耐湿性強度が低下する
という問題があった。
【0004】そこで、この発明は、チップと樹脂または
マウント材との密着性を上げて剥離を防止し、耐湿性強
度を向上させることができる半導体装置を提供すること
を目的とする。
【0005】
【課題を解決するための手段】本発明は上記課題を解決
するために、チップを樹脂封止した半導体装置におい
て、前記チップの裏面に凹凸部を設けたものである。
【0006】
【作用】本発明によれば、チップの裏面を例えばエッチ
ングすることで凹凸部を設け、チップと樹脂またはマウ
ント材との密着性を向上させることで、チップの剥離を
生じ難くする。これによって、半田実装時に加わる熱ス
トレスで剥離が生じ難くなり、その後の耐湿性強度も向
上することとなる。
【0007】
【実施例】本発明の第1実施例を図1に示す。なお、前
記従来例と対応する部分には同一の符号を付す。チップ
1をリードフレームのアイランド5にマウントする場
合、Agペースト等のマウント材4を用いるが、チップ
1の裏面の凹凸部3によって、密着性を向上させる。
【0008】また、第2実施例を図2に示す。なお、前
記従来例と対応する部分には同一の符号を付す。チップ
1を樹脂6によって直接封止する構造であるが、この場
合、より効果が高い。
【0009】これらのように、チップ1と樹脂6または
マウント材4との密着性が向上することによって、剥離
が生じ難くなる。
【0010】
【発明の効果】以上説明したように本発明によれば、チ
ップと樹脂またはマウント材との密着性が向上し、半田
実装時の熱ストレスによる応力に耐え、剥離が生じ難い
ので、その後の耐湿性強度が向上する。
【図面の簡単な説明】
【図1】本発明の第1の実施例においてチップをリード
フレームにマウントした状態の要部の断面図である。
【図2】本発明の第2の実施例においてチップを直接樹
脂封止した状態の要部の断面図である。
【図3】従来例における要部の断面図である。
【符号の説明】
1 チップ 2 ボンディングワイヤー 3 チップの裏面の凹凸部 4 Agペースト等のマウント材 5 リードフレームのアイランド 6 封止樹脂

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】 チップを樹脂封止した半導体装置におい
    て、前記チップの裏面に凹凸部を設けたことを特徴とす
    る半導体装置。
JP4137654A 1992-04-30 1992-04-30 半導体装置 Withdrawn JPH05308083A (ja)

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JP4137654A JPH05308083A (ja) 1992-04-30 1992-04-30 半導体装置

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JPH05308083A true JPH05308083A (ja) 1993-11-19

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Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR20030047688A (ko) * 2001-12-03 2003-06-18 미쓰비시덴키 가부시키가이샤 반도체 패키지
KR100691942B1 (ko) * 2001-01-15 2007-03-08 앰코 테크놀로지 코리아 주식회사 반도체 패키지 및 그 제조 방법
US7528489B2 (en) 2005-01-07 2009-05-05 Renesas Technology Corp. Semiconductor apparatus and manufacturing method
CN102543910A (zh) * 2012-02-06 2012-07-04 三星半导体(中国)研究开发有限公司 芯片封装件及其制造方法

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Legal Events

Date Code Title Description
A300 Application deemed to be withdrawn because no request for examination was validly filed

Free format text: JAPANESE INTERMEDIATE CODE: A300

Effective date: 19990706