JPH05343732A - ヘテロ接合型半導体装置 - Google Patents

ヘテロ接合型半導体装置

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JPH05343732A
JPH05343732A JP4176229A JP17622992A JPH05343732A JP H05343732 A JPH05343732 A JP H05343732A JP 4176229 A JP4176229 A JP 4176229A JP 17622992 A JP17622992 A JP 17622992A JP H05343732 A JPH05343732 A JP H05343732A
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JP
Japan
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semiconductor
heterojunction
layer
electrode layer
well layer
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Application number
JP4176229A
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English (en)
Inventor
Naoteru Shigekawa
直輝 重川
Takatomo Enoki
孝知 榎木
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NTT Inc
Original Assignee
Nippon Telegraph and Telephone Corp
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Publication date
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Abstract

(57)【要約】 【目的】 半導体基板上に、導電型を与える不純物を意
図的に導入させていないか導入させているとしても十分
低い濃度でしか導入させていない半導体井戸層と、上記
半導体井戸層に比し高いエネルギ位置に伝導帯下端を有
する半導体バッファ層と、上記半導体井戸層に比し高い
エネルギ位置に伝導帯下端を有する半導体バリア層と
が、上記半導体バッファ層、上記半導体井戸層、上記半
導体バリア層の順に積層されている構成を有するヘテロ
接合型半導体装置において、それが適用されたヘテロ接
合型半導体光検出器でみて、ヘテロ接合型半導体光検出
器としての機能が高速に得られるようにする。 【構成】 上記ヘテロ接合型半導体装置において、上記
半導体バリア層が、上記半導体井戸層に比し高いエネル
ギ位置に価電子帯最上端を有する。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、ヘテロ接合型半導体光
検出器、ヘテロ接合型電界効果トランジスタなどに適用
し得るヘテロ接合型半導体装置に関する。
【0002】
【従来の技術】従来、図3及び図4を伴って次に述べる
ヘテロ接合型半導体装置の適用されたヘテロ接合型半導
体光検出器が提案されている。
【0003】すなわち、半導体基板1上に、導電型を与
える不純物(n型不純物またはp型不純物、以下同様)
を意図的に導入させていないか導入させているとしても
十分低い濃度でしか導入させていない半導体井戸層2
と、その半導体井戸層2に比し高いエネルギ位置に伝導
帯下端を有する半導体バッファ層3と、半導体井戸層2
に比し高いエネルギ位置に伝導帯下端を有する半導体バ
リア層4とが、半導体バッファ層3、半導体井戸層2、
半導体バリア層4の順に積層されている構成を有する。
【0004】この場合、半導体基板1は、例えばInP
でなる。
【0005】また、半導体井戸層2は、例えばIn
0.53 Ga 0.47 Asでなる。
【0006】さらに、半導体バッファ層3は、導電型を
与える不純物を意図的に導入させていないか導入させて
いるとしても十分低い濃度でしか導入させていず、且つ
例えばIn 0.52 Al 0.48 Asでなる。
【0007】また、半導体バリア層4は、半導体バッフ
ァ層3と同様に、導電型を与える不純物を意図的に導入
させていないか導入させているとしても十分低い濃度で
しか導入させていず、且つ図4に示すように、半導体井
戸層2に比し低いエネルギ位置に価電子帯上端を有し、
例えば半導体バッファ層3と同じIn 0.52 Al 0.4 8
Asでなる。
【0008】また、半導体基板1上に形成されている半
導体バリア層4上に、アノ―ド電極層6及びカソ―ド電
極7が、例えば半導体バリア層4との間でショットキ接
合を形成するように、付されている。
【0009】以上が、従来提案されているヘテロ接合型
半導体装置の適用されたヘテロ接合型半導体光検出器の
構成である。
【0010】このような従来のヘテロ接合型半導体装置
の適用されたヘテロ接合型半導体光検出器によれば、ア
ノ―ド電極層6及びカソ―ド電極層7間に、バイアス電
圧を、アノ―ド電極層6側を正極として印加させている
状態で、半導体基板1上に形成されている半導体井戸層
2、半導体バッファ層3及び半導体バリア層4による半
導体積層体5に、半導体バリア層4側の上方から、半導
体井戸層2のバンドギャップに比し高いエネルギを有す
る光が一定時間だけ照射されれば、それに応じて、半導
体井戸層2中に電子・正孔対が生成することから、アノ
―ド電極層6及びカソ―ド電極層7を通る電流が、光の
照射開始時点から流れ始め、そして、その電流が、光の
照射終了時点から、光の照射にもとずき生成した電子・
正孔対中の電子及び正孔がバイアス電圧によって半導体
井戸層2中に形成されているドリフト電界のためにアノ
―ド電極層6及びカソ―ド電極層7に向ってそれぞれ走
行し、次で、それらアノ―ド電極層6及びカソ―ド電極
層7にそれぞれ到達して消滅するまで流れる、という機
構で、アノ―ド電極層6及びカソ―ド電極層7を通る電
流が、照射された光に基ずく光電流として流れる。しか
しながら、半導体積層体5に、光が照射されなければ、
半導体井戸層2中に電子・正孔が生成しないので、アノ
―ド電極層6及びカソ―ド電極層7間にバイアス電圧が
印加されていても、アノ―ド電極層6及びカソ―ド電極
層7を通る電流は流れない。
【0011】以上のことから、図3及び図4に示す従来
のヘテロ接合型半導体装置の適用されたヘテロ接合型半
導体光検出器によれば、アノ―ド電極層6及びカソ―ド
電極層7を通る電流を検出させるようにすることで、ヘ
テロ接合型半導体光検出器としての機能が得られる。
【0012】
【発明が解決しようとする課題】図3及び図4に示す従
来のヘテロ接合型半導体装置の適用されたヘテロ接合型
半導体光検出器の場合、半導体バリア層4が、図4に示
すように且つ上述したように、半導体井戸層2に比し低
いエネルギ位置に価電子帯上端を有している。
【0013】このため、半導体バリア層4が、半導体積
層体5への光の照射によって半導体井戸層2中に生成す
る電子・正孔対中の電子及び正孔のいずれに対しても、
ポテンシャル障壁として作用する。
【0014】従って、半導体積層体5への光の照射終了
時点から、光の照射にもとずき半導体井戸層中に生成し
た電子・正孔対中の電子及び正孔が、バイアス電圧によ
って半導体井戸層2中に形成されるドリフト電界のため
に、アノ―ド電極層6及びカソ―ド電極層7にそれぞれ
向って走行し、次で消滅するとき、それら電子及び正孔
は、ともに半導体井戸層2内に閉じ込められている状態
で、アノ―ド電極層6及びカソ―ド電極層7に向ってそ
れぞれ走行し、次でアノ―ド電極層6及びカソ―ド電極
層7に到達して消滅する。
【0015】ところで、半導体井戸層2内に閉じ込めら
れて走行する正孔は、同じ半導体井戸層2内に閉じ込め
られて走行する電子に比し格段的に大きな質量を有して
いるため、半導体井戸層2内に閉じ込められて走行する
電子に比し、格段的に遅い速度しか有しない。このた
め、半導体積層体5への光の照射終了時点から、正孔が
カソ―ド電極層7に到達して消滅するまでに要する時間
が、半導体積層体5への光の照射終了時点から、電子が
アノ―ド電極層6に到達して消滅するまでに要する時間
に比し、格段的に長い。
【0016】従って、上述したヘテロ接合型半導体光検
出器としての動作速度が、半導体積層体5への光の照射
終了時点から、正孔がカソ―ド電極層7に到達して消滅
するまでに要する時間によって制限され、そして、その
時間は、電子がアノ―ド電極層6に到達して消滅するま
でに要する時間に比し、格段的に長い。
【0017】以上のことから、図3及び図4に示す従来
のヘテロ接合型半導体装置の適用されたヘテロ接合型半
導体光検出器によれば、上述したヘテロ接合型半導体光
検出器としての機能を高速に得ることに一定の限度を有
する、という欠点を有していた。
【0018】よって、本発明は、ヘテロ接合型半導体光
検出器に適用しても、上述した欠点のない、新規なヘテ
ロ接合型半導体装置を提案せんとするものである。
【0019】
【課題を解決するための手段】本発明によるヘテロ接合
型半導体装置は、図3及び図4で前述した従来のヘテロ
接合型半導体装置の場合と同様に、半導体基板上に、導
電型を与える不純物を意図的に導入させていないか導入
させているとしても十分低い濃度でしか導入させていな
い半導体井戸層と、上記半導体井戸層に比し高いエネル
ギ位置に伝導帯下端を有する半導体バッファ層と、上記
半導体井戸層に比し高いエネルギ位置に伝導帯下端を有
する半導体バリア層とが、上記半導体バッファ層、上記
半導体井戸層、上記半導体バリア層の順に積層されてい
る構成を有する。
【0020】しかしながら、本発明によるヘテロ接合型
半導体装置は、このような構成を有するヘテロ接合型半
導体装置において、上記半導体バリア層が、上記半導体
井戸層に比し高いエネルギ位置に価電子帯最上端を有す
る。
【0021】
【作用・効果】本発明によるヘテロ接合型半導体装置に
よれば、それを適用した、半導体バリア層上にアノ―ド
電極層及びカソ―ド電極層を付したヘテロ接合型半導体
光検出器でみて、半導体バリア層が、ヘテロ接合型半導
体光検出器への光の照射によって半導体井戸層中に生成
する電子・正孔対中の電子に対しては、ポテンシャル障
壁として作用するが、正孔に対してはポテンシャル障壁
として作用しないことから、ヘテロ接合型半導体光検出
器への光の照射によって半導体井戸層中に生成する電子
・正孔対中の電子及び正孔が、電子については、半導体
井戸層内に閉じ込められてアノ―ド電極層に向って走行
し、次で、アノ―ド電極層に到達して消滅するが、正孔
については、半導体井戸層内に閉じ込められてカソ―ド
電極層に向って走行せず、に、半導体バリア層内に拡散
して、半導体バリア層の表面での再結合により直ちに消
滅するため、ヘテロ接合型半導体光検出器への光の照射
終了時点から、正孔が消滅するのに要する時間が、電子
が消滅するのに要する時間に比し格段的に短く、よっ
て、ヘテロ接合型半導体光検出器としての機能を高速に
得ることができる。
【0022】
【実施例1】次に、図1及び図2を伴って、本発明によ
るヘテロ接合型半導体装置の適用されたヘテロ接合型半
導体光検出器の実施例を述べよう。
【0023】図1及び図2に示す本発明によるヘテロ接
合型半導体装置の適用されたヘテロ接合型半導体光検出
器は、図3及び図4で前述した従来のヘテロ接合型半導
体装置の適用されたヘテロ接合型半導体光検出器の場合
に準じて、図3及び図4で前述した従来のヘテロ接合型
半導体装置の適用されたヘテロ接合型半導体光検出器に
おける半導体基板1に対応している半導体基板11上
に、図3及び図4で前述した従来のヘテロ接合型半導体
装置の適用されたヘテロ接合型半導体光検出器における
半導体井戸層2に対応している、導電型を与える不純物
(n型不純物及びp型不純物、以下同じ)を意図的に導
入させていないか導入させているとしても十分低い濃度
でしか導入させていない半導体井戸層12と、図3及び
図4で前述した従来のヘテロ接合型半導体装置の適用さ
れたヘテロ接合型半導体光検出器の半導体バッファ層3
に対応している、半導体井戸層12に比し高いエネルギ
位置に伝導帯下端を有する半導体バッファ層13と、図
3及び図4で前述した従来のヘテロ接合型半導体装置の
適用されたヘテロ接合型半導体光検出器の半導体バリア
層4に対応している、半導体井戸層12に比し高いエネ
ルギ位置に伝導帯下端を有する半導体バリア層14と
が、半導体バッファ層13、半導体井戸層12、半導体
バリア層14の順に積層されている構成を有する。
【0024】この場合、半導体基板11は、図3及び図
4で前述した従来のヘテロ接合型半導体装置の適用され
たヘテロ接合型半導体光検出器の半導体基板1と同様
に、例えばInPでなる。
【0025】また、半導体井戸層12は、図3及び図4
で前述した従来のヘテロ接合型半導体装置の適用された
ヘテロ接合型半導体光検出器の半導体井戸層2と同様
に、例えばIn 0.53 Ga 0.47 Asでなる。
【0026】さらに、半導体バッファ層13は、図3及
び図4で前述した従来のヘテロ接合型半導体装置の適用
されたヘテロ接合型半導体光検出器の半導体バッファ層
3と同様に、導電型を与える不純物を意図的に導入させ
ていないか導入させているとしても十分低い濃度でしか
導入させていず、且つ例えばIn 0.52 Al 0.48 As
でなる。
【0027】また、半導体バリア層14は、図3及び図
4で前述した従来のヘテロ接合型半導体装置の適用され
たヘテロ接合型半導体光検出器の半導体バリア層4と同
様に、導電型を与える不純物を意図的に導入させていな
いか導入させているとしても十分低い濃度でしか導入さ
せていない。
【0028】しかしながら、半導体バリア層14は、図
2に示すように、図3及び図4で前述した従来のヘテロ
接合型半導体装置の適用されたヘテロ接合型半導体光検
出器の半導体バリア層4とは異なり、半導体井戸層12
に比し高いエネルギ位置に価電子帯最上端を有し、例え
ばAlAsSbでなる。
【0029】また、図3及び図4で前述した従来のヘテ
ロ接合型半導体装置の適用されたヘテロ接合型半導体光
検出器の場合に準じて、半導体基板11に形成されてい
る半導体バリア層4上に、図3及び図4で前述した従来
のヘテロ接合型半導体装置の適用されたヘテロ接合型半
導体光検出器におけるアノ―ド電極6及びカノ―ド電極
7にそれぞれ対応しているアノ―ド電極16及びカノ―
ド電極17が、例えば半導体バリア層14との間でショ
ットキ接合を形成するように、付されている。
【0030】以上が、本発明によるヘテロ接合型半導体
装置の適用されたヘテロ接合型半導体光検出器の実施例
の構成である。
【0031】このような構成を有する本発明によるヘテ
ロ接合型半導体装置の適用されたヘテロ接合型半導体光
検出器によれば、図3及び図4で前述した従来のヘテロ
接合型半導体装置の適用されたヘテロ接合型半導体光検
出器の場合に準じて、アノ―ド電極層16及びカソ―ド
電極層17間に、バイアス電圧を、アノ―ド電極層16
側を正極として印加させている状態で、半導体基板11
上に形成されている半導体井戸層12、半導体バッファ
層13及び半導体バリア層14による半導体積層体15
に、半導体バリア層14側の上方から、半導体井戸層1
2のバンドギャップに比し高いエネルギを有する光が一
定時間だけ照射されれば、それに応じて、半導体井戸層
12中に電子・正孔対が生成することから、アノ―ド電
極層16及びカソ―ド電極層17を通る電流が、光の照
射開始時点から流れ始め、そして、その電流が、光の照
射終了時点から、光の照射にもとずき生成した、電子・
正孔対中の電子及び正孔が、バイアス電圧によって半導
体井戸層12中に形成されているドリフト電界のために
アノ―ド電極層16及びカソ―ド電極層17に向ってそ
れぞれ走行し、次で電子がアノ―ド電極層16に到達し
て消滅し且つ正孔が後述するように消滅するまで流れ
る、という機構で、アノ―ド電極層16及びカソ―ド電
極層17を通る電流が、照射された光に基ずく光電流と
して流れる。しかしながら、半導体積層体15に、上述
した光が照射されなければ、図3及び図4で前述した従
来のヘテロ接合型半導体装置の適用されたヘテロ接合型
半導体光検出器の場合と同様に、半導体井戸層12中に
電子・正孔が生成しないので、アノ―ド電極層16及び
カソ―ド電極層17間にバイアス電圧が印加されていて
も、アノ―ド電極層16及びカソ―ド電極層17を通る
電流は流れない。
【0032】以上のことから、図1及び図2に示す本発
明によるヘテロ接合型半導体装置の適用されたヘテロ接
合型半導体光検出器の場合も、図3及び図4で前述した
従来のヘテロ接合型半導体装置の適用されたヘテロ接合
型半導体光検出器の場合と同様に、アノ―ド電極層16
及びカソ―ド電極層17を通る電流を検出させるように
することで、ヘテロ接合型半導体光検出器としての機能
が得られる。
【0033】しかしながら、図1及び図2に示す本発明
によるヘテロ接合型半導体装置の適用されたヘテロ接合
型半導体光検出器の場合、半導体バリア層14が、図2
に示すように且つ上述したように、半導体井戸層12に
比し低いエネルギ位置に価電子帯上端を有している。
【0034】このため、半導体バリア層14が、半導体
積層体15への光の照射によって半導体井戸層2中に生
成する電子・正孔対中の電子に対しては、ポテンシャル
障壁として作用するが、正孔に対しては、ポテンシャル
障壁として作用しない。
【0035】従って、半導体積層体15への光の照射終
了時点から、光の照射にもとずき半導体井戸層12中に
生成した電子・正孔対中の電子及び正孔が、バイアス電
圧によって半導体井戸層12中に形成されるドリフト電
界のために、アノ―ド電極層16及びカソ―ド電極層1
7にそれぞれ向って走行し、次で消滅するとき、それら
電子及び正孔は、電子については、半導体井戸層2内に
閉じ込められている状態で、アノ―ド電極層16に向っ
て走行し、次でアノ―ド電極層16に到達して消滅する
が、正孔については、半導体井戸層12内に閉じ込めら
れることなしに半導体バリア層14内に拡散し、次で、
半導体バリア層14の表面上での再結合によって消滅す
る。従って、正孔については、半導体井戸層12内に閉
じ込められている状態で、カソ―ド電極層17に向って
走行し、次で、カソ―ド電極層17に到達して消滅す
る、ということで消滅しない。
【0036】そして、この場合の半導体積層体5への光
の照射終了時点から、正孔が、半導体バリア層14の表
面での再結合によって消滅するまでに要する時間は、半
導体積層体5への光の照射終了時点から、正孔が、半導
体井戸層12内に閉じ込められてカソ―ド電極層17に
向って走行し、次でカソ―ド電極層17に到達して消滅
するまでに要する時間に比し、格段的に短いことはもち
ろん、半導体積層体5への光の照射終了時点から、電子
が、半導体井戸層12内に閉じ込められてアノ―ド電極
層16に向って走行し、次でアノ―ド電極層16に到達
して消滅するまでに要する時間に比し、格段的に長い。
【0037】以上のことから、図1及び図2に示す本発
明によるヘテロ接合型半導体装置の適用されたヘテロ接
合型半導体光検出器によれば、上述したヘテロ接合型半
導体光検出器としての動作速度が、半導体積層体15へ
の光の照射終了時点から、電子がアノ―ド電極層16に
到達して消滅するまでに要する時間によって制限される
としても、その時間が、正孔が半導体井戸層12内に閉
じ込められてカソ―ド電極層17に向って走行し、次で
カソ―ド電極層17に到達して消滅するとした場合、そ
の消滅までに要する時間に比し、格段的に短いので、上
述したヘテロ接合型半導体光検出器としての機能を、図
3及び図4で前述した従来のヘテロ接合型半導体装置の
適用されたヘテロ接合型半導体光検出器に比し格段的に
高速に得ることができる。
【0038】なお、上述した本発明によるヘテロ接合型
半導体装置の適用されたヘテロ接合型半導体光検出器の
実施例においては、半導体井戸層12がIn 0.53 Ga
0.4 7 Asでなるものとして、半導体バリア層14がA
lAsSbでなる場合について述べたが、半導体井戸層
12がIn 0.53 Ga 0.47 Asでなるとき、半導体バ
リア層14をGaAsSb、AlGaAsSbでなるも
のとして、上述したと同様の作用効果を得ることもで
き、また、半導体バッファ層13を半導体バリア層14
と同じ半導体材料でなるものとして、上述したと同様の
作用効果を得ることもでき、さらに、アノ―ド電極層1
6及びカソ―ド電極層17のいずれか一方または双方
を、半導体バリア層14に、オ―ム接触するように、付
して、上述したと同様の作用効果を得ることもでき、そ
の他、本発明の精神を脱することなしに、種々の変型、
変更をなし得るであろう。
【0039】また、上述においては、本発明によるヘテ
ロ接合型半導体装置をヘテロ接合型半導体光検出器に適
用した場合について述べたが、ヘテロ接合型電界効果ト
ランジスタに適用することもでき、そして、この場合
は、図3及び図4に示す本発明によるヘテロ接合型半導
体装置の適用されたヘテロ接合型半導体光検出器におい
て、アノ―ド電極層16及びカソ―ド電極層17をソ―
ス電極層及びドレイン電極層と読み替え、また、半導体
バリア層14に、いま述べたソ―ス電極層及びドレイン
電極層間の領域において、ゲ―ト電極層をショットキ接
合を形成するように付した構成とすればよい。
【0040】また、本発明によるヘテロ接合型半導体装
置は、図1及び図2を伴って前述したように、ヘテロ接
合型半導体光検出器にも適用し得、また、いま述べたよ
うに、ヘテロ接合型電界効果トランジスタにも適用し得
るが、本発明によるヘテロ接合型半導体装置の適用され
たヘテロ接合型半導体光検出器と、本発明によるヘテロ
接合型半導体装置の適用されたヘテロ接合型電界効果ト
ランジスタとは、前述したところから明らかなように、
半導体基板11、及びその半導体基板11上に形成され
た半導体井戸層12、半導体バッファ層13及び半導体
バリア層14について、共通とすることができることか
ら、それらヘテロ接合型半導体光検出器及びヘテロ接合
型電界効果トランジスタを、それらに共通の半導体基板
上にモノリシックに構成することで、それらによる電流
増幅作用を有する光電変換装置を、容易に構成すること
ができる。
【図面の簡単な説明】
【図1】本発明によるヘテロ接合型半導体装置の適用さ
れたヘテロ接合型半導体光検出器の実施例を示す略線的
断面図である。
【図2】図1に示す本発明によるヘテロ接合型半導体装
置の適用されたヘテロ接合型半導体光検出器の実施例
を、エネルギバンド構造で示す図である。
【図3】従来のヘテロ接合型半導体装置の適用されたヘ
テロ接合型半導体光検出器を示す略線的断面図である。
【図4】図3に示す従来のヘテロ接合型半導体装置の適
用されたヘテロ接合型半導体光検出器を、エネルギバン
ド構造で示す図である。
【符号の説明】
1 半導体基板 2 半導体井戸層 3 半導体バッファ層 4 半導体バリア層 5 半導体積層体 6 アノ―ド電極層 7 カソ―ド電極層 11 半導体基板 12 半導体井戸層 13 半導体バッファ層 14 半導体バリア層 15 半導体積層体 16 アノ―ド電極層 17 カソ―ド電極層

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】 半導体基板上に、導電型を与える不純物
    を意図的に導入させていないか導入させているとしても
    十分低い濃度でしか導入させていない半導体井戸層と、
    上記半導体井戸層に比し高いエネルギ位置に伝導帯下端
    を有する半導体バッファ層と、上記半導体井戸層に比し
    高いエネルギ位置に伝導帯下端を有する半導体バリア層
    とが、上記半導体バッファ層、上記半導体井戸層、上記
    半導体バリア層の順に積層されている構成を有するヘテ
    ロ接合型半導体装置において、 上記半導体バリア層が、上記半導体井戸層に比し高いエ
    ネルギ位置に価電子帯最上端を有することを特徴とする
    ヘテロ接合型半導体装置。
JP4176229A 1992-06-10 1992-06-10 ヘテロ接合型半導体装置 Pending JPH05343732A (ja)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US8415713B2 (en) 2008-02-25 2013-04-09 National Institute Of Advanced Industrial Science And Technology Photo-field effect transistor and its production method

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