JPH0535616B2 - - Google Patents

Info

Publication number
JPH0535616B2
JPH0535616B2 JP59105748A JP10574884A JPH0535616B2 JP H0535616 B2 JPH0535616 B2 JP H0535616B2 JP 59105748 A JP59105748 A JP 59105748A JP 10574884 A JP10574884 A JP 10574884A JP H0535616 B2 JPH0535616 B2 JP H0535616B2
Authority
JP
Japan
Prior art keywords
signal
value
clock
sampler
detector
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Lifetime
Application number
JP59105748A
Other languages
English (en)
Other versions
JPS60249450A (ja
Inventor
Junji Namiki
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
Nippon Electric Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Nippon Electric Co Ltd filed Critical Nippon Electric Co Ltd
Priority to JP59105748A priority Critical patent/JPS60249450A/ja
Publication of JPS60249450A publication Critical patent/JPS60249450A/ja
Publication of JPH0535616B2 publication Critical patent/JPH0535616B2/ja
Granted legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L7/00Arrangements for synchronising receiver with transmitter
    • H04L7/02Speed or phase control by the received code signals, the signals containing no special synchronisation information
    • H04L7/033Speed or phase control by the received code signals, the signals containing no special synchronisation information using the transitions of the received signal to control the phase of the synchronising-signal-generating means, e.g. using a phase-locked loop
    • H04L7/0334Processing of samples having at least three levels, e.g. soft decisions

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Synchronisation In Digital Transmission Systems (AREA)

Description

【発明の詳細な説明】 (産業上の利用分野) この発明はデイジタル信号伝送におけるクロツ
ク信号位相同期技術に関する。
(発明の背景) 高能率デイジタル信号伝送においては、小ロー
ルオフ波形整形されたパルスを用いて符号伝送を
行うため、受信側のサンプル・タイミングのずれ
は特性を急激に劣化させることになる。従来、サ
ンプル・タイミング、すなわちクロツク信号抽出
は、入力信号を整流し、クロツク成分を発生させ
ておいて、狭帯域の帯域通過波器を通してクロ
ツクを抽出していた。すなわち従来クロツクの抽
出はアナログ回路により行われており、回路素子
の調整が必要なことから、検査、保守などに手間
を要することが多かつた。
また近年受信器のデイジタル化が進み、クロツ
ク信号抽出のデイジタル処理の必要性が高まつて
きた。デイジタル化受信器の場合、クロツク信号
を抽出すると言う方式より、むしろサンプル・タ
イミングを直接制御する方式が向いている。
(発明の目的) 本発明の目的は、デイジタル処理に向いた、簡
易なサンプルタイミング制御を実現するクロツク
位相誤差検出器を提供することにある。
(発明の構成) 本発明によれば、クロツク信号の位相誤差を検
出するクロツク位相誤差検出器であつて、 (a) クロツク信号の零位相で入力信号をサンプル
する第1のサンプラ、 (b) 前記クロツク信号のπ位相で入力信号をサン
プルする第2のサンプラ、 (c) 前記第1のサンプラの出力を符号識別する識
別器、 (d) 該識別器出力の2周期前の値と現時刻での値
が一致し、かつ1周期前の値と現時刻での値が
異なる場合に検出信号を出力する検出器、 (e) 前記第2のサンプラ出力の1周期前の値と現
時刻での値との振幅差を検出する振幅差検出
器、 (f) 該振幅差検出器出力に前記第1のサンプラ出
力の1周期前の出力値の極性を掛けた値を求
め、前記検出器が検出信号を出力したときにの
み前記掛けた値をクロツク位相誤差として出力
する手段、 とから少なくとも構成されるクロツク位相誤差検
出器が得られる。
(発明の原理) 次に本発明に付いて図面を参照して詳細に説明
する。
第1図aは+1、−1の2値デイジタル信号、
あるいは4相位相変調波の復調信号の実部、また
は虚部のアイ・パターンを示した図である。同図
bは、そのサンプル・タイミングを示しており、
矢印で示したクロツク周期(T秒)ごとのそれ
は、アイ・パターンの最も広く目の開く時間に一
致している。以下ではこのタイミングを信号検出
タイミングと呼ぶこととする。同図cは、先のb
とπ相(180°)だけずれたタイミング位相を示し
ている。以下では、このタイミングをクロツク位
相検出タイミングと呼ぶ。このタイミングで第1
図aの波形をサンプルすると、その前後で送信符
号が変化しなかつた場合の±1の値と、逆に変化
した場合の零近傍の値との3種類の値をとる。第
1図aの波形は、伝送パルスのロール・オフ率や
ビツト・パターンにも依存するが、おおよそ第2
図aの様に簡略化して扱つても、平均的には問題
はない。まず第2図aの太線の様な信号変化につ
いて考察してみる。この変化は送信符号が±1、
−1、+1、−1と交互に繰返されて送信された場
合である。同図b,cは各々信号検出タイミング
とクロツク位相検出タイミングを示している。こ
こでTe秒だけ前者を遅らせるとアイ・パターン
の目の広さはW0からW1へと狭くなつてしまうこ
とになる。つぎに相前後する2つのクロツク位相
検出タイミングによりサンプルされる信号の大き
さを考えてみよう。第2図cのTe=0のとき、
2つのサンプル値は1000と1001であり、同一の値
をとつている。一方Te≠0でTe<0(すなわちサ
ンプル遅れ)の場合は2つのサンプル値は1002と
1003となり、両者の差は非零となる。またTe
0の時には1004と1005となり、両者の差は同じく
非零となり、その極性はTe<0の場合と逆にな
る。このことを利用すれば、まず信号検出タイミ
ングで第2図aの太線2000の様な信号遷移(−
1、+1、−1)を抽出し、その時の前後するクロ
ツク位相検出タイミングでのサンプル値の差を求
めることによつて、Teの極性と大きさが推定で
きることがわかる。ここでもし、信号遷移が太線
2000の代りに細線2001である場合、(信号遷移は
+1、−1、+1)Teに対するクロツク位相検出
タイミングでの前後するサンプル値の差の極性は
先の例とは逆になる。実用上は信号遷移(−1、
+1、−1)と(+1、−1、+1)の両方を利用
する方が、クロツク位相差検出器としてはより多
くの位相差情報を提供できるので、両方とも利用
することが得策ではあるが、片方のみを利用して
も本発明の目的を達成することはできる。以下で
は両方とも使用する場合についてのみ述べること
とする。位相差情報、すなわち(1000、1001)の
サンプル値の差や(1004、1005)のサンプル値の
差にそれらのサンプルの間の信号検出タイミング
でのサンプル値(この場合は+1か−1)を掛け
る必要がある。第2図で太線2000の信号遷移(−
1、+1、−1)の場合にはクロツク位相検出タイ
ミングでの2サンプル値(1000、1001)または
(1004、1005)の差に信号検出タイミングでのサ
ンプル値1006の極性(+1)を、逆に細線の信号
遷移(+1、−1、+1)の場合には信号検出タイ
ミングでのサンプル値1007の極性(−1)を掛け
る必要がある。以上がクロツク位相検出の原理で
ある。
今までの説明では、入力信号の信号遷移が+
1、−1、+1、−1と周期的に繰りかえす場合で
あつたが、一般データが入力であつても、もちろ
ん問題はない。すなわちそられランダムな信号遷
移の中で(+1、−1、+1)及び(−1、+1、−
1)の遷移のみを選択的に抽出してクロツク位相
検出が行なわれるのである。
(実施例) 第3図は本発明の一実施例のブロツク図であ
る。図中の1が第1のサンプラー、2が第2のサ
ンプラー、3が第1のサンプラー出力を符号識別
する識別器、4が検出器で信号送出周期Tの遅延
回路40,41と加算器42及び絶対値回路44
で識別器3の出力(±1)の2周期前の値と現在
の値が等しい場合には2が出力され、異なれば零
が出力される。一方減算器43からは1周期前の
値と現在の値が異る場合に2が出力され、同一の
場合には零が出力される。これによりアンド・ゲ
ート46の出力が高位レベルHになるためには、
識別器出力の2周期前の値と現在の値が等しく、
かつ1周期前の値と現在の値が異る場合に限られ
ることがわかる。5は、振幅検出器で先の40,
41と同じ遅延回路50の入出力差を減算器51
によつて検出するものである。6は、振幅等検出
器の出力に第1のサンプラの一周期前の出力の極
性をブロツク4の遅延回路40の出力から得て掛
算を行うものである。
7は検出器4の出力が「H」になつた時にの
み、掛算器6の出力を端子101へ導くための掛
算器である。なお第1、第2のサンプラのサンプ
ル・タイミングはクロツク発振器8とT/2遅延回
路9とによつて第1のサンプラーには信号検出タ
イミング、第2のサンプラーにはクロツク位相検
出タイミングが各々供給される。
端子101はクロツク位相差信号が出力される
ので、これを適当な低減フイルターにより、その
出力を平滑し、クロツク発振器8に供給すること
によつてクロツク位相(クロツク周波数)が制御
されることとなる。
(発明の効果) 本発明によつて小数のデイジタル素子のみによ
つて、クロツク位相制御が平易に行える。
【図面の簡単な説明】
第1図は2値のデータ伝送波形を説明する為の
図、第2図はクロツク位相差情報を抽出する原理
を説明するための図、第3図は本発明の一実施例
を示すブロツク図である。 図中、1……第1のサンプラ、2……第2のサ
ンプラ、3……識別器、4……検出器、5……振
幅差検出器、6……掛算器を各々示す。

Claims (1)

  1. 【特許請求の範囲】 1 受信デイジタル信号(入力信号)のクロツク
    信号の位相誤差を検出するクロツク位相誤差検出
    器であつて、 (a) クロツク信号の零位相で入力信号をサンプル
    する第1のサンプラ、 (b) 前記クロツク信号のπ位相で入力信号をサン
    プルする第2のサンプラ、 (c) 前記第1のサンプラの出力を符号識別する識
    別器、 (d) 該識別器出力の2周期前の値と現時刻での値
    が一致し、かつ1周期前の値と現時刻での値が
    異なる場合に検出信号を出力する検出器、 (e) 前記第2のサンプラ出力の1周期前の値と現
    時刻での値との振幅差を検出する振幅差検出
    器、 (f) 該振幅差検出器出力に前記第1のサンプラ出
    力の1周期前の出力値の極性を掛けた値を求
    め、前記検出器が検出信号を出力したときにの
    み前記掛けた値をクロツク位相誤差として出力
    する手段、 とから少なくとも構成されることを特徴とするク
    ロツク位相誤差検出器。
JP59105748A 1984-05-25 1984-05-25 クロツク位相誤差検出器 Granted JPS60249450A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP59105748A JPS60249450A (ja) 1984-05-25 1984-05-25 クロツク位相誤差検出器

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP59105748A JPS60249450A (ja) 1984-05-25 1984-05-25 クロツク位相誤差検出器

Publications (2)

Publication Number Publication Date
JPS60249450A JPS60249450A (ja) 1985-12-10
JPH0535616B2 true JPH0535616B2 (ja) 1993-05-27

Family

ID=14415870

Family Applications (1)

Application Number Title Priority Date Filing Date
JP59105748A Granted JPS60249450A (ja) 1984-05-25 1984-05-25 クロツク位相誤差検出器

Country Status (1)

Country Link
JP (1) JPS60249450A (ja)

Also Published As

Publication number Publication date
JPS60249450A (ja) 1985-12-10

Similar Documents

Publication Publication Date Title
US4918709A (en) Data demodulator baud clock phase locking
US4518922A (en) Decision-directed, automatic frequency control technique for non-coherently demodulated M-ARY frequency shift keying
KR970060707A (ko) 데이터 동기화기 록 검출기 및 록 검출 신호 발생 방법
CA2180905A1 (en) Digital Demodulator
US4458206A (en) Circuit for synchronizing the demodulation of phase modulated transmission bursts
JP2001094531A (ja) Ofdm信号におけるシンボル境界を表す同期パルスを生成する方法およびofdm信号の受信方法
JPS61240706A (ja) 位相検出回路
JPH0535616B2 (ja)
JPH0657019B2 (ja) タイミング引込み方法
KR100725486B1 (ko) 통신기기용 타이밍 동기 검출 장치와 방법 및 이를 적용한 통신기기
JPH09214574A (ja) データ同期装置の位相検出器およびその動作方法
JPH0535617B2 (ja)
US7298202B2 (en) FSK demodulator
JPH06152667A (ja) クロック再生回路
KR100289404B1 (ko) 국소대칭강제파형부를 이용한 패턴지터를 줄이는 장치 및 방법
JP2721455B2 (ja) データ伝送装置のタイミング生成方法
JPH0151218B2 (ja)
GB2213663A (en) Data demodulator carrier phase locking
KR100191307B1 (ko) 디지털심볼타이밍복구장치
JPS591025B2 (ja) コ−ド語検出方法
JPH0131819B2 (ja)
JP3353331B2 (ja) クロック抽出方法及びクロック抽出回路
JPH04365245A (ja) 蓄積一括復調装置
JPH0418496B2 (ja)
JP2523750B2 (ja) キャリア再生回路