JPH054311Y2 - - Google Patents

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JPH054311Y2
JPH054311Y2 JP1985026564U JP2656485U JPH054311Y2 JP H054311 Y2 JPH054311 Y2 JP H054311Y2 JP 1985026564 U JP1985026564 U JP 1985026564U JP 2656485 U JP2656485 U JP 2656485U JP H054311 Y2 JPH054311 Y2 JP H054311Y2
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JP
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board
ground pattern
substrate
electronic
casing
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JP1985026564U
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JPS61142497U (ja
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Description

【考案の詳細な説明】 〔考案の技術分野〕 本考案は電子機器のシールド構造に関するもの
である。
〔考案の技術的背景とその問題点〕
通常、高周波回路を備えた電子機器、例えば無
線機等においては、上記高周波回路から漏洩する
電磁波が、他の電子部品に悪影響を及ぼすことの
ないよう、上記高周波回路を金属製のシールドケ
ースで覆つている。その一例を示したものが第3
図である。
基板Aの表面左方に配設された多数のデイスク
リート部品Bと、基板Aの表面および裏面左方に
形成された図示していない配線パターンとによつ
て高周波回路部Cが構成されており、上記デイス
クリート部品Bは基板に取り付けられた上部シー
ルドケースDによつて覆われている。
一方、基板Aの裏面側においても、上記配線パ
ターンおよびデイスクリート部品をハンダ付けし
た部分から電磁波が漏洩することを防ぐため、上
記配線パターン等を覆うように下部シールドケー
スEが取り付けられている。
また基板Aには図示していないアースパターン
が形成されており、上記基板Aをダイカストシヤ
ーシFに取り付けることにより、上記高周波回路
部Cおよびその他の諸回路が上記アースパターン
を介してアースされる。
ところで、ダイカストシヤーシFに基板Aを収
容する際、記述の如く該基板Aの表面側と裏面側
とには、それぞれシールドケースD,Eが取り付
けられているため、ダカストシヤーシF内に深い
収容スペースを必要とし、かくして電子機器の外
形が大形化する不都合があつた。また、各シール
ドケースD,Eは、それぞれ別体から構成されて
いるため、部品点数が増加し、コストの上昇や組
み立て工程の煩雑化等を招来していた。
〔考案の目的〕
本考案は、上記実状に鑑みて、簡易な組立て作
業によつて電子部品のシールドを可能とし、併せ
て電子機器の小型化および部品点数の削減をも達
成し得る電子機器のシールド構造を提供すること
を目的とする。
〔考案の概要〕
そこで本考案では、一方面の所定領域に電子部
品を実装し、かつ前記一方面以外の面における少
なくとも前記所定領域に対応する箇所にシート状
のアースパターンが形成され、さらに前記所定領
域と該所定領域以外の領域との境界部に前記アー
スパターンに接続され上記一方面に達する複数の
スルーホールを形成して成る基板を備えるととも
に、電子機器筐体を構成するとともに導電性を備
え、かつ底板を有するとともに該底板に凹部を画
成するための突条を有し、さらに前記凹部に前記
電子部品を収容しつつ前記突条の端面に前記スル
ーホールを当接させた状態で前記基板が収容設置
されるケーシングを具備することによつて上記目
的を達成している。
〔考案の実施例〕
以下、本考案の達成を、一実施例を示す図面に
基づいて詳細に説明する。
第1図は、本考案に係るシールド構造を、無線
機の高周波回路部をシールドするための構造に適
用した例を示している。
基板1における一方面(裏面)1aの左方部に
設定された所定領域には、配線パターン(図示せ
ず)が形成されており、この配線パターンには、
一部の電子部品がマイクロストリツプライン化さ
れて実装されている。
さらに上記配線パターン上の所定位置には、そ
れぞれチツプ化された電子部品(チツプ部品)2
a,2b,2cが、ハンダ付けにより実装され、
これにより高周波回路部3が構成されている。
一方、基板1の他方面(表面)1b、すなわち
上記一方面以外の面における左方部、言い換えれ
ば上記高周波回路部3の構成されている基板1の
上記所定領域と対応する箇所には、シート状のア
ースパターン4が形成されており、該アースパタ
ーン4は、図示する如く基板表面の左半分全域に
亘つて形成されている。
また、上記アースパターン4の右方縁部、言い
換えれば、基板1における上記所定領域と該所定
領域以外の領域(基板1においてアースパターン
4の形成されていない領域)との境界部には、上
記アースパターン4と接続され基板1の一方面に
達する複数のスルーホール5,5……が、該境界
部(アースパターン4の右方縁部)に沿つて形成
されている。なお、第1図中の符号6は、上記高
周波回路3以外の回路を構成する電子部品であ
る。
一方、上記基板1を収容するケーシング、言い
換えれば電子機器筐体を構成するケーシングとし
てのダイカストシヤーシ10は、底板11、左右
の側板12,13、および端板14を有してお
り、さらにこのダイカストシヤーシ10は、本例
では導電性を備えたアルミ材にて一体的に形成さ
れている。
また上記底板11の四隅には、基板1を固設す
るための台座15が突設されているとともに、上
記底板11の略中央部には、突条16が形成され
ている。
この突条16は、図に示す如く底板11の巾方
向に沿つて上述したアースパターン4の右方縁
部、言い換えれば複数のスルーホール5,5……
の形成位置と対応して延設されており、その両端
は側板12および13と融合している。
上記構成のダイカストシヤーシ10に、基板1
を取り付けると、第2図に示すように、基板1上
に構成された高周波回路部3が、ダイカストシヤ
ーシ10の底板の表面11a、側板の表面12
a,13a、端板の表面14a、および突条16
の側面16aにより画成された凹部17に収容さ
れる。
また、このとき基板1の一方面1aが、突条1
6の端面16bと突き当たることによつて、アー
スパターン4とダイカストシヤーシ10とが、複
数のスルーホール5,5……を介して互いに導通
される。
したがつて、上記ダイカストシヤーシ10に基
板1を取付けることで、上記基板1に実装された
電子部品が、互いに電気的に導通されたダイカス
トシヤーシ10の凹部17とアースパターン4と
により囲繞されてシールドされることとなる。
なお、上記スルーホール5を介してダイカスト
シヤーシ10とアースパターン4とが接続される
ことにより、有効にアースを取ることができる。
また、上記アースパターン4の縁部に沿つて形
成された複数のスルーホール5,5……が、ダイ
カストシヤーシ10の突条16と当接すること
で、上記基板1における所定領域と所定領域以外
の領域とが電気的に遮断されることとなる。
これにより、上記基板1における所定領域に実
装された高周波回路部3を構成する電子部品と、
所定領域以外の領域に実装された電子部品との間
における電磁波の侵入および漏洩が未然に防止さ
れ、もつて上記高周波回路部3を構成する電子部
品が確実にシールドされることとなる。
なお、本実施例では、電子部品を基板の一方面
に配設したが、例えばボリユーム等のように外部
から操作する部品や、あるいはフイルタ等のよう
にチツプ化が不可能な電子部品は、基板の他方面
に配設される場合もある。
〔考案の効果〕
以上詳述した如く、本考案に係る電子機器のシ
ールド構造によれば、ケーシングに形成した凹部
と基板に形成したアースパターンとによつて電子
部品を囲繞するよう構成し、上記電子部品をシー
ルドするため部材として上記ケーシングを利用し
ているので別体から成るシールドケースを用いる
ことなくシールドが可能となり、もつて部品点数
の低減が達成される。
また、基板に形成した複数のスルーホールを、
ケーシングに形成した突条に当接させることによ
つて、アースパターンとケーシングとを互いに導
通させるよう構成したので、ケーシングに基板を
取り付けるだけでアースパターンとケーシングと
が導通し、もつて簡易な組立て作業により電子部
品をシールドすることが可能となつた。
さらに、基板に形成した複数のスルーホールに
よつて、基板における所定領域と所定領域以外の
領域とを電気的に遮断するよう構成したので、電
磁波の影響を嫌う電子部品と他の電子部品とを1
枚の基板上に実装することが可能となり、もつて
電子機器の小型化を達成することができる。
【図面の簡単な説明】
第1図は本考案に関わる電子機器のシールド構
造を無線機におけるシールド構造に適用した例を
示す分解斜視図、第2図は上記シールド構造の要
部拡大断面図、第3図は従来のシールド構造を採
用した電子機器の分解斜視図である。 1……基板、1a……一方面、1b……他方面
(一方面以外の面)、2a,2b,2c……チツプ
部品(電子部品)、3……高周波回路部、4……
アースパターン、5……スルーホール、10……
ダイカストシヤーシ(ケーシング)、11……底
板、16……突条、16b…端面、17……凹
部。

Claims (1)

  1. 【実用新案登録請求の範囲】 基板の一方面の所定領域に実装される電子部品
    と、 前記基板の一方面以外の面において、少なくと
    も前記所定領域に対応する箇所に形成されるシー
    ト状のアースパターンと、 前記基板における前記所定領域と該所定領域以
    外の領域との境界部に沿つて形成され、前記アー
    スパターンに接続されかつ上記基板の一方面に達
    する複数のスルーホールと、 電子機器筐体を構成するととともに導電性を備
    え、かつ底板を有するとともに該底板に凹部を画
    成するための突条を有し、前記凹部に前記電子部
    品を収容しつつ前記突条の端面に前記スルーホー
    ルを当接させた状態で前記基板が収容設置される
    ケーシングと、 を備えて成ることを特徴とする電子機器のシー
    ルド構造。
JP1985026564U 1985-02-26 1985-02-26 Expired - Lifetime JPH054311Y2 (ja)

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JP1985026564U JPH054311Y2 (ja) 1985-02-26 1985-02-26

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JP1985026564U JPH054311Y2 (ja) 1985-02-26 1985-02-26

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Publication Number Publication Date
JPS61142497U JPS61142497U (ja) 1986-09-03
JPH054311Y2 true JPH054311Y2 (ja) 1993-02-02

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Publication number Priority date Publication date Assignee Title
JPH0642397Y2 (ja) * 1988-10-27 1994-11-02 池田電機株式会社 放電灯用インバータ装置のシールド構造

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JPS6022909Y2 (ja) * 1980-07-31 1985-07-08 慶子 古沢 茹卵の微塵切器
JPH02955Y2 (ja) * 1980-08-20 1990-01-10
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JPS61142497U (ja) 1986-09-03

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