JPH0554286B2 - - Google Patents
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- JPH0554286B2 JPH0554286B2 JP58200476A JP20047683A JPH0554286B2 JP H0554286 B2 JPH0554286 B2 JP H0554286B2 JP 58200476 A JP58200476 A JP 58200476A JP 20047683 A JP20047683 A JP 20047683A JP H0554286 B2 JPH0554286 B2 JP H0554286B2
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- JP
- Japan
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- circuit
- output
- transistor
- comparator
- switching
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-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
- H03K17/16—Modifications for eliminating interference voltages or currents
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
- H03K17/22—Modifications for ensuring a predetermined initial state when the supply voltage has been applied
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- Manipulation Of Pulses (AREA)
Description
【発明の詳細な説明】
この発明は信号検出回路に係り、特に、信号入
力部に比較器を設置して基準レベルと入力信号と
を比較して信号検出をする信号検出回路の電源投
入時の誤検出防止に関する。
力部に比較器を設置して基準レベルと入力信号と
を比較して信号検出をする信号検出回路の電源投
入時の誤検出防止に関する。
第１図はこの種の信号検出回路を示している。
比較器２の非反転入力端子（＋）に形成された入
力端子４Ａには、検出すべき信号が与えられ、他
方その反転入力端子（−）に形成された入力端子
４Ｂには電圧源６で比較基準レベルVREFが設定さ
れている。この比較器２の出力は鋸波を発生する
波形発生回路８に与えられ、波形発生回路８はト
ランジスタ１０、抵抗１２及びコンデンサ１４か
ら構成され、その出力はスイツチング回路１６に
与えられる。このスイツチング回路１６は、駆動
電圧Vccが印加される電源端子１７と基準電位点
端子１８との間に、抵抗２０を介してトランジス
タ２２を設置したものであり、トランジスタ２２
のベースには前記波形発生回路８の出力が与えら
れ、その出力はコレクタに形成された出力端子２
４から取出される。
比較器２の非反転入力端子（＋）に形成された入
力端子４Ａには、検出すべき信号が与えられ、他
方その反転入力端子（−）に形成された入力端子
４Ｂには電圧源６で比較基準レベルVREFが設定さ
れている。この比較器２の出力は鋸波を発生する
波形発生回路８に与えられ、波形発生回路８はト
ランジスタ１０、抵抗１２及びコンデンサ１４か
ら構成され、その出力はスイツチング回路１６に
与えられる。このスイツチング回路１６は、駆動
電圧Vccが印加される電源端子１７と基準電位点
端子１８との間に、抵抗２０を介してトランジス
タ２２を設置したものであり、トランジスタ２２
のベースには前記波形発生回路８の出力が与えら
れ、その出力はコレクタに形成された出力端子２
４から取出される。
このような信号検出回路によれば、信号振幅レ
ベルが基準レベルVREFを越えた範囲で与えられる
パルス幅を持つパルスが比較器２から出力され、
そのパルス幅の期間において、トランジスタ１０
が導通し、それ以外の期間においては不導通とな
り、このスイツチング動作に応動してコンデンサ
１４の充放電動作が繰り返され、トランジスタ２
２のベースには鋸波電圧が形成される。この鋸波
電圧はトランジスタ２２のスレシユホールドレベ
ルを越えている範囲において、出力電圧がコレク
タに発生し、その電圧出力を出力端子２４から取
出すことができる。
ベルが基準レベルVREFを越えた範囲で与えられる
パルス幅を持つパルスが比較器２から出力され、
そのパルス幅の期間において、トランジスタ１０
が導通し、それ以外の期間においては不導通とな
り、このスイツチング動作に応動してコンデンサ
１４の充放電動作が繰り返され、トランジスタ２
２のベースには鋸波電圧が形成される。この鋸波
電圧はトランジスタ２２のスレシユホールドレベ
ルを越えている範囲において、出力電圧がコレク
タに発生し、その電圧出力を出力端子２４から取
出すことができる。
第２図は、電源スイツチの投入から定常状態の
動作までの動作波形を示し、第２図Ａは電源電圧
Vccの立上がり波形、第２図Ｂは比較器２の入力
端子４Ａに対する入力信号波形を示し、Ｂにおい
て、Ｓは電源投入時に発生する検出すべき信号以
外の過渡音信号（ポツプ音信号）を示している。
このような信号Ｓが到来し、その信号レベルが基
準レベルを越えている場合、第２図Ｃに示すよう
に、比較器２は出力を発生する。この出力は波形
発生回路８で検出され、第２図Ｄに示すように、
対応する鋸波電圧を発生し、出力端子２４には第
２図Ｅに示す電圧が発生する。この場合、Ｅに示
す出力の内、区間Ｔの電圧出力は過渡音信号によ
る誤動作部分を示している。
動作までの動作波形を示し、第２図Ａは電源電圧
Vccの立上がり波形、第２図Ｂは比較器２の入力
端子４Ａに対する入力信号波形を示し、Ｂにおい
て、Ｓは電源投入時に発生する検出すべき信号以
外の過渡音信号（ポツプ音信号）を示している。
このような信号Ｓが到来し、その信号レベルが基
準レベルを越えている場合、第２図Ｃに示すよう
に、比較器２は出力を発生する。この出力は波形
発生回路８で検出され、第２図Ｄに示すように、
対応する鋸波電圧を発生し、出力端子２４には第
２図Ｅに示す電圧が発生する。この場合、Ｅに示
す出力の内、区間Ｔの電圧出力は過渡音信号によ
る誤動作部分を示している。
このような誤動作を生じた場合、出力側の制御
系統或いは信号系統の誤動作を生ぜしめることに
なる。
系統或いは信号系統の誤動作を生ぜしめることに
なる。
そこで、この発明は、電源投入時の過渡状態に
よる過渡信号によつて生じる信号検出の誤動作を
防止した信号検出回路を提供することを目的とす
る。
よる過渡信号によつて生じる信号検出の誤動作を
防止した信号検出回路を提供することを目的とす
る。
即ち、この発明の信号検出回路は、入力信号と
基準レベルとを比較して両者の大小関係に応じて
出力を発生する比較器２と、電源と基準電位点と
の間に第１の抵抗１２及びコンデンサ１４の直列
回路を接続するとともに、前記比較器の前記出力
が第２の抵抗２６を介してベースに加えられてス
イツチングする第１のトランジスタ１０のコレク
タとエミツタとの間に接続コンデンサを並列に接
続し、前記比較器の出力に応じて前記第１のトラ
ンジスタをスイツチングさせて前記コンデンサを
充電又は放電状態に制御することにより波形を発
生する波形発生回路８と、この波形発生回路の前
記コンデンサの充電電圧をベースに受けてスイツ
チングする第２のトランジスタ２２を備え、この
第２のトランジスタのスイツチングに応じた出力
を発生する第１のスイツチング回路１６とを備え
た信号検出回路であつて、前記比較器が発生した
前記出力を分周する分周回路２８と、この分周回
路の出力をセツト入力に、電源投入時のリセツト
パルスをリセツト入力に受けてスイツチングし、
出力を発生するフリツプフロツプ回路３６と、こ
のフリツプフロツプ回路の出力をベースに受けて
導通する第３のトランジスタ４０のコレクタを前
記第１のトランジスタのベースに接続し、かつ前
記第３のトランジスタのエミツタを前記第１のト
ランジスタのエミツタに共通に接続し、前記フリ
ツプフロツプ回路の出力に応じて前記第２のトラ
ンジスタを導通させることにより前記第１のトラ
ンジスタのベースを強制的に不導通レベルに移行
させて前記波形発生回路の出力を解除する第２の
スイツチング回路３８とを備えたことを特徴とす
る。
基準レベルとを比較して両者の大小関係に応じて
出力を発生する比較器２と、電源と基準電位点と
の間に第１の抵抗１２及びコンデンサ１４の直列
回路を接続するとともに、前記比較器の前記出力
が第２の抵抗２６を介してベースに加えられてス
イツチングする第１のトランジスタ１０のコレク
タとエミツタとの間に接続コンデンサを並列に接
続し、前記比較器の出力に応じて前記第１のトラ
ンジスタをスイツチングさせて前記コンデンサを
充電又は放電状態に制御することにより波形を発
生する波形発生回路８と、この波形発生回路の前
記コンデンサの充電電圧をベースに受けてスイツ
チングする第２のトランジスタ２２を備え、この
第２のトランジスタのスイツチングに応じた出力
を発生する第１のスイツチング回路１６とを備え
た信号検出回路であつて、前記比較器が発生した
前記出力を分周する分周回路２８と、この分周回
路の出力をセツト入力に、電源投入時のリセツト
パルスをリセツト入力に受けてスイツチングし、
出力を発生するフリツプフロツプ回路３６と、こ
のフリツプフロツプ回路の出力をベースに受けて
導通する第３のトランジスタ４０のコレクタを前
記第１のトランジスタのベースに接続し、かつ前
記第３のトランジスタのエミツタを前記第１のト
ランジスタのエミツタに共通に接続し、前記フリ
ツプフロツプ回路の出力に応じて前記第２のトラ
ンジスタを導通させることにより前記第１のトラ
ンジスタのベースを強制的に不導通レベルに移行
させて前記波形発生回路の出力を解除する第２の
スイツチング回路３８とを備えたことを特徴とす
る。
以下、この発明を図面に示した実施例を参照し
て詳細に説明する。
て詳細に説明する。
第３図はこの発明の信号検出回路の実施例を示
し、第１図に示す信号検出回路と同一部分には同
一符号を付してある。図において、波形発生回路
８には、電源に第１の抵抗１２を介して接続され
たコンデンサ１４が設置され、このコンデンサ１
４の端子間には第１のトランジスタ１０が並列に
接続されている。比較器２の出力は第２の抵抗２
６を介してトランジスタ１０のベースに加えられ
ている。トランジスタ１０のコレクタとエミツタ
間に接続されたコンデンサ１４は、トランジスタ
１０が非導通のとき、第１の抵抗１２を通じて充
電されるとともに、トランジスタ１０が比較器２
の出力によつて導通したとき、トランジスタ１０
を通じて放電される。このトランジスタ１０のス
イツチングによるコンデンサ１４の充放電によ
り、コンデンサ１４に鋸波電圧が形成される。こ
のコンデンサ１４に発生した鋸波電圧が、第１の
スイツチング回路１６のトランジスタ２２のベー
スに与えられる。
し、第１図に示す信号検出回路と同一部分には同
一符号を付してある。図において、波形発生回路
８には、電源に第１の抵抗１２を介して接続され
たコンデンサ１４が設置され、このコンデンサ１
４の端子間には第１のトランジスタ１０が並列に
接続されている。比較器２の出力は第２の抵抗２
６を介してトランジスタ１０のベースに加えられ
ている。トランジスタ１０のコレクタとエミツタ
間に接続されたコンデンサ１４は、トランジスタ
１０が非導通のとき、第１の抵抗１２を通じて充
電されるとともに、トランジスタ１０が比較器２
の出力によつて導通したとき、トランジスタ１０
を通じて放電される。このトランジスタ１０のス
イツチングによるコンデンサ１４の充放電によ
り、コンデンサ１４に鋸波電圧が形成される。こ
のコンデンサ１４に発生した鋸波電圧が、第１の
スイツチング回路１６のトランジスタ２２のベー
スに与えられる。
また、比較器２の出力は、計数回路としての分
周回路２８に与えられている。分周回路２８はＴ
フリツプフロツプ回路３０，３２で構成され、各
Ｔフリツプフロツプ回路３０，３２はそれぞれ入
力パルスを２分周する分周回路を構成している。
Ｔフリツプフロツプ回路３０のトリガ入力Ｔには
比較器２の出力が与えられ、Ｔフリツプフロツプ
回路３０の反転出力がＴフリツプフロツプ回路
３２のトリガ入力Ｔと成つており、この結果、分
周回路２８は1/4分周出力を発生するように成つ
ている。各Ｔフリツプフロツプ回路３０，３２の
リセツト端子Ｒには共通のリセツト端子３４が形
成され、電源の投入と同時にリセツトパルスが与
えられる。
周回路２８に与えられている。分周回路２８はＴ
フリツプフロツプ回路３０，３２で構成され、各
Ｔフリツプフロツプ回路３０，３２はそれぞれ入
力パルスを２分周する分周回路を構成している。
Ｔフリツプフロツプ回路３０のトリガ入力Ｔには
比較器２の出力が与えられ、Ｔフリツプフロツプ
回路３０の反転出力がＴフリツプフロツプ回路
３２のトリガ入力Ｔと成つており、この結果、分
周回路２８は1/4分周出力を発生するように成つ
ている。各Ｔフリツプフロツプ回路３０，３２の
リセツト端子Ｒには共通のリセツト端子３４が形
成され、電源の投入と同時にリセツトパルスが与
えられる。
この分周回路２８の出力側にはSRフリツプフ
ロツプ回路３６が設置され、このSRフリツプフ
ロツプ回路３６のセツト入力Ｓには前記Ｔフリツ
プフロツプ回路３２の非反転出力Ｑが与えられ、
リセツト入力Ｒにはリセツト端子３４からリセツ
トパルスが与えられる。
ロツプ回路３６が設置され、このSRフリツプフ
ロツプ回路３６のセツト入力Ｓには前記Ｔフリツ
プフロツプ回路３２の非反転出力Ｑが与えられ、
リセツト入力Ｒにはリセツト端子３４からリセツ
トパルスが与えられる。
また、波形発生回路８のトランジスタ１０のベ
ースと基準電位ラインとの間には、SRフリツプ
フロツプ回路３６の出力に応動して波形発生回路
８の動作を制御する第２のスイツチング回路３８
が設置されている。このスイツチング回路３８は
第３のトランジスタ４０で構成され、このトラン
ジスタ４０のベースにはSRフリツプフロツプ回
路３６の反転出力が与えられている。
ースと基準電位ラインとの間には、SRフリツプ
フロツプ回路３６の出力に応動して波形発生回路
８の動作を制御する第２のスイツチング回路３８
が設置されている。このスイツチング回路３８は
第３のトランジスタ４０で構成され、このトラン
ジスタ４０のベースにはSRフリツプフロツプ回
路３６の反転出力が与えられている。
以上の構成において、その動作を第４図を参照
して詳細に説明する。第４図において、Ｈは高レ
ベル区間、Ｌは低レベル区間を示す。
して詳細に説明する。第４図において、Ｈは高レ
ベル区間、Ｌは低レベル区間を示す。
第４図Ａは電源の投入状態、第４図Ｂは入力端
子４Ａに与えられる入力信号を示し、Ｂにおい
て、VREFは電圧源６によつて入力端子４Ｂに与え
られる基準電圧レベル、Ｓは電源の投入時におけ
る過渡状態で発生し、信号入力の前段階で与えら
れる過渡音信号即ちポツプ音信号である。
子４Ａに与えられる入力信号を示し、Ｂにおい
て、VREFは電圧源６によつて入力端子４Ｂに与え
られる基準電圧レベル、Ｓは電源の投入時におけ
る過渡状態で発生し、信号入力の前段階で与えら
れる過渡音信号即ちポツプ音信号である。
第４図Ｃは比較器２の出力パルスを示し、その
出力パルスは入力信号の振幅レベルが基準電圧レ
ベルを越えている区間のパルス幅を持ち、信号Ｓ
に対応するパルスも発生する。
出力パルスは入力信号の振幅レベルが基準電圧レ
ベルを越えている区間のパルス幅を持ち、信号Ｓ
に対応するパルスも発生する。
分周回路２８のＴフリツプフロツプ回路３０，
３２及びSRフリツプフロツプ回路３６は電源の
投入に応動してリセツト端子３４からリセツト入
力が与えられ、電源の投入と同時にリセツト状態
に移行している。このような状態において、比較
器２の出力パルスは分周回路２８のＴフリツプフ
ロツプ回路３０に順次与えられ、第４図Ｄはこの
フリツプフロツプ回路３０の反転出力を示し、
これは比較器２の分周出力と成つており、この出
力がＴフリツプフロツプ回路３２に与えられ
る。第４図ＥはＴフリツプフロツプ回路３２の非
反転出力Ｑを示し、この出力はＴフリツプフロツ
プ回路３０の分周出力と成つている。
３２及びSRフリツプフロツプ回路３６は電源の
投入に応動してリセツト端子３４からリセツト入
力が与えられ、電源の投入と同時にリセツト状態
に移行している。このような状態において、比較
器２の出力パルスは分周回路２８のＴフリツプフ
ロツプ回路３０に順次与えられ、第４図Ｄはこの
フリツプフロツプ回路３０の反転出力を示し、
これは比較器２の分周出力と成つており、この出
力がＴフリツプフロツプ回路３２に与えられ
る。第４図ＥはＴフリツプフロツプ回路３２の非
反転出力Ｑを示し、この出力はＴフリツプフロツ
プ回路３０の分周出力と成つている。
この出力ＱはSRフリツプフロツプ回路３６に
与えられ、SRフリツプフロツプ回路３６はセツ
ト状態に移行するが、電源投入と同時にリセツト
状態に置かれているため、その反転出力は電源
投入時点からＴフリツプフロツプ回路３２が反転
出力を発生するまでの所定時間において高レベル
となり第４図Ｆに示す出力を発生する。
与えられ、SRフリツプフロツプ回路３６はセツ
ト状態に移行するが、電源投入と同時にリセツト
状態に置かれているため、その反転出力は電源
投入時点からＴフリツプフロツプ回路３２が反転
出力を発生するまでの所定時間において高レベル
となり第４図Ｆに示す出力を発生する。
このため、電源投入からの一定時間、即ち分周
回路２８が２発目のパルスの計数を開始する時刻
が到来するまでの時間において、トランジスタ４
０は導通状態となり、波形発生回路８の動作が停
止され、比較器２の出力パルスの検出が遮断され
る。
回路２８が２発目のパルスの計数を開始する時刻
が到来するまでの時間において、トランジスタ４
０は導通状態となり、波形発生回路８の動作が停
止され、比較器２の出力パルスの検出が遮断され
る。
そして、前記時間の終了と同時にスイツチング
回路３８が不導通状態となり、トランジスタ１０
のベースには第４図Ｃに示すパルスに対応した第
４図Ｇに示すパルスが入力され、トランジスタ１
０は比較器２の入力パルスに応動してスイツチン
グ動作を繰り返し、トランジスタ２２のベースに
は、第４図Ｈに示す鋸波電圧が発生する。この鋸
波電圧がスイツチング回路１６のスレシユホール
ドレベルVSHを越えない区間において、トランジ
スタ２２のコレクタ電圧は一定の高レベルを維持
し、この電圧出力は第４図Ｉに示すようになり、
これを出力端子２４から信号検出出力として取出
すことができる。
回路３８が不導通状態となり、トランジスタ１０
のベースには第４図Ｃに示すパルスに対応した第
４図Ｇに示すパルスが入力され、トランジスタ１
０は比較器２の入力パルスに応動してスイツチン
グ動作を繰り返し、トランジスタ２２のベースに
は、第４図Ｈに示す鋸波電圧が発生する。この鋸
波電圧がスイツチング回路１６のスレシユホール
ドレベルVSHを越えない区間において、トランジ
スタ２２のコレクタ電圧は一定の高レベルを維持
し、この電圧出力は第４図Ｉに示すようになり、
これを出力端子２４から信号検出出力として取出
すことができる。
このように電源投入からの一定時間、波形発生
回路８の動作を停止するので、電源投入時の過渡
状態におけるポツプ音信号の検出を避けることが
でき、信頼性の高い信号検出を行うことができ、
ポツプ音信号による誤動作を防止することができ
る。
回路８の動作を停止するので、電源投入時の過渡
状態におけるポツプ音信号の検出を避けることが
でき、信頼性の高い信号検出を行うことができ、
ポツプ音信号による誤動作を防止することができ
る。
第５図はこの発明の信号検出回路の他の実施例
を示し、前記実施例と同一部分には同一符号を付
してある。前記実施例では単一の比較器２で構成
し、その比較レベルVREFは入力信号の正の振幅に
対して設定したが、この実施例では一対の比較器
２Ａ，２Ｂを設置し、一方の比較器２Ａの非反転
入力端子（＋）、他方の比較器２Ｂの反転入力端
子（−）に共通の入力端子４Ａを形成して入力信
号を与え、比較器２Ａの反転入力端子（−）に形
成した入力端子４Ｂには、電圧源６Ａから比較レ
ベルVREF1、比較器２Ｂの非反転入力端子（＋）
に形成した入力端子４Ｃには、電圧源６Ａから比
較レベルVREF2（＜VREF1）を個別に設定するもの
とする。特に、この基準レベルVREF2を入力信号
振幅の負側に設定すれば、両波検出が可能にな
る。
を示し、前記実施例と同一部分には同一符号を付
してある。前記実施例では単一の比較器２で構成
し、その比較レベルVREFは入力信号の正の振幅に
対して設定したが、この実施例では一対の比較器
２Ａ，２Ｂを設置し、一方の比較器２Ａの非反転
入力端子（＋）、他方の比較器２Ｂの反転入力端
子（−）に共通の入力端子４Ａを形成して入力信
号を与え、比較器２Ａの反転入力端子（−）に形
成した入力端子４Ｂには、電圧源６Ａから比較レ
ベルVREF1、比較器２Ｂの非反転入力端子（＋）
に形成した入力端子４Ｃには、電圧源６Ａから比
較レベルVREF2（＜VREF1）を個別に設定するもの
とする。特に、この基準レベルVREF2を入力信号
振幅の負側に設定すれば、両波検出が可能にな
る。
そして、各比較器２Ａ，２Ｂの出力をOR回路
４２を介して出力するようにし、前記実施例と同
様の回路に供給するようにされる。
４２を介して出力するようにし、前記実施例と同
様の回路に供給するようにされる。
このようにすれば、その動作波形は第６図に示
すようになる。第６図Ａ及びＢは第４図Ａ及びＢ
に対応し、第６図Ｂに示す波形において、電圧レ
ベルVREF1，VREF2は比較レベルを示している。第
６図Ｃは各比較器２Ａ，２Ｂの出力を総合して得
られるOR回路４２の出力を示している。また、
第６図ＤないしＩは第４図ＤないしＩに対応して
いる。
すようになる。第６図Ａ及びＢは第４図Ａ及びＢ
に対応し、第６図Ｂに示す波形において、電圧レ
ベルVREF1，VREF2は比較レベルを示している。第
６図Ｃは各比較器２Ａ，２Ｂの出力を総合して得
られるOR回路４２の出力を示している。また、
第６図ＤないしＩは第４図ＤないしＩに対応して
いる。
この場合、入力信号の正負の振幅レベルを検出
しているため、比較器２Ａ，２Ｂの総合出力パル
ス数の密度が高くなり、電源投入からのパルス間
隔が狭まる結果、前記実施例に比較し、過渡信号
が発生しない場合には入力信号波形の検出につい
て応答速度が早くなるとともに、入力信号波形の
検出漏れが少なくなる利点がある。
しているため、比較器２Ａ，２Ｂの総合出力パル
ス数の密度が高くなり、電源投入からのパルス間
隔が狭まる結果、前記実施例に比較し、過渡信号
が発生しない場合には入力信号波形の検出につい
て応答速度が早くなるとともに、入力信号波形の
検出漏れが少なくなる利点がある。
なお、実施例の波形発生回路８及びスイツチン
グ回路１６は、第１図に示す回路と共通のものと
して説明したが、この発明はこの種の回路以外の
スイツチング回路或いは論理回路を用いても同様
の効果が期待でき、実施例の回路に限定されるも
のではない。
グ回路１６は、第１図に示す回路と共通のものと
して説明したが、この発明はこの種の回路以外の
スイツチング回路或いは論理回路を用いても同様
の効果が期待でき、実施例の回路に限定されるも
のではない。
以上説明したように、この発明によれば、電源
投入時、過渡状態で発生した過渡信号の到来区間
における入力信号の検出を阻止したので、検出す
べき正規の入力信号のみを選択的に検出でき、過
渡信号による信号検出の誤動作を防止して信号検
出の信頼性を高めることができる。
投入時、過渡状態で発生した過渡信号の到来区間
における入力信号の検出を阻止したので、検出す
べき正規の入力信号のみを選択的に検出でき、過
渡信号による信号検出の誤動作を防止して信号検
出の信頼性を高めることができる。
第１図は従来の信号検出回路を示す回路図、第
２図はその動作波形を示す説明図、第３図はこの
発明の信号検出回路の実施例を示す回路図、第４
図はその動作波形を示す説明図、第５図はこの発
明の信号検出回路の他の実施例を示す回路図、第
６図はその動作波形を示す説明図である。 ２，２Ａ，２Ｂ……比較器、８……波形発生回
路、１０……第１のトランジスタ、１２……第１
の抵抗、１４……コンデンサ、１６……第１のス
イツチング回路、２２……第２のトランジスタ、
２６……第２の抵抗、２８……分周回路、３６…
…フリツプフロツプ回路、３８……第２のスイツ
チング回路、４０……第３のトランジスタ。
２図はその動作波形を示す説明図、第３図はこの
発明の信号検出回路の実施例を示す回路図、第４
図はその動作波形を示す説明図、第５図はこの発
明の信号検出回路の他の実施例を示す回路図、第
６図はその動作波形を示す説明図である。 ２，２Ａ，２Ｂ……比較器、８……波形発生回
路、１０……第１のトランジスタ、１２……第１
の抵抗、１４……コンデンサ、１６……第１のス
イツチング回路、２２……第２のトランジスタ、
２６……第２の抵抗、２８……分周回路、３６…
…フリツプフロツプ回路、３８……第２のスイツ
チング回路、４０……第３のトランジスタ。
Claims (1)
- 【特許請求の範囲】 １ 入力信号と基準レベルとを比較して両者の大
小関係に応じて出力を発生する比較器と、 電源と基準電位点との間に第１の抵抗及びコン
デンサの直列回路を接続するとともに、前記比較
器の前記出力が第２の抵抗を介してベースに加え
られてスイツチングする第１のトランジスタのコ
レクタとエミツタとの間に前記コンデンサを並列
に接続し、前記比較器の出力に応じて前記第１の
トランジスタをスイツチングさせて前記コンデン
サを充電又は放電状態に制御することにより波形
を発生する波形発生回路と、 この波形発生回路の前記コンデンサの充電電圧
をベースに受けてスイツチングする第２のトラン
ジスタを備え、この第２のトランジスタのスイツ
チングに応じた出力を発生する第１のスイツチン
グ回路とを備えた信号検出回路であつて、 前記比較器が発生した前記出力を分周する分周
回路と、 この分周回路の出力をセツト入力に、電源投入
時のリセツトパルスをリセツト入力に受けてスイ
ツチングし、出力を発生するフリツプフロツプ回
路と、 このフリツプフロツプ回路の出力をベースに受
けて導通する第３のトランジスタのコレクタを前
記第１のトランジスタのベースに接続し、かつ前
記第３のトランジスタのエミツタを前記第１のト
ランジスタのエミツタに共通に接続し、前記フリ
ツプフロツプ回路の出力に応じて前記第３のトラ
ンジスタを導通させることにより前記第１のトラ
ンジスタのベースを強制的に不導通レベルに移行
させて前記波形発生回路の出力を解除する第２の
スイツチング回路と、 を備えたことを特徴とする信号検出回路。 ２ 前記比較器は第１の基準レベルを設定した第
１の比較器と、前記第１の基準レベルとは異なる
第２の基準レベルを設定した第２の比較器で構成
し、これら第１及び第２の比較器で入力信号と前
記第１及び第２の基準レベルとを比較し、前記第
１及び第２の比較器から得られる出力をOR回路
を通して前記分周回路に入力するようにしたこと
を特徴とする特許請求の範囲第１項に記載の信号
検出回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20047683A JPS6091714A (ja) | 1983-10-25 | 1983-10-25 | 信号検出回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20047683A JPS6091714A (ja) | 1983-10-25 | 1983-10-25 | 信号検出回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6091714A JPS6091714A (ja) | 1985-05-23 |
| JPH0554286B2 true JPH0554286B2 (ja) | 1993-08-12 |
Family
ID=16424947
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP20047683A Granted JPS6091714A (ja) | 1983-10-25 | 1983-10-25 | 信号検出回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6091714A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN105306017B (zh) * | 2015-12-04 | 2018-09-14 | 上海兆芯集成电路有限公司 | 信号产生电路以及工作周期调整电路 |
Family Cites Families (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5112423Y2 (ja) * | 1971-04-09 | 1976-04-03 | ||
| JPS57168351U (ja) * | 1981-04-17 | 1982-10-23 |
-
1983
- 1983-10-25 JP JP20047683A patent/JPS6091714A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6091714A (ja) | 1985-05-23 |
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