JPH0590754A - 多層回路基板の製造方法 - Google Patents

多層回路基板の製造方法

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JPH0590754A
JPH0590754A JP25178691A JP25178691A JPH0590754A JP H0590754 A JPH0590754 A JP H0590754A JP 25178691 A JP25178691 A JP 25178691A JP 25178691 A JP25178691 A JP 25178691A JP H0590754 A JPH0590754 A JP H0590754A
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JP
Japan
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green sheets
circuit board
multilayer circuit
manufacturing
land electrode
Prior art date
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Pending
Application number
JP25178691A
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English (en)
Inventor
Koichi Oba
耕一 大庭
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Kyocera Corp
Original Assignee
Kyocera Corp
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Publication date
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Abstract

(57)【要約】 (修正有) 【目的】 製造時にグリーンシートの積層作業に誤りが
あったか否かが容易に確認できる、製造歩留りが良好な
多層回路基板の製造方法を提供する。 【構成】 多層回路基板は、複数枚のグリーンシート7
a…7gを積層し、一体焼成すると形成できる。各グリ
ーンシート7a…7gは、それぞれスルーホール導体9
a…9gを有しており、各スルーホール導体9a…9g
はグリーンシート7a…7gが正しく積層されていれば
一連の導通路を形成し得る。したがって、スルーホール
導体9a…9g間の導通を電気的にチェックすることに
より、グリーンシート7a…7gの積層作業に誤りがあ
ったか否かが容易に確認できる。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、回路基板の製造方法、
特に多層回路基板の製造方法に関する。
【0002】
【従来の技術】一般的な多層回路基板は、複数の基板を
含む積層基板と、基板間に配置された内部回路とを備え
ている。このような多層回路基板は、内部回路パターン
が印刷されたグリーンシートを複数枚積層し、これを一
体焼成すると製造できる。
【0003】
【発明が解決しようとする課題】前記従来の多層回路基
板は、製造時に、グリーンシートの積層順序、積層方向
及び表裏等の取り違えが起こりやすく、不良品の発生率
が高い。このため、グリーンシートごとに識別マークを
付与し、作業ミスを排除しようとしているが、グリーン
シートの積層が完了した後は、積層作業に誤りがあった
か否かについての確認ができない。
【0004】本発明の目的は、グリーンシートの積層作
業に誤りがあったか否かが容易に確認できる多層回路基
板の製造方法を提供することにある。
【0005】
【課題を解決するための手段】本発明に係る多層回路基
板の製造方法は、複数枚のグリーンシートをその間に内
部回路を配して積層体とするとともに焼成一体化してな
る多層回路基板の製造方法である。この方法は、積層体
を構成する各グリーンシートに各々スルーホール導体及
びスルーホール導体に接続するランド電極パターンを形
成し、スルーホール導体が上下に位置するグリーンシー
トのランド電極パターンに電気的に接続するようグリー
ンシートを積層している。
【0006】
【作用】本発明の多層回路基板の製造方法では、グリー
ンシートの積層体の製造工程において、グリーンシート
を所定の積層順等にしたがって正しく積層すると、グリ
ーンシートの積層方向にスルーホール導体及びランド電
極パターンからなる一連の導通路が形成される。したが
って、導通路の導通状況を電気的にチェックすることに
より、グリーンシートの積層に誤りがあったか否かが判
断できる。したがって、本発明の製造方法は、製造途中
で不良品を容易に発見できるので、製造歩留りが高い。
【0007】
【実施例】図1及び図2に本発明の一実施例により製造
された多層回路基板の一例を示す。なお、図2は図1の
II−II断面図である。図において、多層回路基板1は、
複数の基板2a,2b…2f,2gを含む積層基板2
と、基板2a,2b…2f,2g間にそれぞれ配置され
た内部回路領域3a…3f(図2)と、積層基板2の図
上面に設けられた表面配線領域4とから主に構成されて
いる。
【0008】積層基板2は、たとえばSiO2 、Al2
O3 、ZnO及びMgOを主成分とする結晶化ガラス粉
末とアルミナ粉末とを含む混合粉末の焼成体であり、各
基板2a…2gが焼成時に一体化したものである。この
積層基板2には、図3(図1のIII −III 断面図)に示
すように、積層基板2の端部、即ち内部回路領域3a…
3f以外の位置に導通路5が形成されている。導通路5
は、積層基板2の図上面から図下面にかけて一連に形成
されており、各基板2a…2gに設けられた導電部6a
…6gが互いに接続されたものである。導通路5の図上
端及び下端には、それぞれ基板2a及び基板2bの図上
面及び下面に電極部5a,5bが形成されている。各導
電部6a…6gは、それぞれ基板2a…2gを貫通して
おり、最上層の基板2aから最下層の基板2gにかけて
図の左側から右側に徐々に位置をずらして設けられてい
る。
【0009】内部回路領域3a…3fは、所定のパター
ンに形成された内部配線を含んでいる。内部配線は、た
とえば銀製であり、他の内部回路領域3a…3fに含ま
れる内部配線パターンと図示しないスルーホールを通じ
て接続されている。表面配線領域4は、所定のパターン
に形成された表面配線を含んでいる。表面配線は、内部
配線と同じくたとえば銀製又は銅製であり、基板2aに
設けられた図示しないスルーホールを通じて内部回路領
域3aの内部回路と通じている。
【0010】次に、図4を参照して、本発明の一実施例
に係る、前記多層回路基板1の製造方法について説明す
る。まず、基板2a…2gを形成するためのグリーンシ
ート7a…7gを作成する。ここでは、例えばSi
O2 、Al2 O3 、ZnO、MgOを主成分とする結晶
化ガラス粉末70重量%とアルミナ粉末30重量%とを
含むガラスセラミックス混合粉末に溶剤、バインダー及
び可塑剤を加えて混練し、スラリーを作成する。そし
て、得られたスラリーをドクターブレード法によりシー
ト状に成形する。得られた各グリーンシート7a…7g
には、取扱いを容易にするために、外周に図示しない金
属製の枠を取り付けるのが好ましい。
【0011】次に、得られた各グリーンシート7a…7
gの内部回路領域8a…8g内の所定部位にスルーホー
ル(図示せず)を設ける。このスルーホールは、グリー
ンシート間の内部配線を連結するためのものである。ま
た、内部回路領域8aの外側にスルーホール9a…9g
をそれぞれ設ける。各スルーホール9a…9gは、最上
層のグリーンシート7aから最下層のグリーンシート7
gにかけて図の左から右方向に徐々に位置をずらして形
成する(図5参照)。なお、スルーホールは、たとえば
パンチングマシンにより形成できる。
【0012】次に、内部回路領域8a…8g内の図示し
ないスルーホールとスルーホール9’a…9’g内に印
刷により銀ペーストを充填する。これにより、スルーホ
ール導体9a…9gが形成される。そして、充填した銀
ペーストを乾燥した後に、内部回路領域8a…8g内に
所定の内部配線パターンを形成する。また、図4及び図
5に示すように、スルーホール導体9a…9gが露出す
る一方の面に、それぞれスルーホール導体9a…9gと
接続するランド電極パターン10a…10gを形成す
る。なお、ランド電極パターン10a…10gは、例え
ば図5に示すようにグリーンシート7aのスルーホール
導体9aの下面露出部がグリーンシート7b上に形成さ
れたランド電極パターン10bと接続し得るように形成
されており、図の左方向に延びている。内部配線パター
ン及びランド電極パターン10a…10gは、銀ペース
トを印刷すると同時形成できる。
【0013】なお、積層基板2の最下層に相当するグリ
ーンシート7gの下面には、電極部5bとなるランド電
極パターンを形成する。次に、グリーンシート7a…7
gを、図4に示すようにこの順に積層する。ここでは、
図5に示すように、グリーンシート7a…7g間のラン
ド電極パターン10a…10gがスルーホール導体9a
…9gを介して多層回路基板1の厚み方向に階段状に当
接する。そして、グリーンシート7a…7gを熱圧着
し、一体化する。このようにして一体化されたグリーン
シート7a…7gには、スルーホール導体9a…9gが
ランド電極パターン10a…10gにより連なった導通
路が形成される。
【0014】次に、一体化されたグリーンシート7a…
7gについて、ランド電極パターン10a,10g間の
導通を電気的にチェックする。ここでは、スルーホール
導体9a…9gによる一連の導通路が形成されているの
で、図3の電極部5a,5b間の導通路5に相当するグリ
ーンシート7a上のランド電極パターン10aとグリー
ンシート7gの下面に形成したランド電極パターン間は
導通しているはずである。ところが、たとえばグリーン
シート7bの積層位置や積層方向が取り違えられている
と、グリーンシート7bのランド電極パターン10bと
上側のグリーンシート7aのスルーホール導体9a又は
グリーンシート7bのスルーホール導体9bと下側のグ
リーンシート7cのランド電極パターン10cとが導通
しなくなる。したがって、グリーンシート7a…7gの
積層体の上下面のランド電極パターン間の導通が確認で
きれば、グリーンシート7a…7gが間違いなく積層さ
れているのが容易に判断できる。
【0015】次に、積層体の外周部を切断し、各グリー
ンシート7a…7gに装着されている枠体を除去し、そ
の後にシートの積層体を焼成する。これにより、積層基
板2が得られる。得られた積層基板2には、スルーホー
ル導体9a…9gがランド配線パターン10a…10g
を通じて接続した導通路5(図3)が形成される。次
に、積層基板2の上面に表面配線を形成する。表面配線
は、通常の厚膜手法により形成できる。これにより、多
層回路基板1が得られる。
【0016】〔他の実施例〕前記実施例では、多層回路
基板1内に導通路5を形成したが、導通路5は積層体の
外周部の切断位置よりも外部に形成してもよい。また、
切断線にまたがるように形成してもよい。この場合、切
断端面に現れるランド電極パターン10a…10gの配
列状況によってもグリーンシート7a…7gの積層状況
が確認できる。
【0017】なお、前記実施例ではランド電極パターン
が順次階段状に配列されているが、ランド電極パターン
は積層の途中で配列方向が変わるように設けられていて
もよい。
【0018】
【発明の効果】本発明に係る多層回路基板の製造方法で
は、グリーンシートの積層方向にスルーホール導体及び
ランド電極パターンからなる一連の導通路が形成される
ので、製造途中においてグリーンシートの積層作業に誤
りがあったか否かが容易に確認できる。
【図面の簡単な説明】
【図1】本発明の一実施例により製造された多層回路基
板の斜視図。
【図2】図1のII−II断面図。
【図3】図1のIII −III 断面図。
【図4】前記実施例の製造工程を示す斜視図。
【図5】図4の縦断面部分図。
【符号の説明】
1 多層回路基板 2 積層基板 2a…2g 基板 3a…3f 内部回路領域 5 導通路 7a…7g グリーンシート 9a…9g スルーホール導体

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】複数枚のグリーンシートをその間に内部回
    路を配して積層体とするとともに焼成一体化してなる多
    層回路基板の製造方法であって、前記積層体を構成する
    前記各グリーンシートに各々スルーホール導体及び前記
    スルーホール導体に接続するランド電極パターンを形成
    し、前記スルーホール導体が上下に位置する前記グリー
    ンシートの前記ランド電極パターンに電気的に接続する
    よう前記各グリーンシートを積層することを特徴とする
    多層回路基板の製造方法。
JP25178691A 1991-09-30 1991-09-30 多層回路基板の製造方法 Pending JPH0590754A (ja)

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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2009060505A1 (ja) * 2007-11-05 2009-05-14 Fujitsu Limited 積層順序検査方法および配線板製造方法
US8090497B2 (en) 2006-12-06 2012-01-03 Kojima Press Industry Co., Ltd. Vehicle accessory touch switch
US8203468B2 (en) 2006-08-29 2012-06-19 Kojima Press Industry Co., Ltd. Electric capacitance-type touch switch

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US8203468B2 (en) 2006-08-29 2012-06-19 Kojima Press Industry Co., Ltd. Electric capacitance-type touch switch
US8090497B2 (en) 2006-12-06 2012-01-03 Kojima Press Industry Co., Ltd. Vehicle accessory touch switch
WO2009060505A1 (ja) * 2007-11-05 2009-05-14 Fujitsu Limited 積層順序検査方法および配線板製造方法
JP5104874B2 (ja) * 2007-11-05 2012-12-19 富士通株式会社 積層順序検査方法および配線板製造方法

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