JPH0626212B2 - 半導体装置の製造方法 - Google Patents

半導体装置の製造方法

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JPH0626212B2
JPH0626212B2 JP61235605A JP23560586A JPH0626212B2 JP H0626212 B2 JPH0626212 B2 JP H0626212B2 JP 61235605 A JP61235605 A JP 61235605A JP 23560586 A JP23560586 A JP 23560586A JP H0626212 B2 JPH0626212 B2 JP H0626212B2
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silicide
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信恭 北岡
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Nippon Electric Co Ltd
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Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は半導体装置の製造方法に関し、特に高融点金属
あるいはその珪化物からなる半導体装置の製造方法に関
する。
〔従来の技術〕 従来、高融点金属あるいはその珪化物(以降シリサイド
と称す)を被着する工程とその後の熱処理工程とは独立
に行われていたので、その工程の途中で半導体基板表面
及び高融点金属あるいはそのシリサイドからなる半導体
表面が大気に晒されることがあった。
第3図(a),(b)は従来の半導体装置の製造方法の
一例を説明するための工程順に示した半導体チップの断
面図である。
この従来例では、先ず、第3図(a)に示すように、シ
リコン基板1上に順次形成した酸化膜2及び多結晶シリ
コン膜3の上にチタン層4a′を形成した後、一旦大気
中に晒すことがあるのでチタン層4a′の表面に酸化物
層6が出来る。
次に、第3図(b)に示すように、酸化物層6を付けた
まま、熱処理を行い多結晶シリコン膜3とチタン層4
a′とを反応させてチタンシリサイド層4′を形成す
る。
この場合、表面の酸化物層6が存在するために、チタン
シリサイド層4′は不均一になりしかも層抵抗が高くな
る。
〔発明が解決しようとする問題点〕
上述した従来の半導体装置の製造方法では、高融点金属
あるいはそのシリサイドを被着する工程とその後の熱処
理工程とを独立に行いしかも途中で半導体基板が大気に
晒されていたので、高融点金属あるいはそのシリサイド
表面上に酸化物層が形成されたり、あるいは不純物が付
着する等して高融点金属あるいはそのシリサイドからな
る導体層が不均一でしかも層抵抗が高くなるという欠点
があった。
又、導体層表面を熱処理前にフッ酸で処理しようとする
とチタンまで同時に除去されてしまうという問題もあっ
た。
〔問題点を解決するための手段〕
本発明の特徴は、半導体基板の上に高融点金属あるいは
その珪化物を被着した後に真空中又は不活性ガス雰囲気
中でランプアニールによる短時間熱処理を施し導体層を
形成する単位工程を少くとも一回含み、前記単位工程中
及び前記単位工程から前記単位工程までの間、その全期
間に亘って前記半導体基板を大気中に晒すことなく真空
中又は非酸化性ガス雰囲気中に保持する半導体装置の製
造方法にある。
〔実施例〕
次に、本発明の実施例について図面を参照して説明す
る。
第1図(a)〜(c)は本発明の第1の実施例を説明す
るための工程順に示した半導体チップの断面図である。
この実施例は、先ず、第1図(a)に示すように、シリ
コン基板1の上に 500Åの酸化膜2及び3000Åの多結晶
シリコン膜3を順次形成する。
次に、第1図(b)に示すように、多結晶シリコン膜3
の表面をフッ酸で処理して大気中で出来た酸化膜を除去
した後真空蒸着法により、 500Åのチタン層4aを形成
する。
次に、第1図(c)に示すように、大気中に晒さずに連
続して真空中でハロゲンランプアニール法により 800
℃,15秒間加熱し、チタンシリサイド層4を形成する。
第2図(a),(b)は本発明の第2の実施例を説明す
るための工程順に示した半導体チップの断面図である。
この実施例は、先ず、第2図(a)に示すように、シリ
コン基板1の上に酸化膜2及び多結晶シリコン膜3を順
次形成した後多結晶シリコン膜3の表面をフッ酸処理し
て、スパッタ法によりタングステンとシリコンの組成比
が1:3.5 のWS3.5 からなるタングステンシリサイド層
5aを1000Åの厚さで形成する。続いて、シリコン基板
1を大気中に晒すことなく真空中でハロゲンランプアニ
ール法により1000℃,10秒間加熱する。ここで、シリコ
ンの組成比の多いタングステンシリサイドを、先ず被着
したのは、下層の多結晶シリコン層3との密着性を良く
するためである。
しかし、このタングステンシリサイド層5aの層抵抗は
高いので、半導体基板1上のタングステンシリサイド層
5aの表面を大気に晒さずに、連続して、第2図(b)
に示すように、タングステンとシリコンの組成比が1:1.
8 とタングステンの組成比が多いWS1.8 からなるタン
グステンシリサイド層5bをスパッタ法により1000Åの
厚さで形成する。更に真空中でハロゲンランプアニール
法により、1000℃、10秒間の加熱をする。
これにより低抵抗タングステンシリサイド層を形成で
き、シリサイド層の被着と熱処理との一連の工程で半導
体基板は、一度も大気にさらされないため、高純度なタ
ングステンシリサイド層が得られる。
なお、この実施例では、各シリサイド層を被着する毎に
ランプアニールを行っているが、勿論、シリサイド層全
部を先に被着した後にランプアニールを行っても良い。
〔発明の効果〕
以上説明したように本発明では、高融点金属あるいはそ
のシリサイドの被着と熱処理とを一連の真空中で行な
い、工程の途中で半導体基板の表面が大気に晒されない
ため、大気からの汚染を阻止すると共に高融点金属ある
いはそのシリサイドの表面上の酸化物層の形成も防止
し、均一でしかも層抵抗の低い導体層が安定に得られる
という効果がある。
【図面の簡単な説明】
第1図(a)〜(c)及び第2図(a),(b)はそれ
ぞれ本発明の第1及び第2の実施例を説明するための工
程順に示した半導体チップの断面図、第3図(a),
(b)は従来の半導体装置の製造方法の一例を説明する
ための工程順に示した半導体チップの断面図である。 1……シリコン基板、2……酸化膜、3……多結晶シリ
コン膜、4,4′……チタンシリサイド層、4a,4
a′……チタン層、5a,5b……タングステンシリサ
イド層、6……酸化物層。

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】半導体基板の上に高融点金属あるいはその
    珪化物を被着した後に真空中又は不活性ガス雰囲気中で
    ランプアニールによる短時間熱処理を施し導体層を形成
    する単位工程を少くとも一回含み、前記単位工程中及び
    前記単位工程から前記単位工程までの間、その全期間に
    亘って前記半導体基板を大気中に晒すことなく真空中又
    は非酸化性ガス雰囲気中に保持することを特徴とする半
    導体装置の製造方法。
JP61235605A 1986-10-02 1986-10-02 半導体装置の製造方法 Expired - Lifetime JPH0626212B2 (ja)

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