JPH0716226U - マトリックス方式のキー入力制御回路 - Google Patents

Abstract

(57)【要約】 【目的】 近年の測定器類は各種設定にマトリックス方
式のキーを使用しているものが数多くあるが、ラジエー
ションの影響を排除するためにスタティック方式による
キー入力方法で、且つ、２つのキーを同時に入力し識別
可能とするキー入力回路を提供する。 【構成】 マトリックス状に構成された複数のキースイ
ッチと、プライオリティの異なる２種類のエンコーダ回
路と、記憶回路とから構成する。

Description

【考案の詳細な説明】

【０００１】

【産業上の利用分野】

マトリックス方式によるキー入力回路に関する。

【０００２】

【従来の技術】

一般にマトリックス方式のキー入力制御回路にはダイナミック方式とスタティ ック方式とがあり、このうちのスタティック方式の従来の技術例を図４に示す。 各数字０，１，２，・・・，７に対応する入力キー０，１，２，・・・，７と、 ２個のプライオリティ・エンコーダ回路２１，２２と、同エンコーダ回路２１， ２２の出力を記憶する記憶回路２５とから構成される。各キーからの個々の出力 ライン１０〜１７はプライオリティ・エンコーダ回路２１の８本の入力に接続さ れる。又、キーの共通した１本の出力ライン１９はプライオリティ・エンコーダ 回路２２の入力のうちの１つに接続される。

【０００３】 プライオリティ・エンコーダ回路２１の入力出力関係を示す真理値表を図２に 示す。この例では、正論理で表現している。即ち、信号のある時を論理”１”、 信号の無い時を論理”０”とし、”Ｘ”はいずれの論理でもかまわないことを現 している。このプライオリティ・エンコーダ２１の場合はそのプライオリティが 入力０の時が最も高く入力７の場合が最も低いことを示している。例えば入力０ と入力１とが論理”０”で入力２が論理”１”であるとすると、残りの入力３〜 ７がいずれの論理であっても、その出力Ｃ，Ｂ，Ａにはバイナリーコードで入力 ２に対応する”０１０”という出力が得られる。と、言うことは、入力５が論理 ”１”であっても、それよりもプライオリティの高い入力に論理”１”の信号が あれば、入力５に対応する出力は、得られないことを意味する。

【０００４】 図４において２のキー２が押されたとする。このとき入力１２と１９とはとも に論理”１”になるとすると、エンコーダ回路２１の出力は”０１０”となる。 またエンコーダ回路２２は、入力ライン０，２，３，・・・７はその接続を図示 していないが、ともに入力信号がないものとすると、その出力は”００１”とな り計６ビットの出力”００１０１０”が次の記憶回路に記憶されて、これが２の キーのコードとして識別される。

【０００５】 次に２と５との２つのキーが同時に押されたとする。入力１２と１５との両方 がともに論理”１”となってエンコーダ回路２１に入力されるが、上述したよう に入力ライン１２の方がプライオリティが高いために、エンコーダ回路２１の出 力は”０１０”が出力される。一方、入力ライン１９は共通ラインになっている ので、エンコーダ回路２２の入力１のみが論理”１”となり、エンコーダ回路２ ２の出力は”００１”となる。従って記憶回路に記憶されるのは”００１０１０ ”となり、２つのキー入力であっても２のキーが押されたものと認識されること になる。

【０００６】

【考案が解決しようとする課題】

マトリックス方式のキー入力制御回路は一般的にダイナミック方式が多いので あるが、計測器の中でノイズを測定するような場合には、ダイナミック方式によ るとラジエーションの影響を受け、本来のノイズ成分に影響を与えるのでスタテ ィック方式の方が良い。又、測定器はライン用と研究用とに分けて考えることが あるが、前者の場合にはできるだけ操作が簡単な方が望ましく、後者の方は測定 者にとっては様々なアプリケーションが出来る方が良い。従ってこの両者を満足 させるためのキー操作は、前者にはできるだけ数少ないキーでワンタッチで操作 できる方が良く、後者には少ないキーを有効に使用するためにテンプテートなど を用いて２つのキーを同時入力などしてその設定内容が豊富であることが望まし い。よって、この考案が解決しようとしている課題は、ノイズ成分を測定する測 定器において、スタティック方式のキー入力回路で、且つ、同時入力された２つ のキーを識別できるキー入力制御回路を提供することである。

【０００７】

【解決するための手段】

そのキーの出力の１ラインは各キー共通であり、他のもう１ラインは個々のキ ー出力とから構成されるキーマトリックス回路と、プライオリティの異なる２種 類のプライオリティ・エンコーダ回路と、これらエンコーダ回路の出力を記憶す る記憶回路とから構成する。

【０００８】

【実施例】

図１に実施例を示す。プライオリティ・エンコーダ回路２１，２２の入力出力 関係を示す真理値表は図２に示す通りであるが、プライオリティ・エンコーダ回 路２３，２４の入力出力関係を示す真理値表は図３に示す通りである。即ち、図 ２の場合のプライオリティは、入力０が最も高く入力７が最も低かったが、図３ の場合のプライオリティは、入力７が最も高く入力０が最も低くなる。そして各 キーの個々の出力ライン１１〜１７はエンコーダ回路２１と２３の同じ入力端子 に接続し、又、共通ライン１９はエンコーダ回路２２，２４の同じ入力端子に接 続する。エンコーダ回路２１，２２出力は記憶回路２５で、又、エンコーダ回路 ２３，２４の出力は記憶回路２６に記憶する。

【０００９】 今１つのキー２が押されたとする。この場合ライン１２と１９とが論理”１” となるだけであるので、エンコーダ回路２２の出力は”００１”，エンコーダ回 路２１の出力は”０１０”となり記憶回路２５には”００１０１０”のコードが 記憶される。又、エンコーダ回路２４の出力は”００１”，エンコーダ回路２３ の出力は”０１０”となり記憶回路２６には”００１０１０”のコードが記憶さ れる。即ち、記憶回路２５，２６には同じ２のキーコードが記憶されたことにな る。

【００１０】 次に２つのキー２と５とが同時に押されたとする。この場合ライン１２と１５ 及び１９とが論理”１”になるとする。この時エンコーダ回路２２の出力は”０ ０１”であるが、エンコーダ回路２１の方は入力２の方が入力５よりプライオリ ティが高いのでエンコーダ回路２１の出力は”０１０”となり記憶回路２５には ”００１０１０”のコードが記憶される。次に、エンコーダ回路２４の出力は” ００１”であるが、エンコーダ回路２３の方は入力５の方が入力２よりプライオ リティが高いのでエンコーダ回路２３の出力は”１０１”となり記憶回路２６に は”００１１０１”のコードが記憶される。即ち、記憶回路２６には５のキーコ ードが記憶されたことになる。

【００１１】 従って、記憶回路に記憶されたキーコードをプロセッサなどで解読すれば、１ つのキー入力があったのか、２つのキー入力があったのかを用意に識別すること が可能である。

【００１２】

【考案の効果】

このようにスタティック方式で２つのキーを同時入力し識別することが可能と なったために、ノイズを測定する測定器で、１台でライン用と研究用とに使い分 けることができた。このために開発費の大幅な削減を計れ、且つ、製造ラインも １つで両者向けの製品を製造できるので製造原価の逓減が計れ、強いては顧客に もより安価な製品を提供することが可能となった。

【図面の簡単な説明】

【図１】請求項１の実施例を示す回路のブロック図であ
る。

【図２】プライオリティ・エンコーダ２１，２２の入出
力関係を示す真理値表である。

【図３】プライオリティ・エンコーダ２３，２４の入出
力関係を示す真理値表である。

【図４】従来の実施例を示す回路のブロック図である。

【符号の説明図】０ ０のキー １ １のキー ２ ２のキー ３ ３のキー ４ ４のキー ５ ５のキー ６ ６のキー ７ ７のキー １０ ０のキーの出力ライン １１ １のキーの出力ライン １２ ２のキーの出力ライン １３ ３のキーの出力ライン １４ ４のキーの出力ライン １５ ５のキーの出力ライン １６ ６のキーの出力ライン １７ ７のキーの出力ライン １９ 各キー共通の出力ライン ２１ 入力０が最も優先度の高いプライオリティ・エン
コーダ回路 ２２ 入力０が最も優先度の高いプライオリティ・エン
コーダ回路 ２３ 入力７が最も優先度の高いプライオリティ・エン
コーダ回路 ２４ 入力７が最も優先度の高いプライオリティ・エン
コーダ回路 ２５ 記憶回路 ２６ 記憶回路

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【手続補正書】

【提出日】平成６年２月３日

【手続補正１】

【補正対象書類名】明細書

【補正対象項目名】図２

【補正方法】変更

【補正内容】

【図２】プライオリティ・エンコーダ２１，２２の入出
力関係を示す真理値の図表である。

【手続補正２】

【補正対象書類名】明細書

【補正対象項目名】図３

【補正方法】変更

【補正内容】

【図３】プライオリティ・エンコーダ２３，２４の入出
力関係を示す真理値の図表である。

───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.⁶ 識別記号 庁内整理番号 ＦＩ 技術表示箇所 Ｈ０３Ｍ 11/08

Claims (1)

【実用新案登録請求の範囲】
1. 【請求項１】 マトリックス状に組まれた複数のキース
   イッチ（０〜７）からなる入力手段と、 これらキースイッチの出力を受けるプライオリティの異
   なる２種類のプライオリティ・エンコーダ回路（２１〜
   ２４）でキーコードを得る手段と、 エンコーダ回路の出力を記憶する記憶回路（２５，２
   ６）からなる手段と、 を具備したことを特徴とするキー入力制御回路。