JPH0729710Y2 - パルス入力回路 - Google Patents
パルス入力回路Info
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- JPH0729710Y2 JPH0729710Y2 JP11602789U JP11602789U JPH0729710Y2 JP H0729710 Y2 JPH0729710 Y2 JP H0729710Y2 JP 11602789 U JP11602789 U JP 11602789U JP 11602789 U JP11602789 U JP 11602789U JP H0729710 Y2 JPH0729710 Y2 JP H0729710Y2
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- 239000003990 capacitor Substances 0.000 description 8
- 238000006243 chemical reaction Methods 0.000 description 4
- 238000010586 diagram Methods 0.000 description 4
- 238000007599 discharging Methods 0.000 description 2
- 230000007423 decrease Effects 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 230000000630 rising effect Effects 0.000 description 1
Landscapes
- Emergency Protection Circuit Devices (AREA)
Description
【考案の詳細な説明】 産業上の利用分野 本考案はパルス入力回路に係り、特に高レベルパルス信
号のレベルを所定の範囲内に変換するパルス入力回路に
関する。
号のレベルを所定の範囲内に変換するパルス入力回路に
関する。
従来の技術 IC（集積回路）などへ入力信号を入力する際にはICの電
圧保証レベル以下として入力する必要がある。このよう
なICなどに信号を入力する際に入力信号をICの電圧保証
レベル以下の値に変換するレベル変換回路としては従来
第２図に示すような回路が用いられていた。
圧保証レベル以下として入力する必要がある。このよう
なICなどに信号を入力する際に入力信号をICの電圧保証
レベル以下の値に変換するレベル変換回路としては従来
第２図に示すような回路が用いられていた。
第２図に示す回路はタコメータの駆動用IC1への入力信
号レベル変換を行なうレベルを変換回路で、抵抗R4，R5
により入力されるイグニッションパルス信号を分圧して
適当なレベルにし、ツェナーダイオードZD2によりツェ
ナー電圧以上のレベルがIC1に入力されないようにして
いた。さらに、コンデンサC2，抵抗R6，R5により時定数
回数を構成して、入力イグニッションパルス信号を平滑
してIC1に入力していた。
号レベル変換を行なうレベルを変換回路で、抵抗R4，R5
により入力されるイグニッションパルス信号を分圧して
適当なレベルにし、ツェナーダイオードZD2によりツェ
ナー電圧以上のレベルがIC1に入力されないようにして
いた。さらに、コンデンサC2，抵抗R6，R5により時定数
回数を構成して、入力イグニッションパルス信号を平滑
してIC1に入力していた。
考案が解決しようとする課題 しかるに、従来のレベル変換回路はツェナーダイオード
ZD2により一定電圧以上のレベルにならないようにして
いるだけなのでIC1の電源電圧VDDが変動してIC1の電圧
保証レベルが降下しても入力信号の最大入力レベルは一
定であるため、入力信号レベルがICの電圧保証レベル以
上となってIC1を破損してしまったり、また、入力信号
が低レベルのときには入力信号がそのまま時定数回路に
供給されるため、より滑らかな入力信号を得るために時
定数回路の時定数を長く取ってしまうと第２図（ａ），
（ｂ）に示すようにIC1に入力される信号の最低レベル
が十分に低下せずにIC1のスレッショルドレベルに達し
なくなり、IC1が回転数の正確な測定ができなくなる等
の問題点があった。
ZD2により一定電圧以上のレベルにならないようにして
いるだけなのでIC1の電源電圧VDDが変動してIC1の電圧
保証レベルが降下しても入力信号の最大入力レベルは一
定であるため、入力信号レベルがICの電圧保証レベル以
上となってIC1を破損してしまったり、また、入力信号
が低レベルのときには入力信号がそのまま時定数回路に
供給されるため、より滑らかな入力信号を得るために時
定数回路の時定数を長く取ってしまうと第２図（ａ），
（ｂ）に示すようにIC1に入力される信号の最低レベル
が十分に低下せずにIC1のスレッショルドレベルに達し
なくなり、IC1が回転数の正確な測定ができなくなる等
の問題点があった。
本考案は上記の点に鑑みてなされたもので、供給回路の
入力電圧保証値が変動しても入力パルス信号レベルをそ
の値以内に保証すると共に供給回路を確実に動作させ得
るパルス入力回路を提供することを目的とする。
入力電圧保証値が変動しても入力パルス信号レベルをそ
の値以内に保証すると共に供給回路を確実に動作させ得
るパルス入力回路を提供することを目的とする。
課題を解決するための手段 本考案は入力パルス信号のレベルを電源用電圧によって
入力可能な上昇レベルが決まる回路に入力可能な上限レ
ベル内になるように変換して入力するパルス入力回路に
おいて、前記入力パルス信号の供給ラインに直列に接続
され、前記入力パルス信号のレベルに応じてオン・オフ
し、前記入力パルス信号のレベルが前記上限レベル以下
の一定レベル以下となったときにオフとなり前記入力パ
ルス信号の供給を供給する第１のスイッチング素子と、
前記入力パルス信号の供給ラインと前記電源との間に設
けられ、前記電源によりバイアスされ、前記入力パルス
信号のレベルに応じてオン・オフし、前記入力パルス信
号のレベルが前記電源の電圧以上となったときにオンと
なり、前記入力パルス信号と電源とを接続して前記入力
パルス信号のレベルを前記電源の電圧以下に制限するこ
とにより前記上限レベル以下に制限する第２のスイッチ
ング素子とを具備してなる。
入力可能な上昇レベルが決まる回路に入力可能な上限レ
ベル内になるように変換して入力するパルス入力回路に
おいて、前記入力パルス信号の供給ラインに直列に接続
され、前記入力パルス信号のレベルに応じてオン・オフ
し、前記入力パルス信号のレベルが前記上限レベル以下
の一定レベル以下となったときにオフとなり前記入力パ
ルス信号の供給を供給する第１のスイッチング素子と、
前記入力パルス信号の供給ラインと前記電源との間に設
けられ、前記電源によりバイアスされ、前記入力パルス
信号のレベルに応じてオン・オフし、前記入力パルス信
号のレベルが前記電源の電圧以上となったときにオンと
なり、前記入力パルス信号と電源とを接続して前記入力
パルス信号のレベルを前記電源の電圧以下に制限するこ
とにより前記上限レベル以下に制限する第２のスイッチ
ング素子とを具備してなる。
作用 第１のスイッチング素子は入力パルス信号が低レベルの
ときに入力パルス信号をキャンセルすることにより確実
に零レベルとして入力パルス信号供給回路の下限レベル
より低いレベルにできるため回路の動作を確実に行なわ
せることができ、さらに、第２のスイッチング素子は入
力パルス信号を供給する回路の入力保証レベルである所
定レベルの信号によりバイアスされており、入力パルス
信号レベルの上限はこの所定のレベルにより制限されて
いるため、入力パルス信号レベルは所定のレベル以上に
はならない。
ときに入力パルス信号をキャンセルすることにより確実
に零レベルとして入力パルス信号供給回路の下限レベル
より低いレベルにできるため回路の動作を確実に行なわ
せることができ、さらに、第２のスイッチング素子は入
力パルス信号を供給する回路の入力保証レベルである所
定レベルの信号によりバイアスされており、入力パルス
信号レベルの上限はこの所定のレベルにより制限されて
いるため、入力パルス信号レベルは所定のレベル以上に
はならない。
実施例 第１図は本考案の一実施例の回路図を示す。
本実施例は自動車のエンジンの回転数を表示するタコメ
ータの入力回路に用いた例である。集積回路１は端子２
に入力されるエンジン回転数に応じた周波数の信号より
表示装置を駆動するための信号を生成している。表示装
置はIC1からの信号によりエンジン回転数を表示する。
また、IC1には外部より電圧VDDが印加され、この電圧V
DDにより動作する。
ータの入力回路に用いた例である。集積回路１は端子２
に入力されるエンジン回転数に応じた周波数の信号より
表示装置を駆動するための信号を生成している。表示装
置はIC1からの信号によりエンジン回転数を表示する。
また、IC1には外部より電圧VDDが印加され、この電圧V
DDにより動作する。
時定数用コンデンサC1，分圧・放電用抵抗R2，充放電用
抵抗R3は入力パルス信号を平滑にする時定数回路を構成
していて、抵抗R3の一端はコンデンサC1を介して接地さ
れ、もう一端は抵抗R2を介して接地されている。抵抗R3
とコンデンサC1との接続点がIC1の端子２に接続され、
抵抗R3と抵抗R2との接続点にはダイオードD2のカソード
が接続される。
抵抗R3は入力パルス信号を平滑にする時定数回路を構成
していて、抵抗R3の一端はコンデンサC1を介して接地さ
れ、もう一端は抵抗R2を介して接地されている。抵抗R3
とコンデンサC1との接続点がIC1の端子２に接続され、
抵抗R3と抵抗R2との接続点にはダイオードD2のカソード
が接続される。
ダイオードD1が第２のスイッチング素子、ツェナーダイ
オードZD1が第１のスイッチング素子を構成しておりダ
イオードD1，D2，ツェナーダイオードZD1は低レベル入
力をキャンセルし、及び高レベル入力を制限する回路を
構成している。ダイオードD1，D2，ツェナーダイオード
ZD1のアノードは一体的に接続され、ダイオードD1のカ
ソードはIC1の電源電圧VDDに接続され、ダイオードD2の
カソードは抵抗R3と抵抗R2との接続点に接続され、ツェ
ナーダイオードZD1のアノードはダイオード保護及び分
圧用の抵抗R1を介して点火装置からのイグニッションパ
ルス信号が入力される入力端子３に接続される。
オードZD1が第１のスイッチング素子を構成しておりダ
イオードD1，D2，ツェナーダイオードZD1は低レベル入
力をキャンセルし、及び高レベル入力を制限する回路を
構成している。ダイオードD1，D2，ツェナーダイオード
ZD1のアノードは一体的に接続され、ダイオードD1のカ
ソードはIC1の電源電圧VDDに接続され、ダイオードD2の
カソードは抵抗R3と抵抗R2との接続点に接続され、ツェ
ナーダイオードZD1のアノードはダイオード保護及び分
圧用の抵抗R1を介して点火装置からのイグニッションパ
ルス信号が入力される入力端子３に接続される。
次に回路の動作について第２図と共に説明する。入力端
子３に第３図（ａ）に示すような波形のイグニッション
パルス信号が入力されたとする。第３図（ａ）に示す波
形で低レベルの部分Ａが入力端子３に入力されると、抵
抗R1を介して入力可能なレベルまで落され、ツェナーダ
イオードZD1に印加される。
子３に第３図（ａ）に示すような波形のイグニッション
パルス信号が入力されたとする。第３図（ａ）に示す波
形で低レベルの部分Ａが入力端子３に入力されると、抵
抗R1を介して入力可能なレベルまで落され、ツェナーダ
イオードZD1に印加される。
ツェナーダイオードZD1は入力されたレベルがツェナー
ダイオードZD1のツェナー電圧に達しなければ、接続点
ａのレベルは零となり、コンデンサC1に充電されていた
電荷は抵抗R2，R3を介して放電されることになり、端子
２のレベルは徐々に減少する。
ダイオードZD1のツェナー電圧に達しなければ、接続点
ａのレベルは零となり、コンデンサC1に充電されていた
電荷は抵抗R2，R3を介して放電されることになり、端子
２のレベルは徐々に減少する。
次に入力端子３のイグニッションパルス信号がレベルが
増加して、接続点ｂのレベルがツェナーダイオードZD1
のツェナー電圧レベルを越えると接続点ａのレベルが上
昇し、コンデンサC1を充電し、第３図（ｃ）に示すよう
に端子２のレベルを徐々に上昇させる。
増加して、接続点ｂのレベルがツェナーダイオードZD1
のツェナー電圧レベルを越えると接続点ａのレベルが上
昇し、コンデンサC1を充電し、第３図（ｃ）に示すよう
に端子２のレベルを徐々に上昇させる。
イグニッションパルス信号のレベルが第３図（ａ）の高
レベル部分Ｂになり、接続点ａのレベルが電源電圧VDD
にダイオードD1の順方向電圧VFを加算したレベルを越え
るとダイオードD1がオンして、接続点ａのレベルはVDD
＋VF以上にならない。このため、端子２は第３図（ｃ）
に示すように一定レベル以上にならない。
レベル部分Ｂになり、接続点ａのレベルが電源電圧VDD
にダイオードD1の順方向電圧VFを加算したレベルを越え
るとダイオードD1がオンして、接続点ａのレベルはVDD
＋VF以上にならない。このため、端子２は第３図（ｃ）
に示すように一定レベル以上にならない。
このように、コンデンサC1，抵抗R2，R3による時定数を
比較的長く取っても低レベルパルス信号が入力された場
合にそのレベル変動に端子２への入力信号を十分追従さ
せることができる。また、高レベルのパルス信号はカッ
トして、IC1の入力電圧保証レベルVDD＋0.3〔Ｖ〕以内
とすることができる。
比較的長く取っても低レベルパルス信号が入力された場
合にそのレベル変動に端子２への入力信号を十分追従さ
せることができる。また、高レベルのパルス信号はカッ
トして、IC1の入力電圧保証レベルVDD＋0.3〔Ｖ〕以内
とすることができる。
さらに、高レベルパルス信号の入力時には電源電圧VDD
によりバイアスされたダイオードD1，D2を用いることに
よりレベルの変換を行っているため、IC1の電源電圧が
変動しても高レベルパルス信号は電源電圧VDDに応じた
レベルとされ、常にIC1の電圧保証レベルVDD＋0.3
〔Ｖ〕以内とすることができる。
によりバイアスされたダイオードD1，D2を用いることに
よりレベルの変換を行っているため、IC1の電源電圧が
変動しても高レベルパルス信号は電源電圧VDDに応じた
レベルとされ、常にIC1の電圧保証レベルVDD＋0.3
〔Ｖ〕以内とすることができる。
なお、本実施例ではスイッチング素子としてダイオード
を用いたがこれに限ることはなく、ダイオード的なスイ
ッチング動作を行なう素子であればよい。
を用いたがこれに限ることはなく、ダイオード的なスイ
ッチング動作を行なう素子であればよい。
考案の効果 上述の如く、本考案によれば、入力パルス信号の入力さ
れる回路の入力保証レベルである所定のレベルが変動し
ても第２のスイッチング素子は所定のレベルの信号によ
りバイアスされ、所定のレベルの信号に応じて入力パル
ス信号のレベルを制限するため、入力パルス信号は入力
パルス信号が供給される回路の入力保証レベルを越える
ことがなく、回路を破損してしまうことがなく、また、
第１のスイッチング素子により入力パルス信号が所定の
レベル以下の一定レベル以下となったときには入力パル
ス信号がキャンセルされ、零レベルとなり、入力パルス
信号レベルを入力パルス信号が供給される回路の下限レ
ベル以下にすることができるため、入力パルス信号が供
給される回路を確実に動作させることができる等の特長
を有する。
れる回路の入力保証レベルである所定のレベルが変動し
ても第２のスイッチング素子は所定のレベルの信号によ
りバイアスされ、所定のレベルの信号に応じて入力パル
ス信号のレベルを制限するため、入力パルス信号は入力
パルス信号が供給される回路の入力保証レベルを越える
ことがなく、回路を破損してしまうことがなく、また、
第１のスイッチング素子により入力パルス信号が所定の
レベル以下の一定レベル以下となったときには入力パル
ス信号がキャンセルされ、零レベルとなり、入力パルス
信号レベルを入力パルス信号が供給される回路の下限レ
ベル以下にすることができるため、入力パルス信号が供
給される回路を確実に動作させることができる等の特長
を有する。
第１図は本考案の一実施例の回路図、第２図は従来の一
例の回路図、第３図は本考案の一実施例及び従来の一例
の動作を説明するための波形図である。 １…集積回路（IC）、R1…保護・分圧用抵抗、R2…分圧
・放電用抵抗、R3…充・放電用抵抗、C1…時定数用コン
デンサ、D1…電圧クリップ用ダイオード、D2…レベルシ
フト用ダイオード、ZD1…低レベル入力キャンセル用ツ
ェナーダイオード。
例の回路図、第３図は本考案の一実施例及び従来の一例
の動作を説明するための波形図である。 １…集積回路（IC）、R1…保護・分圧用抵抗、R2…分圧
・放電用抵抗、R3…充・放電用抵抗、C1…時定数用コン
デンサ、D1…電圧クリップ用ダイオード、D2…レベルシ
フト用ダイオード、ZD1…低レベル入力キャンセル用ツ
ェナーダイオード。
Claims (1)
- 【請求項１】入力パルス信号のレベルを電源の電圧によ
って入力可能な上限レベルが決まる回路に該上限レベル
内になるように変換して入力するパルス入力回路におい
て、 前記入力パルス信号の供給ラインに直列に接続され、前
記入力パルス信号のレベルに応じてオン・オフし、前記
入力パルス信号のレベルが前記上限レベル以下の一定レ
ベル以下となったときにオフとなり前記入力パルス信号
の供給を停止する第１のスイッチング素子と、 前記入力パルス信号の供給ラインと前記電源との間に設
けられ前記電源電圧によりバイアスされ、前記入力パル
ス信号のレベルに応じてオン・オフし、前記入力パルス
信号のレベルが前記電源の電圧以上となったときにオン
となり前記入力パルス信号の供給ラインと前記電源とを
接続して前記入力パルス信号のレベルを前記電源の電圧
以下に制限することにより前記回路に入力可能な上限レ
ベル以下に制限する第２のスイッチング素子とを具備
し、前記第１及び第２のスイッチング素子により前記入
力パルス信号を前記入力パルス信号が供給される回路の
入力範囲に適応させる構成としてなるパルス入力回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11602789U JPH0729710Y2 (ja) | 1989-10-02 | 1989-10-02 | パルス入力回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11602789U JPH0729710Y2 (ja) | 1989-10-02 | 1989-10-02 | パルス入力回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0354330U JPH0354330U (ja) | 1991-05-27 |
| JPH0729710Y2 true JPH0729710Y2 (ja) | 1995-07-05 |
Family
ID=31664334
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11602789U Expired - Fee Related JPH0729710Y2 (ja) | 1989-10-02 | 1989-10-02 | パルス入力回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0729710Y2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| USD805232S1 (en) | 2016-06-08 | 2017-12-12 | Humanscale Corporation | Lamp |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2001052644A1 (en) * | 2000-01-20 | 2001-07-26 | Kantaro Yamamoto | Floating head eye |
-
1989
- 1989-10-02 JP JP11602789U patent/JPH0729710Y2/ja not_active Expired - Fee Related
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| USD805232S1 (en) | 2016-06-08 | 2017-12-12 | Humanscale Corporation | Lamp |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0354330U (ja) | 1991-05-27 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |