JPH075071U - プログラマブル抵抗負荷回路 - Google Patents

プログラマブル抵抗負荷回路

Info

Publication number
JPH075071U
JPH075071U JP3826293U JP3826293U JPH075071U JP H075071 U JPH075071 U JP H075071U JP 3826293 U JP3826293 U JP 3826293U JP 3826293 U JP3826293 U JP 3826293U JP H075071 U JPH075071 U JP H075071U
Authority
JP
Japan
Prior art keywords
programmable
converter
multiplier
vin
load
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP3826293U
Other languages
English (en)
Other versions
JP2581118Y2 (ja
Inventor
正和 安東
純一 関
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Advantest Corp
Original Assignee
Advantest Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Advantest Corp filed Critical Advantest Corp
Priority to JP3826293U priority Critical patent/JP2581118Y2/ja
Publication of JPH075071U publication Critical patent/JPH075071U/ja
Application granted granted Critical
Publication of JP2581118Y2 publication Critical patent/JP2581118Y2/ja
Anticipated expiration legal-status Critical
Expired - Fee Related legal-status Critical Current

Links

Landscapes

  • Measuring Instrument Details And Bridges, And Automatic Balancing Devices (AREA)
  • Tests Of Electronic Circuits (AREA)

Abstract

(57)【要約】 【目的】 ICテスタのDUTの抵抗負荷として、各信
号にそれぞれ外付け負荷抵抗を半田で取り付ける方法が
あるが、抵抗値変更には大きな工数がかかる。そこで、
プログラマブルな抵抗負荷を実現することが本考案の目
的である。 【構成】 DUTの出力Vinを乗算器とV/I変換器
に入力し、乗算器のもう一方の入力には、D/A変換器
を通してプログラマブルな電圧Yを接続し、乗算器の出
力をV/I変換器に接続することで、プログラマブルな
抵抗負荷を実現する。

Description

【考案の詳細な説明】
【0001】
【産業上の利用分野】
この考案は、ICテスタのDUTの負荷として、プログラマブル抵抗を提供す るプログラマブル抵抗負荷回路に関するものである。
【0002】
【従来の技術】
従来の抵抗負荷の提供は、図2(a)のように、各信号にそれぞれ外付け負荷 抵抗を半田で取り付ける方法があるが、プログラマブルでなく、抵抗値変更には 大きな工数がかかる。また、プログラマブルな方法として、図2(b)のように 、電流源負荷があるが、負荷が定電流であり、抵抗負荷とは動作が異なる。
【0003】
【考案が解決しようとする課題】
DUTの出力電圧に比例した電流を、DUT出力に印加することで、抵抗負荷 と等価な負荷となる。本考案の課題は、プログラマブルな抵抗負荷を実現するこ とである。
【0004】
【課題を解決するための手段】
DUTの出力Vinを乗算器1とV/I変換器3に入力し、乗算器のもう一方 の入力には、D/A変換器2を通してプログラマブルな電圧Yを接続し、乗算器 の出力をV/I変換器に接続することで、プログラマブルな抵抗負荷を実現する 。
【0005】
【作用】
上記の接続により Rin=Eref・Re/Y が得られ、Reを固定抵抗 とすることで、RinはプログラマブルなYで制御できる。
【0006】
【実施例】
(実施例1) 実施例を図1により説明する。まず、プログラマブルなD/A変換器2の出力 を乗算器1の一方の入力Yに接続する。乗算器のもう一方の入力Xには、DUT の出力Vinを接続する。乗算器は、出力 Eout=Vx・Vy/Eref を計算する。ここで、Erefはディメンジョンを合わせる定数で、普通は10 ボルトである。
【0007】 Eoutは、V/I変換器3に入力し、その回路を図1(b)とすると、 I=Vx・Vy/Eref・Re となる。ここで、Eref=10ボルト、Vx=Vin、Vy=Yであるので、 I=Vin・Y/10Re となる。
【0008】 次に、図1(a)より、 Rin=Vin/I I=Vin・Y/10Reを代入して、 Rin=Vin/(Vin・Y/10Re)=10Re/Y となる。つまり、Reが固定抵抗であるので、Yをプログラマブルとする事でR inがプログラマブルとなる。
【0009】 (実施例2) V/I変換器の別の一例として図3を示す。この場合、 I=−V/R2 =−X・Y/10R2 X=Vinだから I=−Vin・Y/10R2 となる。次に、図1(a)より、 Rin=Vin/I Iを代入して、 Rin=Vin/(−Vin・Y/10R2 )=−10R2 /Y となり、R2 が固定抵抗であるので、Yをプログラマブルとすることで、Rin がプログラマブルとなる。
【0010】
【考案の効果】
以上のように、乗算器とV/I変換器を使用することで、DUTの負荷抵抗R inをプログラマブルにすることができる。
【図面の簡単な説明】
【図1】実施例1の回路図である。
【図2】従来の回路図である。
【図3】実施例2のV/I変換器の回路図である。
【符号の説明】
1 乗算器 2 D/A変換器 3 V/I変換器

Claims (1)

    【実用新案登録請求の範囲】
  1. 【請求項】 ICテスタのDUT負荷をプログラマブル
    抵抗で提供する方法として、乗算器(1)と、V/I変
    換器(3)で構成し、乗算器にはDUT出力Vinと、
    プログラマブル入力Yを入力し、乗算器の出力をV/I
    変換器の入力に接続し、V/I変換器の出力をVinに
    接続した、プログラマブル抵抗負荷回路。
JP3826293U 1993-06-18 1993-06-18 プログラマブル抵抗負荷回路 Expired - Fee Related JP2581118Y2 (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP3826293U JP2581118Y2 (ja) 1993-06-18 1993-06-18 プログラマブル抵抗負荷回路

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP3826293U JP2581118Y2 (ja) 1993-06-18 1993-06-18 プログラマブル抵抗負荷回路

Publications (2)

Publication Number Publication Date
JPH075071U true JPH075071U (ja) 1995-01-24
JP2581118Y2 JP2581118Y2 (ja) 1998-09-21

Family

ID=12520414

Family Applications (1)

Application Number Title Priority Date Filing Date
JP3826293U Expired - Fee Related JP2581118Y2 (ja) 1993-06-18 1993-06-18 プログラマブル抵抗負荷回路

Country Status (1)

Country Link
JP (1) JP2581118Y2 (ja)

Also Published As

Publication number Publication date
JP2581118Y2 (ja) 1998-09-21

Similar Documents

Publication Publication Date Title
JPH0770935B2 (ja) 差動電流増幅回路
JPH075071U (ja) プログラマブル抵抗負荷回路
JPS6164724U (ja)
JPS616775U (ja) 電流−電圧変換回路
JPH086652A (ja) 電子負荷装置
JP2678669B2 (ja) 基準電圧入力回路
JPS595937Y2 (ja) 複合部品ネットワ−ク
JPS6118457Y2 (ja)
JPS5995708A (ja) 増幅回路
JPH087462Y2 (ja) 規準電源回路
JPS6065813U (ja) 可変電流源
JP2635185B2 (ja) 圧力検出装置
JPH03136349A (ja) 集積回路の製造方法
JPH0330828B2 (ja)
JPH02301213A (ja) ヒステリシス付きコンパレータ
JP2000151311A (ja) ゲイン制御装置
JPS63299506A (ja) 定電流ドライブ回路
JPH01117774U (ja)
JPS5984477U (ja) 輝度制御回路
JPH06259690A (ja) 受信計器用外部端子台
JPH04120121U (ja) レギユレータ出力回路
JPS5888414U (ja) ピ−ク検波回路
JPH0579482U (ja) Icソケット
JPS60624U (ja) 電子負荷装置
JPH0648235U (ja) 抵抗発生装置

Legal Events

Date Code Title Description
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 19980623

LAPS Cancellation because of no payment of annual fees