JPH0793319B2 - 電界効果トランジスタの製造方法 - Google Patents

電界効果トランジスタの製造方法

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JPH0793319B2
JPH0793319B2 JP59215135A JP21513584A JPH0793319B2 JP H0793319 B2 JPH0793319 B2 JP H0793319B2 JP 59215135 A JP59215135 A JP 59215135A JP 21513584 A JP21513584 A JP 21513584A JP H0793319 B2 JPH0793319 B2 JP H0793319B2
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effect transistor
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和秀 郷田
正博 萩尾
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松下電子工業株式会社
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    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10DINORGANIC ELECTRIC SEMICONDUCTOR DEVICES
    • H10D30/00Field-effect transistors [FET]
    • H10D30/80FETs having rectifying junction gate electrodes

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  • Electrodes Of Semiconductors (AREA)
  • Junction Field-Effect Transistors (AREA)

Description

【発明の詳細な説明】 (産業上の利用分野) 本発明はマイクロ波帯等で用いられる電界効果トランジ
スタ(FET)の製造方法に関するものである。
(従来例の構成とその問題点) GaAsFETの高周波、高速性能の向上にはソース抵抗の低
減がきわめて重要であり、このためにこれまでゲートを
セルフアラインで形成する様々な方法が提案されてき
た。
以下、図面を参照しながら従来のゲートをセルフアライ
ンで形成する製造方法の一例について説明する。
第2図は従来のゲートをセルフアラインで形成するため
の製造工程の一例を示すものである。半導体基板1上の
n層2の表面のゲート電極を形成すべき場所にSiO2など
の無機物の膜、いわゆるダミーゲート3を形成した後、
ダミーゲート3をマスクとしてイオン注入してn+層を形
成する。その上に有機物の膜としてレジスト5を塗布す
る(第2図(a))。このときダミーゲート3の上部の
レジスト5は若干薄くなる。
次にダミーゲート3の上部が露出するようにO2を用いた
プラズマエッチによりレジスト5をエッチングする(第
2図(b))。
次いで、SiO2で形成したダミーゲート3をウェットエッ
チし、Alなどの金属6を蒸着する(第2図(c))。そ
してレジスト5を除去するとレジスト5の上の金属6が
リフトオフされ、ゲート電極7が得られる(第2図
(d))。
しかしながら、上記のような方法ではダミーゲート3の
上部のレジスト5の厚さと半導体上のレジストの厚さと
の差が小さいため、ダミーゲート3の上部を露出するよ
うにエッチングするとリフトオフ用レジストスペーサー
が薄くなり金属6を厚く蒸着することができず、ゲート
抵抗が増大するという欠点を有していた。
(発明の目的) 本発明は上記欠点をなくすためになされたものであり、
ゲート電極を厚く形成することのできるFETの製造方法
を提供するものである。
(発明の構成) この目的を達成するために本発明のFETの製造方法は、
ゲート電極を形成すべき場所に無機物の膜が形成された
半導体基板上に、第1の有機物を塗布したのち200℃以
上の熱処理を行ない、次いで第1の有機物を薄くして前
記無機物の膜の上部を露出せしめる工程と、第2の有機
物を塗布したのち第2の有機物を薄くして無機物の膜の
上部を露出せしめる工程と、前記無機物の膜をエッチン
グ除去し、ゲート金属を蒸着したのち、前記第2の有機
物の上のゲート電極を第2の有機物とともに除去する工
程とを備えて構成されている。
(実施例の説明) 以下本発明の一実施例について図面を参照しながら説明
する。
第1図は本発明の電界効果トランジスタの製造方法によ
る製造工程を示すものである。
半導体基板11上のn層12の表面のゲート電極を形成すべ
き場所にSiO2などの無機物の膜、いわゆるダミーゲート
13を形成した後、ダミーゲート13をマスクとしてイオン
注入してn+層14を形成する。その上に有機物の膜として
第1のレジスト15を塗布する(第1図(a))。次に20
0℃以上で熱処理して第1のレジスト15を平坦化し、ダ
ミーゲート13の上部が露出するようにO2を用いたプラズ
マエッチにより第1のレジスト15をエッチングする(第
1図(b))。
このとき熱処理温度が高い程平坦化が充分に行なわれ、
例えばノボラック系の樹脂を用いたレジストでは300℃
が最適である。
次いでその上に第2の有機物の膜として第2のレジスト
16を形成し、ダミーゲート13の上部が露出するようにO2
を用いたプラズマエッチにより第2のレジスト16をエッ
チングする(第1図(c))。
その後、SiO2で形成したダミーゲート13をウェットエッ
チし、Alなどの金属17を蒸着する(第1図(d))。こ
の時、金属17は第1の有機物の層があるため厚く蒸着す
ることができる。そしてレジスト15,16を除去すると第
1のレジスト15の上の金属17がリフトオフされ、ゲート
電極18が得られる(第1図(e))。
(発明の効果) 以上のように本発明は半導体基板上に第1の有機物を塗
布したのち200℃以上の熱処理を行い、次いで第1の有
機物を薄くして無機物の膜の上部を露出せしめる工程
と、第2の有機物を塗布したのち第2の有機物を薄くし
て無機物の膜の上部を露出せしめる工程と、無機物の膜
をエッチング除去することによりゲート電極を厚く形成
でき、その実用的効果は大なるものがある。
【図面の簡単な説明】
第1図(a)〜(e)は本発明の製造工程図、第2図
(a)〜(d)は従来の製造工程図である。 1,11……半導体基板、2,21……n層、3,13……ダミーゲ
ート、4,14……n+層、5……レジスト、6,17……蒸着金
属、7,18……ゲート電極、15……第1のレジスト、16…
…第2のレジスト。

Claims (2)

    【特許請求の範囲】
  1. 【請求項1】ゲート電極を形成すべき場所に無機物の膜
    が形成された半導体基板上に、第1の有機物を塗布する
    工程と、 前記第1の有機物を薄くして前記無機物の膜の上部を露
    出せしめる工程と、 前記第1の有機物及び前記無機物の膜上に第2の有機物
    を塗布する工程と、 前記第2の有機物を薄くして前記無機物の膜の上部を露
    出せしめる工程と、 前記無機物の膜を除去する工程と、 前記ゲート電極となる金属膜を全面に蒸着する工程と、 前記第2の有機物上の前記金属膜を前記第2の有機物と
    ともに除去する工程と を備えたことを特徴とする電界効果トランジスタの製造
    方法。
  2. 【請求項2】第1の有機物を塗布した後、200℃以上の
    熱処理を行うことを特徴とする特許請求の範囲第1項記
    載の電界効果トランジスタの製造方法。
JP59215135A 1984-10-16 1984-10-16 電界効果トランジスタの製造方法 Expired - Lifetime JPH0793319B2 (ja)

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JPS59229876A (ja) * 1983-06-13 1984-12-24 Toshiba Corp シヨツトキ−ゲ−ト型電界効果トランジスタの製造方法

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