JPH07947Y2 - 電圧印加電流測定回路 - Google Patents
電圧印加電流測定回路Info
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- JPH07947Y2 JPH07947Y2 JP12275288U JP12275288U JPH07947Y2 JP H07947 Y2 JPH07947 Y2 JP H07947Y2 JP 12275288 U JP12275288 U JP 12275288U JP 12275288 U JP12275288 U JP 12275288U JP H07947 Y2 JPH07947 Y2 JP H07947Y2
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- voltage
- transistor
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- 238000005259 measurement Methods 0.000 title claims description 6
- 238000006243 chemical reaction Methods 0.000 claims description 4
- 238000010586 diagram Methods 0.000 description 4
- 238000000034 method Methods 0.000 description 3
- 230000003321 amplification Effects 0.000 description 1
- 238000003780 insertion Methods 0.000 description 1
- 230000037431 insertion Effects 0.000 description 1
- 238000003199 nucleic acid amplification method Methods 0.000 description 1
- 230000035945 sensitivity Effects 0.000 description 1
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- Measurement Of Current Or Voltage (AREA)
Description
【考案の詳細な説明】 〔産業上の利用分野〕 本考案は、負荷に設定電圧を印加して該負荷に流れる電
流を測定する電圧印加電流測定回路に関する。
流を測定する電圧印加電流測定回路に関する。
従来、負荷に設定電圧を印加して該負荷に流れる電流を
測る場合、一般に、いわゆるVFM （Voltage Forcing Me
asurement）の機能をもった電源を用いて測る方法か、
あるいは、直列に電流計を挿入して測るか、または、直
列に抵抗を挿入し、該抵抗の電圧降下を電圧計によって
測る簡便な方法が採られてきた。
測る場合、一般に、いわゆるVFM （Voltage Forcing Me
asurement）の機能をもった電源を用いて測る方法か、
あるいは、直列に電流計を挿入して測るか、または、直
列に抵抗を挿入し、該抵抗の電圧降下を電圧計によって
測る簡便な方法が採られてきた。
上記の直列に電流計あるいは抵抗を挿入して測る簡便な
方法では、設定電圧に対し、電流計の内部抵抗あるいは
挿入抵抗による電圧降下分の誤差が生ずるという問題が
あった。
方法では、設定電圧に対し、電流計の内部抵抗あるいは
挿入抵抗による電圧降下分の誤差が生ずるという問題が
あった。
一方、従来の設定電圧全域にわたる電圧を補償するVFM
の機能をもった電源を組込んだ測定回路は、回路構成が
複雑で、高価であるという問題があった。
の機能をもった電源を組込んだ測定回路は、回路構成が
複雑で、高価であるという問題があった。
本考案は上記の事情に鑑みてなされたもので、簡単な回
路構成で、誤差少なく測定できる回路を提供することを
目的とする。
路構成で、誤差少なく測定できる回路を提供することを
目的とする。
本考案の測定回路は、カレント・ミラー回路を用い、該
カレント・ミラー回路の一方のトランジスタのコレクタ
からの出力をオペアンプに負帰還することにより、該ト
ランジスタに順方向電流が流れた場合の電圧降下を補償
し、該カレント・ミラー回路の他方のトランジスタのコ
レクタに電流−電圧変換回路を接続し、設定電圧を上記
オプアンプの非反転入力端子に入力して上記カレント・
ミラー回路の上記一方のトランジスタのコレクタを経て
負荷に印加し、上記電流−電圧変換回路に現われる変換
電圧によって負荷に流れる電流を測定する構成としたも
のである。
カレント・ミラー回路の一方のトランジスタのコレクタ
からの出力をオペアンプに負帰還することにより、該ト
ランジスタに順方向電流が流れた場合の電圧降下を補償
し、該カレント・ミラー回路の他方のトランジスタのコ
レクタに電流−電圧変換回路を接続し、設定電圧を上記
オプアンプの非反転入力端子に入力して上記カレント・
ミラー回路の上記一方のトランジスタのコレクタを経て
負荷に印加し、上記電流−電圧変換回路に現われる変換
電圧によって負荷に流れる電流を測定する構成としたも
のである。
第１図は本考案の一実施例を示す回路図である。
図において１は電圧入力端子、２はオペアンプ3a,3bは
カレント・ミラー回路を構成するトランジスタQ1，Q2,4
は電圧出力端子、５はオペアンプ、６は抵抗R1、７は負
荷である。
カレント・ミラー回路を構成するトランジスタQ1，Q2,4
は電圧出力端子、５はオペアンプ、６は抵抗R1、７は負
荷である。
電圧入力端子１に設定電圧V1を印加すると、この電圧が
オペアンプ２の出力端子、トランジスタQ1を経て電圧出
力端子４に電圧V3として出力される。トランジスタQ1は
ダイオード接続になっているため、V3はV1に対してダイ
オードの順方向電圧分降下する。これを補償するため
に、トランジスタQ1の出力がオペアンプ２に負帰還され
ており、V1＝V3となり、負荷７に設定電圧V1が途中で電
圧降下することなく印加される。
オペアンプ２の出力端子、トランジスタQ1を経て電圧出
力端子４に電圧V3として出力される。トランジスタQ1は
ダイオード接続になっているため、V3はV1に対してダイ
オードの順方向電圧分降下する。これを補償するため
に、トランジスタQ1の出力がオペアンプ２に負帰還され
ており、V1＝V3となり、負荷７に設定電圧V1が途中で電
圧降下することなく印加される。
トランジスタQ1とQ2がカレント・ミラー回路を構成して
いるため、トランジスタQ1に流れる電流I1とトランジス
タQ2に流れる電流I2の間には、トランジスタQ1，Q2の直
流増幅率をHFEとすると、 の関係が成立し、HFEが充分大きいと、I2がI1に殆ど等
しくなる。
いるため、トランジスタQ1に流れる電流I1とトランジス
タQ2に流れる電流I2の間には、トランジスタQ1，Q2の直
流増幅率をHFEとすると、 の関係が成立し、HFEが充分大きいと、I2がI1に殆ど等
しくなる。
この電流I2をオペアンプ５と抵抗R1が構成する電流−電
圧変換回路で電圧に変換したV4（＝−I2R）を測ること
で、負荷７を流れる電流値を得る。
圧変換回路で電圧に変換したV4（＝−I2R）を測ること
で、負荷７を流れる電流値を得る。
以上のように、負荷７に設定電圧を印加し、負荷７を流
れる電流I1と殆んど等しい電流I2を電圧に変換して測る
構成のため、誤差の少ない測定ができる。
れる電流I1と殆んど等しい電流I2を電圧に変換して測る
構成のため、誤差の少ない測定ができる。
第２図、第３図はそれぞれ本考案の他の実施例を示す回
路図である。
路図である。
図において1,2,3a,3b,4,5,6,7は第１図の同一符号と同
一または相当するものを示し、8,9はトランジスタQ3，Q
4、10は抵抗R2である。
一または相当するものを示し、8,9はトランジスタQ3，Q
4、10は抵抗R2である。
第２図に示すものは、基本動作は第１図に示す実施例と
同じで、電流I1と電流I2の近似性をより高めるために、
トランジスタQ3を追加したものである。この場合、電流
I1とI2の関係は となる。
同じで、電流I1と電流I2の近似性をより高めるために、
トランジスタQ3を追加したものである。この場合、電流
I1とI2の関係は となる。
第３図に示すものは、負荷７に流れる電流が比較的に大
きい場合、オプアンプ２の出力電流の不足を補償するた
めに、トランジスタQ4を追加し、さらに、ミラー電流I2
を小さくするために、抵抗R2を挿入したもので、電流I1
に対し電流I2は で表わす電流に抑えられる。
きい場合、オプアンプ２の出力電流の不足を補償するた
めに、トランジスタQ4を追加し、さらに、ミラー電流I2
を小さくするために、抵抗R2を挿入したもので、電流I1
に対し電流I2は で表わす電流に抑えられる。
ここでK:ボルツマンの定数、T:絶対温度、q:電子の電荷
量、 この場合、抵抗R2を大きくすれば、電流計としての感度
が低下することがない。
量、 この場合、抵抗R2を大きくすれば、電流計としての感度
が低下することがない。
上記には各トランジスタがPNPのものを示したが、NPNト
ランジスタにしてもよい。
ランジスタにしてもよい。
また、オペアンプ２の入力バイアス電流は、FET入力のB
i−FETタイプを使用すれば、カレント・ミラー回路に与
える影響は無視できる。
i−FETタイプを使用すれば、カレント・ミラー回路に与
える影響は無視できる。
以上説明したとおり、本考案によれば、簡単な回路構成
によって、抵抗などによる電圧降下がもたらす誤差を含
むまない値が得られるという効果がある。
によって、抵抗などによる電圧降下がもたらす誤差を含
むまない値が得られるという効果がある。
第１図は本考案の一実施例を示す回路図、第２図、第３
図はそれぞれ本考案の他の実施例を示す回路図である。 １……電圧入力端子、２……オペアンプ、3a,3b,8,9…
…トランジスタ、４……電圧出力端子、５……オペアン
プ、6,10……抵抗、７……負荷、 なお図中同一符号は同一または相当するものを示す。
図はそれぞれ本考案の他の実施例を示す回路図である。 １……電圧入力端子、２……オペアンプ、3a,3b,8,9…
…トランジスタ、４……電圧出力端子、５……オペアン
プ、6,10……抵抗、７……負荷、 なお図中同一符号は同一または相当するものを示す。
Claims (1)
- 【請求項１】負荷に設定電圧を印加して該負荷に流れる
電流を測定する電圧印加電流測定回路において、第１の
オペアンプの非反転入力端子に上記設定電圧を接続し、
該オペアンプの出力端子からダイオード接続した第１の
トランジスタを経て一端を接地した上記負荷に電流を流
すよう構成した電流回路、 上記第１のトランジスタと上記負荷との接続点の電圧を
上記第１のオペアンプの反転入力端子に接続し、上記負
荷に加えられる電圧がほぼ等しくなるよう制御するフィ
ードバック回路、 上記第１のトランジスタに対するカレントミラーを構成
し、上記第１のトランジスタに流れる電流とほぼ同一の
電流が流れる第２のトランジスタ、 第２のオペアンプの反転入力端子に上記第２のトランジ
スタの電流出力端子を接続し、該第２のオペアンプの非
反転入力端子を接地し、該第２のオペアンプの出力端子
と上記反転入力端子との間に所定抵抗値の抵抗を接続し
て構成した電流電圧変換回路を備えたことを特徴とする
電圧印加電流測定回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12275288U JPH07947Y2 (ja) | 1988-09-21 | 1988-09-21 | 電圧印加電流測定回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12275288U JPH07947Y2 (ja) | 1988-09-21 | 1988-09-21 | 電圧印加電流測定回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0245468U JPH0245468U (ja) | 1990-03-28 |
| JPH07947Y2 true JPH07947Y2 (ja) | 1995-01-11 |
Family
ID=31370976
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12275288U Expired - Lifetime JPH07947Y2 (ja) | 1988-09-21 | 1988-09-21 | 電圧印加電流測定回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH07947Y2 (ja) |
-
1988
- 1988-09-21 JP JP12275288U patent/JPH07947Y2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0245468U (ja) | 1990-03-28 |
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