JPH0824287B2 - データ伝送方式 - Google Patents

データ伝送方式

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JPH0824287B2
JPH0824287B2 JP1083897A JP8389789A JPH0824287B2 JP H0824287 B2 JPH0824287 B2 JP H0824287B2 JP 1083897 A JP1083897 A JP 1083897A JP 8389789 A JP8389789 A JP 8389789A JP H0824287 B2 JPH0824287 B2 JP H0824287B2
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data transmission
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JP1083897A
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恭子 三上
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NEC Corp
Original Assignee
NEC Corp
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Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明はデータを伝送方式に関し、特にデータの伝送
におけるフレームパルスとデータとをシリアルに伝送す
る伝送方式に関するものである。
〔従来の技術〕
従来、この種のデータを伝送方式としては、データと
フレームパルスとを別線で送る方法もしくはCMIコード
を用い、CMI符号バイオレーシヨンを用いてフレームパ
ルスを重畳する方式がある。
〔発明が解決しようとする課題〕
前述した従来のデータ伝送方式は、別線送り方法では
データとフレームパルスとを送るための配線が２本必要
であり、CMI符号を用いる方法ではブロツク同期をとる
ための回路が複雑となるという課題があつた。
〔課題を解決するための手段〕
このような課題を解決するために本発明のデータ伝送
方式は、フレームパルスを符号「11」、情報「０」を符
号「00」、および情報「１」を符号「10」または「01」
からなる２ビットの符号にそれぞれ置換してデータ列を
送受信するとともに、受信したデータ列のうち隣接する
ビット間の論理積出力によりフレームパルスを検出する
ようにしたものである。
また、受信したデータ列を１ビット分遅延させる遅延
手段を設け、この遅延手段からの出力とデータ列との論
理積出力によりフレームパルスを検出するようにしたも
のである。
〔作用〕
本発明においては、フレームパルス重畳部分のみ
「１」が２個連続しているので、アンド操作で少なくと
も１ビツトの「１」が出力される。
〔実施例〕
次に本発明について図面を参照して説明する。
第１図は本発明によるデータ伝送方式の一実施例を説
明するための送受信機のブロツク図である。同図におい
て、１は送信情報が印加される入力端子、２は例えばエ
ンコーダ機能を有している送信機、３は送信出力データ
が得られる出力端子である。また、11はＤフリツプフロ
ツプ12およびアンドゲート13を有する受信機、14は前記
送信出力データが印加される入力端子、15は受信出力デ
ータが得られる出力端子、16はＤフリツプフロツプ12を
駆動させるクロツクパルスCKが図示しない装置から印加
されるクロツクパルス入力端子である。
このような構成において、送信機２の入力端子１に第
２図（ａ）に示すような送信情報、例えばフレームパル
スPf,情報「１」，情報「１」，情報「０」が順次シリ
アルに入力されると、その出力端子３には同図（ｃ）に
示すようにフレームパルスPfに対して符号「11」，情報
「１」に対して符号「10」，情報「０」に対して符号
「00」とするデータ列「11101000……」が出力される。
このデータ列「11101000……」は受信機11の入力端子
14にシリアルに入力されると、Ｄフリツプフロツプ12の
Ｄ入力端に入力され同図（ｂ）に示すクロツクパルスの
立ち上りタイミングに同期して取り込まれ、この入力デ
ータ列が同図（ｄ）に示すように遅延時間ｔだけ遅延さ
れてＱ出力端に出力される。そしてアンドゲート13によ
りＱ出力と入力データ列とのアンド操作を行なうと、同
図（ｅ）に示すようにその論理積出力が送出されるの
で、フレームパルスPfに対応する部分のみが信号として
出力される。したがつてフレームパルスPfのみを検出す
ることができる。
なお、前述した実施例において、情報「１」の符号と
して「10」の代りに「01」を割り当てても同様の効果が
得られることは明白である。
〔発明の効果〕
以上説明したように本発明によれば、データとフレー
ムパルスとを伝送するための配線が１本で済み、またCM
I符号を用いる方法と比較すると、CMI符号のブロツク同
期が不要となり、回路が簡単化できるという極めて優れ
た効果が得られる。
【図面の簡単な説明】
第１図は本発明によるデータ伝送方式の一実施例を説明
するための送受信機のブロツク図、第２図（ａ）〜
（ｅ）はその動作を説明するタイミング図。 １……入力端子、２……送信機、３……出力端子、11…
…受信機、12……Ｄフリツプフロツプ、13……アンドゲ
ート、14……入力端子、15……出力端子、16……クロツ
クパルス入力端子。

Claims (2)

    【特許請求の範囲】
  1. 【請求項１】所望の情報に所定のフレームを識別するた
    めのフレームパルスを重畳してシリアル伝送するデータ
    伝送方式において、 フレームパルスを符号「11」、情報「０」を符号「0
    0」、および情報「１」を符号「10」または「01」から
    なる２ビットの符号にそれぞれ置換してデータ列を送受
    信するとともに、 受信した前記データ列のうち隣接するビット間の論理積
    出力によりフレームパルスを検出することを特徴とする
    データ伝送方式。
  2. 【請求項２】請求項１記載のデータ伝送方式において、 受信した前記データ列を１ビット分遅延させる遅延手段
    を設け、 この遅延手段からの出力と前記データ列との論理積出力
    によりフレームパルスを検出することを特徴とするデー
    タ伝送方式。
JP1083897A 1989-04-04 1989-04-04 データ伝送方式 Expired - Lifetime JPH0824287B2 (ja)

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JPH02264533A JPH02264533A (ja) 1990-10-29
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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5460814A (en) * 1977-10-25 1979-05-16 Nippon Telegr & Teleph Corp <Ntt> Timing circuit of dipulse system

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JPH02264533A (ja) 1990-10-29

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