JPH09121122A - 信号発生方法 - Google Patents
信号発生方法Info
- Publication number
- JPH09121122A JPH09121122A JP15484296A JP15484296A JPH09121122A JP H09121122 A JPH09121122 A JP H09121122A JP 15484296 A JP15484296 A JP 15484296A JP 15484296 A JP15484296 A JP 15484296A JP H09121122 A JPH09121122 A JP H09121122A
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- Japan
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- frequency
- address
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Abstract
(57)【要約】
【課題】 回路規模を増大させることなく、周波数精度
の向上を図れる信号発生方法を提供する。 【解決手段】 波形データを波形ＲＯＭに記憶させ、こ
の波形ＲＯＭにアドレスを与えて、波形を発生させる。
波形ＲＯＭ対するアドレスは、値Ｎに基づいて歩進させ
いくと共に、値Ｌを累積し、値Ｌが所定の値に達した
ら、アドレス（Ｎ＋１）に基づいて変化させる。これに
より、回路規模が増大せずに、精度の向上が図れる。
の向上を図れる信号発生方法を提供する。 【解決手段】 波形データを波形ＲＯＭに記憶させ、こ
の波形ＲＯＭにアドレスを与えて、波形を発生させる。
波形ＲＯＭ対するアドレスは、値Ｎに基づいて歩進させ
いくと共に、値Ｌを累積し、値Ｌが所定の値に達した
ら、アドレス（Ｎ＋１）に基づいて変化させる。これに
より、回路規模が増大せずに、精度の向上が図れる。
Description
【０００１】
【発明の属する技術分野】この発明は、特に、設定デー
タに応じて発振周波数が制御される数値制御型発振器に
用いて好適な信号発生方法に関する。
タに応じて発振周波数が制御される数値制御型発振器に
用いて好適な信号発生方法に関する。
【０００２】
【従来の技術】数値制御型発振器は、設定データに応じ
て発振周波数が制御される発振器である。このような数
値制御型発振器は、例えば通信衛星を介して送られてき
た信号の搬送波に同期した信号を形成する場合に用いら
れる。
て発振周波数が制御される発振器である。このような数
値制御型発振器は、例えば通信衛星を介して送られてき
た信号の搬送波に同期した信号を形成する場合に用いら
れる。
【０００３】つまり、図３において、アンテナ４１で通
信衛星からの電波が受信される。この通信衛星から送ら
れてくる信号は、ドップラー効果により、その搬送波周
波数が変動することがある。この受信信号は、アンテナ
４１の近傍に配設されたコンバータ４２で所定周波数に
変換される。そして、このコンバータ４２からの信号が
ダウンコンバータ４３に供給される。ダウンコンバータ
４３でこの信号が数ＭＨｚの所定周波数の中間周波信号
に変換される。
信衛星からの電波が受信される。この通信衛星から送ら
れてくる信号は、ドップラー効果により、その搬送波周
波数が変動することがある。この受信信号は、アンテナ
４１の近傍に配設されたコンバータ４２で所定周波数に
変換される。そして、このコンバータ４２からの信号が
ダウンコンバータ４３に供給される。ダウンコンバータ
４３でこの信号が数ＭＨｚの所定周波数の中間周波信号
に変換される。
【０００４】ダウンコンバータ４３の出力が位相比較回
路４４に供給される。また、数値制御型発振器４５の出
力が位相比較回路４４に供給される。位相比較回路４４
で、ダウンコンバータ４３からの搬送波と数値制御型発
振器４５の出力信号との位相比較がなされ、この位相比
較出力がローパスフィルタ４６を介してＡ／Ｄコンバー
タ４７に供給される。Ａ／Ｄコンバータ４７の出力が数
値制御型発振器４５に供給される。このＡ／Ｄコンバー
タ４７の出力データに応じて、数値制御型発振器４５の
発振周波数が制御される。これにより、数値制御型発振
器４５からは、搬送波周波数に同期した信号を得ること
ができる。
路４４に供給される。また、数値制御型発振器４５の出
力が位相比較回路４４に供給される。位相比較回路４４
で、ダウンコンバータ４３からの搬送波と数値制御型発
振器４５の出力信号との位相比較がなされ、この位相比
較出力がローパスフィルタ４６を介してＡ／Ｄコンバー
タ４７に供給される。Ａ／Ｄコンバータ４７の出力が数
値制御型発振器４５に供給される。このＡ／Ｄコンバー
タ４７の出力データに応じて、数値制御型発振器４５の
発振周波数が制御される。これにより、数値制御型発振
器４５からは、搬送波周波数に同期した信号を得ること
ができる。
【０００５】図４は、このようなＰＬＬ回路に用いられ
る従来の数値制御型発振器の構成を示すものである。
る従来の数値制御型発振器の構成を示すものである。
【０００６】図４において、５１は周波数を設定するた
めのコントローラである。コントローラ５１には、周波
数設定値Ｎが与えられる。この周波数設定値Ｎが周波数
設定レジスタ５２に供給される。
めのコントローラである。コントローラ５１には、周波
数設定値Ｎが与えられる。この周波数設定値Ｎが周波数
設定レジスタ５２に供給される。
【０００７】周波数設定レジスタ５２の出力が加算器５
３に供給される。加算器５３の出力がアドレスレジスタ
５４に供給される。アドレスレジスタ５４の出力が加算
器５３に供給される。
３に供給される。加算器５３の出力がアドレスレジスタ
５４に供給される。アドレスレジスタ５４の出力が加算
器５３に供給される。
【０００８】アドレスレジスタ５４には、クロック発生
回路５５から周波数ＦC のクロックが供給される。加算
器５３及びアドレスレジスタ５４で、周波数設定レジス
タ５２の出力が順次累積される。
回路５５から周波数ＦC のクロックが供給される。加算
器５３及びアドレスレジスタ５４で、周波数設定レジス
タ５２の出力が順次累積される。
【０００９】アドレスレジスタ５４の出力が波形発生Ｒ
ＯＭ５６のアドレスに供給される。波形発生ＲＯＭ５６
には、例えば２i のアドレスに対して１周期分の波形デ
ータが蓄えられる。
ＯＭ５６のアドレスに供給される。波形発生ＲＯＭ５６
には、例えば２i のアドレスに対して１周期分の波形デ
ータが蓄えられる。
【００１０】波形発生ＲＯＭ５６からは、アドレスレジ
スタ５４からのアドレスに従って、波形データが出力さ
れる。この波形発生ＲＯＭ５６の出力がＤ／Ａコンバー
タ５７に供給される。Ｄ／Ａコンバータ５７で、波形整
形ＲＯＭ５６からの波形データがアナログ波形に変換さ
れる。このアナログ波形が出力端子５８から出力され
る。
スタ５４からのアドレスに従って、波形データが出力さ
れる。この波形発生ＲＯＭ５６の出力がＤ／Ａコンバー
タ５７に供給される。Ｄ／Ａコンバータ５７で、波形整
形ＲＯＭ５６からの波形データがアナログ波形に変換さ
れる。このアナログ波形が出力端子５８から出力され
る。
【００１１】周波数設定値がＮの時には、アドレスレジ
スタ５４から発生されるアドレスＡk は、加算器５３及
びアドレスレジスタ５４により、周波数設定値Ｎ毎にク
ロックＦc で、進められる。アドレスＡk が２i まで進
められると１周期分の信号が発生されるので、アドレス
Ａk が２i まで進められる時間が出力端子５８から出力
される発振出力の周期に対応する。この周期Ｔnco は、
スタ５４から発生されるアドレスＡk は、加算器５３及
びアドレスレジスタ５４により、周波数設定値Ｎ毎にク
ロックＦc で、進められる。アドレスＡk が２i まで進
められると１周期分の信号が発生されるので、アドレス
Ａk が２i まで進められる時間が出力端子５８から出力
される発振出力の周期に対応する。この周期Ｔnco は、
【数１】 となる。
【００１２】したがって、発振周波数ＦNCO は、 ＦNCO ＝Ｆc （Ｎ／２i ） となる。故に、従来の数値制御型発振器の周波数精度△
ＦNCO は、 △ＦNCO ＝Ｆc ×（１／２i ） となる。
ＦNCO は、 △ＦNCO ＝Ｆc ×（１／２i ） となる。
【００１３】
【発明が解決しようとする課題】このように、従来の数
値制御型発振器では、発振周波数の精度が △ＦNCO ＝Ｆc ×（１／２i ） となる。上式より、発振周波精度を向上させるために
は、クロックの発振周波数Ｆc を高くするか、アドレス
のビット数ｉを増加させれば良いことになる。
値制御型発振器では、発振周波数の精度が △ＦNCO ＝Ｆc ×（１／２i ） となる。上式より、発振周波精度を向上させるために
は、クロックの発振周波数Ｆc を高くするか、アドレス
のビット数ｉを増加させれば良いことになる。
【００１４】ところが、クロックの周波数Ｆc を高くす
ると、設定値Ｎを高速で累積しなければならなくなり、
加算器５３での遅延時間を短くしなければならなくな
る。ところが、加算器５３の遅延時間の短縮には、限界
がある。また、アドレスのビット数ｉを増加させると、
これに伴って回路が増大する。
ると、設定値Ｎを高速で累積しなければならなくなり、
加算器５３での遅延時間を短くしなければならなくな
る。ところが、加算器５３の遅延時間の短縮には、限界
がある。また、アドレスのビット数ｉを増加させると、
これに伴って回路が増大する。
【００１５】したがって、この発明の目的は、回路規模
を増大させることなく、周波数精度の向上を図れる信号
発生方法を提供することにある。
を増大させることなく、周波数精度の向上を図れる信号
発生方法を提供することにある。
【００１６】
【課題を解決するための手段】この発明は、波形データ
が記憶されたメモリにアドレス信号を与えて波形を発生
させるようにした信号発生方法において、メモリに対す
るアドレスは、第１の値を歩進させて形成されると共
に、第２の値を累積し、第２の値が所定値になったら、
上記アドレスを所定数変化させるようにしたことを特徴
とする信号発生方法である。
が記憶されたメモリにアドレス信号を与えて波形を発生
させるようにした信号発生方法において、メモリに対す
るアドレスは、第１の値を歩進させて形成されると共
に、第２の値を累積し、第２の値が所定値になったら、
上記アドレスを所定数変化させるようにしたことを特徴
とする信号発生方法である。
【００１７】周波数設定値Ｌを累積し、この累積値Ｂが
所定の値Ｂmax 以上に達したら、周波数設定値Ｎを（Ｎ
＋１）にする処理を実行するコントローラ１が配設され
る。このため、周波数精度を高く設定できる。
所定の値Ｂmax 以上に達したら、周波数設定値Ｎを（Ｎ
＋１）にする処理を実行するコントローラ１が配設され
る。このため、周波数精度を高く設定できる。
【００１８】
【発明の実施の形態】以下、この発明の一実施例につい
て図面を参照して説明する。図１は、この発明の一実施
例を示すものである。図１において、１は周波数を設定
するためのコントローラである。コントローラ１には、
周波数設定値Ｎ及びＬが与えられる。周波数設定値Ｎ
は、主たる発振周波数を設定するためのものである。周
波数設定値Ｌは、高精度の発振周波数を設定するための
ものである。周波数設定値Ｎは、周波数設定レジスタ２
に供給される。
て図面を参照して説明する。図１は、この発明の一実施
例を示すものである。図１において、１は周波数を設定
するためのコントローラである。コントローラ１には、
周波数設定値Ｎ及びＬが与えられる。周波数設定値Ｎ
は、主たる発振周波数を設定するためのものである。周
波数設定値Ｌは、高精度の発振周波数を設定するための
ものである。周波数設定値Ｎは、周波数設定レジスタ２
に供給される。
【００１９】コントローラ１には、Ｍ分周器９から割り
込み信号が与えられると、周波数設定値Ｌを累積し、こ
の累積値が所定の値に達したら、周波数設定値Ｎを（Ｎ
＋１）に設定する制御プログラムが設けられる。
込み信号が与えられると、周波数設定値Ｌを累積し、こ
の累積値が所定の値に達したら、周波数設定値Ｎを（Ｎ
＋１）に設定する制御プログラムが設けられる。
【００２０】すなわち、クロック発生回路５からは、周
波数ＦC のクロックが発生される。このクロックがＭ分
周器９を介してコントローラ１の割り込み端子に供給さ
れる。この信号がコントローラ１の割り込み端子に供給
されると、コントローラ１は、図２に示すような割り込
み処理を実行する。
波数ＦC のクロックが発生される。このクロックがＭ分
周器９を介してコントローラ１の割り込み端子に供給さ
れる。この信号がコントローラ１の割り込み端子に供給
されると、コントローラ１は、図２に示すような割り込
み処理を実行する。
【００２１】つまり、図２において、周波数設定値Ｌが
これまでの累積値Ｂと加算され、新たな累積値Ｂが求め
られる（ステップ１１）。なお、累積値Ｂは、初期状態
では０に設定される。
これまでの累積値Ｂと加算され、新たな累積値Ｂが求め
られる（ステップ１１）。なお、累積値Ｂは、初期状態
では０に設定される。
【００２２】求められた累積値Ｂが所定の最大値Ｂmax
に達したかどうかが判断される（ステップ１２）。
に達したかどうかが判断される（ステップ１２）。
【００２３】累積値Ｂが最大値Ｂmax 以下なら、周波数
設定レジスタ２に設定される周波数設定値がＮとされ
る。そして、通常処理ルーチンに復帰される。
設定レジスタ２に設定される周波数設定値がＮとされ
る。そして、通常処理ルーチンに復帰される。
【００２４】累積値Ｂが最大値Ｂmax 以上なら、累積値
Ｂから最大値Ｂmax が減算され、この値（Ｂ−Ｂmax ）
が新たな累積値Ｂとされる（ステップ１４）。
Ｂから最大値Ｂmax が減算され、この値（Ｂ−Ｂmax ）
が新たな累積値Ｂとされる（ステップ１４）。
【００２５】そして、周波数設定レジスタ２に設定され
る周波数設定値が（Ｎ＋１）とされ、通常処理ルーチン
に復帰される。
る周波数設定値が（Ｎ＋１）とされ、通常処理ルーチン
に復帰される。
【００２６】図１において、周波数設定レジスタ２の出
力が加算器３に供給される。加算器３の出力がアドレス
レジスタ４に供給される。アドレスレジスタ４の出力が
加算器３に供給される。
力が加算器３に供給される。加算器３の出力がアドレス
レジスタ４に供給される。アドレスレジスタ４の出力が
加算器３に供給される。
【００２７】アドレスレジスタ４には、クロック発生回
路５から周波数ＦC のクロックが供給される。加算器３
及びアドレスレジスタ４で、周波数設定レジスタ２の出
力が順次累積される。
路５から周波数ＦC のクロックが供給される。加算器３
及びアドレスレジスタ４で、周波数設定レジスタ２の出
力が順次累積される。
【００２８】アドレスレジスタ４の出力が波形発生ＲＯ
Ｍ６のアドレスに供給される。波形発生ＲＯＭ６には、
例えば２i のアドレスに対して１周期分の波形データが
蓄えられる。
Ｍ６のアドレスに供給される。波形発生ＲＯＭ６には、
例えば２i のアドレスに対して１周期分の波形データが
蓄えられる。
【００２９】波形発生ＲＯＭ６からは、アドレスレジス
タ４からのアドレスに従って、波形データが出力され
る。この波形発生ＲＯＭ６の出力がＤ／Ａコンバータ７
に供給される。Ｄ／Ａコンバータ７で、波形発生ＲＯＭ
６からの波形データがアナログ波形に変換される。この
アナログ波形が出力端子８から出力される。
タ４からのアドレスに従って、波形データが出力され
る。この波形発生ＲＯＭ６の出力がＤ／Ａコンバータ７
に供給される。Ｄ／Ａコンバータ７で、波形発生ＲＯＭ
６からの波形データがアナログ波形に変換される。この
アナログ波形が出力端子８から出力される。
【００３０】この発明の一実施例では、このように、Ｍ
分周器９からの出力毎に周波数設定値Ｌを累積し、この
累積値Ｂが所定の値Ｂmax に達したら、周波数設定値を
（Ｎ＋１）にするプログラムが設けられたコントローラ
１が配設される。このため、周波数精度を高く設定でき
る。
分周器９からの出力毎に周波数設定値Ｌを累積し、この
累積値Ｂが所定の値Ｂmax に達したら、周波数設定値を
（Ｎ＋１）にするプログラムが設けられたコントローラ
１が配設される。このため、周波数精度を高く設定でき
る。
【００３１】つまり、アドレスレジスタ４から発生され
るアドレスＡk は、加算器３及びアドレスレジスタ４に
より、周波数設定値Ｎ毎にクロックＦC で進められる。
これとともに、周波数設定値Ｌの累積値Ｂが所定の値Ｂ
max まで達する毎に、周波数設定値Ｎが（Ｎ＋１）に設
定される。
るアドレスＡk は、加算器３及びアドレスレジスタ４に
より、周波数設定値Ｎ毎にクロックＦC で進められる。
これとともに、周波数設定値Ｌの累積値Ｂが所定の値Ｂ
max まで達する毎に、周波数設定値Ｎが（Ｎ＋１）に設
定される。
【００３２】波形発生ＲＯＭ６には、２i のアドレスに
１周期分の波形データが蓄えられているので、アドレス
レジスタ４から発生されるアドレスＡk が２i まで進め
られる時間が波形発生ＲＯＭ６から出力される信号の周
期に対応する。
１周期分の波形データが蓄えられているので、アドレス
レジスタ４から発生されるアドレスＡk が２i まで進め
られる時間が波形発生ＲＯＭ６から出力される信号の周
期に対応する。
【００３３】したがって、出力端子８から出力される発
振出力の発振周波数ＦNCO は、
振出力の発振周波数ＦNCO は、
【数２】 となる。
【００３４】故に、周波数精度△ＦNCO の精度は、
【数３】 となる。
【００３５】
【発明の効果】この発明によれば、周波数設定値Ｌを累
積し、この累積値Ｂが所定の値Ｂmax以上に達したら、
周波数設定値Ｎを（Ｎ＋１）にする処理を実行するコン
トローラ１が配設される。このため、従来に比べて（１
／Ｂmax ）の周波数精度を得ることができ、回路規模を
増大させることなく、周波数精度を上げることができ
る。
積し、この累積値Ｂが所定の値Ｂmax以上に達したら、
周波数設定値Ｎを（Ｎ＋１）にする処理を実行するコン
トローラ１が配設される。このため、従来に比べて（１
／Ｂmax ）の周波数精度を得ることができ、回路規模を
増大させることなく、周波数精度を上げることができ
る。
【図１】この発明の一実施例のブロック図である。
【図２】この発明の一実施例の説明に用いるフローチャ
ートである。
ートである。
【図３】数値制御型発振器の説明に用いるブロック図で
ある。
ある。
【図４】従来の数値制御型発振器の一例のブロック図で
ある。
ある。
１：コントローラ、２：周波数設定レジスタ、３：加算
器、４：アドレスレジスタ、５：クロック発生回路
器、４：アドレスレジスタ、５：クロック発生回路
Claims (1)
- 【請求項１】 波形データが記憶されたメモリにアドレ
ス信号を与えて波形を発生させるようにした信号発生方
法において、 上記メモリに対するアドレスは、第１の値を歩進させて
形成されると共に、 第２の値を累積し、上記第２の値が所定値になったら、
上記アドレスを所定数変化させるようにしたことを特徴
とする信号発生方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15484296A JPH09121122A (ja) | 1996-05-27 | 1996-05-27 | 信号発生方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15484296A JPH09121122A (ja) | 1996-05-27 | 1996-05-27 | 信号発生方法 |
Related Parent Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2143087A Division JPH0437205A (ja) | 1990-05-31 | 1990-05-31 | 発振装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH09121122A true JPH09121122A (ja) | 1997-05-06 |
Family
ID=15593092
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15484296A Pending JPH09121122A (ja) | 1996-05-27 | 1996-05-27 | 信号発生方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH09121122A (ja) |
-
1996
- 1996-05-27 JP JP15484296A patent/JPH09121122A/ja active Pending
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