JPH09128255A - プログラマブル論理制御器 - Google Patents
プログラマブル論理制御器Info
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- JPH09128255A JPH09128255A JP8257039A JP25703996A JPH09128255A JP H09128255 A JPH09128255 A JP H09128255A JP 8257039 A JP8257039 A JP 8257039A JP 25703996 A JP25703996 A JP 25703996A JP H09128255 A JPH09128255 A JP H09128255A
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- Japan
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- task
- communication
- logic controller
- time
- programmable logic
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-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
- G05B19/00—Program-control systems
- G05B19/02—Program-control systems electric
- G05B19/04—Program control other than numerical control, i.e. in sequence controllers or logic controllers
- G05B19/05—Programmable logic controllers, e.g. simulating logic interconnections of signals according to ladder diagrams or function charts
- G05B19/052—Linking several PLC's
-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
- G05B2219/00—Program-control systems
- G05B2219/10—Plc systems
- G05B2219/15—Plc structure of the system
- G05B2219/15081—Period length ratio between application and communication task is settable
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- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Engineering & Computer Science (AREA)
- Automation & Control Theory (AREA)
- Programmable Controllers (AREA)
Abstract
(57)【要約】
【課題】 サイクル時間は最大でもユーザーが望む時間
であり、アイドル時間は回避され、有用でないサイクル
の実行は減少されるプログラマブル論理制御器（ＰＬ
Ｃ）を提供する。 【解決手段】 ＰＬＣではデータはデータ通信部分と順
次制御部分との間で交換される。順次制御部分では通信
タスクは各ＰＬＣサイクル中に所定の期間作動される。
次にユーザータスクが作動され、これは就中交換された
データに基づきマシン又はプロセスを制御する。通信タ
スクが作動する期間とユーザータスクが作動する期間と
の比を取ることにより非常に短い応答時間を有する非常
に時間臨界的なプロセスが制御されるマシン又はプロセ
スの動作のより時間臨界的でないフェーズ中の幾つかの
ＰＬＣサイクル内で交換可能な大量のデータと同じよう
に制御される。
であり、アイドル時間は回避され、有用でないサイクル
の実行は減少されるプログラマブル論理制御器（ＰＬ
Ｃ）を提供する。 【解決手段】 ＰＬＣではデータはデータ通信部分と順
次制御部分との間で交換される。順次制御部分では通信
タスクは各ＰＬＣサイクル中に所定の期間作動される。
次にユーザータスクが作動され、これは就中交換された
データに基づきマシン又はプロセスを制御する。通信タ
スクが作動する期間とユーザータスクが作動する期間と
の比を取ることにより非常に短い応答時間を有する非常
に時間臨界的なプロセスが制御されるマシン又はプロセ
スの動作のより時間臨界的でないフェーズ中の幾つかの
ＰＬＣサイクル内で交換可能な大量のデータと同じよう
に制御される。
Description
【０００１】
【発明の属する技術分野】本発明はプロセスの順次の制
御用及び少なくとも一つの外部のシステムとのデータ通
信用のプロセッサユニットからなり、順次の制御中にタ
スクを周期的に実行するよう配置されるプログラマブル
論理制御器（ＰＬＣ）に関する。
御用及び少なくとも一つの外部のシステムとのデータ通
信用のプロセッサユニットからなり、順次の制御中にタ
スクを周期的に実行するよう配置されるプログラマブル
論理制御器（ＰＬＣ）に関する。
【０００２】
【従来の技術】一般的にＰＬＣは（マイクロ）プロセッ
サ又は例えばプロセスをモニタし制御する特定のタスク
の実行用の（マイクロ）プロセッサのシステムである。
その様なプロセスは協力設置（ｃｏｌｌａｂｏｒａｔｉ
ｎｇ ｉｎｓｔａｌｌａｔｉｏｎ）の複合と同様にマシ
ンの制御である。正確な動作のために制御される及び例
えばユーザーコンソールからパラメータを制御するプロ
セス又はシステムから由来する信号に応答する一方で多
数のタスクを実行する必要がある。ＰＬＣで実行される
種々のタスクは固定された順序で実行される；サイクル
中（以下にＰＬＣサイクルと称する）に所定の長さの時
間が該タスクのそれぞれに対して利用可能となる。典型
的なＰＬＣサイクルでタスクは：プログラマブル論理制
御器の正確な動作に要求される一般的なオーバーヘッ
ド；例えば制御されるシステムからの信号のようなデー
タの書き込み；ユーザータスクの実行、即ちシステムに
対する制御信号を形成するための入来する信号の処理；
例えば操作者コンソール及び／又は中央コンピュータと
の外部通信である。各タスクに割り当てられた期間の長
さは固定であり、それにより全サイクル時間は固定さ
れ、それ故またプログラマブル論理制御器の全応答時間
（ＴＲＴ）固定される。全応答時間は入力信号の一つの
値が変化する瞬間とこの変化が出力制御信号に影響する
瞬間との間の所要時間である。
サ又は例えばプロセスをモニタし制御する特定のタスク
の実行用の（マイクロ）プロセッサのシステムである。
その様なプロセスは協力設置（ｃｏｌｌａｂｏｒａｔｉ
ｎｇ ｉｎｓｔａｌｌａｔｉｏｎ）の複合と同様にマシ
ンの制御である。正確な動作のために制御される及び例
えばユーザーコンソールからパラメータを制御するプロ
セス又はシステムから由来する信号に応答する一方で多
数のタスクを実行する必要がある。ＰＬＣで実行される
種々のタスクは固定された順序で実行される；サイクル
中（以下にＰＬＣサイクルと称する）に所定の長さの時
間が該タスクのそれぞれに対して利用可能となる。典型
的なＰＬＣサイクルでタスクは：プログラマブル論理制
御器の正確な動作に要求される一般的なオーバーヘッ
ド；例えば制御されるシステムからの信号のようなデー
タの書き込み；ユーザータスクの実行、即ちシステムに
対する制御信号を形成するための入来する信号の処理；
例えば操作者コンソール及び／又は中央コンピュータと
の外部通信である。各タスクに割り当てられた期間の長
さは固定であり、それにより全サイクル時間は固定さ
れ、それ故またプログラマブル論理制御器の全応答時間
（ＴＲＴ）固定される。全応答時間は入力信号の一つの
値が変化する瞬間とこの変化が出力制御信号に影響する
瞬間との間の所要時間である。
【０００３】更にまたＰＬＣは例えばユーザーコンソー
ルのような外部システムと通信しなければならず、この
場合に外部システムの制御パラメータを書き込むのみな
らず、相互の整合性及び制御されるプロセス又はシステ
ムの瞬間の状態と見なされる整合性に対するこれらのパ
ラメータのチェックもまた必要である。パラメータのこ
のチェックと適合の完了の後に必要ならば通信タスクの
実行中に新たな値はユーザープログラムによりアクセス
されうるプロセッサの部分に転送されねばならない。
ルのような外部システムと通信しなければならず、この
場合に外部システムの制御パラメータを書き込むのみな
らず、相互の整合性及び制御されるプロセス又はシステ
ムの瞬間の状態と見なされる整合性に対するこれらのパ
ラメータのチェックもまた必要である。パラメータのこ
のチェックと適合の完了の後に必要ならば通信タスクの
実行中に新たな値はユーザープログラムによりアクセス
されうるプロセッサの部分に転送されねばならない。
【０００４】上記の従来のシステムではユーザー又は通
信タスク中に実行される動作の数は値又は入力信号の変
化及び／又は引き継がれる制御パラメータに依存して変
化する故にＴＲＴは変動に曝される。例えば完全に新た
な制御パラメータの組を引き継ぐために幾つかのＰＬＣ
サイクルの通信時間が必要とされることが生じる。従っ
て新たなパラメータが（完全に）考慮に入れられずに応
用プログラムの実行に多大な時間が費やされる。この期
間中に多数のＰＬＣサイクルが有用な制御が達成される
ことなしに経過し、システムの応答時間の顕著な増加を
導く。この状況を回避するために通信時間がパラメータ
を引き継ぐために必要な最大時間に固定される場合には
この時間は完全には必要とされないことがしばしば生
じ、それにより多くのＰＬＣサイクルはアイドル期間を
有し、そこではどのようなタスクをもなされない。これ
はまたＰＬＣの動作を遅くする。
信タスク中に実行される動作の数は値又は入力信号の変
化及び／又は引き継がれる制御パラメータに依存して変
化する故にＴＲＴは変動に曝される。例えば完全に新た
な制御パラメータの組を引き継ぐために幾つかのＰＬＣ
サイクルの通信時間が必要とされることが生じる。従っ
て新たなパラメータが（完全に）考慮に入れられずに応
用プログラムの実行に多大な時間が費やされる。この期
間中に多数のＰＬＣサイクルが有用な制御が達成される
ことなしに経過し、システムの応答時間の顕著な増加を
導く。この状況を回避するために通信時間がパラメータ
を引き継ぐために必要な最大時間に固定される場合には
この時間は完全には必要とされないことがしばしば生
じ、それにより多くのＰＬＣサイクルはアイドル期間を
有し、そこではどのようなタスクをもなされない。これ
はまたＰＬＣの動作を遅くする。
【０００５】
【発明が解決しようとする課題】本発明の目的はＰＬＣ
サイクルの持続時間は最大でもユーザーが望む時間であ
り、ここではサイクル内のアイドル時間は簡単に回避さ
れ、制御の観点から有用でないサイクルの実行は減少さ
れるプログラマブル論理制御器を提供することにある。
サイクルの持続時間は最大でもユーザーが望む時間であ
り、ここではサイクル内のアイドル時間は簡単に回避さ
れ、制御の観点から有用でないサイクルの実行は減少さ
れるプログラマブル論理制御器を提供することにある。
【０００６】
【課題を解決するための手段】これを達成するために、
本発明によるＰＬＣは各サイクルで与えられた時間期間
は各タスクに利用可能であり、該タスクは応用プログラ
ムを実行するユーザータスクと少なくとも一つの外部の
システムとデータ通信中に収集された応用プログラムに
対して制御パラメータを引き継ぐ通信タスクとからな
り、通信タスクと応用プログラムの実行に利用可能な周
期の期間の比は応用プログラムの実行中に調整可能であ
るという特徴を有する。ユーザータスクが多くの時間を
必要とすることが予期され、又は例えばマシンの動作の
時間臨界的なフェーズ中のようなユーザータスクの中断
が最小化されなければならない状況では通信タスクに対
する時間は低い値に調整される。制御パラメータの変化
がプロセスを顕著に妨害することなしに実行可能な場合
にはユーザタスクの時間は比較的により短く、通信タス
クの時間は比較的により長い。臨界的でないプロセスの
フェーズ又はマシンの制御ではこの特性は制御されるシ
ステムに対して決定的ではなく、それにより全応答時間
の増加は不適切なものではない。システムタスクへの切
替は延長されたユーザータスクまでもが完全に実施され
るまで待機しなければならないシステムと比較して、本
発明によるＰＬＣはサイクル時間変化は予め決定され、
ユーザーが特定の環境を希望するときのみ長くなる。
本発明によるＰＬＣは各サイクルで与えられた時間期間
は各タスクに利用可能であり、該タスクは応用プログラ
ムを実行するユーザータスクと少なくとも一つの外部の
システムとデータ通信中に収集された応用プログラムに
対して制御パラメータを引き継ぐ通信タスクとからな
り、通信タスクと応用プログラムの実行に利用可能な周
期の期間の比は応用プログラムの実行中に調整可能であ
るという特徴を有する。ユーザータスクが多くの時間を
必要とすることが予期され、又は例えばマシンの動作の
時間臨界的なフェーズ中のようなユーザータスクの中断
が最小化されなければならない状況では通信タスクに対
する時間は低い値に調整される。制御パラメータの変化
がプロセスを顕著に妨害することなしに実行可能な場合
にはユーザタスクの時間は比較的により短く、通信タス
クの時間は比較的により長い。臨界的でないプロセスの
フェーズ又はマシンの制御ではこの特性は制御されるシ
ステムに対して決定的ではなく、それにより全応答時間
の増加は不適切なものではない。システムタスクへの切
替は延長されたユーザータスクまでもが完全に実施され
るまで待機しなければならないシステムと比較して、本
発明によるＰＬＣはサイクル時間変化は予め決定され、
ユーザーが特定の環境を希望するときのみ長くなる。
【０００７】本発明によるＰＬＣの好ましい実施例によ
れば通信タスクに利用可能な周期の期間は応用プログラ
ムを介して調整されうる。これは応用プログラムでは制
御されたシステム又はプロセスが時間臨界的なフェーズ
であるか否か大量の新たなデータがいつ予想されるかが
知られている故に有用である。本発明の実施例は通信タ
スクに利用可能な期間が所定の制限内で調整可能であ
る。通信時間がゼロでない最小値を有し、また最大値で
制限される場合にはユーザータスクと同様に通信タスク
は各サイクルで作動される。故に通信タスクを介してユ
ーザープログラムは外部のシステムから常に影響されう
ることが確実になった。
れば通信タスクに利用可能な周期の期間は応用プログラ
ムを介して調整されうる。これは応用プログラムでは制
御されたシステム又はプロセスが時間臨界的なフェーズ
であるか否か大量の新たなデータがいつ予想されるかが
知られている故に有用である。本発明の実施例は通信タ
スクに利用可能な期間が所定の制限内で調整可能であ
る。通信時間がゼロでない最小値を有し、また最大値で
制限される場合にはユーザータスクと同様に通信タスク
は各サイクルで作動される。故に通信タスクを介してユ
ーザープログラムは外部のシステムから常に影響されう
ることが確実になった。
【０００８】本発明の更なる実施例ではプロセッサ（Ｃ
ＰＵ）は順次の制御用の第一のプロセッサ（ＳＣＰ）
と、少なくとも一つの外部のシステムとのデータ通信用
の第二のプロセッサ（ＤＣＰ）と、第一と第二のプロセ
ッサ間の通信用の通信ユニット（ＭＢＸ）とからなる。
ＰＬＣで２つのタスクに特有のプロセッサを用いて外部
システムとのデータ通信と制御されたシステムの制御は
並列に実行される。これは制御されたシステムの順次の
制御の加速を意味する。
ＰＵ）は順次の制御用の第一のプロセッサ（ＳＣＰ）
と、少なくとも一つの外部のシステムとのデータ通信用
の第二のプロセッサ（ＤＣＰ）と、第一と第二のプロセ
ッサ間の通信用の通信ユニット（ＭＢＸ）とからなる。
ＰＬＣで２つのタスクに特有のプロセッサを用いて外部
システムとのデータ通信と制御されたシステムの制御は
並列に実行される。これは制御されたシステムの順次の
制御の加速を意味する。
【０００９】
【発明の実施の形態】本発明のこれらの及び他の特徴は
以下に示される実施例を参照して明らかになるよう説明
する。図１のブロック図はプログラマブル論理制御器Ｐ
ＬＣを示し、例えばシリアルバスＳＢＳ、多数のセンサ
Ｓ１，Ｓ２，．．．に結合され、それにより制御される
システムの信号（図示せず）は測定されプログラマブル
論理制御器ＰＬＣ内に入来する。プログラマブル論理制
御器ＰＬＣはまたそれに制御されるシステムの制御信号
を印加するために例えば同じシリアルバスＳＢＳを介し
てアクチュエータＡ１，Ａ２，．．．，に結合される。
単一のバスＳＢＳに加えて入力信号及び制御信号に対す
る別のバスもまた実現可能である。シリアルバスＳＢＳ
への結合から離れてプログラマブル論理制御器は制御さ
れたシステムに結合され、制御器はまた１以上の外部シ
ステムに結合される。例により示されるのは命令を入来
し、制御されたシステムと論理制御器、制御器のプログ
ラミングとテスト用のプログラミング及びデバッキング
システムＰＤＳ、外部コンピュータシステムＨＳＴ，ネ
ットワークＮＴＷを介して他の論理コントローラへの接
続の状態を表示するユーザーコンソール又はマンマシン
インターフェイスＭＭＩである。
以下に示される実施例を参照して明らかになるよう説明
する。図１のブロック図はプログラマブル論理制御器Ｐ
ＬＣを示し、例えばシリアルバスＳＢＳ、多数のセンサ
Ｓ１，Ｓ２，．．．に結合され、それにより制御される
システムの信号（図示せず）は測定されプログラマブル
論理制御器ＰＬＣ内に入来する。プログラマブル論理制
御器ＰＬＣはまたそれに制御されるシステムの制御信号
を印加するために例えば同じシリアルバスＳＢＳを介し
てアクチュエータＡ１，Ａ２，．．．，に結合される。
単一のバスＳＢＳに加えて入力信号及び制御信号に対す
る別のバスもまた実現可能である。シリアルバスＳＢＳ
への結合から離れてプログラマブル論理制御器は制御さ
れたシステムに結合され、制御器はまた１以上の外部シ
ステムに結合される。例により示されるのは命令を入来
し、制御されたシステムと論理制御器、制御器のプログ
ラミングとテスト用のプログラミング及びデバッキング
システムＰＤＳ、外部コンピュータシステムＨＳＴ，ネ
ットワークＮＴＷを介して他の論理コントローラへの接
続の状態を表示するユーザーコンソール又はマンマシン
インターフェイスＭＭＩである。
【００１０】プログラマブル論理制御器ＰＬＣは１以上
の記憶モジュールとシリアルバス又はバスＳＢＳへのイ
ンターフェイスモジュールＩＦＣを有する中央プロセッ
サユニットＣＰＵからなる。記憶モジュールは就中シス
テムプログラム及び応用プログラムを含む。プロセッサ
ユニットＣＰＵはセンサ及びアクチュエータを介して制
御されるシステムの順次の制御をなす部分ＳＣＰと、Ｎ
ＴＷ、ＨＳＴ，ＭＭＩ，ＰＤＳのような外部システムと
データ通信するＤＣＰ部分とに副分割されうる。後者の
部分は種々の外部システムにより表されたパラメータを
読み出すのみならず、相互の整合と、もしあれば衝突を
解決するこれらのパラメータをまたチェックする。
の記憶モジュールとシリアルバス又はバスＳＢＳへのイ
ンターフェイスモジュールＩＦＣを有する中央プロセッ
サユニットＣＰＵからなる。記憶モジュールは就中シス
テムプログラム及び応用プログラムを含む。プロセッサ
ユニットＣＰＵはセンサ及びアクチュエータを介して制
御されるシステムの順次の制御をなす部分ＳＣＰと、Ｎ
ＴＷ、ＨＳＴ，ＭＭＩ，ＰＤＳのような外部システムと
データ通信するＤＣＰ部分とに副分割されうる。後者の
部分は種々の外部システムにより表されたパラメータを
読み出すのみならず、相互の整合と、もしあれば衝突を
解決するこれらのパラメータをまたチェックする。
【００１１】図２の（Ａ）、（Ｂ）はＰＬＣサイクル中
のタスクの実行の概略を示す図である。図２の（Ａ）は
外部のシステムとのデータ通信と同様にプロセス制御を
実行するプロセッサが利用可能である場合のタスクの実
行を示す。図２の（Ｂ）はデータ通信用に別のプロセッ
サが利用可能である場合のプロセス制御用のタスクの実
行を示す。図２の（Ａ）の部分ＤＣ１，ＤＣ２はプロセ
ッサがそれぞれパラメータの入来と実行をなす外部シス
テムとデータを交換するときを示す。この目的のために
ドライバＤＲＶが時々作動される。更にまたパラメータ
はチェックされ、論理制御器内の適切な記憶位置に書き
込まれる。制御器がブロックＩＮＰ，ＵＳＲ，ＯＵＴ，
ＣＯＭ，ＦＭＷを実行するときに順次制御タスクは実行
される。ブロックＩＮＰ中にセンサからのアナログとデ
ジタル信号が読み取られ；ブロックＵＳＲはこの情報が
応用プログラム内の命令に従って処理されることを示
す。ブロックＯＵＴの実行では計算された制御信号はア
クチュエータに印加される。ブロックＣＯＭ中にデータ
は順次の制御タスクとデータ通信タスクとの間で交換さ
れる。このタスク中にデータブロックは例えば両方のタ
スクにアクセス可能なメモリへの書き込みと読み出しに
より制御に専有される部分とデータ通信に専有される部
分との間で交換される。この交換は連続には生じない。
何故ならば応用プログラムがそれに反応する制御パラメ
ータの組は整合しないからである。最終的にブロックＦ
ＭＷ内でいわゆるファームウエアプログラムは制御器の
内部処理を制御する。ファームウエアプログラムはパラ
メータを介して入来されたコマンドが割り当てられた時
間により許容される限りデータ通信タスク中にプログラ
ムブロック内で実行されることを確実にする。これは例
えば各コマンド又はプログラムに対してどの位の時間を
それの実行に必要とするかをルックアップテーブルを介
して示すことを実現する。全てのコマンドがＰＬＣサイ
クル内で実行されうる場合には他のコマンドは次のサイ
クルまで延期される。斯くして種々のコマンドの実行が
割り当てられた時間が過ぎたときにも中断されない。
のタスクの実行の概略を示す図である。図２の（Ａ）は
外部のシステムとのデータ通信と同様にプロセス制御を
実行するプロセッサが利用可能である場合のタスクの実
行を示す。図２の（Ｂ）はデータ通信用に別のプロセッ
サが利用可能である場合のプロセス制御用のタスクの実
行を示す。図２の（Ａ）の部分ＤＣ１，ＤＣ２はプロセ
ッサがそれぞれパラメータの入来と実行をなす外部シス
テムとデータを交換するときを示す。この目的のために
ドライバＤＲＶが時々作動される。更にまたパラメータ
はチェックされ、論理制御器内の適切な記憶位置に書き
込まれる。制御器がブロックＩＮＰ，ＵＳＲ，ＯＵＴ，
ＣＯＭ，ＦＭＷを実行するときに順次制御タスクは実行
される。ブロックＩＮＰ中にセンサからのアナログとデ
ジタル信号が読み取られ；ブロックＵＳＲはこの情報が
応用プログラム内の命令に従って処理されることを示
す。ブロックＯＵＴの実行では計算された制御信号はア
クチュエータに印加される。ブロックＣＯＭ中にデータ
は順次の制御タスクとデータ通信タスクとの間で交換さ
れる。このタスク中にデータブロックは例えば両方のタ
スクにアクセス可能なメモリへの書き込みと読み出しに
より制御に専有される部分とデータ通信に専有される部
分との間で交換される。この交換は連続には生じない。
何故ならば応用プログラムがそれに反応する制御パラメ
ータの組は整合しないからである。最終的にブロックＦ
ＭＷ内でいわゆるファームウエアプログラムは制御器の
内部処理を制御する。ファームウエアプログラムはパラ
メータを介して入来されたコマンドが割り当てられた時
間により許容される限りデータ通信タスク中にプログラ
ムブロック内で実行されることを確実にする。これは例
えば各コマンド又はプログラムに対してどの位の時間を
それの実行に必要とするかをルックアップテーブルを介
して示すことを実現する。全てのコマンドがＰＬＣサイ
クル内で実行されうる場合には他のコマンドは次のサイ
クルまで延期される。斯くして種々のコマンドの実行が
割り当てられた時間が過ぎたときにも中断されない。
【００１２】図２の（Ｂ）は２つのプロセッサからなる
システムに対して同様に示す。図の左側の部分には順次
制御プロセッサのタスクＩＮＰ，ＵＳＲ，ＯＵＴ，ＣＯ
Ｍ，ＦＭＷが示される。図の右の部分はドライバＤＲＶ
への実行を伴うデータ通信タスクを示す。１つのプロセ
ッサを含む場合には応用プログラムによる通信タスクの
時間割り当てで引き起こされた変化はオペレータコンソ
ール又は中央コンピュータのような外部のユニットとの
通信に主に関係する。これはＰＬＣサイクルの一部分で
あり、それは図２の（Ａ）での基準ＤＰＣにより示され
る。特に通信タスクＣＯＭ／ＭＢＸである２つのプロセ
ッサを含む場合には２つのプロセッサ間の通信の制御は
影響される。
システムに対して同様に示す。図の左側の部分には順次
制御プロセッサのタスクＩＮＰ，ＵＳＲ，ＯＵＴ，ＣＯ
Ｍ，ＦＭＷが示される。図の右の部分はドライバＤＲＶ
への実行を伴うデータ通信タスクを示す。１つのプロセ
ッサを含む場合には応用プログラムによる通信タスクの
時間割り当てで引き起こされた変化はオペレータコンソ
ール又は中央コンピュータのような外部のユニットとの
通信に主に関係する。これはＰＬＣサイクルの一部分で
あり、それは図２の（Ａ）での基準ＤＰＣにより示され
る。特に通信タスクＣＯＭ／ＭＢＸである２つのプロセ
ッサを含む場合には２つのプロセッサ間の通信の制御は
影響される。
【００１３】１及び２のプロセッサの場合の両方でデー
タ通信タスクと順次制御タスクとの間のデータの交換は
両方のタスクからアドレスされうるメモリＭＢＸを介し
て実行される。図２の（Ａ）、（Ｂ）に示されるように
シーケンス制御タスク内のメモリＭＢＸからの書き込み
と読み出しはこのタスク中に実行されるサイクルの一部
分中になされる。サイクル中に与えられた時間の長さは
シーケンス制御で各タスクに割り当てられる。
タ通信タスクと順次制御タスクとの間のデータの交換は
両方のタスクからアドレスされうるメモリＭＢＸを介し
て実行される。図２の（Ａ）、（Ｂ）に示されるように
シーケンス制御タスク内のメモリＭＢＸからの書き込み
と読み出しはこのタスク中に実行されるサイクルの一部
分中になされる。サイクル中に与えられた時間の長さは
シーケンス制御で各タスクに割り当てられる。
【００１４】図３は本発明によるプログラマブル論理制
御器用の応用プログラムのフローチャートを示す。示さ
れている応用プログラムはマシン又はプロセスの動作の
２つのフェーズを制御する。部分３０に示される第一の
フェーズは例えば注入モールド機械のモールドの充填及
びそれに続く開放のような時間臨界的なフェーズであ
る。符号４０で示される第二のフェーズは時間臨界性は
はるかに少なく、注入モールド機械の場合には例えばワ
ークピースの除去とモールドの閉鎖のようなものであ
る。より時間臨界的でないのと同様に時間臨界的なフェ
ーズが生ずる更なる制御タスクは数値制御された切削機
械又は旋盤の制御である。ワークピースが実際に加工さ
れる間のフェーズは空いた空間での工具又はワークピー
スの変位又は工具の交換より実質的により時間臨界的で
ある。
御器用の応用プログラムのフローチャートを示す。示さ
れている応用プログラムはマシン又はプロセスの動作の
２つのフェーズを制御する。部分３０に示される第一の
フェーズは例えば注入モールド機械のモールドの充填及
びそれに続く開放のような時間臨界的なフェーズであ
る。符号４０で示される第二のフェーズは時間臨界性は
はるかに少なく、注入モールド機械の場合には例えばワ
ークピースの除去とモールドの閉鎖のようなものであ
る。より時間臨界的でないのと同様に時間臨界的なフェ
ーズが生ずる更なる制御タスクは数値制御された切削機
械又は旋盤の制御である。ワークピースが実際に加工さ
れる間のフェーズは空いた空間での工具又はワークピー
スの変位又は工具の交換より実質的により時間臨界的で
ある。
【００１５】プログラムは例えばユーザーコンソールか
らのコマンドにより始動され、斯くして動作が如何にな
されるかを示す必要な制御パラメータをフェッチする。
次にプログラムは時間臨界的なフェーズで開始する。本
発明によれば第一（ブロック３２）にデータ通信に利用
可能な期間は例えば２ｍｓのような非常に小さな値に調
整される。次に時間臨界的なフェーズが実行され、その
間に順次： −ブロック４１ではマシン又はプロセスの瞬間状態がＰ
ＬＣサイクルの入力タスク中に入来したパラメータを基
に決定される； −ブロック４２では必要な補正が計算される； −ブロック４３では必要な制御信号がメモリ位置で入力
され、ここからそれらはＰＬＣサイクルのタスクを実行
する間にアクチュエータに印加される； −ブロック４４ではこの第一のフェーズが終了したかど
うかチェックされる。もしそうでなければユーザータス
ク内のこのサイクルは繰り返される；さもなければ動作
は第二のフェーズに進む。このフェーズはそれぞれブロ
ック５１、５２、５３、５４で示された同じタスクから
なる。しかしながらこの第二のフェーズ５０はファーム
ウエアプログラムにＰＬＣサイクルのデータ通信フェー
ズは例えば１０又は２０ｍｓのように長くなければなら
ないことを示すようにブロック３３により先行される。
この長いフェーズの間に制御パラメータの大きなブロッ
クは１又は幾つかのＰＬＣサイクルでユーザータスクに
利用可能にされうる。
らのコマンドにより始動され、斯くして動作が如何にな
されるかを示す必要な制御パラメータをフェッチする。
次にプログラムは時間臨界的なフェーズで開始する。本
発明によれば第一（ブロック３２）にデータ通信に利用
可能な期間は例えば２ｍｓのような非常に小さな値に調
整される。次に時間臨界的なフェーズが実行され、その
間に順次： −ブロック４１ではマシン又はプロセスの瞬間状態がＰ
ＬＣサイクルの入力タスク中に入来したパラメータを基
に決定される； −ブロック４２では必要な補正が計算される； −ブロック４３では必要な制御信号がメモリ位置で入力
され、ここからそれらはＰＬＣサイクルのタスクを実行
する間にアクチュエータに印加される； −ブロック４４ではこの第一のフェーズが終了したかど
うかチェックされる。もしそうでなければユーザータス
ク内のこのサイクルは繰り返される；さもなければ動作
は第二のフェーズに進む。このフェーズはそれぞれブロ
ック５１、５２、５３、５４で示された同じタスクから
なる。しかしながらこの第二のフェーズ５０はファーム
ウエアプログラムにＰＬＣサイクルのデータ通信フェー
ズは例えば１０又は２０ｍｓのように長くなければなら
ないことを示すようにブロック３３により先行される。
この長いフェーズの間に制御パラメータの大きなブロッ
クは１又は幾つかのＰＬＣサイクルでユーザータスクに
利用可能にされうる。
【図１】それに結合する制御されるシステムの部分を有
するＰＬＣのブロック図を示す。
するＰＬＣのブロック図を示す。
【図２】（Ａ），（Ｂ）はＰＬＣサイクル内の種々の型
のタスクを示す。
のタスクを示す。
【図３】本発明によるＰＬＣ用の応用プログラムのフロ
ーチャートを示す。
ーチャートを示す。
Ａ１，Ａ２ アクチュエータ ＣＰＵ 中央プロセッサユニット ＨＳＴ 外部コンピュータシステム ＩＦＣ インターフェイスモジュール ＭＭＩ ユーザーコンソール又はマンマシンインターフ
ェイス ＮＴＷ ネットワーク ＰＤＳ プログラミング及びデバッキングシステム ＰＬＣ プログラマブル論理制御器 Ｓ１，Ｓ２ センサ ＳＢＳ シリアルバス
ェイス ＮＴＷ ネットワーク ＰＤＳ プログラミング及びデバッキングシステム ＰＬＣ プログラマブル論理制御器 Ｓ１，Ｓ２ センサ ＳＢＳ シリアルバス
Claims (5)
- 【請求項１】 プロセスの順次の制御用及び少なくとも
一つの外部のシステムとのデータ通信用のプロセッサユ
ニットからなり、順次の制御中にタスクを周期的に実行
するよう配置されたプログラマブル論理制御器（ＰＬ
Ｃ）であって、各サイクルで所定の時間期間は各タスク
に利用可能であり、該タスクは応用プログラムを実行す
るユーザータスクと少なくとも一つの外部のシステムと
データ通信中に得た応用プログラムに対して制御パラメ
ータを引き継ぐ通信タスクとからなり、通信タスクと応
用プログラムの実行に利用可能な周期の期間の比は応用
プログラムの実行中に調整可能であるプログラマブル論
理制御器。 - 【請求項２】 通信タスクに利用可能な周期の期間は応
用プログラムを介して調整されうる請求項１記載のプロ
グラマブル論理制御器。 - 【請求項３】 通信タスクに利用可能な期間が所定の制
限内で調整可能である請求項１又は２記載のプログラマ
ブル論理制御器。 - 【請求項４】 プロセッサ（ＣＰＵ）は順次の制御用の
第一のプロセッサ（ＳＣＰ）と、少なくとも一つの外部
のシステムとのデータ通信用の第二のプロセッサ（ＤＣ
Ｐ）と、第一と第二のプロセッサ間の通信用の通信ユニ
ット（ＭＢＸ）とからなる請求項１乃至３のうちのいず
れか１項記載のプログラマブル論理制御器。 - 【請求項５】 その制御パラメータが通信タスク中に得
た外部システムはユーザーコンソール及び／又はプログ
ラミングシステム及び／又は他のプログラマブル論理制
御器及び／又は中央コンピュータから由来する請求項１
乃至４のうちのいずれか１項記載のプログラマブル論理
制御器。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| BE9500812A BE1009813A3 (nl) | 1995-09-29 | 1995-09-29 | Programmeerbare logische controller. |
| BE09500812 | 1995-09-29 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH09128255A true JPH09128255A (ja) | 1997-05-16 |
Family
ID=3889209
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8257039A Pending JPH09128255A (ja) | 1995-09-29 | 1996-09-27 | プログラマブル論理制御器 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US5867383A (ja) |
| EP (1) | EP0766156A1 (ja) |
| JP (1) | JPH09128255A (ja) |
| BE (1) | BE1009813A3 (ja) |
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- 1996-09-23 EP EP96202658A patent/EP0766156A1/en not_active Withdrawn
- 1996-09-27 JP JP8257039A patent/JPH09128255A/ja active Pending
- 1996-09-30 US US08/722,650 patent/US5867383A/en not_active Expired - Fee Related
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| Publication number | Publication date |
|---|---|
| BE1009813A3 (nl) | 1997-08-05 |
| EP0766156A1 (en) | 1997-04-02 |
| US5867383A (en) | 1999-02-02 |
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