JPH09199517A - 半導体装置 - Google Patents

半導体装置

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JPH09199517A
JPH09199517A JP8009124A JP912496A JPH09199517A JP H09199517 A JPH09199517 A JP H09199517A JP 8009124 A JP8009124 A JP 8009124A JP 912496 A JP912496 A JP 912496A JP H09199517 A JPH09199517 A JP H09199517A
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JP
Japan
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semiconductor device
lead frame
semiconductor chip
groove
mount
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JP8009124A
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Takeshi Harada
毅 原田
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NEC Corp
Original Assignee
NEC Corp
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Publication date
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Abstract

(57)【要約】 【課題】リードフレームのマウント分にマウント材を介
して半導体チップを実装して樹脂封止を施した半導体装
置において、放熱性を確保しながら断続動作試験や温度
サイクル時の熱応力を緩和させる。 【解決手段】半導体チップ1が、マウント材3によって
溶融固着されるリードフレーム2に、直交状、放射状、
格子状などの形状の溝を設ける。これにより、マウント
材3を厚くでき、評価及び試験時に生じる熱応力を緩和
する事ができる。また部分的に溝を施すため、放熱性を
確保しながら信頼性を向上させる事ができる。また、部
分的に溝を施す為、半導体チップ1の大小に関係なく、
1種類のリードフレーム2にて対応できる。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は、半導体装置に関
し、特に断続動作試験や温度サイクル試験での耐量を向
上させた半導体装置に関する。
【0002】
【従来の技術】近年、半導体装置の低オン抵抗化及び外
形の小型化に伴い、マウントアイランドに対する半導体
チップの大きさは、年々大きくなってきている。これに
伴い半導体装置の評価及び試験において、半導体装置の
受けるストレスは増加している。これらの問題に対する
対策として、図4の断面図に示すものがある。
【0003】この半導体装置は、リードフレーム2の上
に接合材3を介して半導体チップ1を設けたものである
が、この接合材3の中に高熱伝導プレート4を入れたも
のである。この高熱伝導プレート4には、溝が施された
ものがあるが、これらは、プレート4を入れる工数やプ
レート費用が付加される為、半導体装置の原価率が悪化
する。
【0004】もう1つの対策としては、シミュレーショ
ンや実験等より、マウント材3を厚くする事によって、
半導体装置の評価や試験における断続動作試験耐量や温
度サイクル耐量を向上させる事ができるが、放熱性が悪
くなり、熱抵抗特性を満足しなくなる為、マウント材を
厚くするのには限界が生じる。
【0005】
【発明が解決しようとする課題】この従来のマウント材
(接合材)3の中に高熱伝導プレート4を入れた半導体
装置では、高熱伝導プレート4を入れる為の工数や、プ
レート4の費用が付加されるため、高熱伝導プレート4
を使用しない方法を確立する必要がある。
【0006】また、リードフレーム1のマウント部にマ
ウント材3を介して半導体チップ1を実装して樹脂封止
を施した半導体装置において、マウント材3を厚くした
半導体装置では、放熱性が悪くなる事によって、熱抵抗
特性を満足しない場合が生じる。
【0007】この発明の目的は、この種の半導体装置の
製造工程を変更せずに、なおかつ放熱性を継持させなが
ら、半導体装置の評価や試験において、継続動作試験耐
量や温度サイクル耐量を向上できる半導体装置を提供す
る事にある。
【0008】
【課題を解決するための手段】本発明の構成は、リード
フレームのマウント部にマウント材を介して半導体チッ
プを実装して樹脂封止を施した半導体装置において、前
記マンウント材が接着される前記リードフレームの面
に、前記半導体チップの中央部とコーナ部が接合される
溝を設けたことを特徴とする。
【0009】本発明においては、リードフレームに設け
た溝により、部分的にマウント材が厚くなる事で、評価
や試験における熱応力を吸収する部分が多くなり、放熱
性を確保しながら信頼性を向上させる事ができる。
【0010】
【発明の実施の形態】図1(a),(b)は本発明の一
実施形態である半導体装置の要部の平面図および断面図
であり、図2(a),(b),(c)は、半導体装置に
施される各溝の例を示す平面図である。本実施形態の半
導体装置は、半導体チップ1が、溝5を施したリードフ
レーム2に、マウント材3によって溶融固着されてい
る。この半導体チップ1が実装されているリードフレー
ム2の実装面は、樹脂6で覆われていてリードフレーム
2の反対側が露出している。
【0011】この溝5の断面形状については、四角形の
ものが一般的であるが、マウント材の充填性を考慮する
と半円形のものが望ましい。また、溝5の寸法について
は、熱応力と放熱性を考え、幅については、1〜2m
m、長さについては、リードフレーム2に実装する半導
体チップ1よりも長く、深さについては、10〜80μ
mに設定するのが効果的である。
【0012】図2は、リードフレーム2に施される溝5
の異なる形状を示している。半導体装置の大きさにより
図2(a),(b),(c)より最適な溝を選択でき
る。図2(a)は図1の溝5を45°回転させたもの
で、比較的放熱性に優れた配置となっている。図2
(b),(c)は溝5を放射状、又は格子状にしたもの
で、半導体装置の評価及び試験での熱応力を吸収しやす
くなっている。
【0013】図3は、本発明の他の実施形態の半導体装
置の要部の断面図である。この半導体装置は図1と同様
な半導体装置であるが、リードフレーム2が樹脂6でそ
の全面が覆われたものである。
【0014】
【発明の効果】以上説明したように本発明によれば、リ
ードフレームのマウント部にマウント在を介して半導体
チップを実装して樹脂封止を施した半導体装置におい
て、リードフレームのマウント面に溝を施す事により、
マウント材を厚くする事ができ、半導体装置の評価及び
試験時に生じる熱応力を5〜10%緩和する事ができ、
かつ部分的に溝を施しているので、放熱性を確保しなが
ら信頼性を向上させる事ができる。さらに部分的に溝を
施しているので、半導体チップの大小にかかわらずマウ
ントする事ができるため、1種類のリードフレームで対
応でき、量産性に優れている。
【図面の簡単な説明】
【図1】本発明の一実施形態の半導体装置の要部の平面
図及び断面図である。
【図2】図1の半導体装置に施される溝の各例の平面図
である。
【図3】本発明の他の実施形態の半導体装置の要部の断
面図である。
【図4】従来例の半導体装置の要部の断面図である。
【符号の説明】
1 半導体チップ 2 リードフレーム 3 マウント材(接合材) 4 高熱伝導プレート 5 溝 6 樹脂

Claims (3)

    【特許請求の範囲】
  1. 【請求項1】 リードフレームのマウント部にマウント
    材を介して半導体チップを実装して樹脂封止を施した半
    導体装置において、前記マンウント材が接着される前記
    リードフレームの面に、前記半導体チップの中央部とコ
    ーナ部が接合される溝を設けたことを特徴とする半導体
    装置。
  2. 【請求項2】 溝の形状がX文字、十文字、放射状ある
    いは格子状である請求項1記載の半導体装置。
  3. 【請求項3】 樹脂封止がリードフレームの上面または
    全面に施されたものである請求項1記載の半導体装置。
JP8009124A 1996-01-23 1996-01-23 半導体装置 Pending JPH09199517A (ja)

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Cited By (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100499606B1 (ko) * 2000-06-13 2005-07-07 앰코 테크놀로지 코리아 주식회사 반도체 패키지 제조용 부재
CN1319023C (zh) * 1998-12-17 2007-05-30 株式会社日立制作所 半导体装置及其制造方法
JP2008159742A (ja) * 2006-12-22 2008-07-10 Fujitsu Component Ltd 半導体素子の実装構造
JP2009009957A (ja) * 2007-06-26 2009-01-15 Nec Electronics Corp 半導体装置
JP2011155286A (ja) * 2011-03-22 2011-08-11 Rohm Co Ltd 半導体装置
JP2016188763A (ja) * 2015-03-30 2016-11-04 株式会社フジクラ 半導体パッケージおよび圧力センサパッケージ
US20200051880A1 (en) * 2018-08-10 2020-02-13 Infineon Technologies Ag Semiconductor device comprising a recess and method of fabricating the same
CN114203645A (zh) * 2020-09-18 2022-03-18 力特半导体(无锡)有限公司 用于低容量tvs的封装结构
JP2023045874A (ja) * 2021-09-22 2023-04-03 株式会社東芝 半導体装置

Cited By (12)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN1319023C (zh) * 1998-12-17 2007-05-30 株式会社日立制作所 半导体装置及其制造方法
KR100499606B1 (ko) * 2000-06-13 2005-07-07 앰코 테크놀로지 코리아 주식회사 반도체 패키지 제조용 부재
JP2008159742A (ja) * 2006-12-22 2008-07-10 Fujitsu Component Ltd 半導体素子の実装構造
US7948091B2 (en) 2006-12-22 2011-05-24 Fujitsu Component Limited Mounting structure for semiconductor element
JP2009009957A (ja) * 2007-06-26 2009-01-15 Nec Electronics Corp 半導体装置
US8076771B2 (en) 2007-06-26 2011-12-13 Renesas Electronics Corporation Semiconductor device having metal cap divided by slit
JP2011155286A (ja) * 2011-03-22 2011-08-11 Rohm Co Ltd 半導体装置
JP2016188763A (ja) * 2015-03-30 2016-11-04 株式会社フジクラ 半導体パッケージおよび圧力センサパッケージ
US20200051880A1 (en) * 2018-08-10 2020-02-13 Infineon Technologies Ag Semiconductor device comprising a recess and method of fabricating the same
CN114203645A (zh) * 2020-09-18 2022-03-18 力特半导体(无锡)有限公司 用于低容量tvs的封装结构
JP2023045874A (ja) * 2021-09-22 2023-04-03 株式会社東芝 半導体装置
US12087672B2 (en) 2021-09-22 2024-09-10 Kabushiki Kaisha Toshiba Semiconductor device with reduced thermal resistance for improved heat dissipation

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Legal Events

Date Code Title Description
A02 Decision of refusal

Free format text: JAPANESE INTERMEDIATE CODE: A02

Effective date: 19981222