JPH11149438A - Ｄｍａ転送装置 - Google Patents
Ｄｍａ転送装置Info
- Publication number
- JPH11149438A JPH11149438A JP9316733A JP31673397A JPH11149438A JP H11149438 A JPH11149438 A JP H11149438A JP 9316733 A JP9316733 A JP 9316733A JP 31673397 A JP31673397 A JP 31673397A JP H11149438 A JPH11149438 A JP H11149438A
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Abstract
(57)【要約】
【課題】 音声データなどの大量のデータを分割してＤ
ＭＡ転送する場合に連続してＤＭＡ転送を実行する間に
音声が途切れないようにする。 【解決手段】 ＤＭＡ転送が終了したと同時に、転送次
アドレスレジスタ１７に格納していた次の転送アドレス
を転送アドレスカウンタ１４に送出し、転送次バイトカ
ウントレジスタ１８に格納していた次の転送バイトカウ
ントを転送バイトカウンタ１２に送出する。
ＭＡ転送する場合に連続してＤＭＡ転送を実行する間に
音声が途切れないようにする。 【解決手段】 ＤＭＡ転送が終了したと同時に、転送次
アドレスレジスタ１７に格納していた次の転送アドレス
を転送アドレスカウンタ１４に送出し、転送次バイトカ
ウントレジスタ１８に格納していた次の転送バイトカウ
ントを転送バイトカウンタ１２に送出する。
Description
【０００１】
【発明の属する技術分野】本発明は、車両走行案内を音
声にて行う車載用のナビゲーション装置等におけるＤＭ
Ａ転送装置に関する。
声にて行う車載用のナビゲーション装置等におけるＤＭ
Ａ転送装置に関する。
【０００２】
【従来の技術】図３は音声データをＤＭＡ（Direct Mem
ory Access）転送する基本的な構成である。１は車載ナ
ビゲーションのＣＰＵであり、２はその主記憶装置であ
る。３は音声データをＤＭＡ転送するＤＭＡ転送装置、
４は音声データを格納するＦＩＦＯ（First In First O
ut）メモリ、５はＡＤＰＣＭ（Adative Differential P
ulse Code Modulation）デコーダ装置であり、６はＤ／
Ａ（Digital/Analogue）部、７はスピーカである。
ory Access）転送する基本的な構成である。１は車載ナ
ビゲーションのＣＰＵであり、２はその主記憶装置であ
る。３は音声データをＤＭＡ転送するＤＭＡ転送装置、
４は音声データを格納するＦＩＦＯ（First In First O
ut）メモリ、５はＡＤＰＣＭ（Adative Differential P
ulse Code Modulation）デコーダ装置であり、６はＤ／
Ａ（Digital/Analogue）部、７はスピーカである。
【０００３】上記のＤＭＡ転送装置３の詳細を図４に示
す。図４において、２１は転送アドレスカウンタであ
り、２２は転送バイトカウンタである。２３は転送デー
タを一時的に格納しておくデータバッファである。２４
はＤＭＡ転送を制御するデータを格納するコントロール
レジスタであり、２５はメインバスインタフェース部で
ある。２６はＤＭＡ転送をコントロールする転送制御部
である。
す。図４において、２１は転送アドレスカウンタであ
り、２２は転送バイトカウンタである。２３は転送デー
タを一時的に格納しておくデータバッファである。２４
はＤＭＡ転送を制御するデータを格納するコントロール
レジスタであり、２５はメインバスインタフェース部で
ある。２６はＤＭＡ転送をコントロールする転送制御部
である。
【０００４】上記従来例のＤＭＡ転送動作を図５を用い
て説明する。まず、ソフトウェアより転送アドレスカウ
ンタ２１にＤＭＡ転送する音声データが格納されている
主記憶装置のアドレスを設定し（Ｓ３１）、ＤＭＡ転送
するバイトカウント量を転送バイトカウンタ２２に設定
する（Ｓ３２）。次にコントロールレジスタ２４にＤＭ
Ａ転送の開始を設定すると（Ｓ３３）、メインバス・イ
ンタフェース回路２５は所定の手続を行い、メインバス
のバスを獲得し（Ｓ３４）、アドレスカウンタ２１のア
ドレスを使用して主記憶装置から音声データを読み込み
（Ｓ３５）、転送アドレスカウンタ２１がカウントアッ
プして（Ｓ３６）、読み込んだ音声データをデータ・バ
ッファ２３に格納する（Ｓ３７）。次にＡＤＰＣＭデコ
ーダにデータバッファ２３に格納された音声データを送
出し（Ｓ３８）、転送バイトカウンタ２２をカウントダ
ウンする（Ｓ３９）。転送バイトカウンタの値が０か否
か判定して（Ｓ４０）、転送バイトカウンタの値が０で
なければステップ３４に戻り、０であればＤＭＡ転送を
終了する。
て説明する。まず、ソフトウェアより転送アドレスカウ
ンタ２１にＤＭＡ転送する音声データが格納されている
主記憶装置のアドレスを設定し（Ｓ３１）、ＤＭＡ転送
するバイトカウント量を転送バイトカウンタ２２に設定
する（Ｓ３２）。次にコントロールレジスタ２４にＤＭ
Ａ転送の開始を設定すると（Ｓ３３）、メインバス・イ
ンタフェース回路２５は所定の手続を行い、メインバス
のバスを獲得し（Ｓ３４）、アドレスカウンタ２１のア
ドレスを使用して主記憶装置から音声データを読み込み
（Ｓ３５）、転送アドレスカウンタ２１がカウントアッ
プして（Ｓ３６）、読み込んだ音声データをデータ・バ
ッファ２３に格納する（Ｓ３７）。次にＡＤＰＣＭデコ
ーダにデータバッファ２３に格納された音声データを送
出し（Ｓ３８）、転送バイトカウンタ２２をカウントダ
ウンする（Ｓ３９）。転送バイトカウンタの値が０か否
か判定して（Ｓ４０）、転送バイトカウンタの値が０で
なければステップ３４に戻り、０であればＤＭＡ転送を
終了する。
【０００５】
【発明が解決しようとする課題】この種の装置におい
て、音声データがＤＭＡ転送の転送バイトカウントの最
大値よりも大きい場合、ＤＭＡ転送を必要回数連続して
実行しなければならないが、上記従来例においては、Ｄ
ＭＡ転送の終了を割り込みやポーリングで監視し、ＤＭ
Ａ転送が終了した際には、直ちに次のＤＭＡ転送の設定
をして音声が途切れることを回避しなければならない。
そのために、ＡＤＰＣＭデコーダとのインタフェースに
数多くの音声データを格納して、ソフトウェアがＤＭＡ
転送の再設定を行う時間をかせぐための相当数のＦＩＦ
Ｏメモリが必要となるという問題点を有していた。
て、音声データがＤＭＡ転送の転送バイトカウントの最
大値よりも大きい場合、ＤＭＡ転送を必要回数連続して
実行しなければならないが、上記従来例においては、Ｄ
ＭＡ転送の終了を割り込みやポーリングで監視し、ＤＭ
Ａ転送が終了した際には、直ちに次のＤＭＡ転送の設定
をして音声が途切れることを回避しなければならない。
そのために、ＡＤＰＣＭデコーダとのインタフェースに
数多くの音声データを格納して、ソフトウェアがＤＭＡ
転送の再設定を行う時間をかせぐための相当数のＦＩＦ
Ｏメモリが必要となるという問題点を有していた。
【０００６】本発明は、上記従来例の問題を解決するも
のであり、必要最小限のＦＩＦＯメモリによって音声を
再生することのできるＤＭＡ転送装置を提供することを
目的としている。
のであり、必要最小限のＦＩＦＯメモリによって音声を
再生することのできるＤＭＡ転送装置を提供することを
目的としている。
【０００７】
【課題を解決するための手段】本発明は、上記目的を達
成するために、ＤＭＡ転送が終了したと同時に、次の転
送アドレスと転送バイトカウンタを再設定することによ
り、必要最小限のＦＩＦＯメモリによって音声を再生す
ることができるようにしたものである。
成するために、ＤＭＡ転送が終了したと同時に、次の転
送アドレスと転送バイトカウンタを再設定することによ
り、必要最小限のＦＩＦＯメモリによって音声を再生す
ることができるようにしたものである。
【０００８】
【発明の実施の形態】本発明の請求項１に記載の発明
は、転送アドレスをカウントアップする手段と、転送バ
イトカウントをカウントアップする手段と、転送データ
を格納出力する手段と、前記３つの手段を制御する手段
とを備えたＤＭＡ転送装置において、ＤＭＡ転送が終了
したと同時に、次のＤＭＡ転送のアドレスとバイトカウ
ントを再設定する手段を備えたＤＭＡ転送装置であり、
必要最小限のＦＩＦＯメモリによって音声を再生するこ
とができる。
は、転送アドレスをカウントアップする手段と、転送バ
イトカウントをカウントアップする手段と、転送データ
を格納出力する手段と、前記３つの手段を制御する手段
とを備えたＤＭＡ転送装置において、ＤＭＡ転送が終了
したと同時に、次のＤＭＡ転送のアドレスとバイトカウ
ントを再設定する手段を備えたＤＭＡ転送装置であり、
必要最小限のＦＩＦＯメモリによって音声を再生するこ
とができる。
【０００９】本発明の請求項２に記載の発明は、転送ア
ドレスをカウントアップする手段と、転送バイトカウン
トをカウントアップする手段と、転送データを格納出力
する手段と、前記３つの手段を制御する手段とを備えた
ＤＭＡ転送装置において、次の転送アドレスを格納しＤ
ＭＡ転送が終了したと同時に前記転送アドレスをカウン
トアップする手段に次の転送アドレスを送出する手段
と、次の転送バイトカウントを格納しＤＭＡ転送が終了
したと同時に前記転送バイトカウントをカウントアップ
する手段に次の転送バイトカウントを送出する手段とを
備えたＤＭＡ転送装置であり、ＤＭＡ転送が終了した際
には、直ちにハードウェアにより自動的に次のＤＭＡ転
送の設定が行われるので、ソフトウェアは音切れが発生
するまでの間の再設定を行う必要がなく、ＡＤＰＣＭデ
コーダとの間のＦＩＦＯメモリも必要最小限設けるだけ
でよくなる。
ドレスをカウントアップする手段と、転送バイトカウン
トをカウントアップする手段と、転送データを格納出力
する手段と、前記３つの手段を制御する手段とを備えた
ＤＭＡ転送装置において、次の転送アドレスを格納しＤ
ＭＡ転送が終了したと同時に前記転送アドレスをカウン
トアップする手段に次の転送アドレスを送出する手段
と、次の転送バイトカウントを格納しＤＭＡ転送が終了
したと同時に前記転送バイトカウントをカウントアップ
する手段に次の転送バイトカウントを送出する手段とを
備えたＤＭＡ転送装置であり、ＤＭＡ転送が終了した際
には、直ちにハードウェアにより自動的に次のＤＭＡ転
送の設定が行われるので、ソフトウェアは音切れが発生
するまでの間の再設定を行う必要がなく、ＡＤＰＣＭデ
コーダとの間のＦＩＦＯメモリも必要最小限設けるだけ
でよくなる。
【００１０】（実施の形態）本発明の実施の形態を図１
に示す。図１において、１１は転送アドレスカウンタで
あり、１７は次のＤＭＡ転送のアドレスを格納し、ＤＭ
Ａ転送終了と同時に転送アドレスカウンタにそのアドレ
スを送出する転送次アドレスレジスタである。１２は転
送バイトカウンタであり、１８は次の転送バイトカウン
トを格納し、ＤＭＡ転送終了と同時に転送バイトカウン
タにそのバイトカウントを送出する転送次バイトカウン
トレジスタである。１３は転送データを一時的に格納し
ておくデータバッファである。１４はＤＭＡ転送を制御
するデータを格納するコントロールレジスタであり、１
５はメインバスインタフェース部である。１６はそのデ
ータによりＤＭＡ転送を制御する転送制御部である。
に示す。図１において、１１は転送アドレスカウンタで
あり、１７は次のＤＭＡ転送のアドレスを格納し、ＤＭ
Ａ転送終了と同時に転送アドレスカウンタにそのアドレ
スを送出する転送次アドレスレジスタである。１２は転
送バイトカウンタであり、１８は次の転送バイトカウン
トを格納し、ＤＭＡ転送終了と同時に転送バイトカウン
タにそのバイトカウントを送出する転送次バイトカウン
トレジスタである。１３は転送データを一時的に格納し
ておくデータバッファである。１４はＤＭＡ転送を制御
するデータを格納するコントロールレジスタであり、１
５はメインバスインタフェース部である。１６はそのデ
ータによりＤＭＡ転送を制御する転送制御部である。
【００１１】次に、本実施の形態の動作を図２を用いて
説明する。まず、ソフトウェアより転送アドレスカウン
タ１１にＤＭＡ転送をする音声データが格納されている
主記憶装置のアドレスを設定し（Ｓ１１）、ＤＭＡ転送
をするバイトカウント量を転送バイトカウンタ１２に設
定する（Ｓ１２）。次に連続してＤＭＡ転送をする音声
データがあるか否か判定し（Ｓ１３）、あれば転送アド
レスレジスタ１７に次回ＤＭＡ転送をする音声データが
格納されている主記憶装置のアドレスを設定し（Ｓ１
４）、次回ＤＭＡ転送をするバイトカウント量を転送バ
イトカウンタ１８に設定する（Ｓ１５）。なければコン
トロールレジスタ１４にＤＭＡ転送の開始を設定すると
（Ｓ１６）、メインバス・インタフェース回路１５は所
定の手続を行い、メインバスのバス権を獲得し（Ｓ１
７）、転送アドレスカウンタ１１のアドレスを使用して
メインメモリから音声データを読み込み（Ｓ１８）、転
送アドレスカウンタ１１がカウントアップして（Ｓ１
９）、読み込んだ音声データをデータ・バッファ１３に
格納する（Ｓ２０）。次にＡＤＰＣＭデコーダにデータ
バッファ１３に格納された音声データを送出し（Ｓ２
１）、転送バイトカウンタ１２をカウントダウンする
（Ｓ２２）。転送バイトカウンタの値が０か否かを判定
して（Ｓ２３）、転送バイトカウンタの値が０でなけれ
ばステップ１７に戻り、０であれば次に連続したＤＭＡ
転送があるか否かを判定し（Ｓ２４）、次のＤＭＡ転送
があればステップ１４に戻り、なければＤＭＡ転送を終
了する。
説明する。まず、ソフトウェアより転送アドレスカウン
タ１１にＤＭＡ転送をする音声データが格納されている
主記憶装置のアドレスを設定し（Ｓ１１）、ＤＭＡ転送
をするバイトカウント量を転送バイトカウンタ１２に設
定する（Ｓ１２）。次に連続してＤＭＡ転送をする音声
データがあるか否か判定し（Ｓ１３）、あれば転送アド
レスレジスタ１７に次回ＤＭＡ転送をする音声データが
格納されている主記憶装置のアドレスを設定し（Ｓ１
４）、次回ＤＭＡ転送をするバイトカウント量を転送バ
イトカウンタ１８に設定する（Ｓ１５）。なければコン
トロールレジスタ１４にＤＭＡ転送の開始を設定すると
（Ｓ１６）、メインバス・インタフェース回路１５は所
定の手続を行い、メインバスのバス権を獲得し（Ｓ１
７）、転送アドレスカウンタ１１のアドレスを使用して
メインメモリから音声データを読み込み（Ｓ１８）、転
送アドレスカウンタ１１がカウントアップして（Ｓ１
９）、読み込んだ音声データをデータ・バッファ１３に
格納する（Ｓ２０）。次にＡＤＰＣＭデコーダにデータ
バッファ１３に格納された音声データを送出し（Ｓ２
１）、転送バイトカウンタ１２をカウントダウンする
（Ｓ２２）。転送バイトカウンタの値が０か否かを判定
して（Ｓ２３）、転送バイトカウンタの値が０でなけれ
ばステップ１７に戻り、０であれば次に連続したＤＭＡ
転送があるか否かを判定し（Ｓ２４）、次のＤＭＡ転送
があればステップ１４に戻り、なければＤＭＡ転送を終
了する。
【００１２】
【発明の効果】本発明は、上記実施の形態から明らかな
ように、ＤＭＡ転送が終了したと同時に、次のＤＭＡ転
送のアドレスとバイトカウントを再設定するようにした
ので、必要最小限のＦＩＦＯメモリで音声データを転送
することができる。
ように、ＤＭＡ転送が終了したと同時に、次のＤＭＡ転
送のアドレスとバイトカウントを再設定するようにした
ので、必要最小限のＦＩＦＯメモリで音声データを転送
することができる。
【図１】本発明の実施の形態におけるＤＭＡ転送装置の
ブロック図
ブロック図
【図２】本発明の実施の形態におけるＤＭＡ転送装置の
動作フロー図
動作フロー図
【図３】従来例における音声データをＤＭＡ転送する装
置の一般的な概略ブロック図
置の一般的な概略ブロック図
【図４】従来例におけるＤＭＡ転送装置のブロック図
【図５】従来例におけるＤＭＡ転送装置の動作フロー図
１ ＣＰＵ ２ 主記憶装置 ３ ＤＭＡ転送装置 ４ ＦＩＦＯメモリ ５ ＡＤＰＣＭデコーダ装置 ６ Ｄ／Ａ部 ７ スピーカ １１、２１ 転送アドレスカウンタ １２、２２ 転送バイトカウンタ １３、２３ データバッファ １４、２４ コントロールレジスタ １５、２５ メインバスインタフェース部 １６、２６ 転送制御部 １７ 転送次アドレスレジスタ １８ 転送次バイトカウントレジスタ
Claims (2)
- 【請求項１】 転送アドレスをカウントアップする手段
と、転送バイトカウントをカウントアップする手段と、
転送データを格納出力する手段と、前記３つの手段を制
御する手段とを備えたＤＭＡ転送装置において、ＤＭＡ
転送が終了したと同時に、次のＤＭＡ転送のアドレスと
バイトカウントを再設定する手段を備えたＤＭＡ転送装
置。 - 【請求項２】 転送アドレスをカウントアップする手段
と、転送バイトカウントをカウントアップする手段と、
転送データを格納出力する手段と、前記３つの手段を制
御する手段とを備えたＤＭＡ転送装置において、次の転
送アドレスを格納しＤＭＡ転送が終了したと同時に前記
転送アドレスをカウントアップする手段に次の転送アド
レスを送出する手段と、次の転送バイトカウントを格納
しＤＭＡ転送が終了したと同時に前記転送バイトカウン
トをカウントアップする手段に次の転送バイトカウント
を送出する手段とを備えたＤＭＡ転送装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9316733A JPH11149438A (ja) | 1997-11-18 | 1997-11-18 | Ｄｍａ転送装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9316733A JPH11149438A (ja) | 1997-11-18 | 1997-11-18 | Ｄｍａ転送装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH11149438A true JPH11149438A (ja) | 1999-06-02 |
Family
ID=18080305
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9316733A Pending JPH11149438A (ja) | 1997-11-18 | 1997-11-18 | Ｄｍａ転送装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH11149438A (ja) |
-
1997
- 1997-11-18 JP JP9316733A patent/JPH11149438A/ja active Pending
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20040615 |
|
| A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20060825 |
|
| A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20060912 |
|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20070206 |