JPS5829683A - サ−マルプリンタヘツド - Google Patents
サ−マルプリンタヘツドInfo
- Publication number
- JPS5829683A JPS5829683A JP12735881A JP12735881A JPS5829683A JP S5829683 A JPS5829683 A JP S5829683A JP 12735881 A JP12735881 A JP 12735881A JP 12735881 A JP12735881 A JP 12735881A JP S5829683 A JPS5829683 A JP S5829683A
- Authority
- JP
- Japan
- Prior art keywords
- circuits
- integrated
- circuit
- diode
- distributing board
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B41—PRINTING; LINING MACHINES; TYPEWRITERS; STAMPS
- B41J—TYPEWRITERS; SELECTIVE PRINTING MECHANISMS, i.e. MECHANISMS PRINTING OTHERWISE THAN FROM A FORME; CORRECTION OF TYPOGRAPHICAL ERRORS
- B41J2/00—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed
- B41J2/315—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material
- B41J2/32—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material using thermal heads
- B41J2/345—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material using thermal heads characterised by the arrangement of resistors or conductors
Landscapes
- Electronic Switches (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明はサーマルプリンタヘッドに関する。
周知のようにサーマルプリンタヘッドは、基板の表面に
形成された抵抗体に通１ｒしてこれを発熱させることに
よって所要のプリントを行ならものであるづｚｌ この
ようなヘッドにおいてファクシミリ用と１〜で抵抗体を
一直線に並べ、これらを選択的に通電するよらにしたも
の力！ある。たとえば厚膜等に上り長尺状の抵抗層を形
成１１、又これをほぼ等間隔に横切ふ導線を形成し、こ
の導線を選択１、てその導線間に挾まれふ抵抗層部分を
発熱させるようにしてＩｙｈふ。
形成された抵抗体に通１ｒしてこれを発熱させることに
よって所要のプリントを行ならものであるづｚｌ この
ようなヘッドにおいてファクシミリ用と１〜で抵抗体を
一直線に並べ、これらを選択的に通電するよらにしたも
の力！ある。たとえば厚膜等に上り長尺状の抵抗層を形
成１１、又これをほぼ等間隔に横切ふ導線を形成し、こ
の導線を選択１、てその導線間に挾まれふ抵抗層部分を
発熱させるようにしてＩｙｈふ。
第１図はその一例を示１７．基板の表面に長尺状の厚膜
からなふ抵抗層１を形成１〜、又複数の導線２を抵抗層
ｌを横切丞よ＾に形成す石とと本に集積された逆流防止
用のダイオード回路３及び同じ（集積されたトランジス
タ回ＩＦ４．シフトレジスタ５等からなふ駆動回路６に
４線２を接続すふ。
からなふ抵抗層１を形成１〜、又複数の導線２を抵抗層
ｌを横切丞よ＾に形成す石とと本に集積された逆流防止
用のダイオード回路３及び同じ（集積されたトランジス
タ回ＩＦ４．シフトレジスタ５等からなふ駆動回路６に
４線２を接続すふ。
第１図の例はダイオード回路３．駆ｔ）＋ ｒｉ＝１
＋修６を複数用意Ｌ＊例を示す。ひとつのダイオード回
路３と駆動回路６Ｖｃ関すみ回路例を示したの≠５第２
図である。第１図、第２図の例は導線２を抵抗層ｌの両
側に交互に引出１．た繊成であり、一方の側に引出され
た導線２Ａけダイオード［…路３の各ダイオード３Ａに
接続される。そ１．て各ダイオード３Ａけひとつお缶に
一括されて端子７．８に接続される。又他方のＩＪ＋ｖ
に引出された導線２Ｂはトランジスタ回路４の各トラン
ジスタ４Ａを経て端子９に接続され石。各トランジスタ
４Ａのベースはシフトレジスタ５の各セクション５Ａに
接続すれる。
＋修６を複数用意Ｌ＊例を示す。ひとつのダイオード回
路３と駆動回路６Ｖｃ関すみ回路例を示したの≠５第２
図である。第１図、第２図の例は導線２を抵抗層ｌの両
側に交互に引出１．た繊成であり、一方の側に引出され
た導線２Ａけダイオード［…路３の各ダイオード３Ａに
接続される。そ１．て各ダイオード３Ａけひとつお缶に
一括されて端子７．８に接続される。又他方のＩＪ＋ｖ
に引出された導線２Ｂはトランジスタ回路４の各トラン
ジスタ４Ａを経て端子９に接続され石。各トランジスタ
４Ａのベースはシフトレジスタ５の各セクション５Ａに
接続すれる。
抵抗層１け互いに隣り合う導線ＶＣ１つて複数の抵抗層
部分８１〜Ｓｎに区画される。最初に抵抗層部分Ｓ＋
、Ｓ４，８６．８８〜Ｓｎについテノ発熱をｉ択−ｉふ
。そのためにシフトレジスタ５の各セクション５ＡｉＣ
１，，又は Ｏの内容をレジストすみ。ここに ＩＮは
発熱させ込場合を、又 ０７．け発熱させな層場合とす
ふ。そ１−て端子７に発熱用直流電源の正極を、又端子
９に同電源の負極を接続＋ム。内容を １２．とするセ
クションにベース≠（連なるトランジスタ雀オンとされ
為ので、前記抵抗層部分に選択的に通電されて発熱する
。
部分８１〜Ｓｎに区画される。最初に抵抗層部分Ｓ＋
、Ｓ４，８６．８８〜Ｓｎについテノ発熱をｉ択−ｉふ
。そのためにシフトレジスタ５の各セクション５ＡｉＣ
１，，又は Ｏの内容をレジストすみ。ここに ＩＮは
発熱させ込場合を、又 ０７．け発熱させな層場合とす
ふ。そ１−て端子７に発熱用直流電源の正極を、又端子
９に同電源の負極を接続＋ム。内容を １２．とするセ
クションにベース≠（連なるトランジスタ雀オンとされ
為ので、前記抵抗層部分に選択的に通電されて発熱する
。
次に残余の抵抗層部分についての発熱を選択するために
シフトレジスタ５の各セクションの内容を改めて再び
ｌ／／又は ０，７にレジストする。そ１−１て端子８
に発熱用直流電源の正極を、端子９に同電源の負極を接
続する。このときも内容を １７／とするセクションに
ベース≠Ｉ連なるトランジスタがオンとされるので、前
記１．ｆｒ残余の抵抗層部分に選択的に通電されて発熱
する。
シフトレジスタ５の各セクションの内容を改めて再び
ｌ／／又は ０，７にレジストする。そ１−１て端子８
に発熱用直流電源の正極を、端子９に同電源の負極を接
続する。このときも内容を １７／とするセクションに
ベース≠Ｉ連なるトランジスタがオンとされるので、前
記１．ｆｒ残余の抵抗層部分に選択的に通電されて発熱
する。
ところで上述１−か構成は、前記抵抗層部分のひとつを
１ドツトと１．た場合に８ドツト／ｍＴｎの密度ネでけ
賽現で１２．．８ドツ）７ｍｍ では各ドツトのピッチ
け１／ｓ ＝ ０．１２５ ｍｍであり、抵抗層ｌの一
方の側に引出されふ導線のピッチＰＨ１／４：０．２５
ｍｍである。そこで３２回路用のダイオード回路３Ｊ１
７動回路６を構成したと干れば、隣り合う各Ｅｐｔ路の
ピッチａけ０，２５ Ｘ ３２ 、＝ ８ ｍｍとなり
、３２回路用の各回路３，６けこの程度のピッチをもっ
て並設でをふ程度の犬★さに構成子ることは可能であふ
。
１ドツトと１．た場合に８ドツト／ｍＴｎの密度ネでけ
賽現で１２．．８ドツ）７ｍｍ では各ドツトのピッチ
け１／ｓ ＝ ０．１２５ ｍｍであり、抵抗層ｌの一
方の側に引出されふ導線のピッチＰＨ１／４：０．２５
ｍｍである。そこで３２回路用のダイオード回路３Ｊ１
７動回路６を構成したと干れば、隣り合う各Ｅｐｔ路の
ピッチａけ０，２５ Ｘ ３２ 、＝ ８ ｍｍとなり
、３２回路用の各回路３，６けこの程度のピッチをもっ
て並設でをふ程度の犬★さに構成子ることは可能であふ
。
１〜か１．最近に至ってたとえばコンピュータ端末用の
プリンタなどに層密度のドツトの配列力（要求されきつ
つある。たとえば１２ドツ）７ｍｍの密度のものが現牢
に要求されてＩ／−１為七２この場合導線のピッチＰけ
１／６’５０．１６５ ｍｍとなり、本！、３２回路用
の各回路３．６を使用するとすれば、隣り合う冬ｍ回路
３，６のピッ−）ａｉｄ Ｑ１６５ Ｘ３２＝５．２８
ｍｍと１−なければならず、従来と同一集積回路をもっ
て１．では、この程度のピッチをもって配列すみことは
で爽な（なる。本つともこれを解決ｌ−よらとするには
、４８回路用の各回路を従来と同一形状に製作すればよ
りのである２２、そのためにけ新たに集積チップを開発
しなければならな１ハ１２、又仮りに開発１．得たと１
−で本、それだけ高集積化されることになるから１少滴
り省低１．、臀価なものとなふ。
プリンタなどに層密度のドツトの配列力（要求されきつ
つある。たとえば１２ドツ）７ｍｍの密度のものが現牢
に要求されてＩ／−１為七２この場合導線のピッチＰけ
１／６’５０．１６５ ｍｍとなり、本！、３２回路用
の各回路３．６を使用するとすれば、隣り合う冬ｍ回路
３，６のピッ−）ａｉｄ Ｑ１６５ Ｘ３２＝５．２８
ｍｍと１−なければならず、従来と同一集積回路をもっ
て１．では、この程度のピッチをもって配列すみことは
で爽な（なる。本つともこれを解決ｌ−よらとするには
、４８回路用の各回路を従来と同一形状に製作すればよ
りのである２２、そのためにけ新たに集積チップを開発
しなければならな１ハ１２、又仮りに開発１．得たと１
−で本、それだけ高集積化されることになるから１少滴
り省低１．、臀価なものとなふ。
この発明はドツトの配列を品密イ化１−でも、集積回路
の配列を可能にすることを目的と干る。
の配列を可能にすることを目的と干る。
この発明は集積回路を多段的に配置し、これらと導線と
を中間配線板を用かで中継することを特徴と干るもので
ある。
を中間配線板を用かで中継することを特徴と干るもので
ある。
この発明の実施例を纂３図以降によって詩明する。図の
例は各集＃ｔｍ路を部分した構成を示し。
例は各集＃ｔｍ路を部分した構成を示し。
抵抗層ｌを横切ム導線を抵抗層１の両側に交互に引出１
．て導線２Ａ、２Ｂとすること、及び導線２Ａはダイオ
ードに、４紳２Ｂはトランジスタに接続されることば第
１図、第２図と同様である。１．かしこの発明に１．た
がい、３２回路用又はそれ以下の回路用の集積化された
ダイオード回路３１，３２及ヒトランジスタ回１Ｂ４１
，４２．シフトレジスタＦｉｌ、５２からなる集積化さ
れた駆動回路６１．６２が用意される。図の例では両ダ
イオード回路３１゜３２け中継用の配線板］ｌ上に、駆
動回路６１゜６２本中継用の配線板１２上に設置する。
．て導線２Ａ、２Ｂとすること、及び導線２Ａはダイオ
ードに、４紳２Ｂはトランジスタに接続されることば第
１図、第２図と同様である。１．かしこの発明に１．た
がい、３２回路用又はそれ以下の回路用の集積化された
ダイオード回路３１，３２及ヒトランジスタ回１Ｂ４１
，４２．シフトレジスタＦｉｌ、５２からなる集積化さ
れた駆動回路６１．６２が用意される。図の例では両ダ
イオード回路３１゜３２け中継用の配線板］ｌ上に、駆
動回路６１゜６２本中継用の配線板１２上に設置する。
その場合各配線板上の各回路は、抵抗層１の長手方向に
対して直交すみ方向に４段的に配列される。配線板１１
．１２はプリント基板、セラミック又は樹脂フィルムの
ような絶縁性のものが使用され、表面にＣｕ箔その他に
よふ導線力Ｉ形成されてあみ。後記する配線のために表
面積に不足づにあふときは配線板１１．１２を多層に；
−てもよ−。
対して直交すみ方向に４段的に配列される。配線板１１
．１２はプリント基板、セラミック又は樹脂フィルムの
ような絶縁性のものが使用され、表面にＣｕ箔その他に
よふ導線力Ｉ形成されてあみ。後記する配線のために表
面積に不足づにあふときは配線板１１．１２を多層に；
−てもよ−。
配線板１１の外部端子１１Ａに導線２人が順番に接続さ
れる。外部端子１１Ａけ配線板１１上の導線を介１．て
内部端子１１Ｂに接続されてあり。
れる。外部端子１１Ａけ配線板１１上の導線を介１．て
内部端子１１Ｂに接続されてあり。
この内部端子１１３３とダイオード回路３１．３２ と
が結線される。各ダイオード回路３１．３２のダイオー
ド３１Ａ 、 ３１Ｂは交互に一括され、端子７．８に
接続されることけ第２図と同じであＡ０配線板１２本同
じように構成され、その外部端子に導線２Ｂ−ｈ！接続
され、外部端子に接続されである内部端子と各駆動同格
６１．６２と≠（接続される。この構成における各抵抗
層部分の通電制御は第２図のｉ４′７成と特に相違量る
ところけなり０第３図、第４図に示すＰ４膜にお謁て、
各回路３１３２．６１．６２カ！それぞれ従来と同じ〈
３２回路用の本のであると１図のように各回路にっ会そ
れぞれ２個使用寸ふとなれば６４回路づよ実現で缶ふよ
うに々る。すなわち６４ドツト分を１ピツチとして集積
回路≠に配置で吉るようになふ。具体例をあげて説明＋
ふと、前記したよつに１２ドツ）／ｍｍとし′ｆｔ場合
、第１図の構成では集積＠回路のピッチａ≠ｆ５，２８
ｍｍであること７！Ｉに必要であったづＩ、図の例では
同じ３２回路用の集積回路を用１ハた場合け５，２８
Ｘ ２ ＝ １０．５６ｍｍのピッチａで配列＋為こと
力（でＡふようになふ。すなわちこの構成によれば６ド
ツ）／ｍｍの場合よりもなお余裕をもって集積回路を配
列することがで爽るのであ為。
が結線される。各ダイオード回路３１．３２のダイオー
ド３１Ａ 、 ３１Ｂは交互に一括され、端子７．８に
接続されることけ第２図と同じであＡ０配線板１２本同
じように構成され、その外部端子に導線２Ｂ−ｈ！接続
され、外部端子に接続されである内部端子と各駆動同格
６１．６２と≠（接続される。この構成における各抵抗
層部分の通電制御は第２図のｉ４′７成と特に相違量る
ところけなり０第３図、第４図に示すＰ４膜にお謁て、
各回路３１３２．６１．６２カ！それぞれ従来と同じ〈
３２回路用の本のであると１図のように各回路にっ会そ
れぞれ２個使用寸ふとなれば６４回路づよ実現で缶ふよ
うに々る。すなわち６４ドツト分を１ピツチとして集積
回路≠に配置で吉るようになふ。具体例をあげて説明＋
ふと、前記したよつに１２ドツ）／ｍｍとし′ｆｔ場合
、第１図の構成では集積＠回路のピッチａ≠ｆ５，２８
ｍｍであること７！Ｉに必要であったづＩ、図の例では
同じ３２回路用の集積回路を用１ハた場合け５，２８
Ｘ ２ ＝ １０．５６ｍｍのピッチａで配列＋為こと
力（でＡふようになふ。すなわちこの構成によれば６ド
ツ）／ｍｍの場合よりもなお余裕をもって集積回路を配
列することがで爽るのであ為。
なおこの発明は図の実施例に示す構成のサーマルプリン
タヘッドに限られず、他の構成のものにで本適用で傘る
ことはいうまでもなり０以上詳述したようにこの発明に
よればドツトの配列密度を高めｆｒ場合でも、各ドツト
の駆動制御のための集積１ｎ路を余裕のあるピッチで配
列することづ工でき、１−たがって集積回１塔として亮
集漬化１、、ｆｒものを使用すＬ必要けないとｂつか効
果を奏すふ。
タヘッドに限られず、他の構成のものにで本適用で傘る
ことはいうまでもなり０以上詳述したようにこの発明に
よればドツトの配列密度を高めｆｒ場合でも、各ドツト
の駆動制御のための集積１ｎ路を余裕のあるピッチで配
列することづ工でき、１−たがって集積回１塔として亮
集漬化１、、ｆｒものを使用すＬ必要けないとｂつか効
果を奏すふ。
８ｇ１図は従来例の平面図、第２図は同回路図、第３図
はこの発明の実施例を示す平面図、第４図は同回路図、
第５図は配線板の一例を示す平面図であふ。
はこの発明の実施例を示す平面図、第４図は同回路図、
第５図は配線板の一例を示す平面図であふ。
Claims (1)
- 抵抗層に連なふ導線と、前記抵抗層を選択的に発熱制御
すふための集積化された［…路とを配線板を介１−で接
続するとともに前記回路を多段的に配置シてなふサーマ
ルプリンタヘッド。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12735881A JPS5829683A (ja) | 1981-08-13 | 1981-08-13 | サ−マルプリンタヘツド |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12735881A JPS5829683A (ja) | 1981-08-13 | 1981-08-13 | サ−マルプリンタヘツド |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5829683A true JPS5829683A (ja) | 1983-02-21 |
Family
ID=14957966
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12735881A Pending JPS5829683A (ja) | 1981-08-13 | 1981-08-13 | サ−マルプリンタヘツド |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5829683A (ja) |
Citations (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS50144448A (ja) * | 1974-05-09 | 1975-11-20 | ||
| JPS5421854A (en) * | 1977-07-20 | 1979-02-19 | Toshiba Corp | Recording head |
| JPS5421853A (en) * | 1977-07-20 | 1979-02-19 | Toshiba Corp | Recording head |
| JPS57105759A (en) * | 1980-12-24 | 1982-07-01 | Fujitsu Ltd | Device for recording |
| JPS57107866A (en) * | 1980-12-26 | 1982-07-05 | Toshiba Corp | Thermal head |
-
1981
- 1981-08-13 JP JP12735881A patent/JPS5829683A/ja active Pending
Patent Citations (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS50144448A (ja) * | 1974-05-09 | 1975-11-20 | ||
| JPS5421854A (en) * | 1977-07-20 | 1979-02-19 | Toshiba Corp | Recording head |
| JPS5421853A (en) * | 1977-07-20 | 1979-02-19 | Toshiba Corp | Recording head |
| JPS57105759A (en) * | 1980-12-24 | 1982-07-01 | Fujitsu Ltd | Device for recording |
| JPS57107866A (en) * | 1980-12-26 | 1982-07-05 | Toshiba Corp | Thermal head |
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