JPS5886632A - デ−タ処理装置 - Google Patents

デ−タ処理装置

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Publication number
JPS5886632A
JPS5886632A JP56186009A JP18600981A JPS5886632A JP S5886632 A JPS5886632 A JP S5886632A JP 56186009 A JP56186009 A JP 56186009A JP 18600981 A JP18600981 A JP 18600981A JP S5886632 A JPS5886632 A JP S5886632A
Authority
JP
Japan
Prior art keywords
data
transmission
cable
section
signal
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP56186009A
Other languages
English (en)
Inventor
Eiichi Kagawa
栄一 香川
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP56186009A priority Critical patent/JPS5886632A/ja
Publication of JPS5886632A publication Critical patent/JPS5886632A/ja
Pending legal-status Critical Current

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Classifications

    • GPHYSICS
    • G06COMPUTING OR CALCULATING; COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G06F13/38Information transfer, e.g. on bus
    • G06F13/42Bus transfer protocol, e.g. handshake; Synchronisation
    • G06F13/4204Bus transfer protocol, e.g. handshake; Synchronisation on a parallel bus
    • G06F13/4221Bus transfer protocol, e.g. handshake; Synchronisation on a parallel bus being an input/output bus, e.g. ISA bus, EISA bus, PCI bus, SCSI bus
    • G06F13/4226Bus transfer protocol, e.g. handshake; Synchronisation on a parallel bus being an input/output bus, e.g. ISA bus, EISA bus, PCI bus, SCSI bus with asynchronous protocol

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  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Detection And Prevention Of Errors In Transmission (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 この発明は、データを入出力するデータ入出力装置と、
このデータ入出力装置にケーブルを介して接続され、デ
ータを記憶し、かつプログラム処理する制御装置とをも
つデータ処理装置に関する。
この棟のデータ処理装置として第1図に示すものがあっ
た。第1図において、1はいわゆるマンマシン・インタ
ーフェイス装置で、データを入出力する装置、2は装置
1と並列信号でデータを受信するように多数本の縁から
なるケーブル1aを介して装置1に接続され、ケーブル
1aを介して入力されるデータを記憶すると共に予め記
憶しているプログラムに従ってデータ処理をするコント
ローラである。
装置1において、操作入力部3を操作することKより、
データがこれより出力され、表示出力部4及び制御部5
に入力される。表示出力部4は、例えばCRTよりなり
、入力されたデータを画面上に表示する。制御部5は、
伝送制御を行なうもので、操作入力部3から入力される
データを所定の形式の並列信号に変換した後、伝送部6
へ転送する。伝送部6は制御部5から入力されたデータ
をケーブル1a用の伝送信号に変換してこれに送出する
コントローラ2において、伝送部7はケーブル1aを介
して受信する伝送信号からデータを抽出して制御部8に
転送する。制御部8は、制御部5と同じような機能を有
し、伝送部7から入力されたデータを適当なタイミング
でプロセッサよりなる中央演算処理部9に転送する。中
央演算処理部9は制御部8、プログラムを記憶するメモ
リ10、データを記憶するメモリ11、プロセス・デー
タを出力するプロセス出力部12a及びプロセス・デー
タを入力するプロセス入力部12bをノくス9aを介し
て接続しており、パス9aを介してこれらとデータの受
授を行ない、演算処理を実行する。
第2図は伝送部6及び1のブロック図である。
伝送部6は、ケーブル1aヘデータを送信する送信部1
3及び書込み命令等のコマンドからなる制御信号を送信
する送信部14、またケーブル1aからデータを受信す
る受信部15及び制御信号を送信する送信部16・・を
有し、これらは制御部5に共通接続されている。伝送部
7は、ケーブル1aからのデータを通過させるゲー)1
7及び制御信号を通過させるゲート18′、ゲート17
からのデータを受信する受信部19、ゲート18からの
制御信号を受信する受信部20、ケーブル1aを介して
受信部15にデータを送る送信部21並びにケーブル1
a〜を介して受信部16に制御信号を送信する送信部2
2を有し、受信部19.20.送信ff1s21及び2
2は制御部8に共通接続されているO 動作として例えば操作入力部3からメモリ10にデータ
を書込む場合を説明すると、操作入力部3を操作し、書
込むべきデータD(アドレスを含む)及び書込み命令W
を発生する。データDは制御部5.伝送部6の送信部1
3.ケーブル1 a を伝送部7のゲート17.受信部
19.制御部8及び中央演算処理部9を介してメモリ1
0に送られ。
蕾込み命令Wは制御部5.伝送部6の送信部14゜ケー
ブル1aK送出7のゲート18.受信m20゜制御部8
及び中央演算処理部9を介してメモ1月0に送られる。
メモリ10は、このようにして入力される書込み命令W
Eより指定されたアドレスにデータDを書き込む。
次に、ケーブル1aを切離し又は接続する場合、誤った
データ及び制御信号が発生することがあるので、カード
・スイッチSWを操作し、ゲート11゜18を閉じてか
らケーブル1aの切離し又は接続を行なう。
従来のデータ処理装置は、以上のよ5[構成されている
ので、ケーブルを切離し又は接続する場合は誤動作防止
用のスイッチを操作する必要があり、ケーブルの本数か
ら明らかなように装置及びその取扱いを複雑にする欠点
があった。
この発明は、上記のような従来のものの欠点を除去する
ためKなされたもので、装置間を伝送する伝送信号を直
列信号とし、かつ伝送誤りチェック用の符号を付加する
ことKより、ケーブルの本数とデータの誤りを少なくす
ることができるデータ処理i&首を提供することを目的
とする。
以下、この発明の一実施例を図について説明する。第3
図において、23は制御部5から受信する並列信号を直
列信号に変換してケーブル18に送出する変換器、24
はケ′−プル1aから受信する直列信号を並列信号に変
換して制御部5に送出する変換器である。25はケーブ
ル1aから受信する1列信号を並列信号Kf換して制御
部8に送出する変換器、26は制御部8から受信する並
列信号を直列信号に変換してケーブル1aK送出する変
換器である。その他の部分は第1図に示す通りである。
伝送部6,7間の伝送手順は次のようになっている。
(al伝送部6から伝送部Tへ伝送するデーダ及び制御
信号(コマンド]は第4図aに示すような伝送フォーマ
ットをもったブロックデータで伝送され、ヘッダ及びB
CC(ブロック・チェック拳キャラクタ)が付加される
(bl伝送起動の主導権は伝送部6がもつ。
(C)制御部9はコマンドを受信すれば必ず受信可否の
データ(返答信号)を第4図すの伝送フォーマットで伝
送部6に返送する。
(cl)制御部5は中央演算処理部9の実行状態を表わ
すステータスを周期的に間合せるコマンドを発生する。
(e)伝送部6.7はヘッダにより同期をとり、BCC
により受信したデータの伝送誤りチェックを行なう。
(f)伝送flls6はコマンドつ伝送に対して否定的
応答があった場合及び応答が所定時限無い場合は再送な
行なう。
メモリ10にデータを操作入力部3から書込む場合を例
にして動作を説明する。操作入力部3を操作し、誉込む
べきデータD(アドレスを含む)及び書込み命令Wを発
生する。データD及び齋込み命令Wは制御部5.伝送部
6の変換器23.ケーブルlaw伝送部7の変換器25
及び制(MIB8及び中央演算処理部9を介してメモリ
10に転送され、指定されたアドレスにデータDを書込
む。
この際、伝送部6から送出される伝送信号は第4図aに
示すような伝送フォーマットをもつBCCが付加されて
いるので、制御部8はBCCにより伝送部7から受信し
た伝送信号をチェックし、この結果誤りが無ければ書込
み命令W及びデータDを中央演算処理部9に送る。そし
て、もし誤りがあれば受信した1ブロツクデータを全て
無効とし、ケーブル1aに否定応答を第4図すの伝送フ
ォーマットで送出する。制御部5はこのような否定応答
を受信すると、前(ロ)送信したデータDを再送し、前
述の動作を繰返す。
データをメモリ10又は11から読出す場合は、コマン
ドを読出し命令とすることによりなされ、読み出したデ
ータの転送方向が畜込み命令の場合と逆になり、データ
は変換器26及び24を通る。
ケーブル1aを切離した場合、即ち装置1.コントロー
ラ2間の接続を切離した場合、データが伝送されたよう
な雑音が・発生してもコントローラ2及び装置1ではB
CCにより、データの伝送誤りチェックをするので、こ
のようなデータは実質止金て誤りとなるので無視される
このような切離しを原因とし、装置1においてコントロ
ーラ1側からデータの送信に対する応答が所定時限受信
されなかったときは、前述の再送をし、また適当な回数
だけ再送を繰返して(伝送が成功しないときはケーブル
1aが切離されているとして再送を中止する。
なお、上記実施例でのクープ、IL/1aは、信号を単
方向に伝送するため2本の瞼であったが、信号を2方向
に伝送するように伝送ii6.7を檎′成して1本の@
Kしてもよい。
以上のように、この発明によれば装置間の信号を直列信
号とし、受信側において伝送誤りチェックを行なうよう
にしたので、ケーブルの本数を少なくでき、装置を簡単
にでき、ケーブルの接続作業も容易となる効果がある。
【図面の簡単な説明】
第1図は従来のデータ処理装置のブロック図、第2図は
第1図に示す伝送′部のブロック図、第3図はこの発明
の一実施例によるデータ処j8I!装置の伝送部を示す
ブロック図、第4図は第3図に示す伝送部の伝送フォー
マット図である。 1・−・装置、2・・!コントローラ、3・・・操作入
力部、5,8・・・制御部、6.7・・拳伝送部、9・
・・中央演算処理部、10.11・・・メモリ、23〜
26・・・変換器。 なお、図中、同一符号は同−又は相当部分を示す。

Claims (1)

    【特許請求の範囲】
  1. データを入出力するデータ入出力装置と、ケーブルを介
    して上記データ入出力装置に接続されデータの記憶及び
    プログラム処理をするコントローラとを備え、上記デー
    タ入出力装置、コントローラ間で上記データに関連する
    信号の送受信をするデータ処理装置において、上記ケー
    ブルに送誤りチェック用のチェック・コードを付加した
    データを直列信号で送出し、かつ上記ケーブルから受信
    する上記直列信号を並列信号に変換する変換器をて受信
    するデータをこのデータに付加されているチェック・コ
    ードにより伝送誤りチェックをする制御部と誉上記デー
    タ入出力装置及びコントローラにそれぞれ備えたことを
    特徴とするデータ処理装置。
JP56186009A 1981-11-18 1981-11-18 デ−タ処理装置 Pending JPS5886632A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP56186009A JPS5886632A (ja) 1981-11-18 1981-11-18 デ−タ処理装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP56186009A JPS5886632A (ja) 1981-11-18 1981-11-18 デ−タ処理装置

Publications (1)

Publication Number Publication Date
JPS5886632A true JPS5886632A (ja) 1983-05-24

Family

ID=16180770

Family Applications (1)

Application Number Title Priority Date Filing Date
JP56186009A Pending JPS5886632A (ja) 1981-11-18 1981-11-18 デ−タ処理装置

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JP (1) JPS5886632A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP0460951A3 (ja) * 1990-06-08 1994-03-23 Mita Industrial Co Ltd

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP0460951A3 (ja) * 1990-06-08 1994-03-23 Mita Industrial Co Ltd

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