JPS5886711A - 誤動作検出方式 - Google Patents
誤動作検出方式Info
- Publication number
- JPS5886711A JPS5886711A JP18574081A JP18574081A JPS5886711A JP S5886711 A JPS5886711 A JP S5886711A JP 18574081 A JP18574081 A JP 18574081A JP 18574081 A JP18574081 A JP 18574081A JP S5886711 A JPS5886711 A JP S5886711A
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- JP
- Japan
- Prior art keywords
- solenoid
- time
- drive circuit
- output
- voltage
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01F—MAGNETS; INDUCTANCES; TRANSFORMERS; SELECTION OF MATERIALS FOR THEIR MAGNETIC PROPERTIES
- H01F7/00—Magnets
- H01F7/06—Electromagnets; Actuators including electromagnets
- H01F7/08—Electromagnets; Actuators including electromagnets with armatures
- H01F7/18—Circuit arrangements for obtaining desired operating characteristics, e.g. for slow operation, for sequential energisation of windings, for high-speed energisation of windings
- H01F7/1844—Monitoring or fail-safe circuits
Landscapes
- Physics & Mathematics (AREA)
- Electromagnetism (AREA)
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Accessory Devices And Overall Control Thereof (AREA)
- Impact Printers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明はブリ／ター等に用いられるソレノイド駆動回路
が正常に動作したか、否かを、検出する為の誤動作方式
に関する。
が正常に動作したか、否かを、検出する為の誤動作方式
に関する。
従来、多数のソレノイドを有する装置、例えばプリンタ
等のソレノイド駆動回路が正常に動作したか、否かを判
別する為に、駆動回路の出力トランジスタのＯＮ 、
ＯＦＦを論理的に検出する方法があったｏしかしこの従
来方式によっては、駆動回路までの動作は確認できるが
、実際にソレノイドに電流が流れたか、否か、までの判
断は出来なかった。
等のソレノイド駆動回路が正常に動作したか、否かを判
別する為に、駆動回路の出力トランジスタのＯＮ 、
ＯＦＦを論理的に検出する方法があったｏしかしこの従
来方式によっては、駆動回路までの動作は確認できるが
、実際にソレノイドに電流が流れたか、否か、までの判
断は出来なかった。
本発明は、係る点に鑑みて成されたものであり、駆動回
路、ソレノイドコイル、電源等の構成要素のいずれが原
因であっても誤動作を検出する事の出来る、極めて有効
な方式を提供出来るものである。
路、ソレノイドコイル、電源等の構成要素のいずれが原
因であっても誤動作を検出する事の出来る、極めて有効
な方式を提供出来るものである。
以下一実施例に基すき本発明の詳細な説明するＯ
第１図は、本発明に係るソレノイド駆動装置のブロック
図であり ＣＰＵは制御装置であって、ソレノイドの駆動タイミン
グ信号を発生させ、又、誤動作検出の一部をも兼ねてお
り、誤りを検出するとエラーランプＢを点灯させる。
図であり ＣＰＵは制御装置であって、ソレノイドの駆動タイミン
グ信号を発生させ、又、誤動作検出の一部をも兼ねてお
り、誤りを検出するとエラーランプＢを点灯させる。
ＯＭＰはコンパレータであり一人力ｖ８と十入力孔を比
較しｖ８よりＶ。が高いとき、出力Ｔを１にする０８Ｑ
Ｌは多数のソレノイドとその駆動回路等の総称であり、
制御装置ＯＰＵの出力Ｒ１〜Ｒ４によって目的のソレノ
イドを駆動すべく構成されており、その詳細を第２図に
よって説明する。
較しｖ８よりＶ。が高いとき、出力Ｔを１にする０８Ｑ
Ｌは多数のソレノイドとその駆動回路等の総称であり、
制御装置ＯＰＵの出力Ｒ１〜Ｒ４によって目的のソレノ
イドを駆動すべく構成されており、その詳細を第２図に
よって説明する。
Ｌ、〜Ｌ４は４コのソレノイドコイルであり、各ソレノ
イドコイルの駆動回路側には各々、ダイオードＤ、〜Ｄ
４がつながり各ダイオードの一方は、共通出力線Ｖ０に
つながる。
イドコイルの駆動回路側には各々、ダイオードＤ、〜Ｄ
４がつながり各ダイオードの一方は、共通出力線Ｖ０に
つながる。
これ等のダイオードはソレノイドコイル駆動トランジス
タＱ、−Ｑ、がＯＮからＯＦＦに変化した時、ソレノイ
ドに蓄えられたエネルギーを放出させる為に用いるもの
であり、従来はダイオードのコモン側の線■。はソレノ
イドの電源ｖ８ｏＬに直接つなげるものであるが、本発
明に於いては、ソレノイドの磁気エネルギーを単純に電
源に戻すのではなく、このエネルギーを一度コモン線ｖ
ｏと電源ｖ８０Ｌ間に入れたコンデンサＯＴに蓄えた後
抵抗ＲＴを通して電源焉。１に流す様に構成した。尚、
駆動トランジスタＱ１〜Ｑ４のペースにはそれぞれベー
ス抵抗ＲＢと入力抵抗ＲＩが接続され１人力抵抗−には
それぞれ前記制御回路ＣＰＵの出力信号、Ｒ１−Ｒ４が
つながっている。
タＱ、−Ｑ、がＯＮからＯＦＦに変化した時、ソレノイ
ドに蓄えられたエネルギーを放出させる為に用いるもの
であり、従来はダイオードのコモン側の線■。はソレノ
イドの電源ｖ８ｏＬに直接つなげるものであるが、本発
明に於いては、ソレノイドの磁気エネルギーを単純に電
源に戻すのではなく、このエネルギーを一度コモン線ｖ
ｏと電源ｖ８０Ｌ間に入れたコンデンサＯＴに蓄えた後
抵抗ＲＴを通して電源焉。１に流す様に構成した。尚、
駆動トランジスタＱ１〜Ｑ４のペースにはそれぞれベー
ス抵抗ＲＢと入力抵抗ＲＩが接続され１人力抵抗−には
それぞれ前記制御回路ＣＰＵの出力信号、Ｒ１−Ｒ４が
つながっている。
以上の如く構成した一実施例の動作について第３図のタ
イミングチャートに従って説明する〇崗タイミング泌ヤ
ードは制御装置がＬ２を駆動した後、つづいてり、とり
、を同時に駆動する場合についてのものである。
イミングチャートに従って説明する〇崗タイミング泌ヤ
ードは制御装置がＬ２を駆動した後、つづいてり、とり
、を同時に駆動する場合についてのものである。
まず制御回路はソレノイドＩｊ２を駆動する為に出力Ｒ
１をｌにすると、駆動回路のトランジスタＱ、がＯＮＩ
、てソレノイドＬ、に電流を流す、次に所望の時間径制
御回路ＣＰＵが鴫出カ信号１゜にする。するとソレノイ
ド駆動回路のトランジスタＱ、がＯＦＦになる。この後
、駆動トランジスタＱ、がＯＮの時に蓄えられた磁気エ
ネルギーｑ工。
１をｌにすると、駆動回路のトランジスタＱ、がＯＮＩ
、てソレノイドＬ、に電流を流す、次に所望の時間径制
御回路ＣＰＵが鴫出カ信号１゜にする。するとソレノイ
ド駆動回路のトランジスタＱ、がＯＦＦになる。この後
、駆動トランジスタＱ、がＯＮの時に蓄えられた磁気エ
ネルギーｑ工。
は、電流となつ−ＣダイオードＤ、を通りコンデンサ叫
に流れ込み、コンデンサｃＴの両端には電圧Ｖを発生す
る。この時の電圧Ｖはコンデンサｑの容量をＣ２流れ込
んだ電荷量をｑ。とすｎばυ＝ｑｏ１０であり、共通線
Ｖ。には、ｖ８ｏ、１．＋υノ電圧が表われる。即ち、
第３図Ｖ。の波形のようになる。その後コンデンサＣ１
に蓄えられた電荷Ｑａは、抵抗ＲＴを通り電荷量ｑ。に
よって決まる時間をかけて電源ｖ８゜１に放出される。
に流れ込み、コンデンサｃＴの両端には電圧Ｖを発生す
る。この時の電圧Ｖはコンデンサｑの容量をＣ２流れ込
んだ電荷量をｑ。とすｎばυ＝ｑｏ１０であり、共通線
Ｖ。には、ｖ８ｏ、１．＋υノ電圧が表われる。即ち、
第３図Ｖ。の波形のようになる。その後コンデンサＣ１
に蓄えられた電荷Ｑａは、抵抗ＲＴを通り電荷量ｑ。に
よって決まる時間をかけて電源ｖ８゜１に放出される。
一方共通線Ｖ。は第１図に示した様に電圧比較器ＯＭＰ
の＋側入力に接続されており、又−個入力には基準電圧
としてｖ８が加えられている。この基準電圧はソレノイ
ドの電源電圧ｖ８ｏＩ、より少し高めに設定されている
。
の＋側入力に接続されており、又−個入力には基準電圧
としてｖ８が加えられている。この基準電圧はソレノイ
ドの電源電圧ｖ８ｏＩ、より少し高めに設定されている
。
即ち、第３図に示した如く共通線Ｖ。が基準電圧ＶＢを
上まわった時、比較器ＯＭＦの出力Ｔが１となる。この
出力Ｔが１になっている時間は、前記したコンデンサＯ
ＴＫ蓄えられた電荷量ｑ。によって決まる時間、【、で
ある０又、比較器の出力Ｔは、制御装置ＯＰＵに入力さ
れる。制御装置ＯＰ［Ｊはこの信号Ｔが１になっている
時間を計る。
上まわった時、比較器ＯＭＦの出力Ｔが１となる。この
出力Ｔが１になっている時間は、前記したコンデンサＯ
ＴＫ蓄えられた電荷量ｑ。によって決まる時間、【、で
ある０又、比較器の出力Ｔは、制御装置ＯＰＵに入力さ
れる。制御装置ＯＰ［Ｊはこの信号Ｔが１になっている
時間を計る。
そして、その時間が予め設定された時間と違わないかを
判別するものである。予め設定されたの式によって決ま
る時間である。崗、式中のｎは、何個のソレノイドを駆
動したかの数である。
判別するものである。予め設定されたの式によって決ま
る時間である。崗、式中のｎは、何個のソレノイドを駆
動したかの数である。
今制御回路はソレノイドコイル個を駆動【７たのでｎ＝
１である。又判別の結果、時間が一致しなければ、例え
ば、比較器の出力Ｔが１の時間が零であればソレノイド
や配線に断線があった、又は駆動回路がこわれていた等
、何等かの理由でソレノイドに電流が流れなかった事に
なる。
１である。又判別の結果、時間が一致しなければ、例え
ば、比較器の出力Ｔが１の時間が零であればソレノイド
や配線に断線があった、又は駆動回路がこわれていた等
、何等かの理由でソレノイドに電流が流れなかった事に
なる。
又、比較器の出力Ｔが１の時間が長すぎた場合は配線の
ショート等、何等かの理由で２つ以上のソレノイドがＯ
Ｎ ｌ、てしまった事がわかる。
ショート等、何等かの理由で２つ以上のソレノイドがＯ
Ｎ ｌ、てしまった事がわかる。
この様な時制御回路ＣＰＵは、う／プＥを点灯させ誤動
作を知らせる。
作を知らせる。
さて、制御装置はつづいてソレノイドＬ３． Ｉ’１を
同時にＯＮさせる為、出力Ｒ，，Ｒ，にｌを出力する。
同時にＯＮさせる為、出力Ｒ，，Ｒ，にｌを出力する。
これによって駆動回路のトランジスタＱ、。
Ｑ４がＯＮとなりソレノイドＬ３ｔ Ｌ４に電流を流す
。
。
制御装置ＣＰＵは再び一定時間経過後、出力”！＋Ｒ４
を０にする。従って、駆動トランジスタＱｓｔＱ４がＯ
ＦＦとなり、ソレノイドに蓄えられた磁気エネルギーｑ
ＩＪは、それぞれダイオードＤ８．及びＤ４を通りコ／
デンナＣＴに蓄えられる。この時コンデンサＣＴの両端
には、前記ソレノイドＬ、を駆動した時と同様に電圧ν
が表われるが、今度はソレノイドＬ、 、 Ｌ、の２つ
を同時にＯＮさせていたので、 ｕ ＝ ２ Ｘ ｑ
ｃ ／ Ｏとなる。つづいてこの電荷２ Ｘ ｑ、は抵
抗臀を通して、電荷量２Ｘｑｃに基ずく時間で放出され
第３図のＶ。の如き電圧変化を示し、その電圧に基すき
比較器ＯＭＰの出力Ｔは”１′′を出力する。制御回路
ＣＰＵは、こ・のＴが”１″の時間を計り、前記時間の
式ｔと比鰐し、違っていないかを判定する。
を０にする。従って、駆動トランジスタＱｓｔＱ４がＯ
ＦＦとなり、ソレノイドに蓄えられた磁気エネルギーｑ
ＩＪは、それぞれダイオードＤ８．及びＤ４を通りコ／
デンナＣＴに蓄えられる。この時コンデンサＣＴの両端
には、前記ソレノイドＬ、を駆動した時と同様に電圧ν
が表われるが、今度はソレノイドＬ、 、 Ｌ、の２つ
を同時にＯＮさせていたので、 ｕ ＝ ２ Ｘ ｑ
ｃ ／ Ｏとなる。つづいてこの電荷２ Ｘ ｑ、は抵
抗臀を通して、電荷量２Ｘｑｃに基ずく時間で放出され
第３図のＶ。の如き電圧変化を示し、その電圧に基すき
比較器ＯＭＰの出力Ｔは”１′′を出力する。制御回路
ＣＰＵは、こ・のＴが”１″の時間を計り、前記時間の
式ｔと比鰐し、違っていないかを判定する。
以上、説明した様に本発明は、駆動回路のみならず、駆
動回路以降の配線やソレノイドそのものに不具合があっ
ても、それを検出する事が出来るＥｌその構成が極めて
シンプルであり安価に出来るため、極めて有効な検出方
式を提供し得るものである。
動回路以降の配線やソレノイドそのものに不具合があっ
ても、それを検出する事が出来るＥｌその構成が極めて
シンプルであり安価に出来るため、極めて有効な検出方
式を提供し得るものである。
第１図は本発明の一実施例を示すブロック図であり、Ｏ
ＰＵ ・・・制御装置、ＯＭＰ・・電圧比較器。 ＳＱＬ・・・ソレノイド、及び駆動回路、図 第２図はソレノイド、駆動回へ、第３図は、各部の波形
及びタイミングを示すタイミングチャート図である。 出Ｍ 人 キャノン株式会社 Ｃ」社−−１ ｖ、ｏｔ
ＰＵ ・・・制御装置、ＯＭＰ・・電圧比較器。 ＳＱＬ・・・ソレノイド、及び駆動回路、図 第２図はソレノイド、駆動回へ、第３図は、各部の波形
及びタイミングを示すタイミングチャート図である。 出Ｍ 人 キャノン株式会社 Ｃ」社−−１ ｖ、ｏｔ
Claims (1)
- に抵抗を接続し、前記コンデンサの両端に発生する電圧
を検出し、基準電圧と比較することによりソレノイドの
誤動作を検出することを特徴とする誤動作検出方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18574081A JPS5886711A (ja) | 1981-11-19 | 1981-11-19 | 誤動作検出方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18574081A JPS5886711A (ja) | 1981-11-19 | 1981-11-19 | 誤動作検出方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5886711A true JPS5886711A (ja) | 1983-05-24 |
Family
ID=16176025
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18574081A Pending JPS5886711A (ja) | 1981-11-19 | 1981-11-19 | 誤動作検出方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5886711A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62290111A (ja) * | 1986-06-09 | 1987-12-17 | Mitsubishi Electric Corp | 誘導性負荷駆動回路の故障検出回路 |
| JPH05152127A (ja) * | 1991-11-29 | 1993-06-18 | Yamaha Corp | ソレノイド異常検出回路 |
-
1981
- 1981-11-19 JP JP18574081A patent/JPS5886711A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62290111A (ja) * | 1986-06-09 | 1987-12-17 | Mitsubishi Electric Corp | 誘導性負荷駆動回路の故障検出回路 |
| JPH05152127A (ja) * | 1991-11-29 | 1993-06-18 | Yamaha Corp | ソレノイド異常検出回路 |
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