JPS5887645A - 計算機間交信方式 - Google Patents
計算機間交信方式Info
- Publication number
- JPS5887645A JPS5887645A JP18541081A JP18541081A JPS5887645A JP S5887645 A JPS5887645 A JP S5887645A JP 18541081 A JP18541081 A JP 18541081A JP 18541081 A JP18541081 A JP 18541081A JP S5887645 A JPS5887645 A JP S5887645A
- Authority
- JP
- Japan
- Prior art keywords
- information
- computer
- module
- exchange area
- shared memory
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F15/00—Digital computers in general; Data processing equipment in general
- G06F15/16—Combinations of two or more digital computers each having at least an arithmetic unit, a program unit and a register, e.g. for a simultaneous processing of several programs
- G06F15/163—Interprocessor communication
- G06F15/167—Interprocessor communication using a common memory, e.g. mailbox
Landscapes
- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Theoretical Computer Science (AREA)
- Software Systems (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Multi Processors (AREA)
- Information Transfer Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（１） 発明の利用分野
本発明は、頷航台の！′を算機から構成される似合Ｉｔ
算機システムにおいて、各計算機が互いに情報を父供す
る。針Ｊｌ磯機関信方式に圓する。
算機システムにおいて、各計算機が互いに情報を父供す
る。針Ｊｌ磯機関信方式に圓する。
（２） 従来技術
複合＃Ｆ鼻礪システムでは、一般に、与えられた菓ｔ！
ＩＩ％たとえばｔｉ算機の相互監視やプロセス制御など
の業務をいくつかに分割し、それらｔ’＊ａの計算機が
少しずつ分担して処理する構成をとる。
ＩＩ％たとえばｔｉ算機の相互監視やプロセス制御など
の業務をいくつかに分割し、それらｔ’＊ａの計算機が
少しずつ分担して処理する構成をとる。
このよりな計算機システムでは、各計算機が分担しｆｃ
栗業務逐行してｉくうえで、互いに情報を交快しなけれ
ばならないといつｘｉｉｔ況が発生する。
栗業務逐行してｉくうえで、互いに情報を交快しなけれ
ばならないといつｘｉｉｔ況が発生する。
谷ｉ１′ｔ′Ｊ４機が互いに情報を交換するためには、
情報の交換エリアと、送ｔＭｉＩ１１１が情報を交換エ
リアに書き込んだことを受ｔｉｎに通知する損耗が必要
である。
情報の交換エリアと、送ｔＭｉＩ１１１が情報を交換エ
リアに書き込んだことを受ｔｉｎに通知する損耗が必要
である。
従来技何では、Ｊ１１１図のように、計算機３，４を、
ｌｔｔ′Ｉ！＃機閾共有メモリ１とｔｌ−鼻慎間りンケ
ージパス２で縮合し、ｒｒｓ績間共肩メモリ１円に情報
交換エリア１１を＆逃、計算機間リンケージバス２に割
込み憬１ｌｌｔ具伽し、これらｔ−便って針鼻機閲交信
を行なっていた。
ｌｔｔ′Ｉ！＃機閾共有メモリ１とｔｌ−鼻慎間りンケ
ージパス２で縮合し、ｒｒｓ績間共肩メモリ１円に情報
交換エリア１１を＆逃、計算機間リンケージバス２に割
込み憬１ｌｌｔ具伽し、これらｔ−便って針鼻機閲交信
を行なっていた。
すなわち、送ＩｊＩｉ４１１針算ａ１３は情報を交換エ
リア１１に膏き込み、つぎに＃鼻機関リンケージバス２
を軸出して受信側計算＊４に割込みをかける。
リア１１に膏き込み、つぎに＃鼻機関リンケージバス２
を軸出して受信側計算＊４に割込みをかける。
受信側計算ｆａ４は、この割込＋を受付けた時。
悄＠Ａｔ−変洪エリフ１１から絖み出す。
この方式は、比較的簡単に、システムｔ−傅處する計Ｘ
機の台ａを拡張できるという置所を持ってイ、６カ、−
７７、＃８ｆｌｋ間リンケージパス２に［Ｆが発生じた
一ｍ合、 ｔｉｅ磯閲交洒が不可能となシ。
機の台ａを拡張できるという置所を持ってイ、６カ、−
７７、＃８ｆｌｋ間リンケージパス２に［Ｆが発生じた
一ｍ合、 ｔｉｅ磯閲交洒が不可能となシ。
情報交換の門番によっては、システムダウンを引き起こ
すことかめるとい９危険性を持っている。
すことかめるとい９危険性を持っている。
したがって、超高膚頼性を費求するシステムでは、 ｔ
ｉＪ１機間りンケージバス２を２ｘ化する方式がとられ
ているが、そのために、システム規模のわシには南画な
システムとなることがある。
ｉＪ１機間りンケージバス２を２ｘ化する方式がとられ
ているが、そのために、システム規模のわシには南画な
システムとなることがある。
ここに、計′ｊ＃機関リンケージパスの障害に備え。
その割込み機構の安価な代替手段が望まｎている。
また、当初から計算機間リンケージバスの割込み機Ｓを
便うＣよどの尚速性を散水せずに、単純にｔｉＪＩ機間
共有メモリだけｔ−使って、ｉｎ機閾父信の機能を具備
することを散水するシステムも少なくない。
便うＣよどの尚速性を散水せずに、単純にｔｉＪＩ機間
共有メモリだけｔ−使って、ｉｎ機閾父信の機能を具備
することを散水するシステムも少なくない。
（３） 発明の目的
本発明は、計算機間共有メモリと、各々の計算機が既に
具備しているハードウェア′？ｔ、ｆＩＩ用して、送ｔ
ｉ１１１４１１＃ｔＪ１：機３が１Ｗ報を計算機関共有
メモリ内の交換エリアＩＩＫ振き込んだことｔ−慣用す
るタイミ／グｔ、受ｔｇ情針算機４に発生名せることに
よシ、ｔｔ鼻機間リンケージバス２を１ｊ！９場合よシ
は性能は劣ってもよいが、情報交換の機能を維持できる
ようにすることを目的とする。
具備しているハードウェア′？ｔ、ｆＩＩ用して、送ｔ
ｉ１１１４１１＃ｔＪ１：機３が１Ｗ報を計算機関共有
メモリ内の交換エリアＩＩＫ振き込んだことｔ−慣用す
るタイミ／グｔ、受ｔｇ情針算機４に発生名せることに
よシ、ｔｔ鼻機間リンケージバス２を１ｊ！９場合よシ
は性能は劣ってもよいが、情報交換の機能を維持できる
ようにすることを目的とする。
（４）発明の緬括ｌｌｌ！明
ｇ２凶に示した複合ｔｉｓ機システムでは、谷計３１！
−に周期タイマをＡｉ＃ｉｉシている。この図では見や
すくするために、受０１１１４１１ｉｉｉｔＪ１機４に
だけに周期タイマ５を衆示しである。
−に周期タイマをＡｉ＃ｉｉシている。この図では見や
すくするために、受０１１１４１１ｉｉｉｔＪ１機４に
だけに周期タイマ５を衆示しである。
送償両耐鼻礪３は慣権込瘍モジュール１４を秋って率に
情報を交換エリア１１へ書き込む。
情報を交換エリア１１へ書き込む。
一方、受信１ｌｌｌ針Ｊ１機４は周期タイマ５金利用し
て、慣截受信七ジュール１５により情報交換エリア１１
を探索するタイミングを発生させる。
て、慣截受信七ジュール１５により情報交換エリア１１
を探索するタイミングを発生させる。
周期タイマ５の割込手が一足間隔で発生するように′！
Ｆ埋しておき、その割込みが発生ずる九びに情報受信モ
ジュール１５が情報交換エリア１１を探索し、もし情報
が★き込まれていたならはそＣを絖み出す。
Ｆ埋しておき、その割込みが発生ずる九びに情報受信モ
ジュール１５が情報交換エリア１１を探索し、もし情報
が★き込まれていたならはそＣを絖み出す。
情報交換エリアの探索周期を許容乾固に納まるように設
足しておき、ｔｉ算機間父濡を維持できることを保障す
る。
足しておき、ｔｉ算機間父濡を維持できることを保障す
る。
（５１ＷＪＭガ
以下１本発明を夫ｍ例を参照して旺細に祝明する。
第３図に情報送置モジュール１４．慣権受信モジュール
１５の詳＃ｌを示す。
１５の詳＃ｌを示す。
１′１１報の５ｅ供は、従来方式と同様に計算機関共有
メモリｌ内の交換エリア１１を便って竹なう。情報交換
エリアには、情報の有無を嶽わすＭ７．Ｆグ１１１ｆｔ
具備する。
メモリｌ内の交換エリア１１を便って竹なう。情報交換
エリアには、情報の有無を嶽わすＭ７．Ｆグ１１１ｆｔ
具備する。
債権送信モジュール１４は、情報を交換エリア１１へ簀
き込＋、Ｍフラグ１１１ｔ−ＯＮする。
き込＋、Ｍフラグ１１１ｔ−ＯＮする。
−刀、情報受信モジュール１５は、周期タイマ５０割込
みで起動される。まず、次回のタイマ割込みを発生させ
るために周期タイマ５に周期時間をセットする。つぎに
、Ｍフラグ１ｌｌｔ−判定する。ＭフラグがＯＮの１合
はには、交懺エリア１１に情報が★き込まれているので
、七ｆＬｔ交換エリアから絖み出し、そして処理する。
みで起動される。まず、次回のタイマ割込みを発生させ
るために周期タイマ５に周期時間をセットする。つぎに
、Ｍフラグ１ｌｌｔ−判定する。ＭフラグがＯＮの１合
はには、交懺エリア１１に情報が★き込まれているので
、七ｆＬｔ交換エリアから絖み出し、そして処理する。
戚後にＭフラグをＯＦＦする。以上の手職で情報交換を
行なう。
行なう。
藁４図、第５図に、従来の方式と本発明の方式との切換
え割＃を示す。
え割＃を示す。
ｊｔｔＪ！愼閲共有メモリ１円に、計算機間り／ケージ
バス２が正常に動作するか否かを示すＢＫ７ラグ１１２
を具備する。ＢＫフラグがＯＦ Ｆ、の状態は、ｔｔｘ
礪間リンケージバス２が正常にＩＩＪ作することを示す
。この場合に、従来方式のＩｔｉ真機間共有メモリ１と
計算機関リンケージバス２を使う畦鼻機閾父堵を行なう
。すなわち送信モジュール１２と、受傷モジュール１３
が動作する。
バス２が正常に動作するか否かを示すＢＫ７ラグ１１２
を具備する。ＢＫフラグがＯＦ Ｆ、の状態は、ｔｔｘ
礪間リンケージバス２が正常にＩＩＪ作することを示す
。この場合に、従来方式のＩｔｉ真機間共有メモリ１と
計算機関リンケージバス２を使う畦鼻機閾父堵を行なう
。すなわち送信モジュール１２と、受傷モジュール１３
が動作する。
このとき１周期タイマ５０割行みが一足間隔で発生し、
受旧モジュール１５も動作するが、第３図に示すようｖ
ｃ、Ｍフラグ１１１がＯＦＦ状態なので、受信モジュー
ル１５の動作は無効になってＶｈる。
受旧モジュール１５も動作するが、第３図に示すようｖ
ｃ、Ｍフラグ１１１がＯＦＦ状態なので、受信モジュー
ル１５の動作は無効になってＶｈる。
一方、ＢＫ７ラグ１１２かＯＮの状態は、ｔｉｎ機間機
関ケージバス２が故嘩して−ることｔ示す。
関ケージバス２が故嘩して−ることｔ示す。
この（転）台は１本発明Ｖこ係わる針其礪間父堵を行な
う。すなわち込はモジュール１４と５党偽モジュール１
５が動作する。
う。すなわち込はモジュール１４と５党偽モジュール１
５が動作する。
このように１便禾方式と本発明の方式との切供えをＢＫ
フラグ１１２で何なう。
フラグ１１２で何なう。
第５図に示すように、送信モジュール１２が１、Ｘ（１
其機関リンケージバス）を起動した時。
其機関リンケージバス）を起動した時。
ＬＸが正常に動作しないならは、ＬＸｖＪＭモジュール
１６が励１１シ、ＢＫ７ラグ１１２をＯＮし。
１６が励１１シ、ＢＫ７ラグ１１２をＯＮし。
Ｍフラグ１１１をＯＮする。そうするととりこよって、
受信子ジュール１５の動作が肩効となシ、ＬＸ陣否％生
時の送部ＴＶ１１報が受信−肘算慨に受傷さｔ″Ｌる。
受信子ジュール１５の動作が肩効となシ、ＬＸ陣否％生
時の送部ＴＶ１１報が受信−肘算慨に受傷さｔ″Ｌる。
こｊＬ以後の肘其愼間父濱は、送置モジュール１４と受
１ｄモジュール１５で行なわれる。
１ｄモジュール１５で行なわれる。
また、１ｓ、機関リンケージバス２の障害が回復した時
には、ＬＸ回復モジュール１７が動作して。
には、ＬＸ回復モジュール１７が動作して。
ＢＫフラグ１１２をＯＦＦする。そうすることによって
、本発明の１ｔ−ｘ機関交信は停止し、再び従事 １
ｒ′；ｉ′Ｉ 米寿式の、ｆｔｓ磯間機関が丸まる。
、本発明の１ｔ−ｘ機関交信は停止し、再び従事 １
ｒ′；ｉ′Ｉ 米寿式の、ｆｔｓ磯間機関が丸まる。
以上の手ＨＬで従来方式のバックアップを行なう。
（６）まとめ
以上睨央したごとく本発明によれば、嶺曾針算機システ
ムにおいて、％酊ＪＬ磯を結合する社真機関共有メモリ
と、個々のｒｒＦｓ磯が具備している周期タイマを使用
して％肘算磯閾交匿が行なえる。
ムにおいて、％酊ＪＬ磯を結合する社真機関共有メモリ
と、個々のｒｒＦｓ磯が具備している周期タイマを使用
して％肘算磯閾交匿が行なえる。
したがって、計ｓ、ｆＩＡ間リンケージバスを具備しな
い安価な複合ｉｔｓ機システムにおけるｉ！ｔＪ！磯闇
父信方式、あるいは、ｉｔｉ鼻機間機関ケージバスを具
備するシステムにおいて、それのバックアップ力式とし
て、本Ａｆｉの方式を応用できる。
い安価な複合ｉｔｓ機システムにおけるｉ！ｔＪ！磯闇
父信方式、あるいは、ｉｔｉ鼻機間機関ケージバスを具
備するシステムにおいて、それのバックアップ力式とし
て、本Ａｆｉの方式を応用できる。
帛ｌ凶は便米の耐鼻機関交旧を示すブロック図。
第２図は本発明の−＊ＩＭｆＩｌを示すブロック図、第
３図は第２図中のｔＷ報送旧モジュール１４．悄権受信
モジュール１５の詳細図、帛４凶、纂５凶は本発明の方
式と従来の方式との切供え制＃會示す辷デ ＋
？） ／ＩＪ ｌ μ−ｖＪ Ｚ
図 １３ 図 亀 第 ４ 図 ′ｖＪ ｓ 図
３図は第２図中のｔＷ報送旧モジュール１４．悄権受信
モジュール１５の詳細図、帛４凶、纂５凶は本発明の方
式と従来の方式との切供え制＃會示す辷デ ＋
？） ／ＩＪ ｌ μ−ｖＪ Ｚ
図 １３ 図 亀 第 ４ 図 ′ｖＪ ｓ 図
Claims (1)
- 【特許請求の範囲】 １、ａ数の訂３！慎が計算機関共有メモリを介して結合
もれるように構成されている複合計算機システムにおい
て、個々の計算機に周期タイマを具備し、ｔｔ算礪間共
脣メモリを情＠父侠エリアとして便い、受部ＩＩ！ｌｉ
ｔ鼻機は周期タイマを便って一定間隔でタイマ割込みｔ
″兄生せ、このタイミングで込ｆｉ！側計算機が情報交
換エリアに情報ｔ″膏き込んだか否かを探索し、もし畳
き込んでめったならばそれｔ−ｖｔみ出すことによって
。 情報交換を行なう耐算機間交信方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18541081A JPS5887645A (ja) | 1981-11-20 | 1981-11-20 | 計算機間交信方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18541081A JPS5887645A (ja) | 1981-11-20 | 1981-11-20 | 計算機間交信方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5887645A true JPS5887645A (ja) | 1983-05-25 |
Family
ID=16170298
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18541081A Pending JPS5887645A (ja) | 1981-11-20 | 1981-11-20 | 計算機間交信方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5887645A (ja) |
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6320652A (ja) * | 1986-07-15 | 1988-01-28 | Fujitsu Ltd | プロセツサ同期方式 |
| JPH01142836A (ja) * | 1987-11-30 | 1989-06-05 | Toshiba Corp | 並列処理方法 |
| JPH02288941A (ja) * | 1988-05-20 | 1990-11-28 | Fuji Electric Co Ltd | 複数処理装置へのシステムデータ設定，変更方法 |
| JPH0353318A (ja) * | 1989-07-21 | 1991-03-07 | Nec Corp | ２ポートメモリ |
| JPH09198355A (ja) * | 1997-03-07 | 1997-07-31 | Hitachi Ltd | プロセッサシステム |
| US5968150A (en) * | 1986-03-12 | 1999-10-19 | Hitachi, Ltd. | Processor element having a plurality of CPUs for use in a multiple processor system |
-
1981
- 1981-11-20 JP JP18541081A patent/JPS5887645A/ja active Pending
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5968150A (en) * | 1986-03-12 | 1999-10-19 | Hitachi, Ltd. | Processor element having a plurality of CPUs for use in a multiple processor system |
| JPS6320652A (ja) * | 1986-07-15 | 1988-01-28 | Fujitsu Ltd | プロセツサ同期方式 |
| JPH01142836A (ja) * | 1987-11-30 | 1989-06-05 | Toshiba Corp | 並列処理方法 |
| JPH02288941A (ja) * | 1988-05-20 | 1990-11-28 | Fuji Electric Co Ltd | 複数処理装置へのシステムデータ設定，変更方法 |
| JPH0353318A (ja) * | 1989-07-21 | 1991-03-07 | Nec Corp | ２ポートメモリ |
| JPH09198355A (ja) * | 1997-03-07 | 1997-07-31 | Hitachi Ltd | プロセッサシステム |
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