JPS5895421A - 誤動作防止装置 - Google Patents
誤動作防止装置Info
- Publication number
- JPS5895421A JPS5895421A JP56193874A JP19387481A JPS5895421A JP S5895421 A JPS5895421 A JP S5895421A JP 56193874 A JP56193874 A JP 56193874A JP 19387481 A JP19387481 A JP 19387481A JP S5895421 A JPS5895421 A JP S5895421A
- Authority
- JP
- Japan
- Prior art keywords
- pulse
- trigger
- input
- signal
- gate
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K5/00—Manipulating of pulses not covered by one of the other main groups of this subclass
- H03K5/13—Arrangements having a single output and transforming input signals into pulses delivered at desired time intervals
- H03K5/14—Arrangements having a single output and transforming input signals into pulses delivered at desired time intervals by the use of delay lines
Landscapes
- Physics & Mathematics (AREA)
- Nonlinear Science (AREA)
- Manipulation Of Pulses (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は所定の入力トリガパルス以外のパルスの場合に
は後段回路にトリガパルスが加わらないようにしようと
するものであり、トリガパルスを受ける毎に状態を変え
るテレビジョン受像機等に用いられる誤動作防止装置を
提供しようとするものである。
は後段回路にトリガパルスが加わらないようにしようと
するものであり、トリガパルスを受ける毎に状態を変え
るテレビジョン受像機等に用いられる誤動作防止装置を
提供しようとするものである。
従来、所定のトリガパルス以外のパルスに対シては入力
回路にフィルタを挿入して除去するのが一般的である。
回路にフィルタを挿入して除去するのが一般的である。
しかしながら、この手段ではパターンの引廻しや、リー
ド線の引廻しのために状態が変化することが多く、特に
フィルタの時定数によるトリガパルスの立上りや立下り
が受は側の規格を満足する範囲では充分な効果が得られ
ない欠点がある。
ド線の引廻しのために状態が変化することが多く、特に
フィルタの時定数によるトリガパルスの立上りや立下り
が受は側の規格を満足する範囲では充分な効果が得られ
ない欠点がある。
そこで、本発明はディジタル処理により上記欠点を除去
した誤動作防止装置を提供しようとするものであり、以
下本発明の実施例について図面とともに説明する。
した誤動作防止装置を提供しようとするものであり、以
下本発明の実施例について図面とともに説明する。
第１図に示すように入力端子１に加えられた第２図ａに
示す入力） ＩＪガパルスは論理微分回路２に加えられ
、２ａ点に第２図すに示す信号が、出力端子２ｂに第２
図Ｃに示すパルスが得られ、ゲート３て加えられる。上
記入力トリガパルス（は遅延線や遅延回路等の遅延手段
４に加えら凡で、第２図ｄに示す信号となり、モノマル
チバイブレータ５に加えられ、第２図ｅに示す信シ」″
と乙・ってゲート３に加えられる。このゲート３の出力
６−１第２図ｆに示すパルスとなり、このパルスが後段
の切換回路等の回路６に新たなトリガ信号として）Ｊ［
＋えられる。
示す入力） ＩＪガパルスは論理微分回路２に加えられ
、２ａ点に第２図すに示す信号が、出力端子２ｂに第２
図Ｃに示すパルスが得られ、ゲート３て加えられる。上
記入力トリガパルス（は遅延線や遅延回路等の遅延手段
４に加えら凡で、第２図ｄに示す信号となり、モノマル
チバイブレータ５に加えられ、第２図ｅに示す信シ」″
と乙・ってゲート３に加えられる。このゲート３の出力
６−１第２図ｆに示すパルスとなり、このパルスが後段
の切換回路等の回路６に新たなトリガ信号として）Ｊ［
＋えられる。
遅延手段４とモノマルチバイブレータ５０代りに第３図
に示すように遅延線４ａとフリッフフロッ７’６ａによ
っても構成することができる。
に示すように遅延線４ａとフリッフフロッ７’６ａによ
っても構成することができる。
今、第１図の回路で入力端子１に加えられるパルスが所
定のものではなく、第４図ａに示すように巾の狭い雑音
パルスの場合、各部の波形は第４図ｂ 、 ｃ’ 、
ｄ 、 ｅ 、 ｆとなりゲート３の出力端子にトリガ
パルスは生じない。また、第５図ａに示すように巾広い
雑音パルスの場合にも、各部の波形は第６図す、ｃ、ｄ
、ｅ、ｆとなり、ゲート３に出力は発生しない。
定のものではなく、第４図ａに示すように巾の狭い雑音
パルスの場合、各部の波形は第４図ｂ 、 ｃ’ 、
ｄ 、 ｅ 、 ｆとなりゲート３の出力端子にトリガ
パルスは生じない。また、第５図ａに示すように巾広い
雑音パルスの場合にも、各部の波形は第６図す、ｃ、ｄ
、ｅ、ｆとなり、ゲート３に出力は発生しない。
このように、所定のトリガパルス以外では新たなトリガ
パルスが発生しないので次段を誤動作させることがなく
なるものである。なお不要パルスがチャタリング状に継
続する場合には第１図の回路でも新たなトリガパルスが
出る場合があるのでこの場合にはＭ１図の入力端子１と
論理微分回路２の入力端子間に再トリガ可能なモノマル
チバイブレータを入れればよい。
パルスが発生しないので次段を誤動作させることがなく
なるものである。なお不要パルスがチャタリング状に継
続する場合には第１図の回路でも新たなトリガパルスが
出る場合があるのでこの場合にはＭ１図の入力端子１と
論理微分回路２の入力端子間に再トリガ可能なモノマル
チバイブレータを入れればよい。
以上のように、本発明は入力トリガパルスを一定時間遅
延させたパルスで駆動されるモノマルチバイブレータま
たはフリップフロップの出力と上記入力トリガパルスの
論理微分されたトリガエツジパルスとの論理ゲートによ
り得られた出力全後段のトリガ入力とすることを特徴と
するものであり、所定のパルス巾以外の雑音パルスが入
った場合には新たなトリガパルスが発生しないので後段
回路を雑音パルスによってトリガしてしまうことかなく
なるものである。
延させたパルスで駆動されるモノマルチバイブレータま
たはフリップフロップの出力と上記入力トリガパルスの
論理微分されたトリガエツジパルスとの論理ゲートによ
り得られた出力全後段のトリガ入力とすることを特徴と
するものであり、所定のパルス巾以外の雑音パルスが入
った場合には新たなトリガパルスが発生しないので後段
回路を雑音パルスによってトリガしてしまうことかなく
なるものである。
第１図は本発明の一実施例における誤動作防止装置のブ
ロック線図、第２図、第４図、勇５図は同装置説明のだ
めの各部の波形図、第３図は同装置の一部分の他の実施
例のブロック線図である。 １・・・・・・入力端子、２・・・・・・論理微分回路
、３・・・・・・ゲート、４，４ａ・・・・・・遅延手
段、５・・・・・・モノマルチバイブレータ、５ａ・・
・・・・クリップフロップ。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名第１
図 第２図 ａ −」−１−一 １００− 第４図 Ｊ□ 第５図 ｆ □
ロック線図、第２図、第４図、勇５図は同装置説明のだ
めの各部の波形図、第３図は同装置の一部分の他の実施
例のブロック線図である。 １・・・・・・入力端子、２・・・・・・論理微分回路
、３・・・・・・ゲート、４，４ａ・・・・・・遅延手
段、５・・・・・・モノマルチバイブレータ、５ａ・・
・・・・クリップフロップ。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名第１
図 第２図 ａ −」−１−一 １００− 第４図 Ｊ□ 第５図 ｆ □
Claims (1)
- 入力トリガパルスを一定時間遅延させたパルスで駆動さ
れるモノマルチバイブレータまだはフリップフロップの
出力と上記入力トリガパルスの論理微分されたトリガエ
ツジパルスとの論理ゲートにより得られだ出力を後段の
トリガ入力とすることを特徴とする誤動作防止装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56193874A JPS5895421A (ja) | 1981-12-01 | 1981-12-01 | 誤動作防止装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56193874A JPS5895421A (ja) | 1981-12-01 | 1981-12-01 | 誤動作防止装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5895421A true JPS5895421A (ja) | 1983-06-07 |
Family
ID=16315181
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56193874A Pending JPS5895421A (ja) | 1981-12-01 | 1981-12-01 | 誤動作防止装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5895421A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02252309A (ja) * | 1989-03-27 | 1990-10-11 | Nissan Motor Co Ltd | ディジタル回路 |
-
1981
- 1981-12-01 JP JP56193874A patent/JPS5895421A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02252309A (ja) * | 1989-03-27 | 1990-10-11 | Nissan Motor Co Ltd | ディジタル回路 |
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