JPS5911596A - メモリのバツクアツプ方法 - Google Patents

メモリのバツクアツプ方法

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JPS5911596A
JPS5911596A JP57119019A JP11901982A JPS5911596A JP S5911596 A JPS5911596 A JP S5911596A JP 57119019 A JP57119019 A JP 57119019A JP 11901982 A JP11901982 A JP 11901982A JP S5911596 A JPS5911596 A JP S5911596A
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JP
Japan
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data
memory
write
area
variable memory
Prior art date
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Application number
JP57119019A
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English (en)
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JPS6235706B2 (ja
Inventor
Hiroshi Tadaki
但木 洋
Yukio Seo
瀬尾 幸男
Junichi Ueno
上野 潤一
Kazuyuki Kamimura
一幸 神村
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Azbil Corp
Original Assignee
Azbil Corp
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Publication date
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Publication of JPS5911596A publication Critical patent/JPS5911596A/ja
Publication of JPS6235706B2 publication Critical patent/JPS6235706B2/ja
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    • GPHYSICS
    • G11INFORMATION STORAGE
    • G11CSTATIC STORES
    • G11C29/00Checking stores for correct operation ; Subsequent repair; Testing stores during standby or offline operation
    • G11C29/70Masking faults in memories by using spares or by reconfiguring
    • G11C29/74Masking faults in memories by using spares or by reconfiguring using duplex memories, i.e. using dual copies

Landscapes

  • Techniques For Improving Reliability Of Storages (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は、プロセス制御等に用いる制御器におけるメモ
リのバックアップ方法に関するものである。
近来、プロセッサを備えた制御器が汎用される傾向にあ
り、可変メモリを設けて必要とするデータのアクセスを
行なっているが、基本的かつ重要なデータは、電源断・
ノイズ等により消滅するのに備え、電源断等によっても
格納内容の消滅しない書込メモリを設けたうえ、これの
格納エリヤを分割して数S類の基本的かつ重要なデータ
を格納し、分割された格納エリヤの指定をスイッチ等に
より行なっておき、可変メモリのデータが消滅した際、
書込メモリにおける指定された格納エリヤのデータを転
送し、可変メモリへ格納するCとが行なわれている。
しかし、従来においては、スイッチ等による人為的な操
作を要するため、取扱が面倒であると共に、誤操作を生
ずる等の欠点を招来していた。
本発明は、従来のか\る欠点を根本的に解決する目的を
有し、可変メ七りと書込メモリとの間におけるデータの
転送を自動的か゛−ノー8理的なものとした極めて効果
的な、メモリのバックアップ方法を提供するものである
以下、実施例を示す図によって本発明の詳細な説明する
第1図は、制御器CTの構成を示すプルツク図テアリ、
マイクロプロセツツ等のプロセッサCPUを中心とし、
固定メモリROM、可変メモリRAM。
書込メモリFROM  およびインターフエイスエ/F
+  、”/F2  等を周辺に配し、これらを母線B
usにより接続し7ており、固定メモIJROM  へ
格納された命令全プロセッサCPUが実行し、インター
フェイス”/F2 を介して与えられるプロセスからの
入力データDiおよび、インターフェイス1./F 、
  を介し7て端末機器TEから与えられたうえ、可変
メモリRAMに格納されている基本的なデータに基づき
、必要とするデータを可変メモリRAMへアクセスi−
7ながら制御演乗二動作を行ない、インターフエイスエ
/Fz’を介して出力データDoをプロセスへ送出して
いる。
また、母線BUS と書込メモリPROMとの間には、
ライターC−@込回路)WRTが挿入されており、書込
メモリPROMに対するデータの書込および、書込メモ
リPROM  からのデータの続出しがライターWRT
を介して行なわれるものとなっている。
第2図(A)は可変メモリ■ζAMの格納状況、同図(
B)は書込メモU PROMの格納状況を示す図であり
、可変メモリRAM  の基本的かつ=Wなデータを格
納するデータエリヤEdには、所定の形態を有するキー
ワードに¥J1. KWzがデータと共に格納されてお
り、キーワードI(Wl、 1(Wzが所定の形態を維
持しているか否かにより、データエリヤEdのデータが
王宮か否かを判断でさるものとなっている、1 また、書込メモ!J PROM +/)格納エリヤは各
エリヤE1〜Enへ分割されており、後述のとおり、端
末機器TEからの書込指示に応じ、’T AメモリRA
MにおけるデータエリヤEdのデータが゛まず第1エリ
ヤE1′〜、格納され、つぎの書込指示に応じて同様の
データが第2エリヤE2′・格納され、書込指示のある
度毎に次位のエリヤへ順次にデータエリヤEdのデータ
が格納されるものとなっている。
したがって、端末機器TEからデータエリヤEdへ格納
された基本的かつ′Ji要なデータは、これを・更新す
る度毎に書込メモリFROMの各エリヤEt□−Enへ
順次に格納することが自在となっており、これらのデー
タを用いれば、可変メモリRAMのデータに異常を生じ
たときのバックアップが可能となる。
第3図は、プロセッサCPUによるtlj制御動作のフ
ローチャートであり、可変メモリ ’RAMのキーワー
ド・チェック″を行ない、寧キーワード正常?″かNO
であれは、畳込メモリ%PRO〜Iの最新データf R
AM \格納゛により、各エリヤE1〜En中における
最後にデータの格納されブζエリヤのデータを可変メモ
リRAM ”\転送し、これのデータエリヤEd −格
納する。
このため、′o3変メモIJRAMのデータに異常を生
ずれば、書込メモリ FROMにおける最新のデータに
より置換され、ノくツクアップが自動的に行なわれる。
また、1ギーワード正常?″がYESであれば端末機器
TEからの1書込指示あり?″を判断し、これがYES
 となれば、可変メモIJ’RAMのデータをFROM
の次位エリヤへ格納パする。
ついで、端末機器TEからのパ読出指示あり?゛を判断
し、これがYES、1!:なれば、優込メモリ”PRO
Mの指定エリヤからデータをtζAMへ格納n rこよ
す、端末機器TEに」、って指定されたエリ−゛−・の
ブ゛−メ全自」変メ七りKA〜i Kおけるデータエリ
ヤEd′\格納する。
したがって、必要に応じ、端末機器の操作によりpJ′
俊メセメモリRAM込メモリFROM  との間におけ
るデータの転送が自任に行なわれ、人為的なバックアッ
プも任意となる。
たyし、%に端末機器TE命用いず、制御器Cr内へ転
送操作用のスイッチ等を設けてもよく、第1図のm成1
3:選定が任意であると共に、データエリ−YEdにお
けるキ9  )”KW+ 、 1(W2 (D数は、条
件に応じて選定すればよい等、本発明Ill釉々の変形
が自在である。
以上の説明により明らかなとおり本発明によれば、可変
メ七りにおけるデータの異常発生に対するバックアップ
が自動的に行なわれると共に、人為的操作によってもバ
ックアップが自任となるため、プロセス制御用等の制御
器において顕著な効果が得られる。
【図面の簡単な説明】
図は本発明の実施例を示し、第1図は構成を示すブロッ
ク図、第2図囚は固定メモリの格納状況を示す図、同図
(B>け書込メモリの格納状況を示す図、第3図は制御
動作を示すフローチャートである。 CT−・・ψ制御器、CPU ・・・・プロセラ丈、R
AM・・番・可変メモリ、PROM  ・・・・書込メ
モリ、Ed  −・・・データエリヤ、KWI、 Kw
2a 嗜* aキーワード、E+ ” En  會@@
*エリヤ。 特許出願人 山武ハネウェル株式会社 代理人 山川政樹(ほか1名) 第2図 (A)     CB) 第3図 57

Claims (1)

    【特許請求の範囲】
  1. プロセッサおよび可変メモリならびに該可変メモリのデ
    ータをバックアップ用として分割された各エリヤへ順次
    に格納する一1込メモリを備えた制御器において、前記
    可変メモリにおけるデータエリヤのキーワードf;cf
    ニックし、異常を検知したときにPItl肥誉込メモリ
    におけるj4.新のデータを前記可変メモリのデータエ
    リヤへ格納すると共に、書込指令に応じて前記QJ変ツ
    メモリおけるデータエリヤのデータを前記書込メモリの
    次位エリヤへ格納し、かつ、続出指示に応じて前記書込
    メモリにおける指定されたエリヤのデータを前記可変メ
    モリのデータエリヤへ格納することを特徴としたメモリ
    のバックアップ方法。
JP57119019A 1982-07-08 1982-07-08 メモリのバツクアツプ方法 Granted JPS5911596A (ja)

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JP57119019A JPS5911596A (ja) 1982-07-08 1982-07-08 メモリのバツクアツプ方法

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JP57119019A JPS5911596A (ja) 1982-07-08 1982-07-08 メモリのバツクアツプ方法

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JPS5911596A true JPS5911596A (ja) 1984-01-21
JPS6235706B2 JPS6235706B2 (ja) 1987-08-03

Family

ID=14750968

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JP57119019A Granted JPS5911596A (ja) 1982-07-08 1982-07-08 メモリのバツクアツプ方法

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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS60232000A (ja) * 1984-05-01 1985-11-18 Meidensha Electric Mfg Co Ltd 不揮発性メモリのデ−タ処理方式
JPS6262624A (ja) * 1985-09-12 1987-03-19 Yaesu Musen Co Ltd アンテナ整合器
FR2766593A1 (fr) * 1997-07-25 1999-01-29 Aerospatiale Procede et dispositif pour proteger des donnees d'un systeme electronique contre une agression ionisante

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS60232000A (ja) * 1984-05-01 1985-11-18 Meidensha Electric Mfg Co Ltd 不揮発性メモリのデ−タ処理方式
JPS6262624A (ja) * 1985-09-12 1987-03-19 Yaesu Musen Co Ltd アンテナ整合器
FR2766593A1 (fr) * 1997-07-25 1999-01-29 Aerospatiale Procede et dispositif pour proteger des donnees d'un systeme electronique contre une agression ionisante

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JPS6235706B2 (ja) 1987-08-03

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