JPS5912604A - 増幅回路 - Google Patents
増幅回路Info
- Publication number
- JPS5912604A JPS5912604A JP12276482A JP12276482A JPS5912604A JP S5912604 A JPS5912604 A JP S5912604A JP 12276482 A JP12276482 A JP 12276482A JP 12276482 A JP12276482 A JP 12276482A JP S5912604 A JPS5912604 A JP S5912604A
- Authority
- JP
- Japan
- Prior art keywords
- resistance
- transistor
- emitter
- base
- resistor
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 239000002131 composite material Substances 0.000 description 1
- 238000010586 diagram Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000000034 method Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03F—AMPLIFIERS
- H03F1/00—Details of amplifiers with only discharge tubes, only semiconductor devices or only unspecified devices as amplifying elements
- H03F1/32—Modifications of amplifiers to reduce non-linear distortion
Landscapes
- Physics & Mathematics (AREA)
- Nonlinear Science (AREA)
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Amplifiers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
をかけることなく増幅回路の低歪化を計るための改良に
関する。
関する。
従来、増幅器の低歪化はオープンルーズの負帰還をかけ
ることにより実現されているが、高域での不安定性の欠
点は解決されていない。またオーディオ増幅器にあって
は聴感上必らずしも満足できない点もある。
ることにより実現されているが、高域での不安定性の欠
点は解決されていない。またオーディオ増幅器にあって
は聴感上必らずしも満足できない点もある。
本発明はかかる従来技術の問題点を改良するため、オー
ブンループ負帰還方式をとることなく低歪かつ高安定な
増幅器を実現することを目的とする。
ブンループ負帰還方式をとることなく低歪かつ高安定な
増幅器を実現することを目的とする。
本発明は上記目的を達成するため、エミッタ接地抵抗を
有するｉｆのトランジスタと、該第１のトランジスタと
同一特性でその負荷となる第２のトランジスタと、該第
２のトランジスタのエミッタに接続される第１の抵抗と
、上記第２のトランジスタのベースとコレクタ間に接続
される第２の抵抗と、上記第２のトランジスタのベース
と第１の抵抗との間に接続される第３の抵抗と夕備え、
上記第１のトランジスタに入出力端子を接続したエミッ
タ接地屋増幅回路を提供するものである。
有するｉｆのトランジスタと、該第１のトランジスタと
同一特性でその負荷となる第２のトランジスタと、該第
２のトランジスタのエミッタに接続される第１の抵抗と
、上記第２のトランジスタのベースとコレクタ間に接続
される第２の抵抗と、上記第２のトランジスタのベース
と第１の抵抗との間に接続される第３の抵抗と夕備え、
上記第１のトランジスタに入出力端子を接続したエミッ
タ接地屋増幅回路を提供するものである。
以下図面にボ丁実施例を参照して本発明を説明すると、
図において、Ｔｒｘは第１のトランジスタ、Ｉｌｌ、２
は該第１のトランジスタの負荷となるＲ１２のトランジ
スタ、Ｒ１はＴｒｉのエミッタ接地抵抗、Ｒ２はＴｒ２
のエミッタに接続される第１の抵抗、１（４はＴｒ２の
ベースとコレクタ間Ｋｇ続される第２の抵抗、凡３は゛
Ｉ゛、２０ベースとＲ２間に接続される第３の抵抗、工
及ばＯは夫々人出及び出力端子である。
図において、Ｔｒｘは第１のトランジスタ、Ｉｌｌ、２
は該第１のトランジスタの負荷となるＲ１２のトランジ
スタ、Ｒ１はＴｒｉのエミッタ接地抵抗、Ｒ２はＴｒ２
のエミッタに接続される第１の抵抗、１（４はＴｒ２の
ベースとコレクタ間Ｋｇ続される第２の抵抗、凡３は゛
Ｉ゛、２０ベースとＲ２間に接続される第３の抵抗、工
及ばＯは夫々人出及び出力端子である。
今、上述した構成のエミッタ接地型増幅回路において、
第１及び第２のトランジスタＴｒｌ ＊ Ｔｒ２が同
一特性でかつｈＦＫが充分大きく、ベース電流が無視で
きるとする。また両トランジスタのベース・エミッタ間
電圧ンそれぞれＶＢＩＣＩ ｖ ”Ｂ２Ｈ２とすると、
入力端子Ｉに印加される入力電圧ＶＩＮに対して第１の
トランジスタＴｒ１のコレクタ電流工。ｌはｈ］ｒｘが
太き（ベース電流が無視できるため、エミッタ電流と同
じと見てよく である。
第１及び第２のトランジスタＴｒｌ ＊ Ｔｒ２が同
一特性でかつｈＦＫが充分大きく、ベース電流が無視で
きるとする。また両トランジスタのベース・エミッタ間
電圧ンそれぞれＶＢＩＣＩ ｖ ”Ｂ２Ｈ２とすると、
入力端子Ｉに印加される入力電圧ＶＩＮに対して第１の
トランジスタＴｒ１のコレクタ電流工。ｌはｈ］ｒｘが
太き（ベース電流が無視できるため、エミッタ電流と同
じと見てよく である。
また同様に第２のトランジスタＩｌｌ 、２のコレクタ
電流Ｉｃ２は、Ａ点の電位なりＡ、出力端子０の電圧な
Ｖ。とすると、 である。
電流Ｉｃ２は、Ａ点の電位なりＡ、出力端子０の電圧な
Ｖ。とすると、 である。
ここで第３の抵抗Ｒ３が充分大きく、Ｒ３を流れる電流
が■。２に比べて無視できるとすると、１ｃｌ＝ Ｉｃ
２である。また■。１＝Ｉｃ２であることによりＶＢＥ
Ｉ トＶＢＥｚハ’ＪＬ ＜ Ｖ１３Ｅ＝ＶＢＥ１ ＝
ＶＢＩＣ２トｊルと、（１）及び（２）式より となる。
が■。２に比べて無視できるとすると、１ｃｌ＝ Ｉｃ
２である。また■。１＝Ｉｃ２であることによりＶＢＥ
Ｉ トＶＢＥｚハ’ＪＬ ＜ Ｖ１３Ｅ＝ＶＢＥ１ ＝
ＶＢＩＣ２トｊルと、（１）及び（２）式より となる。
電源電圧をＶＣＣとすると、Ａ点の電位ＶＡ＆まＶ。
と■。ｏ−■。とｙ、−ｎ、３．ｋＬ４で分割した電圧
の和であるから、 （４）式ｔ（３１式に代入すると、 が成立する。
の和であるから、 （４）式ｔ（３１式に代入すると、 が成立する。
従ってＲ１＝ Ｒ２なる時、（５）式よりとなり、この
（６）式より 電圧■。の変化となることを示している。このこ意味し
ている。
（６）式より 電圧■。の変化となることを示している。このこ意味し
ている。
かくして本発明によれば、上述したように第１及び第２
のトランジスタＴｒｌ ｙ Ｔｒ２が同一特性でｈＦ
Ｋが充分大きい場合、Ｒ１＝ Ｒ２でＲ３が充分大きい
時には出力電圧Ｖ。は■工Ｎに対してリニアな関係とな
り、従来のようなオープンループの負帰還をかけろこと
なく、簡単な回路構成で低歪でしかも高安定の増幅回路
が実現できる。
のトランジスタＴｒｌ ｙ Ｔｒ２が同一特性でｈＦ
Ｋが充分大きい場合、Ｒ１＝ Ｒ２でＲ３が充分大きい
時には出力電圧Ｖ。は■工Ｎに対してリニアな関係とな
り、従来のようなオープンループの負帰還をかけろこと
なく、簡単な回路構成で低歪でしかも高安定の増幅回路
が実現できる。
なお、前記第２．第３の抵抗Ｒ４，几３に代えて周波数
依存性を有するインピーダンス素子又は複合インピーダ
ンス素子を用いてもよい。また第１及び第２トランジス
タとして、例えば１” ＥＴ ９使用しても上述した所
と同様の効果が得られる。
依存性を有するインピーダンス素子又は複合インピーダ
ンス素子を用いてもよい。また第１及び第２トランジス
タとして、例えば１” ＥＴ ９使用しても上述した所
と同様の効果が得られる。
更に本発明では、各トランジスタ、各抵抗のマツチング
が要求されるが、これらはＩＣ化することにより容易に
実現可能である。
が要求されるが、これらはＩＣ化することにより容易に
実現可能である。
図は本発明の一実施例を示す回路図である。
Ｉｌｌ 、１． Ｉｌｌ ｒ２．、、第１．第２のト
ランジスタ、Ｒ＋１・・・エミッタ接地抵抗、Ｒ２−Ｒ
４・・・第１〜第３の抵抗、■・・・入力端子、０・・
・出力端子。 特許出願人 クラリオン株式会社
ランジスタ、Ｒ＋１・・・エミッタ接地抵抗、Ｒ２−Ｒ
４・・・第１〜第３の抵抗、■・・・入力端子、０・・
・出力端子。 特許出願人 クラリオン株式会社
Claims (1)
- 【特許請求の範囲】 （１１エミッタ接地型抵抗を有する第１のトランジスタ
と、該第１のトランジスタと同一特性でその負荷となる
第２のトランジスタと、該第２のトランジスタのエミッ
タに接続されるｉｌの抵抗と、上記第２のトランジスタ
のベースとコレクタ間ｔｔｃ接続される第２の抵抗と、
上記第２のトランジスタのベースと第１の抵抗との間に
接続される第３の抵抗とヲ備え、上記第１のトランジス
タ九入出力端子を接続したこと’ｋｔ￥１徴とする増幅
回路。 （２）前記エミッタ接地抵抗と第１の抵抗とが等しく第
３の抵抗が充分大きいことを特徴とする特許請求の範囲
第１項記載の増幅回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12276482A JPS5912604A (ja) | 1982-07-13 | 1982-07-13 | 増幅回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12276482A JPS5912604A (ja) | 1982-07-13 | 1982-07-13 | 増幅回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5912604A true JPS5912604A (ja) | 1984-01-23 |
Family
ID=14844031
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12276482A Pending JPS5912604A (ja) | 1982-07-13 | 1982-07-13 | 増幅回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5912604A (ja) |
-
1982
- 1982-07-13 JP JP12276482A patent/JPS5912604A/ja active Pending
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