JPS5936859A - 情報処理装置 - Google Patents
情報処理装置Info
- Publication number
- JPS5936859A JPS5936859A JP14820782A JP14820782A JPS5936859A JP S5936859 A JPS5936859 A JP S5936859A JP 14820782 A JP14820782 A JP 14820782A JP 14820782 A JP14820782 A JP 14820782A JP S5936859 A JPS5936859 A JP S5936859A
- Authority
- JP
- Japan
- Prior art keywords
- control memory
- register
- diagnosis
- self
- microinstruction
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- G—PHYSICS
- G01—MEASURING; TESTING
- G01R—MEASURING ELECTRIC VARIABLES; MEASURING MAGNETIC VARIABLES
- G01R31/00—Arrangements for testing electric properties; Arrangements for locating electric faults; Arrangements for electrical testing characterised by what is being tested not provided for elsewhere
- G01R31/28—Testing of electronic circuits, e.g. by signal tracer
- G01R31/317—Testing of digital circuits
- G01R31/31701—Arrangements for setting the Unit Under Test [UUT] in a test mode
Landscapes
- Engineering & Computer Science (AREA)
- General Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Test And Diagnosis Of Digital Computers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
本発明は間欠故障の発見に役立つ自己診断機能を内蔵し
た情報処理装置に関する。
た情報処理装置に関する。
従来より計算機システムを構成するノ・−ドウエアの故
障を検出するための各種手法が存在する。中でも計算機
システムの中核である演算制御装置（通常ＣＰＵあるい
は中央処理装置とも称される）のハードウェア故障を見
つけるため、演算制御装置が故障しているのではないか
と怪しまれる時、テストグログラム或いｉｔテスト診断
プログラムを動作させ、ハードウェアが正常か異常かを
テストする手法が代表的に用いられていた。
障を検出するための各種手法が存在する。中でも計算機
システムの中核である演算制御装置（通常ＣＰＵあるい
は中央処理装置とも称される）のハードウェア故障を見
つけるため、演算制御装置が故障しているのではないか
と怪しまれる時、テストグログラム或いｉｔテスト診断
プログラムを動作させ、ハードウェアが正常か異常かを
テストする手法が代表的に用いられていた。
上記手法を用いるとハードウェアが固定的に故障してい
る場合には故障箇所がローカライズされる。しかしなが
ら故障の９割以上を占める間欠故障、即ち素子の動作マ
ージンがカ〈疫ったシ、素イの劣化のためある条件下で
動作不良を起す等の現象が起った場合、その故障箇所が
見つかる可能性が少なく、この対策が可能となる良策が
待たれていた。
る場合には故障箇所がローカライズされる。しかしなが
ら故障の９割以上を占める間欠故障、即ち素子の動作マ
ージンがカ〈疫ったシ、素イの劣化のためある条件下で
動作不良を起す等の現象が起った場合、その故障箇所が
見つかる可能性が少なく、この対策が可能となる良策が
待たれていた。
本発明は上記要望に基づいてなされたものであり、従来
のテスト方法では発見しにくかったハードウェアの間欠
故障の検出が容易に行ない得、又、このため九計算機シ
ステムの処理能力の低下を最小限に押えた情報処理装置
を提供することを目的とする。又、本発明゛を実現する
うえで特別々ハードウェアを殆んど必要としない安価な
情報処理装置を提供することも他の目的とする。
のテスト方法では発見しにくかったハードウェアの間欠
故障の検出が容易に行ない得、又、このため九計算機シ
ステムの処理能力の低下を最小限に押えた情報処理装置
を提供することを目的とする。又、本発明゛を実現する
うえで特別々ハードウェアを殆んど必要としない安価な
情報処理装置を提供することも他の目的とする。
本発明は上記従来の欠点を補い、ＣＰＵの空き時間にＣ
ＰＵの自己診断テストを起動するだめのマクロ命令を備
えているところに特徴がある。
ＰＵの自己診断テストを起動するだめのマクロ命令を備
えているところに特徴がある。
ハードウェアの自己診断機能は、通常電源投入時、固定
記憶装置（ＲＯＭ ；読出し専用メモリ）に記憶された
内容を用いて実行される。本発明の特徴はマクロ命令（
ソフトウェア命令）にてこの自己診断プログラムを直接
実行可能とすることにあシ、このためＣＰＵがアイドル
状態、Ｐ口ち割込み等のイ村ント発生を待つために少数
の命令ループを繰返し実行している状態の時にマクロ命
令にてハードウェアの自己診断プログラムの起動をかけ
得る情報処理装置を提供するものである。この起動をか
けるため、本発明実施例ではＳＳＴ命令（５ｔａｒｔ
５−ｅｌｆ Ｔｅ５ｔ ）が設けられている。
記憶装置（ＲＯＭ ；読出し専用メモリ）に記憶された
内容を用いて実行される。本発明の特徴はマクロ命令（
ソフトウェア命令）にてこの自己診断プログラムを直接
実行可能とすることにあシ、このためＣＰＵがアイドル
状態、Ｐ口ち割込み等のイ村ント発生を待つために少数
の命令ループを繰返し実行している状態の時にマクロ命
令にてハードウェアの自己診断プログラムの起動をかけ
得る情報処理装置を提供するものである。この起動をか
けるため、本発明実施例ではＳＳＴ命令（５ｔａｒｔ
５−ｅｌｆ Ｔｅ５ｔ ）が設けられている。
以下、図面を使用して本発明実施例につき詳細に説明す
る。
る。
第１図は本発明が実現される情報処理装置のうちのマイ
クロプログラム制御部の実施例を示すブロック図である
。図に：ｌ＝−いて、１１は主メモリ（図示せず）から
続出されたソフトウェア命令、いわゆるマクロ命令を保
持するマクロ命□令しジスク（ＷＨＲ）である。１２〜
１５／Ｉｉマイクロプログラム制御下でコントロールさ
れる様に構成されたセレクタ回路である。セレクタ回路
１２はマクロ命令レジスタ１１の内容により制御メモリ
（ｃｓ９）をアクセスするダートとして、セレクタ回路
３は制御１メモリ１９の出カレノスタ（マイクロデータ
レジスタΔｔｏＢ ｚ ｏ ）の内容によ多制御メモリ
１９をアクセスする回路としてセレクタ回路１４はスタ
ックレジスタ（ＳＴＫ １８）の内容によ多制御メモリ
１９をアクセスする回路（ザゾルーチンリターン）とし
て、セレクタ回路１５はマイクロ命令カウンタ（ＭｆＣ
’ Ｉ ７ ）の内容によシ制御メモリノ９をアクセス
する回路として機能する。
クロプログラム制御部の実施例を示すブロック図である
。図に：ｌ＝−いて、１１は主メモリ（図示せず）から
続出されたソフトウェア命令、いわゆるマクロ命令を保
持するマクロ命□令しジスク（ＷＨＲ）である。１２〜
１５／Ｉｉマイクロプログラム制御下でコントロールさ
れる様に構成されたセレクタ回路である。セレクタ回路
１２はマクロ命令レジスタ１１の内容により制御メモリ
（ｃｓ９）をアクセスするダートとして、セレクタ回路
３は制御１メモリ１９の出カレノスタ（マイクロデータ
レジスタΔｔｏＢ ｚ ｏ ）の内容によ多制御メモリ
１９をアクセスする回路としてセレクタ回路１４はスタ
ックレジスタ（ＳＴＫ １８）の内容によ多制御メモリ
１９をアクセスする回路（ザゾルーチンリターン）とし
て、セレクタ回路１５はマイクロ命令カウンタ（ＭｆＣ
’ Ｉ ７ ）の内容によシ制御メモリノ９をアクセス
する回路として機能する。
１６はアダー回路（＋１）である。このアダー回路１６
を介して現在アクセスしているマイクロ命令の次のマイ
クロ命令アドレスがマイクロ命令カウンタ１７に保持さ
れる。１９は制御メモリである。制御メモリ１９に自己
診断のためのマイクロプログラム及びマクロ命令を実行
するだめのマイクロプログラムが記憶されている。
を介して現在アクセスしているマイクロ命令の次のマイ
クロ命令アドレスがマイクロ命令カウンタ１７に保持さ
れる。１９は制御メモリである。制御メモリ１９に自己
診断のためのマイクロプログラム及びマクロ命令を実行
するだめのマイクロプログラムが記憶されている。
２０はマイクロ命令レジスタ（ＭＤＲ）であって上記セ
レクタ回路１２〜ｘ５に従い、制御メモリ１９がアクセ
スされたとき、その内容が保持される。
レクタ回路１２〜ｘ５に従い、制御メモリ１９がアクセ
スされたとき、その内容が保持される。
第２図はマイクロ命令レジスタ２０の内容がデコーダ２
ノにてデコードされ、被診断ノ・−ドウエア２２の動作
が制御されることを示す機能ブロック図である。
ノにてデコードされ、被診断ノ・−ドウエア２２の動作
が制御されることを示す機能ブロック図である。
第３図は本発明にて使用される５ＳＴ（５ｔａｒｔ８＊
１ｆ Ｔｅ５ｔ ）命、令の命令？オーマ、トを示す図
である。この図に示すＳＳＴ命令がマクロ命令レジスタ
７１Ｆｃ読出されると第１図に示すセレクタ回路１２を
介して制御メモリ９がアクセスさ ゛れ、Ｃフィール
ドの内容に従い各種診断がなされる。このマイクロ診断
の手法については従来より周知の技術で達成されるため
、ここでの説明は省略する。
１ｆ Ｔｅ５ｔ ）命、令の命令？オーマ、トを示す図
である。この図に示すＳＳＴ命令がマクロ命令レジスタ
７１Ｆｃ読出されると第１図に示すセレクタ回路１２を
介して制御メモリ９がアクセスさ ゛れ、Ｃフィール
ドの内容に従い各種診断がなされる。このマイクロ診断
の手法については従来より周知の技術で達成されるため
、ここでの説明は省略する。
以上説明の如く本発明によれば、マクロ命令により、面
接ハードウェアの自己診断をフレキシブルに実行するこ
とが出来、間欠故障の発見に役立つ。又、本発明を実現
するうえで特別なハードウェアを殆んど必要としないた
め、該機能を持った情報処理装置を安価に提供できる。
接ハードウェアの自己診断をフレキシブルに実行するこ
とが出来、間欠故障の発見に役立つ。又、本発明を実現
するうえで特別なハードウェアを殆んど必要としないた
め、該機能を持った情報処理装置を安価に提供できる。
第１図は本発明の実施例を示すブロック図、第２図は本
発明によシ被診断ハードウヱアの動作が制御されること
を示す機能ブロック図、第３図は本発明にて使用される
ＳＳＴマクロ命令の命令フォーマットを示す図である。 １ノ・・・マクロ命令レジスタ、１２〜１５・・・セレ
クタ回路、１６・・・アダー回路、１７・・・マイクロ
命令カウンタ、１８・・・アタックレジスタ、１９・・
・制御１メモリ、２０・・・マイクロ命令レジスタ、２
ノ・・・デコーダ、２２・・・被診断ノ・−ドウエア。 出願人代理人 弁理士 鈴 江 武 彦第１図 第２図 口！コ＝■コ
発明によシ被診断ハードウヱアの動作が制御されること
を示す機能ブロック図、第３図は本発明にて使用される
ＳＳＴマクロ命令の命令フォーマットを示す図である。 １ノ・・・マクロ命令レジスタ、１２〜１５・・・セレ
クタ回路、１６・・・アダー回路、１７・・・マイクロ
命令カウンタ、１８・・・アタックレジスタ、１９・・
・制御１メモリ、２０・・・マイクロ命令レジスタ、２
ノ・・・デコーダ、２２・・・被診断ノ・−ドウエア。 出願人代理人 弁理士 鈴 江 武 彦第１図 第２図 口！コ＝■コ
Claims (1)
- 複数のマクロ命令を有する情報処理装置において、該マ
クロ命令のうちの１つ力；特許１１にＩＩ＋当てられる
と共に、マクロ命令カウンタもしくはマクロ命令レゾス
タ、マイクロデータレジスタによシアクセスされ、自己
診断のだめのマイクロプログラム及びマクロ命令実行の
ためのマイクロプログラムが記憶される制御メモリを有
し、上記特別に割当てられたマクロ命令力；土日ｃマイ
クロ命令レジスタに設定されることによシ演算制御装置
の自己診断用マイクロプログラムを直接起動することを
特徴とする情報処理装置、。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14820782A JPS5936859A (ja) | 1982-08-26 | 1982-08-26 | 情報処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14820782A JPS5936859A (ja) | 1982-08-26 | 1982-08-26 | 情報処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5936859A true JPS5936859A (ja) | 1984-02-29 |
Family
ID=15447653
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14820782A Pending JPS5936859A (ja) | 1982-08-26 | 1982-08-26 | 情報処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5936859A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02187821A (ja) * | 1989-01-17 | 1990-07-24 | Nec Corp | 演算回路 |
| JPH0337717A (ja) * | 1989-07-05 | 1991-02-19 | Nec Corp | 演算回路 |
-
1982
- 1982-08-26 JP JP14820782A patent/JPS5936859A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02187821A (ja) * | 1989-01-17 | 1990-07-24 | Nec Corp | 演算回路 |
| JPH0337717A (ja) * | 1989-07-05 | 1991-02-19 | Nec Corp | 演算回路 |
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