JPS60137065A - 半導体装置 - Google Patents

半導体装置

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Publication number
JPS60137065A
JPS60137065A JP58250539A JP25053983A JPS60137065A JP S60137065 A JPS60137065 A JP S60137065A JP 58250539 A JP58250539 A JP 58250539A JP 25053983 A JP25053983 A JP 25053983A JP S60137065 A JPS60137065 A JP S60137065A
Authority
JP
Japan
Prior art keywords
drain
semiconductor substrate
gate electrode
electrode
insulating film
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP58250539A
Other languages
English (en)
Inventor
Nobuyuki Takenaka
竹中 信之
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electronics Corp
Matsushita Electric Industrial Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Matsushita Electronics Corp, Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electronics Corp
Priority to JP58250539A priority Critical patent/JPS60137065A/ja
Publication of JPS60137065A publication Critical patent/JPS60137065A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10DINORGANIC ELECTRIC SEMICONDUCTOR DEVICES
    • H10D62/00Semiconductor bodies, or regions thereof, of devices having potential barriers
    • H10D62/10Shapes, relative sizes or dispositions of the regions of the semiconductor bodies; Shapes of the semiconductor bodies
    • H10D62/17Semiconductor regions connected to electrodes not carrying current to be rectified, amplified or switched, e.g. channel regions
    • H10D62/213Channel regions of field-effect devices
    • H10D62/221Channel regions of field-effect devices of FETs
    • H10D62/235Channel regions of field-effect devices of FETs of IGFETs
    • H10D62/299Channel regions of field-effect devices of FETs of IGFETs having lateral doping variations
    • H10D62/307Channel regions of field-effect devices of FETs of IGFETs having lateral doping variations the doping variations being parallel to the channel lengths
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10DINORGANIC ELECTRIC SEMICONDUCTOR DEVICES
    • H10D64/00Electrodes of devices having potential barriers
    • H10D64/20Electrodes characterised by their shapes, relative sizes or dispositions 
    • H10D64/27Electrodes not carrying the current to be rectified, amplified, oscillated or switched, e.g. gates
    • H10D64/311Gate electrodes for field-effect devices
    • H10D64/411Gate electrodes for field-effect devices for FETs
    • H10D64/511Gate electrodes for field-effect devices for FETs for IGFETs
    • H10D64/517Gate electrodes for field-effect devices for FETs for IGFETs characterised by the conducting layers
    • H10D64/518Gate electrodes for field-effect devices for FETs for IGFETs characterised by the conducting layers characterised by their lengths or sectional shapes

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 本発明は、金属−絶縁物一半導体構造の電界効果トラン
ジスタ(以下MISFET と略す)の構造に関し、特
にドレイン耐圧の優れたMIsFETの構造に関するも
のである。
従来例の構成とその問題点 従来Nチャンネル型r4 I S F E Tは、第1
図にその断面形状を示すように、低濃度P型シリコン基
板(P=Si)1上に形成され、ソース(n層)2、ド
レイン(n47i# ) 3 、 PM拡fli)44
. ケー ト絶縁膜5およびゲート電極6で構成されて
いる。
一般に、14ISNET では、そのチャンネル長(L
eff)が短くなるにつれて、MISFj!:Tのしき
い値電圧v (vth )がり。ffの減少と共に小さ
くなる現象、いわゆるショートチャンネル効果が顕著に
なってくる。このショートチャンネル効果を低減するた
めに、Leffの短いmIsFMT では、ゲー。
ト絶縁膜6の膜厚を薄くする必要がある。しかし、ゲー
ト絶縁膜6を薄くするとvthが小さくなるので、vt
hを回路設計に必要な値(たとえば0.6v程度)にコ
ントロールするには、不純物濃度が約10 1octn
 程度のP型拡散層(チャンネルドーグ領域)4を形成
する必要がある。このP型拡散層4は、第1図に示すよ
うに、n層型のドレイン拡散層3と接触してpn+n層
接合成しているが、i4IsFMTのドレイン耐圧はこ
のpn+n層接合成するp型拡散層4の不純物濃度に依
存している。つまり、不純物濃度が高い程ドレイン耐圧
は低下する。
このように、従来のml5NET では、Lof fが
短くなると、ゲート絶縁膜6の膜厚を薄くし、チャンネ
ルドープ領域4の不純物濃度を高くして、vthを制御
するため、ドレイン耐圧が低下する欠点があった。
発明の目的 本発明は上記した従来のMISFETの欠点を除去する
ためになされたもので、Loffが短くなってもドレイ
ン耐圧が低下しない新規な構造の半導体装置を提供する
ことにある。
発明の構成 本発明にかかる半導体装置の構成は、−導電形の半導体
基板上に形成されたゲート絶縁膜と、前記ゲート絶縁膜
上に形成された導電性を有するゲート電極と、前記半導
体基板と逆の導電形を示す不純物拡散層とからなるAv
IIskrj!:Tにおいて、前記ゲート電極の断面形
状が凹型であり、さらに同凹部底面下の半導体基板中に
、選択的にチャンネルドープ領域が形成されていること
を特徴としているので、ドレイン拡散層とチャンネルド
ープ領域は直接接触しないので14IsNETのドレイ
ン耐圧は向上する。
実施例の説明 次に本発明の実施例を図面を参照して説明する。
本発明の一実施例によるMISFff’r を有する半
導体装置は、第2図に示すように、半導体基板1上に5
i02.Si3N4等の絶縁膜で形成されたゲート絶縁
膜6と、凹型のゲート電極6と、このゲート電極6め凹
部底面(ゲート電極膜厚=’r1)を通してイオン注入
によって形成した不純物拡散層(チャンネルドープ領域
)4とさらにゲート電極6全体をマスクとしてイオン注
入によって形成したソース2およびドレイン3とを含ん
でいる。
以上述べた様にチャンネルドープ領域4の形成はゲート
電極6上からのイオン注入によって行なうため、ゲート
電極の四部底面下の半導体基板に選択的にイオン注入す
るには、第2図に示した膜厚T1.T2およびイオン注
入の加速エネルギを最適条件に設定する必要がある。た
とえば、ゲート電極を多結晶シリコンで形成し、チャン
ネルドープヲホロンテ行すう場合、T、=1000人、
T2=5000人、ボロンイオン加速エネルギ=100
KeVの条件でイオン注入を行なえば、ゲート電極の四
部底面下の半導体基板にだけボロンイオンが注入される
。ただし、ゲート絶縁膜は膜厚300へのS z O2
膜とした。また、凹部底面の膜厚T1はソー ス、ドレ
イン形成時のイオン注入に対して、マスクとして十分に
作用する膜厚でなければならない。
上側のT1=1000 への場合、ヒソイオン注入でソ
ース、ドレインを形成する場合、ヒソイオン加速エネル
ギを40KeV程度にすれば良い。
本発明のzdIsii’ETのドレイン耐圧は、第2図
に示した、チャンネルドープ領域4とドレイン3の距離
L8に依存する。Ls#”off−Ltであるので、ド
レイン耐圧を制御するには、凹部底面長しtを精度良く
制御する必要がある。
発明の効果 本発明の半導体装置によれば、1vlIsFETのドレ
イン耐圧が高くなるので、微細mIsFgTに特有のホ
ットキャリアによるデバイス特性の劣化を防ぐことが可
能となる。
【図面の簡単な説明】
第1図は、従来の14IsFETの構造を示す要部の断
面図、第2図は本発明によるdIsNETの構造を示す
要部の断面図である。 1・・・・・・半導体基板、2・・・・・・ソース、3
・・・・・・ドレイン、4・・・・・・不純物拡散層(
チャンネルドープ領域)、6・・・・・・ゲート絶縁膜
、6・・・・・・ゲート電極。

Claims (1)

    【特許請求の範囲】
  1. 一導電形の半導体基板上に形成されたゲート絶縁膜と、
    前記ゲート絶縁膜上に形成された導電性を有するゲート
    電極と、前記半導体基板と逆の導電形のソース、ドレイ
    ン領域とを有すると共に、前記ゲート電極の断面形状を
    凹型となし、同門部域面下の半導体基板中にしきい値電
    圧制御用の不純物拡散層(チャンネルドープ領域)を選
    択的に形成したことを特徴とする半導体装置。
JP58250539A 1983-12-26 1983-12-26 半導体装置 Pending JPS60137065A (ja)

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JP58250539A JPS60137065A (ja) 1983-12-26 1983-12-26 半導体装置

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JPS60137065A true JPS60137065A (ja) 1985-07-20

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JP (1) JPS60137065A (ja)

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62224962A (ja) * 1986-03-26 1987-10-02 Mitsubishi Electric Corp 半導体装置
US4920388A (en) * 1987-02-17 1990-04-24 Siliconix Incorporated Power transistor with integrated gate resistor
JP2007324225A (ja) * 2006-05-30 2007-12-13 Mitsumi Electric Co Ltd 半導体装置及びその製造方法

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62224962A (ja) * 1986-03-26 1987-10-02 Mitsubishi Electric Corp 半導体装置
US4920388A (en) * 1987-02-17 1990-04-24 Siliconix Incorporated Power transistor with integrated gate resistor
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