JPS60249472A - フアクシミリ装置の画信号処理回路 - Google Patents
フアクシミリ装置の画信号処理回路Info
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- JPS60249472A JPS60249472A JP59106119A JP10611984A JPS60249472A JP S60249472 A JPS60249472 A JP S60249472A JP 59106119 A JP59106119 A JP 59106119A JP 10611984 A JP10611984 A JP 10611984A JP S60249472 A JPS60249472 A JP S60249472A
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- 238000010586 diagram Methods 0.000 description 3
- 238000000034 method Methods 0.000 description 3
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
発明の属する技術分野
本発明は、ファクシミリ装置の両信号処理回路ｉこ関し
、特に孤立点除去回路を有する処理回路の孤立点＃定の
ための１４値の決定に関する。
、特に孤立点除去回路を有する処理回路の孤立点＃定の
ための１４値の決定に関する。
従来技術
第１図は、従来のファクシミリ装置の両信号処理回路の
一例を示すブロック［）４である。すなわち、原稿を光
学的に走査して得られる画信号（１画素当り４ヒツトの
ディジタル信号）を入力し、入力信号を１ライン遅延回
路ｌによって１ライン分遅延させた信号と、２ライン遅
延回路２によって２ライン分遅延させた信号と、人力信
号との計３ライン分の信号を画素平均値計算回路３，３
Ｘ３画素強調回路４および孤を点判定回路１２に入力さ
せる。Ｆ１１１素平−均値計算回路３は、に記３ライン
分の両信号からある注目画素を中心として、その周辺の
３２×３画素の画信号レベルの平均値を計算して白黒判
定回路７に供給し、３×３画素強調回路４は、−に記注
目画素の周囲９画素の画信号によって注目画素の両信号
を強調して４ヒツトの両信号として出力し、ゲート回路
５および遅延回路６を介して白黒判定回路７に入力させ
る。遅延回路６は画素平均値計算回路３が平均値を算出
した３２Ｘ３画素の中心画素（Ｊ）−■画素）と３Ｘ３
画素強調回路４の出力する注目画素の画像信号の出力タ
イミングを一致させるだめの遅延回路であり、ケート１
ワ１路５は孤立点除去回路ｊ２の孤立点判定回路によっ
て３Ｘ３画素強調回路４の出力を強制的に白とするだめ
の回路である６すなわち、ケート回路５と孤立点判定回
路１２とで孤立点除去回路を構成している。
一例を示すブロック［）４である。すなわち、原稿を光
学的に走査して得られる画信号（１画素当り４ヒツトの
ディジタル信号）を入力し、入力信号を１ライン遅延回
路ｌによって１ライン分遅延させた信号と、２ライン遅
延回路２によって２ライン分遅延させた信号と、人力信
号との計３ライン分の信号を画素平均値計算回路３，３
Ｘ３画素強調回路４および孤を点判定回路１２に入力さ
せる。Ｆ１１１素平−均値計算回路３は、に記３ライン
分の両信号からある注目画素を中心として、その周辺の
３２×３画素の画信号レベルの平均値を計算して白黒判
定回路７に供給し、３×３画素強調回路４は、−に記注
目画素の周囲９画素の画信号によって注目画素の両信号
を強調して４ヒツトの両信号として出力し、ゲート回路
５および遅延回路６を介して白黒判定回路７に入力させ
る。遅延回路６は画素平均値計算回路３が平均値を算出
した３２Ｘ３画素の中心画素（Ｊ）−■画素）と３Ｘ３
画素強調回路４の出力する注目画素の画像信号の出力タ
イミングを一致させるだめの遅延回路であり、ケート１
ワ１路５は孤立点除去回路ｊ２の孤立点判定回路によっ
て３Ｘ３画素強調回路４の出力を強制的に白とするだめ
の回路である６すなわち、ケート回路５と孤立点判定回
路１２とで孤立点除去回路を構成している。
白黒判定回路７は、遅延回路６から人力される４１−目
画素の画信号（４ヒツト）レベルを画素＋ｌｌ価値計算
回路から供給される平均値レベルと比較することにより
、当該注目画素の黒白な１．１１定して、２埴信号拳こ
変抄して出力する。白黒判定回路７からは、孤立点が除
去された２値の画像信号か送出される。
画素の画信号（４ヒツト）レベルを画素＋ｌｌ価値計算
回路から供給される平均値レベルと比較することにより
、当該注目画素の黒白な１．１１定して、２埴信号拳こ
変抄して出力する。白黒判定回路７からは、孤立点が除
去された２値の画像信号か送出される。
孤立点判ず回路１２は、３個の比較回路８と、６個のＤ
タイプフリップフロップ９と、アンＩ・ケート・回路１
０とから構成され、比較回路８は閾値設定回路１１に設
定された固定的な閾値によって、それぞれに人力される
画信号（４ヒツト）の黒白を判定して２値信号に変換出
力する。各比較回路８の出力はそれぞれ、２個のＤタイ
プフリップ２０ツブ９の縦続接続回路に入力される。中
心の注目画素に対応するＤタイプノリツブフロップの出
力を除いた残り８４Ｖ４の点の２値信号を７ンドゲ一ト
回路１０に入力させ、上記８個の点の２値信号がすべて
’１”（白）であるときはアンドケート回路１゜の出力
がｌ′となり、ゲート回路５はアンドゲート回路ｌＯの
出力が°゛ｌ”であるときは、画信号を強制的に白レベ
ルにして遅延回路６に出力する。
タイプフリップフロップ９と、アンＩ・ケート・回路１
０とから構成され、比較回路８は閾値設定回路１１に設
定された固定的な閾値によって、それぞれに人力される
画信号（４ヒツト）の黒白を判定して２値信号に変換出
力する。各比較回路８の出力はそれぞれ、２個のＤタイ
プフリップ２０ツブ９の縦続接続回路に入力される。中
心の注目画素に対応するＤタイプノリツブフロップの出
力を除いた残り８４Ｖ４の点の２値信号を７ンドゲ一ト
回路１０に入力させ、上記８個の点の２値信号がすべて
’１”（白）であるときはアンドケート回路１゜の出力
がｌ′となり、ゲート回路５はアンドゲート回路ｌＯの
出力が°゛ｌ”であるときは、画信号を強制的に白レベ
ルにして遅延回路６に出力する。
Ｉ−述の従来回路は、例えば、背景のレベルが閾イメ１
設定回路１１の設定値を下まわるような濃い色のＢ；（
稿では、孤立点を検出することかできないという欠点が
ある。また、文字等が茨〈書かれた中間調の原稿の場合
は、有為な情報を含んでいる部分が孤立点として除去さ
れる可能性がある。
設定回路１１の設定値を下まわるような濃い色のＢ；（
稿では、孤立点を検出することかできないという欠点が
ある。また、文字等が茨〈書かれた中間調の原稿の場合
は、有為な情報を含んでいる部分が孤立点として除去さ
れる可能性がある。
発明の目的
本発明の目的は、上述の従来の欠点を解決し、原稿の背
景レベルや文字等の濃淡にかかわらず、孤立点を除去す
ることができるファクシミリ装置の両信号処理回路を提
供することにある。
景レベルや文字等の濃淡にかかわらず、孤立点を除去す
ることができるファクシミリ装置の両信号処理回路を提
供することにある。
発明の構成
本発明の画信号処理回路は、原稿を光学的に走査して出
力される１画素当り複数ビットの画信号を入力し、ある
注目画素の周囲の複数画素の画信号を所定の閾値と比較
した結果がすべて白であるとき１士当該汁目画素の画信
号を強制的に白として出力する孤立点除去回路を有する
ファクシミリ装置の画信号処理回路において、前記注目
画素の周辺の複数画素の平均値を参照して閾値を決定す
る閾値決定回路を備えて、前記孤立点除去回路は、」−
記閾値決定回路の出力によって当該性［１画素の周囲画
素の黒白を判定することを特徴とする。
力される１画素当り複数ビットの画信号を入力し、ある
注目画素の周囲の複数画素の画信号を所定の閾値と比較
した結果がすべて白であるとき１士当該汁目画素の画信
号を強制的に白として出力する孤立点除去回路を有する
ファクシミリ装置の画信号処理回路において、前記注目
画素の周辺の複数画素の平均値を参照して閾値を決定す
る閾値決定回路を備えて、前記孤立点除去回路は、」−
記閾値決定回路の出力によって当該性［１画素の周囲画
素の黒白を判定することを特徴とする。
発明の実施例
次に、本発明について１図面を参照して詳細に説明する
。
。
第２図は、本発明の一実施例を示すプひツク図である。
すなわち、原稿を光学的に走査して得られる画信号（１
画素当り４ビツトのディジタル信号号）を入力し、人力
信号を１ライン１ｔｌ延回路ｌによって１ライン分遅延
させた信号と、２ライン遅延回路２によって２ライン分
遅延させた信号と、 ゛人力信号との計３ライン分の信
号を画素１１均値計邊回路３，３×３画素強調回路４お
よび孤立点判定回路２２に入力させる。画素平均値計算
回路３は、」４記３ライン分の画信号から、ある注目画
素を中心として、その周辺の３２×３画素の両信号の・
「均しベルを計算して白黒判定回路７に供給し、３×３
画素強調回路４は、Ｌ記住目画素の周囲９画素の画信号
によって注目画素の両信号を強調して４ビツトの画信号
として出力し、遅延回路１Ｂ。
画素当り４ビツトのディジタル信号号）を入力し、人力
信号を１ライン１ｔｌ延回路ｌによって１ライン分遅延
させた信号と、２ライン遅延回路２によって２ライン分
遅延させた信号と、 ゛人力信号との計３ライン分の信
号を画素１１均値計邊回路３，３×３画素強調回路４お
よび孤立点判定回路２２に入力させる。画素平均値計算
回路３は、」４記３ライン分の画信号から、ある注目画
素を中心として、その周辺の３２×３画素の両信号の・
「均しベルを計算して白黒判定回路７に供給し、３×３
画素強調回路４は、Ｌ記住目画素の周囲９画素の画信号
によって注目画素の両信号を強調して４ビツトの画信号
として出力し、遅延回路１Ｂ。
ケート回路５および遅延回路２４￥介して白黒判定回路
７に入力させる。遅延回路１らは、３×３画素強調回路
４の出力信号と、孤立点判定回路２２の出力の位相を合
せるだめの遅延回路であり、遅延回路２４はＩＩＩＩＩ
票平均値計算回路３が平均値を算出した３２×３画素の
中心画素（注目画素）と３×３画素強調回路４の出力す
る注目画素の画像信号の出力タイミングを一致させるた
めの遅延回路である。
７に入力させる。遅延回路１らは、３×３画素強調回路
４の出力信号と、孤立点判定回路２２の出力の位相を合
せるだめの遅延回路であり、遅延回路２４はＩＩＩＩＩ
票平均値計算回路３が平均値を算出した３２×３画素の
中心画素（注目画素）と３×３画素強調回路４の出力す
る注目画素の画像信号の出力タイミングを一致させるた
めの遅延回路である。
ケート回路５は孤立点判定回路２２の孤立点判定結果に
よって孤立画素の画像信号を強制的に白とする回路であ
る。白黒判定回路７は、遅延回路２４から人力される注
［１画素の画像信号（４ヒツト）を画素平均値、４（算
回路３から供給される平均レベル値と比較することによ
り、当該注目画素の黒白を判定して、２値信号に変換出
力する。白黒判定回路７からは、孤立点が除去された？
値の画像信号が送出される。
よって孤立画素の画像信号を強制的に白とする回路であ
る。白黒判定回路７は、遅延回路２４から人力される注
［１画素の画像信号（４ヒツト）を画素平均値、４（算
回路３から供給される平均レベル値と比較することによ
り、当該注目画素の黒白を判定して、２値信号に変換出
力する。白黒判定回路７からは、孤立点が除去された？
値の画像信号が送出される。
孤立点′＃定回路２２は、３個の遅延回路２０および比
較回路８と、６個のＤタイプフリップフロップ９と、ア
ントケート回路ＩＯとから構成される。比較回路８は、
閾値決定回路１９の出力する閾値によって、それぞれに
入力される画像信号（４ビツト）の黒白を判定して２値
信号に変換出力する。
較回路８と、６個のＤタイプフリップフロップ９と、ア
ントケート回路ＩＯとから構成される。比較回路８は、
閾値決定回路１９の出力する閾値によって、それぞれに
入力される画像信号（４ビツト）の黒白を判定して２値
信号に変換出力する。
閾値決定回路１９は、画素平均値計算回路３の出力する
３２×３画素の平均レベルを基に閾値を決定する。例え
ば、平均レベルそのものを閾値として用いてもよいが、
平均レベルか白または黒に近いようなときは適当な閾値
を設定することが望ましい。ただし、閾値決定回路１８
が閾値を決定出力するまでには、注目画素の周辺の所定
範囲の画素の信号かすべて入力されるまでの時間および
画素平均値Ａ（算回路３の計算時間等の遅延時間がある
。
３２×３画素の平均レベルを基に閾値を決定する。例え
ば、平均レベルそのものを閾値として用いてもよいが、
平均レベルか白または黒に近いようなときは適当な閾値
を設定することが望ましい。ただし、閾値決定回路１８
が閾値を決定出力するまでには、注目画素の周辺の所定
範囲の画素の信号かすべて入力されるまでの時間および
画素平均値Ａ（算回路３の計算時間等の遅延時間がある
。
遅延回路２０は、入力信号およびｌライン遅延回路１．
２ライン遅延回路２の出力をそれぞれ上記ど延時間だけ
遅延させて比較回路８に入力させるための遅延回路であ
る。
２ライン遅延回路２の出力をそれぞれ上記ど延時間だけ
遅延させて比較回路８に入力させるための遅延回路であ
る。
各比較回路８の出力は、それぞれ２個のＤタイプフリッ
プフロップ９の縦続接続回路に入力される。注目画素に
対応する中心のフリップフロップを除いた残り８個の点
の２値信号をアンドゲート（Ｄ回路１０に人力させ、上
記各フリップフロップの出力がすべてｌ” （白）であ
るときはアントゲート回路ｌＯの出力がｌ”となり、当
該注目画素か孤立点であると判？する。ゲート回路５は
、アンドケート回路ＩＯの出力か“ｌ ”であるときは
、３Ｘ３画素強調回路４の出力が孤立点判定回路２２の
出力と位相が合うように遅延回路１６によって遅延され
た画信号を強制的に白にして遅延回路２４に出力する９
本実施例においては、孤立点判定回路２２とゲート回路
５とで孤立点除去回路を４ｔｌＩｊ＆している。
プフロップ９の縦続接続回路に入力される。注目画素に
対応する中心のフリップフロップを除いた残り８個の点
の２値信号をアンドゲート（Ｄ回路１０に人力させ、上
記各フリップフロップの出力がすべてｌ” （白）であ
るときはアントゲート回路ｌＯの出力がｌ”となり、当
該注目画素か孤立点であると判？する。ゲート回路５は
、アンドケート回路ＩＯの出力か“ｌ ”であるときは
、３Ｘ３画素強調回路４の出力が孤立点判定回路２２の
出力と位相が合うように遅延回路１６によって遅延され
た画信号を強制的に白にして遅延回路２４に出力する９
本実施例においては、孤立点判定回路２２とゲート回路
５とで孤立点除去回路を４ｔｌＩｊ＆している。
本実施例においては、閾値決定回路１９が画素平均値計
算回路３の出力を基に閾値を決定するから、原稿の背景
が濃いときでも注目画素の周囲の画素の白判定をするこ
とが可能であり、孤σ点を検出することができるという
効果がある６また、文字や絵が淡い場合でも孤立点を除
去することができ、必要な情報の脱落を防にし、平均レ
ベルによって２値化された画信号として送出することか
できる。
算回路３の出力を基に閾値を決定するから、原稿の背景
が濃いときでも注目画素の周囲の画素の白判定をするこ
とが可能であり、孤σ点を検出することができるという
効果がある６また、文字や絵が淡い場合でも孤立点を除
去することができ、必要な情報の脱落を防にし、平均レ
ベルによって２値化された画信号として送出することか
できる。
発明の効果
以Ｊ−のように、本発明においては、孤を点除去回路の
判定のための閾値を、注目画素の周辺の所定範囲の画素
レベルの平均値を基にして決定するように構成したから
、原稿の背景や文字、絵等の濃淡にかかわらず、孤立点
を除去することが可能となり、かつ必要な情報の脱落を
防止することができるという効果がある。
判定のための閾値を、注目画素の周辺の所定範囲の画素
レベルの平均値を基にして決定するように構成したから
、原稿の背景や文字、絵等の濃淡にかかわらず、孤立点
を除去することが可能となり、かつ必要な情報の脱落を
防止することができるという効果がある。
第１図は従来のファクシミリ装置の画信号処理回路の一
例を示すブロック図、第２図は本発明の一実施例を示す
ブロック図である。 図において、ｌ：ｌライン遅延回路、２：２ライン遅延
回路、３：画素平均値計算回路、４：３×３画素強調回
路、５：ゲート回路、６：遅延回路、７：白黒判定回路
、８：比較回路、９：Ｄタイプフリップフロップ、ＩＯ
：アントゲート回路、１１：ｉ４値設定回路、１２：孤
立点判定回路、１［ｆ、２０゜２４：遅延回路、Ｉ！］
：ｖ！４値決定回路、２２：孤立点判）ｉで回路。 出願人 １１木電気株式会社 代理人 弁理士 住田俊宗
例を示すブロック図、第２図は本発明の一実施例を示す
ブロック図である。 図において、ｌ：ｌライン遅延回路、２：２ライン遅延
回路、３：画素平均値計算回路、４：３×３画素強調回
路、５：ゲート回路、６：遅延回路、７：白黒判定回路
、８：比較回路、９：Ｄタイプフリップフロップ、ＩＯ
：アントゲート回路、１１：ｉ４値設定回路、１２：孤
立点判定回路、１［ｆ、２０゜２４：遅延回路、Ｉ！］
：ｖ！４値決定回路、２２：孤立点判）ｉで回路。 出願人 １１木電気株式会社 代理人 弁理士 住田俊宗
Claims (1)
- 原稿を光学的に走査して出力される１画素当り複数ヒツ
トの画信号を入力し、ある注目画素の周囲のａ数画素の
画信号を所定の闇値と比較した結果がすべて白であると
きは当・該注目画素の両信号を強制的に白として出力す
る孤立点除去回路を有するファクシミリ装置の画信号処
理回路において、前記ｌ］：目画素の周辺の複数画素の
平均値を参照して閾値を決定する閾値決定回路を備えて
、＋ｉｉｉ記孤立点除去回路は、上記閾値決定回路の出
力によって当該注目画素の周囲画素の黒白を判定するこ
とを特徴とするファクシミリ装置の両信号処理回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59106119A JPS60249472A (ja) | 1984-05-25 | 1984-05-25 | フアクシミリ装置の画信号処理回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59106119A JPS60249472A (ja) | 1984-05-25 | 1984-05-25 | フアクシミリ装置の画信号処理回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60249472A true JPS60249472A (ja) | 1985-12-10 |
Family
ID=14425556
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59106119A Pending JPS60249472A (ja) | 1984-05-25 | 1984-05-25 | フアクシミリ装置の画信号処理回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60249472A (ja) |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5723183A (en) * | 1980-07-18 | 1982-02-06 | Ricoh Co Ltd | Picture processing method |
| JPS5880969A (ja) * | 1981-11-09 | 1983-05-16 | Ricoh Co Ltd | 画像処理装置 |
-
1984
- 1984-05-25 JP JP59106119A patent/JPS60249472A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5723183A (en) * | 1980-07-18 | 1982-02-06 | Ricoh Co Ltd | Picture processing method |
| JPS5880969A (ja) * | 1981-11-09 | 1983-05-16 | Ricoh Co Ltd | 画像処理装置 |
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